JP5977209B2 - ステートマシン回路 - Google Patents
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Description
以下、本発明の実施の形態について図面を参照して説明する。
第1の実施の形態の制御基本回路においては、セレクタにより、制御対象回路群から出力される演算結果を反映して、次のプログラムカウンタのアドレス値を指定する方法か、他の制御基本回路より出力されるフラグを反映して、次のアドレス値を指定する方法のいずれかが選択された。つまり、制御対象回路群からの演算結果とフラグ結果の両方を反映して、次のアドレス値を指定することはできなかった。第2の実施の形態は、これら2つの結果の両方を反映させ、複数の制御対象回路群の制御方法に関して、柔軟性を向上させる為の方法に関するものである。
Claims (4)
- 複数の制御対象回路群を制御信号により制御し、相互にフラグ信号を送受信する制御基本回路を複数個備え、
前記制御基本回路は、
前記制御信号の情報と、出力結果パターンの情報と、前記フラグ信号の情報と、フラグパターンの情報とを少なくとも予め保存してあるプログラムメモリと、
前記プログラムメモリのアドレスを指定するプログラムカウンタと、
前記制御対象回路群から出力される信号について前記出力結果パターンとのマッチングを行った結果を出力する出力結果処理手段と、
他の制御基本回路から出力されるフラグ信号について前記フラグパターンとのマッチングを行った結果を出力するフラグ処理手段と、
前記出力結果処理手段の出力及び前記フラグ処理手段の出力を少なくとも含む複数の出力からいずれかを選択するセレクタとを備え、
前記セレクタの出力に基づいて前記プログラムカウンタにより指定されるアドレスを決定し、決定されたアドレスに対応する前記制御信号及び前記フラグ信号のうち少なくともいずれかの信号を前記プログラムメモリから出力する
ステートマシン回路。 - 前記制御基本回路は、前記出力結果処理手段の出力と前記フラグ処理手段の出力を処理する加工手段を備え、
前記プログラムメモリには、演算結果パターンの情報を予め保存しておき、
前記加工手段は、前記出力結果処理手段の出力と前記フラグ処理手段の出力を入力として演算処理を行う演算処理手段と、
前記演算処理の出力について前記演算結果パターンとのマッチングを行う判定手段を備え、
前記セレクタは、前記出力結果処理手段と前記フラグ処理手段と前記加工手段の出力のいずれかを選択し、
前記セレクタにおいて前記加工手段の出力が選択された場合には、前記判定手段の出力に基づいて前記プログラムカウンタにより指定されるアドレスを決定し、決定されたアドレスに対応する前記制御信号及び前記フラグ信号のうち少なくともいずれかの信号を前記プログラムメモリから出力すること
を特徴とする請求項1記載のステートマシン回路。 - 前記加工手段は、前記出力結果処理手段の出力と前記フラグ処理手段の出力のうち少なくともいずれか一つを保持しておくレジスタを備え、前記プログラムメモリには、前記レジスタに前記出力結果処理手段の出力と前記フラグ処理手段の出力を保持するか否かを判断するための情報を保存しておき、前記情報に基づいて、前記出力結果処理手段の出力と前記フラグ処理手段の出力のうち少なくともいずれか一つを保持し、前記演算処理手段は、前記レジスタの内容を用いて演算処理を行うこと
を特徴とする請求項2記載のステートマシン回路。 - 前記フラグ処理手段に前記制御対象回路群からの出力及び前記制御対象回路群以外のステートマシン回路の動作を制御する信号を出力する機能をもつ外部回路の出力の少なくともいずれかを前記フラグ信号として入力すること
を特徴とする請求項1乃至3のいずれか一つに記載のステートマシン回路。
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