JP5542027B2 - デジタル保護制御装置 - Google Patents
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Description
図1は、本発明の実施の形態にかかるデジタル保護制御装置1の構成を示す図である。図1に示されるデジタル保護制御装置1(以下「制御装置1」と称する)は、主たる構成として、演算装置(演算部)2、デジタル変換装置(以下「変換装置」と称する)3−1〜3−Nを有して構成されている。さらに、各変換装置3−1〜3−Nは、二次局通信部31−1〜31−Nとアナログ入力部32−1〜32−Nとを有して構成され、演算装置2は、一次局通信部(データ書込部)25と、入出力部26と、保護制御演算部21と、最新メモリ部22(第1のメモリ)と、バックアップメモリ部(第2のメモリ)23とを有して構成されている。
2 演算装置(演算部)
3−1〜3−N デジタル変換装置(変換部)
4 通信路
21 保護制御演算部
22 最新メモリ部(第1のメモリ)
23 バックアップメモリ部(第2のメモリ)
24 コネクタ
25 一次局通信部(データ書込部)
26 入出力部
27 警報出力
28 制御出力
29 制御入力
31−1〜31−N 二次局通信部
32−1〜32−N アナログ入力部
33−1〜33−N アナログ入力
34−1〜34−N コネクタ
Claims (3)
- 電力系統からのアナログデータをデジタルデータに変換する変換部と、前記変換部から送信されたデジタルデータを用いて保護制御演算を行う演算部と、前記変換部からのデジタルデータを前記演算部へ伝送する通信路とを備えたデジタル保護制御装置であって、
前記変換部は、前記演算部への送信周期毎に、今回の送信周期において所定のサンプリング周期で変換された第1のデジタルデータと、前回の送信周期において前記所定のサンプリング周期で変換された第2のデジタルデータと、を時系列的に連続したデータ列にして出力し、
前記演算部は、
前記第1のデジタルデータを格納する第1のメモリと、
前記第2のデジタルデータを格納する第2のメモリと、
前記変換部からの第1のデジタルデータを前記送信周期毎に前記第1のメモリへ書き込むと共に、前記変換部からの前記第2のデジタルデータを前記送信周期毎に前記第2のメモリへ書き込み、前記通信路上の通信エラーを検出した場合、前記通信エラーが検出された送信周期の前回送信周期に前記第1のメモリへ格納された第1のデジタルデータを、第2のデジタルデータとして前記第2のメモリへ書き込むデータ書込部と、
前記通信エラーが検出されない場合、前記第1のメモリに格納された前記第1のデジタルデータを用いて保護制御演算を行い、前記通信エラーが検出されたとき、前記第2のメモリに格納された前記第2のデジタルデータを用いて保護制御演算を行う保護制御演算部と、を備えたことを特徴とするデジタル保護制御装置。 - 前記データ書込部は、前記変換部からの前記第1のデジタルデータを加算平均化した第1の平均データを前記第1のメモリへ書き込むと共に、前記変換部からの前記第2のデジタルデータを加算平均化した第2の平均データを前記第2のメモリへ書き込み、前記通信エラーを検出した場合、前記通信エラーが検出された送信周期の前回送信周期に前記第1のメモリへ格納された前記第1の平均データを、第2の平均データとして前記第2のメモリへ書き込み、
前記保護制御演算部は、前記通信エラーが検出されない場合、前記第1のメモリに格納された前記第1の平均データを用いて保護制御演算を行い、前記通信エラーが検出されたとき、前記第2のメモリに格納された前記第2の平均データを用いて保護制御演算を行うことを特徴とする請求項1に記載のデジタル保護制御装置。 - 前記保護制御演算部は、前記第2のデジタルデータまたは前記第2の平均データを用いて保護制御演算を開始してからこの保護制御演算が完了するまでの間、前記第2のデジタルデータまたは前記第2の平均データの読み出しを継続することを特徴とする請求項1または2に記載のデジタル保護制御装置。
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