JP5517808B2 - フィルタ装置 - Google Patents
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Description
図1は、本実施の形態のフィルタ装置の構成例を示す図である。図示したように、このフィルタ装置は、制御回路1、フィルタ回路2、コンパレータ3、スイッチ4および発振器5を備える。
2 フィルタ回路
3 コンパレータ
4 スイッチ
5 発振器
11 カウンタ
12 論理積回路
13 nビットシフトレジスタ
Claims (3)
- 入力信号に対して帯域制限を行うフィルタ回路、および当該フィルタ回路の周波数特性を調整する調整回路からなるフィルタ装置であって、
前記調整回路は、
前記フィルタ回路の周波数特性を調整する際に使用する基準信号を生成する発振器と、
前記フィルタ回路へ基準信号が入力されている状態において、前記フィルタ回路への入力信号である第1の信号の振幅と前記フィルタ回路からの出力信号である第2の信号の振幅との差分を算出し、さらに、算出した差分を所定のしきい値と比較するコンパレータと、
前記差分と前記しきい値の比較結果に基づいて、前記フィルタ回路が使用する容量値を調整する制御回路と、
を備え、
前記制御回路は、制御開始時点の前記容量値を設定可能な最大値または最小値に設定し、前記差分と前記しきい値が同じとなるか、前記差分と前記しきい値の大小関係が変化するまで、前記容量値を一定の調整幅で繰り返し調整する
ことを特徴とするフィルタ装置。 - 前記制御回路は、
前記基準信号に基づいて所定周期の切り換えクロックを生成するカウンタと、
すべてのビットを0に設定した状態、または、すべてのビットを1に設定した状態を初期状態とし、前記切り換えクロックが入力されるごとに1ビットずつシフトさせるnビットシフトレジスタと、
前記コンパレータからの出力値に応じて前記切り換えクロックを前記nビットシフトレジスタへ入力させる論理積回路と、
前記フィルタ回路により使用され、前記nビットシフトレジスタの出力値に応じて容量値を変更する容量回路と、
を備え、
前記nビットシフトレジスタがビットシフト動作でi番目(i=1,2,…,n−1)のビットをi+1番目にシフトさせるように構成されている場合、前記論理積回路が前記切り換えクロックを前記nビットシフトレジスタへ入力させる際に、1番目のビット値として、前記nビットシフトレジスタの初期状態において各レジスタに設定されているビット値とは異なる値を設定する
ことを特徴とする請求項1に記載のフィルタ装置。 - 前記基準信号、および外部からの信号を入力信号とし、前記フィルタ回路の周波数特性が確定していない状態では前記基準信号を選択して前記フィルタ回路へ出力し、また、前記フィルタ回路の周波数特性が確定した状態では前記外部からの信号を選択して前記フィルタ回路へ出力するスイッチ、
をさらに備えることを特徴とする請求項1または2に記載のフィルタ装置。
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