JP5492117B2 - 窒化物半導体の積層構造およびその製造方法並びに窒化物半導体装置 - Google Patents
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Description
図1(a)は本発明の第1の実施形態にかかる窒化物半導体半導体の積層構造の模式断面図、図1(b)は基板の段差部を示す模式図、である。
図1(a)のように、窒化物半導体の積層構造5は、基板10、第1バッファ層12、第1結晶層14、第2バッファ層16、第2結晶層20、を有している。窒化物半導体の積層構造5の上に、結晶成長法を用いて窒化物半導体を含む積層体を形成すると、発光素子や電子デバイスを得ることができる。
基板110は、サファイヤからなるものとし、その構造は図1(b)で示されるものと同一とする。GaNを含むバッファ層112を、基板110の上面110a、段差部の下面110b、および段差部の側面110cに設ける。
図3(a)において、サファイヤからなる基板10の上面10aの一部にSiO2のような選択成長マスク層30が形成される。フォトレジスト膜32は、選択成長マスク層30を内部に含む大面積を有するようにパターニングされる。その後、マスクに覆われていない支持体10の表面を後退させる。具体的には、例えば反応性イオンエッチング(RIE:Reactive Ion Etching)を用いて、かつそのエッチング選択比を適正に選ぶことにより、支持体10が表面側からエッチングされるとともに、フォトレジスト膜32も上面および側面からエッチングされる。これに伴い、支持体10には、傾斜した側面を有する段差部10dが形成される。
図3(c)の破線部を拡大した図4(a)において、サファイヤからなる基板10の厚さは、例えば150μmとする。段差下面10bおよび段差側面10cに、GaNなどを含む第1バッファ層12が、上層となる単結晶窒化物半導体の結晶成長温度よりも低い温度で、例えば0.03μmの厚さで形成される。なお、選択成長マスク層30の上面30aには、第1バッファ層12が実質的には形成されない結晶成長条件とすることが好ましい。
第2の実施形態では、第1バッファ層12および第1結晶層14を形成した工程ののちに選択成長マスク層30を除去しない。このため、第2バッファ層17および第2結晶層20は、第1結晶層14の上面14aと選択成長マスク層30の上面30aに設けられる。第1結晶層14の上面14aと選択成長マスク層30の上面30aとの間の段差は小さい。このため、より平坦な窒化物半導体の積層構造5の上に、平坦な窒化物半導体積層体を設けることがより容易となる。
図6(a)において、サファイヤからなる支持体10の厚さは、例えば150μmとする。GaNを含む第1バッファ層12が、段差下面10bおよび段差側面10cに、上層となる単結晶窒化物半導体の結晶成長温度よりも低い温度で、例えば0.03μmの厚さで形成される。なお、選択成長マスク層30の上面30aには、第1バッファ層12が実質的には形成されない結晶成長条件とすることが好ましい。続いて、GaNなどを含む第1結晶層14が、結晶が成長する温度である1000°C以上で第1バッファ層12の上面12aに形成される。図6(b)は、結晶成長工程の途中を示している。図6(c)のように、第1結晶層14が、その上面の高さが、SiO2などからなる選択成長マスク層30の上面の高さと略同一となるように、形成される。
図7は、本実施形態の窒化物半導体装置の一例として、窒化物半導体の積層構造の上面に窒化物半導体からなる積層体を設けた発光素子の模式断面図である。
窒化物半導体からなる積層体50は、図1に表す窒化物半導体の積層構造5の第2結晶層20の上面20aに設けられる。なお、図5に表す第2の実施形態にかかる窒化物半導体の積層構造5でもよい。積層体50は、第1導電形を有する第1の層51、活性層52、および第2導電形を有する第2の層53、を窒化物半導体の積層構造5の側からこの順に有する。
Claims (7)
- InxAlyGa1−x−yN(0≦x≦1、0≦y≦1、x+y≦1)を含む半導体を第1の面に積層可能な窒化物半導体の積層構造であって、
上面と、下面と、前記上面と前記下面とのあいだの側面と、を有する段差部が形成された基板と、
InsAltGa1−s−tN(0≦s≦0.05、0≦t≦1)を含み、前記下面と前記側面とを覆う第1バッファ層と、
前記第1バッファ層の上に設けられ、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含み、前記基板の前記上面よりも上方に設けられた上面を有する第1結晶層と、
InsAltGa1−s−tN(0≦s≦0.05、0≦t≦1)を含み、前記第1結晶層の前記上面と前記基板の前記上面とを連続して覆う第2バッファ層と、
前記第2バッファ層を覆い、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含み、前記第1の面を有する第2結晶層と、
を備え、
前記第1結晶層の前記上面は前記基板の前記上面よりも高く、
かつ前記第1結晶層の前記上面と、前記基板の前記上面と、の段差は、前記基板の前記段差部の高さよりも小さいことを特徴とする窒化物半導体の積層構造。 - InxAlyGa1−x−yN(0≦x≦1、0≦y≦1、x+y≦1)を含む半導体を第1の面に積層可能な窒化物半導体の積層構造であって、
上面と、下面と、前記上面と前記下面とのあいだの側面と、を有する段差部が形成された基板と、
InsAltGa1−s−tN(0≦s≦0.05、0≦t≦1)を含み、前記下面と前記側面とを覆う第1バッファ層と、
前記第1バッファ層の上に設けられ、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含み、前記基板の前記上面よりも上方に設けられた上面を有する第1結晶層と、
前記基板の前記上面に設けられた選択成長マスク層と、
AlwGa1−wN(0.6≦w≦1)を含み、前記第1結晶層の前記上面と前記選択成長マスク層の上面とを連続して覆う第2バッファ層と、
前記第2バッファ層を覆い、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含み、前記第1の面を有する第2結晶層と、
を備え、
前記第1結晶層の前記上面は、前記基板の前記上面よりも高く、
かつ前記第1結晶層の前記上面と、前記選択成長マスク層の前記上面と、の段差は、前記基板の前記段差部の高さよりも小さいことを特徴とする窒化物半導体の積層構造。 - 前記基板の前記上面は、前記第1の面に対して平行な方向に周期的に設けられた凸部の上面であり、
前記段差部の前記側面は、前記凸部の側面であることを特徴とする請求項1または2に記載の窒化物半導体の積層構造。 - 基板の上面の一部に選択成長マスク層を形成する工程と、
前記選択成長マスク層により覆われていない前記基板の表面を後退させて段差部を形成する工程と、
前記選択成長マスク層の上面を覆わず前記段差部の下面と側面とを覆うようにInsAltGa1−s−tN(0≦s≦0.05、0≦t≦1)を含む第1バッファ層を形成する工程と、
前記第1バッファ層の上に、上面が、前記基板の上面よりも高くかつ前記基板の前記上面との間に前記基板の前記段差部の高さよりも小さい段差を生じるように、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含む第1結晶層を、前記第1バッファ層を形成する温度よりも高い温度で形成する工程と、
前記第1結晶層の上面と前記基板の前記上面と、または、前記第1結晶層の前記上面と前記選択成長マスク層の上面と、を連続して覆いIn s Al t Ga 1−s−t N(0≦s≦0.05、0≦t≦1)またはAl w Ga 1−w N(0.6≦w≦1)からなる第2バッファ層を、前記第1結晶層を形成する温度よりも低い温度で形成する工程と、
前記第2バッファ層の上に、InsAltGa1−s−tN(0≦s≦0.05、0≦t≦0.05)を含む第2結晶層を、前記第1バッファ層を形成する温度および前記第2バッファ層を形成する温度のいずれよりも高い温度で形成する工程と、
を備えたことを特徴とする窒化物半導体の積層構造の製造方法。 - 前記第2バッファ層を形成する工程は、前記選択成長マスク層を除去し前記基板の前記上面を露出させたのち、前記第1結晶層の前記上面と前記基板の前記上面とを覆う工程を含むことを特徴とする請求項4記載の窒化物半導体の積層構造の製造方法。
- 前記第2バッファ層を形成する工程は、前記第1結晶層の前記上面と前記選択成長マスク層の前記上面と、を連続して覆う工程を含み、
前記第1結晶層の前記上面と前記選択成長マスク層の前記上面との段差は、前記基板の前記段差部の前記段差よりも小さいことを特徴とする請求項4記載の窒化物半導体の積層構造の製造方法。 - 請求項1〜3のいずれか1つに記載の窒化物半導体の積層構造と、
前記窒化物半導体の積層構造の前記第1の面の上に積層された前記InxAlyGa1−x−yN(0≦x≦1、0≦y≦1、x+y≦1)を含む半導体と、
を備えたことを特徴とする窒化物半導体装置。
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