JP5364036B2 - 接続バス、電子装置及びシステム - Google Patents
接続バス、電子装置及びシステム Download PDFInfo
- Publication number
- JP5364036B2 JP5364036B2 JP2010114526A JP2010114526A JP5364036B2 JP 5364036 B2 JP5364036 B2 JP 5364036B2 JP 2010114526 A JP2010114526 A JP 2010114526A JP 2010114526 A JP2010114526 A JP 2010114526A JP 5364036 B2 JP5364036 B2 JP 5364036B2
- Authority
- JP
- Japan
- Prior art keywords
- interface protocol
- memory component
- memory
- available
- electronic device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/382—Information transfer, e.g. on bus using universal interface adapter
- G06F13/385—Information transfer, e.g. on bus using universal interface adapter for adaptation of a particular data processing system to different peripheral devices
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Description
Claims (22)
- 接続バスによってメモリコンポーネントを電子装置に接続する方法において、
少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが前記接続バスで利用可能であり、
前記電子装置は、前記接続バスを使用可能なメモリコンポーネントに共通の初期化プロトコルを使用して、認識用コマンドを前記メモリコンポーネントに送信し、それから、前記初期化プロトコルを使用して、前記メモリコンポーネントから前記認識用コマンドへの応答を受信し、前記応答に基づいて前記メモリコンポーネントを認識し、
前記メモリコンポーネントの認識を使用して、前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定し、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であり前記接続バスで使用される前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルの一方を選択し、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とする方法。 - 前記第1のインタフェースプロトコルは、前記第1のインタフェースプロトコルより汎用性が高いコマンドセットを有する前記第2のインタフェースプロトコルと比較して、限られた数のコマンドを有することを特徴とする請求項1に記載の方法。
- 前記第1のインタフェースプロトコルは、前記初期化プロトコルを含むことを特徴とする請求項1に記載の方法。
- 接続バスによってメモリコンポーネントを電子装置に接続する方法において、
少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが前記接続バスで利用可能であり、
少なくとも、前記第1のインタフェースプロトコルの一部であるとともに前記接続バスを使用可能なメモリコンポーネントに共通の初期化プロトコルを使用して前記メモリコンポーネントを認識し、
前記メモリコンポーネントの認識を使用して、前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定し、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であり前記接続バスで使用される前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルの一方を選択し、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とする方法。 - 前記第1のプロトコルは、インタフェースプロトコルの変更に関連するコマンドを具え、前記メモリコンポーネントの前記認識に基づいて、前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能であることが決定された場合、前記インタフェースプロトコルの変更に関連する前記コマンドを前記メモリコンポーネントへ転送することにより、前記インタフェースプロトコルは前記第2のインタフェースプロトコルに従って変更されることを特徴とする請求項1に記載の方法。
- 前記メモリコンポーネントの前記認識に基づいて、前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能でないことが決定された場合、前記メモリコンポーネントにおいて利用されるメモリ技術が決定され、前記決定されたメモリ技術に従って前記接続バスにおける信号送信が設定されることを特徴とする請求項1に記載の方法。
- 電子装置と、前記電子装置に接続可能なメモリコンポーネントと、前記メモリコンポーネントを前記電子装置に接続する接続バスと、を具えるシステムにおいて、
少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが前記接続バスで利用可能であり、
前記システムは、認識用コマンドを前記電子装置から前記メモリコンポーネントに送信し、それから、前記認識用コマンドへの応答を前記電子装置から送信するドライバを具え、前記認識用コマンドおよび前記応答は、前記接続バスを使用可能なメモリコンポーネントに共通であり、
前記システムは、
前記メモリコンポーネントを認識する認識装置と、
前記メモリコンポーネントの認識を用いて、前記第1のインタフェースプロトコルおよび前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定する決定装置と、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であると決定され、前記接続バスで使用される前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルの一方を選択する選択装置と、
を具え、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とするシステム。 - メモリコンポーネントを電子装置に接続する接続バスを具える電子装置において、
少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが前記接続バスで利用可能であり、
前記電子装置は、認識用コマンドを前記電子装置から前記メモリコンポーネントに送信し、それから、前記認識用コマンドへの応答を前記メモリコンポーネントから受信するドライバを具え、前記認識用コマンドおよび前記応答は、前記接続バスを使用可能なメモリコンポーネントに共通であり、
前記電子装置は、
前記メモリコンポーネントを認識する認識装置と、
前記メモリコンポーネントの認識を用いて、前記第1のインタフェースプロトコルおよび前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定する決定装置と、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であり、前記接続バスで使用されると決定された前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルの一方を選択する選択装置と、
を具え、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とする電子装置。 - 前記第1のインタフェースプロトコルは、前記第1のインタフェースプロトコルより汎用性が高いコマンドセットを有する前記第2のインタフェースプロトコルと比較して、限られた数のコマンドを有することを特徴とする請求項8に記載の電子装置。
- メモリコンポーネントを電子装置に接続する接続バスを具える電子装置において、
少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが前記接続バスで利用可能であり、
前記電子装置は、
前記第1のインタフェースプロトコルの一部として含まれるとともに前記接続バスを使用可能なメモリコンポーネントに共通の初期化プロトコルを使用して前記メモリコンポーネントを認識する認識装置と、
前記メモリコンポーネントの認識を用いて、前記第1のインタフェースプロトコルおよび前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定する決定装置と、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であると決定され、前記接続バスで使用される前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルの一方を選択する選択装置と、
を具え、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とする電子装置。 - メモリコンポーネントを電子装置に接続するための手段であって、少なくとも第1のインタフェースプロトコルおよび第2のインタフェースプロトコルが利用可能である手段と、
認識用コマンドを前記電子装置から前記メモリコンポーネントに送信し、前記認識用コマンドへの応答を前記メモリコンポーネントから受信するための手段であって、前記認識用コマンドおよび前記応答は、前記接続バスを使用可能なメモリコンポーネントに共通である手段と、
前記メモリコンポーネントを認識するための認識手段と、
前記メモリコンポーネントの認識を用いて、前記第1のインタフェースプロトコルおよび前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能か否かを決定するための決定手段と、
前記メモリコンポーネントの前記認識に基づいて、前記メモリコンポーネントにおいて利用可能であり、前記接続バスで使用される前記第1のインタフェースプロトコルまたは前記第2のインタフェースプロトコルのうちの決定された方を選択するための選択手段と、
を具え、
前記第2のインタフェースプロトコルが前記メモリコンポーネントにおいて利用可能な場合、前記第2のインタフェースプロトコルが選択され、その他の場合、前記第1のインタフェースプロトコルが選択され、前記第1のインタフェースプロトコルはメモリ技術に依存し、前記第2のインタフェースプロトコルはメモリ技術に依存しない、
ことを特徴とする電子装置。 - 前記第1のインタフェースプロトコルは、前記認識用コマンドおよび前記応答を具えることを特徴とする請求項7に記載のシステム。
- 前記第1のインタフェースプロトコルは、前記認識用コマンドおよび前記応答を具えることを特徴とする請求項8に記載の電子装置。
- 前記第1のインタフェースプロトコルは、メモリコンポーネントの初期化に関連する少なくとも1つのコマンドを具え、前記メモリコンポーネントにおいて利用できる前記インタフェースプロトコルは、初期化に関連する前記少なくとも1つのコマンドを解釈可能であることを特徴とする請求項10に記載の電子装置。
- 前記第1のインタフェースプロトコルは、メモリコンポーネントの初期化に関連する少なくとも1つのコマンドを具え、前記メモリコンポーネントにおいて利用できる前記インタフェースプロトコルは、初期化に関連する前記少なくとも1つのコマンドを解釈可能であることを特徴とする請求項4に記載の方法。
- 前記第1のインタフェースプロトコルは、メモリコンポーネントの初期化に関連する少なくとも1つのコマンドを具え、前記メモリコンポーネントにおいて利用できる前記インタフェースプロトコルは、初期化に関連する前記少なくとも1つのコマンドを解釈可能であることを特徴とする請求項11に記載の電子装置。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項1に記載の方法。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項4に記載の方法。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項7に記載のシステム。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項8に記載の装置。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項10に記載の装置。
- 前記第1のインタフェースプロトコルは、前記メモリコンポーネントの論理タイプに依存していることを特徴とする請求項11に記載の装置。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FI20035072A FI20035072A0 (fi) | 2003-05-22 | 2003-05-22 | Liitäntäväylä, elektroniikkalaite ja järjestelmä |
FI20035072 | 2003-05-22 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006508334A Division JP2006526213A (ja) | 2003-05-22 | 2004-05-21 | 接続バス、電子装置及びシステム |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2010282617A JP2010282617A (ja) | 2010-12-16 |
JP2010282617A5 JP2010282617A5 (ja) | 2012-08-23 |
JP5364036B2 true JP5364036B2 (ja) | 2013-12-11 |
Family
ID=8566406
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006508334A Pending JP2006526213A (ja) | 2003-05-22 | 2004-05-21 | 接続バス、電子装置及びシステム |
JP2010114526A Active JP5364036B2 (ja) | 2003-05-22 | 2010-05-18 | 接続バス、電子装置及びシステム |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006508334A Pending JP2006526213A (ja) | 2003-05-22 | 2004-05-21 | 接続バス、電子装置及びシステム |
Country Status (9)
Country | Link |
---|---|
US (1) | US7430625B2 (ja) |
EP (1) | EP1625507B1 (ja) |
JP (2) | JP2006526213A (ja) |
KR (1) | KR100666086B1 (ja) |
CN (1) | CN100483376C (ja) |
AT (1) | ATE440330T1 (ja) |
DE (1) | DE602004022658D1 (ja) |
FI (1) | FI20035072A0 (ja) |
WO (1) | WO2004109529A1 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10235306B2 (en) | 2016-08-04 | 2019-03-19 | Toshiba Memory Corporation | Storage device compatible with selected one of multiple interface standards |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008142742A1 (ja) * | 2007-04-20 | 2008-11-27 | Panasonic Corporation | 挿抜検出装置 |
US7843225B2 (en) * | 2009-04-14 | 2010-11-30 | Via Technologies, Inc. | Protocol-based bus termination for multi-core processors |
US10089270B2 (en) | 2011-10-17 | 2018-10-02 | Intel Corporation | Interchangeable power and signal contacts for IO connectors |
JP5884106B2 (ja) * | 2011-12-22 | 2016-03-15 | 日本電産サンキョー株式会社 | Icカードリーダ及びインタフェースic判別方法 |
CN104268110B (zh) * | 2014-09-15 | 2018-10-12 | 联想(北京)有限公司 | 一种设备识别方法、处理器和设备识别系统 |
US10366033B2 (en) * | 2016-09-15 | 2019-07-30 | General Electric Company | Automated retrofit installation tool for replacement of one or more pre-existing dedicated input/output (I/O) modules and terminal boards with one or more universal I/O modules |
CN108563602A (zh) * | 2018-01-02 | 2018-09-21 | 联想(北京)有限公司 | 电子设备及信息传输方法 |
Family Cites Families (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2701133B1 (fr) * | 1993-02-04 | 1995-03-10 | Gemplus Card Int | Procédé de communication avec un support portatif. |
JP3421378B2 (ja) * | 1993-03-23 | 2003-06-30 | 株式会社東芝 | 伝送制御方式 |
KR0144818B1 (ko) * | 1994-07-25 | 1998-08-17 | 김광호 | 낸드형 플래쉬메모리 아이씨카드 |
JPH08286925A (ja) * | 1995-04-11 | 1996-11-01 | Toshiba Corp | プログラムロード方法およびそのプログラムロード方法を使用したパーソナルコンピュータ |
US6213392B1 (en) * | 1995-05-09 | 2001-04-10 | Smartmove, Ltd. | Card interface for interfacing a host application program to data storage cards |
US5815426A (en) * | 1996-08-13 | 1998-09-29 | Nexcom Technology, Inc. | Adapter for interfacing an insertable/removable digital memory apparatus to a host data part |
JP3565686B2 (ja) * | 1997-08-01 | 2004-09-15 | 東京エレクトロンデバイス株式会社 | コンピュータの記憶装置及び変換システム |
US6138180A (en) * | 1997-09-12 | 2000-10-24 | Symbol Technologies, Inc. | Adaptive computer peripheral for selecting a communications protocol by cycling through a plurality of given protocols |
JP3714969B2 (ja) * | 1998-03-02 | 2005-11-09 | レクサー・メディア・インコーポレイテッド | 改良されたオペレーティングモード検出機能を備えたフラッシュメモリーカード及びユーザフレンドリなインターフェーシングシステム |
US6168077B1 (en) * | 1998-10-21 | 2001-01-02 | Litronic, Inc. | Apparatus and method of providing a dual mode card and reader |
US6901457B1 (en) * | 1998-11-04 | 2005-05-31 | Sandisk Corporation | Multiple mode communications system |
US7269844B2 (en) | 1999-01-15 | 2007-09-11 | Safenet, Inc. | Secure IR communication between a keypad and a token |
US6848045B2 (en) | 1999-01-15 | 2005-01-25 | Rainbow Technologies, Inc. | Integrated USB connector for personal token |
KR100544177B1 (ko) * | 2000-01-18 | 2006-01-23 | 삼성전자주식회사 | 컴퓨터를 통한 디지털 컨텐츠의 저장 및 재생 기능을구비한 개인 휴대 장치의 제어방법 및 이에 따른 개인휴대장치의 동작방법 |
JP4649009B2 (ja) * | 2000-03-08 | 2011-03-09 | 株式会社東芝 | カードインタフェースを備えた情報処理装置、同装置に装着可能なカード型電子機器、及び同装置におけ動作モード設定方法 |
AU8386601A (en) | 2000-06-15 | 2001-12-24 | Rainbow Technologies B.V. | Usb-compliant personal key using a smartcard processor and smartcard reader emulator |
US6438638B1 (en) * | 2000-07-06 | 2002-08-20 | Onspec Electronic, Inc. | Flashtoaster for reading several types of flash-memory cards with or without a PC |
US7095618B1 (en) * | 2000-07-06 | 2006-08-22 | Onspec Electronic, Inc. | Smartconnect universal flash media card adapters |
US6832281B2 (en) * | 2000-07-06 | 2004-12-14 | Onspec Electronic Inc. | Flashtoaster for reading several types of flash memory cards with or without a PC |
US6820148B1 (en) * | 2000-08-17 | 2004-11-16 | Sandisk Corporation | Multiple removable non-volatile memory cards serially communicating with a host |
JPWO2002069127A1 (ja) * | 2001-02-26 | 2004-07-02 | 東京エレクトロンデバイス株式会社 | 記憶媒体制御方法、記憶媒体制御装置、および記憶媒体アダプタ |
US6614685B2 (en) * | 2001-08-09 | 2003-09-02 | Multi Level Memory Technology | Flash memory array partitioning architectures |
US6913196B2 (en) * | 2002-02-20 | 2005-07-05 | O2Micro International Limited | Dual mode controller for ISO7816 and USB enabled smart cards |
TW587790U (en) * | 2002-06-18 | 2004-05-11 | King Byte Information Corp | Device for adapting memory card interface to USB interface |
US6843423B2 (en) * | 2003-03-13 | 2005-01-18 | Stmicroelectronics, Inc. | Smart card that can be configured for debugging and software development using secondary communication port |
US6973519B1 (en) * | 2003-06-03 | 2005-12-06 | Lexar Media, Inc. | Card identification compatibility |
US7069369B2 (en) * | 2004-02-12 | 2006-06-27 | Super Talent Electronics, Inc. | Extended-Secure-Digital interface using a second protocol for faster transfers |
TWI271659B (en) * | 2004-05-05 | 2007-01-21 | Prolific Technology Inc | Memory card equipped with a multi-interface function and method for choosing a compatible transmission mode |
US7061804B2 (en) * | 2004-11-18 | 2006-06-13 | Qualcomm Incorporated | Robust and high-speed memory access with adaptive interface timing |
-
2003
- 2003-05-22 FI FI20035072A patent/FI20035072A0/fi not_active Application Discontinuation
-
2004
- 2004-05-21 AT AT04734273T patent/ATE440330T1/de not_active IP Right Cessation
- 2004-05-21 WO PCT/FI2004/050074 patent/WO2004109529A1/en active IP Right Grant
- 2004-05-21 EP EP04734273A patent/EP1625507B1/en active Active
- 2004-05-21 JP JP2006508334A patent/JP2006526213A/ja active Pending
- 2004-05-21 US US10/851,465 patent/US7430625B2/en active Active
- 2004-05-21 KR KR1020057022231A patent/KR100666086B1/ko not_active IP Right Cessation
- 2004-05-21 CN CNB2004800140707A patent/CN100483376C/zh active Active
- 2004-05-21 DE DE602004022658T patent/DE602004022658D1/de active Active
-
2010
- 2010-05-18 JP JP2010114526A patent/JP5364036B2/ja active Active
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10235306B2 (en) | 2016-08-04 | 2019-03-19 | Toshiba Memory Corporation | Storage device compatible with selected one of multiple interface standards |
Also Published As
Publication number | Publication date |
---|---|
FI20035072A0 (fi) | 2003-05-22 |
US7430625B2 (en) | 2008-09-30 |
KR100666086B1 (ko) | 2007-01-09 |
ATE440330T1 (de) | 2009-09-15 |
CN100483376C (zh) | 2009-04-29 |
KR20060004993A (ko) | 2006-01-16 |
JP2006526213A (ja) | 2006-11-16 |
JP2010282617A (ja) | 2010-12-16 |
EP1625507B1 (en) | 2009-08-19 |
CN1795443A (zh) | 2006-06-28 |
WO2004109529A1 (en) | 2004-12-16 |
DE602004022658D1 (de) | 2009-10-01 |
EP1625507A1 (en) | 2006-02-15 |
US20040268077A1 (en) | 2004-12-30 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP5364036B2 (ja) | 接続バス、電子装置及びシステム | |
JP4649009B2 (ja) | カードインタフェースを備えた情報処理装置、同装置に装着可能なカード型電子機器、及び同装置におけ動作モード設定方法 | |
EP2278475B1 (en) | Multiple removable non-volatile memory cards serially communicating with a host | |
US7739487B2 (en) | Method for booting a host device from an MMC/SD device, a host device bootable from an MMC/SD device and an MMC/SD device method a host device may booted from | |
US7774511B2 (en) | Addressing multiple devices on a shared bus | |
US20080270654A1 (en) | Bus System for Selectively Controlling a Plurality of Identical Slave Circuits Connected to the Bus and Method Therefore | |
JP4588427B2 (ja) | メモリシステムおよびホストとメモリカードとの間のデータ伝送速度設定方法 | |
US20040137805A1 (en) | Method and a system for detecting bus width, an electronic device, and a peripheral device | |
CN102222054A (zh) | 数据传输装置、方法及控制器 | |
JP4793798B2 (ja) | マイクロコンピュータ | |
CN111797583A (zh) | 引脚复用装置以及控制引脚复用装置的方法 | |
JP2005128989A (ja) | 入出力制御装置、機能拡張デバイス | |
KR20060047052A (ko) | 다중 인터페이스 카드 및 다중 인터페이스 카드의 초기화방법 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A712 Effective date: 20111017 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120410 |
|
A524 | Written submission of copy of amendment under article 19 pct |
Free format text: JAPANESE INTERMEDIATE CODE: A524 Effective date: 20120709 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20121127 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20130813 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20130906 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 5364036 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |