JP5361567B2 - データ処理装置、データ処理方法およびプログラム - Google Patents
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Description
図1は、本発明の一実施例である実施例1におけるデータ処理装置の概略構成を示すブロック図である。図1中、データ入出力部101は処理対象のデータの入力と、処理済みのデータの出力とを行う。また、通信部102−1〜102−m(以下、まとめて通信部102と称す)は、データ処理部103−2〜103−m(以下、まとめてデータ処理部103と称す)とそれぞれ対に接続されている。ここで、矢印はデータ(又はパケット)を流す方向を示しており、図に示すように、リング状に接続されている夫々のモジュールが一方向からデータを受信し他方へデータを送信する。
図2は、データ入出力部101に接続されている通信部102―1の概略構成を示すブロック図である。なお、通信部102−1と入出力部101とを有するモジュールを入力モジュールとする。図に示す様に通信部102―1は、データ受信部201、バッファ202、セレクタ203、データ送信部204を有している。
・パケットのvalidフラグ501が有効である。
・接続ID504とカウント値503が受信部201の保持する値と一致する。
・接続されているデータ処理部103へのデータの入力が可能である場合(stall信号253が保留状態でない)。
の全てが成立する場合、このパケットを取り込み、(valid信号251を有効にして)出力端子252よりデータ処理部103へデータを出力する。このとき受信部201は、信号線260を介してバッファ202にデータの取り込みを通知し、バッファ202に格納されるパケットのvalidフラグ501をクリアし、パケットを無効化する。また、パケット取り込み後、受信部201の保持するカウント値503はインクリメントされる。
・入力パケットのvalidフラグ501が有効である。
・接続ID504とカウント値503が受信部201の保持する値と一致する。
・接続されているデータ処理部103へのデータの入力が不可能である場合(stall信号253が保留状態)。
の全てが成立する場合、受信部201は信号線260を介して、バッファ202にデータの保留を通知し、バッファ202に格納されるパケットのstallフラグ502をセットする。また、入力パケットのvalidフラグ501が有効で、接続ID504が一致してもカウント値503が不一致の場合は、データの取り込みができないので、この場合もstallフラグ502をセットする。なお、後述の動作例で説明するように、パケットを受信するか否かの判断において処理内容によってはカウント値を評価しなくてもよい。
・接続されているデータ処理部103からデータの出力が可能である(valid信号256が有効の場合)。
・バッファ202の出力パケットのvalidフラグ501が無効である。
の両方が成立する場合、データ送信部204は、validフラグ501を有効、stallフラグ502を無効にして、カウント値503とレジスタに設定されている接続IDを付加してパケットを生成する。そして、セレクタ203を制御して、出力端子259よりこの生成したパケットをリングバス上に流す。パケット出力後、データ送信部204の保持するカウント値503はインクリメントされる。なお、後述の動作例で説明するように、カウント値を評価しない構成ではカウント値のインクリメントは行わなくてもよい。
図3(a)は、データ受信部201の概略構成を示すブロック図である。図3(a)に示すようにデータ受信部201は、受信IDレジスタ301、カウンタ302、比較部303、判定部304を有している。
・パケットのvalidフラグ501が有効である。
・パケットの接続ID504がレジスタ301に格納されている接続IDと一致する。
・パケットのカウント値503がカウンタ302の値と一致する。
の全てが成立する場合、valid信号251を有効にする。なお、出力端子252にはこのパケットのデータ部が出力される。また、比較部303はカウント値一致信号305とデータ処理完了検出信号306を判定部304に入力する。
図3(b)は、データ送信部204の概略構成を示すブロック図である。図3(b)に示すようにデータ送信部204は、送信IDレジスタ401、カウンタ402、出力制御部403、パケット生成部404、パス設定部405を有する。
・バッファ202の出力パケットのvalidフラグ501が有効かつstallフラグ502が保留を示していない。
・バッファ202の出力パケットの接続ID504がレジスタ401(第2格納手段)に格納されている接続ID(第2識別情報)と一致する。
の両方が成立した場合は、自身が出力したパケットが他のどのモジュールにも保留されずにリングバスを周回して戻ってきたと判定する。そして、パケット生成部404を介してセレクタ203を制御し、validフラグ501を無効にしてパケットを無効化する。この場合、データ処理部103のパケットを出力することが可能となるので、stall信号254をリセットする。なお、出力制御部403は後述するようにデータパスを切り換える場合にもstall信号254をセットする。
・その出力パケットのvalidフラグ501が無効である場合。
・データを抽出し終えて無効化するパケット(validフラグ501が有効かつstallフラグ502が保留を示していないときで、パケットの接続ID504がレジスタ401に格納されている接続IDと一致したパケット)の場合。
のいずれかの場合、validフラグ501を有効、stallフラグ502を無効にして、カウンタ402のカウント値とレジスタ401に設定されている接続IDとパス設定部405のパス識別子を付加してパケットを生成する。そして生成したパケットを、送信部204がセレクタ203を制御することで出力端子259からリングバス上に流す。そして、次のクロックサイクルでカウンタ402のカウント値をインクリメント(+1)する。なお、送信部204のカウンタ402とこの送信部のパケットを受信する受信部201のカウンタ302は、同期を取るため、データ転送開始前に同じ値に初期化される。
パス設定部405のレジスタにアクセスしてこのレジスタの値を変更するデータ506のフォーマットを図4(b)に示す。なお、このデータ506を格納するパケットは図4(a)に示したとおりであるので説明は省略する。データタイプ701はデータ506の種別を示す、RWフラグ702はレジスタへのアクセスの種別が読み出しと書き込みのどちらであるかを示す、アドレス703はアクセス先を示す、データ704は読み出したデータあるいは書き込むデータである。なお、アドレス703は、モジュールの1つを特定できる情報であれば良い。なお、後述する、設定パス開始パケット(切換データ)に格納される設定パス開始データや、接続ID変更パケットに格納される接続ID変更データはデータ506のフォーマットを採用する。
システム制御部800は、演算制御用のCPU801、固定データやプログラムを格納するROM802、データの一時保存やプログラムのロードに使用されるRAM803および、外部データを保持する外部記憶装置804を有する。RAM803はSRAMやDRAMのように多種であってもよいし、複数あってもよい。また、その一部がCPU801の内部で機能してもよい。
図6(a)は、本発明の実施例2におけるデータ処理装置の構成を示すブロック図である。なお、以下の説明では実施例1と同一機能を有する構成や工程には同一符号を付すとともに、構成的、機能的にかわらないものについてはその説明を省略する。図に示すように実施例2のデータ処理部820は、データ入力部901、データ出力部902、データ入力部901に接続している通信部903、データ出力部に接続している通信部904を有している。
図6(b)は、本発明の実施例3におけるデータ処理装置の概略構成を示すブロック図である。なお、以下の説明では実施例1、2と同一機能を有する構成や工程には同一符号を付すとともに、構成的、機能的にかわらないものについてはその説明を省略する。
Claims (11)
- リング状に接続されている複数の処理モジュールに入力手段からデータを入力し、当該データを前記複数の処理モジュールの夫々が一方向に転送するデータ処理装置であって、
前記処理モジュールは、
前記複数の処理モジュールが設定された順番で処理を行うようにデータを転送する第1データ処理パスと、前記複数の処理モジュールが接続された順番で処理を行うようにデータを転送する設定パスとを実現する通信手段と、
前記通信手段の受信したデータを処理して、前記通信手段に出力する処理手段とを有し、
前記通信手段は、前記複数の処理モジュールを前記第1データ処理パスで処理する状態から前記設定パスで処理の順番を設定する状態へ切り換える場合に、前記第1データ処理パスから前記設定パスに切り換えるための切換データを前記第1データ処理パスで処理させることを特徴とするデータ処理装置。 - 前記通信手段の1つは、前記入力手段からの入力を保留させる信号を当該入力手段に送信する保留手段を有し、前記切換データを前記入力手段から受信した場合に、前記保留手段が前記切換データに続くデータを保留することを特徴とする請求項1に記載のデータ処理装置。
- 前記入力手段からの入力を保留させている保留手段を有する通信手段が、前記切換データを他の通信手段から受信した場合に、前記保留手段による保留を解除することを特徴とする請求項2に記載のデータ処理装置。
- 前記入力手段は、前記切換データを前記通信手段から受信した場合に、前記複数の処理モジュールの通信手段の夫々の設定を、第2データ処理パスを実行可能な設定に変更する変更データを前記通信手段へ入力することを特徴とする請求項2又は3に記載のデータ処理装置。
- 前記変更データは前記第2データ処理パスを設定した後、前記設定パスから前記第2データ処理パスに切り換えることを特徴とする請求項4に記載のデータ処理装置。
- 前記複数のモジュールで処理を完了したデータを外部に出力する出力手段を更に有し、前記出力手段にデータを送信するモジュールは、前記切換データを受信した際に、前記入力手段からの入力を保留させているモジュールに通知信号を送信し、前記入力手段からの入力を保留させているモジュールは、前記通知信号に応じて前記保留を解除することを特徴とする請求項2乃至5のいずれか1項に記載のデータ処理装置。
- 前記通信手段は、前記処理手段の出力するデータに、順序を示すカウント値とデータを処理する順番を示す識別情報をデータに付加すること
を特徴とする請求項1乃至6のいずれか1項に記載のデータ処理装置。 - 前記カウント値およびデータを処理する順番を示す識別情報は、レジスタにより設定可能であること
を特徴とする請求項7に記載のデータ処理装置。 - 前記入力手段は、
入力するデータをどのデータ処理パスで処理させるかを識別するパス識別子を付加することを特徴とする請求項1乃至8のいずれか1項に記載のデータ処理装置。 - リング状に接続されている複数の処理モジュールに入力手段からデータを入力し、当該データを前記複数の処理モジュールの夫々が一方向に転送するデータ処理装置におけるデータ処理方法であって、
前記処理モジュールは、
前記複数の処理モジュールが設定された順番で処理を行うようにデータを転送する第1データ処理パスと、前記複数の処理モジュールが接続された順番で処理を行うようにデータを転送する設定パスとを実現する通信工程と、
前記処理モジュールが、前記通信工程で受信したデータを処理して出力する処理工程と、
前記複数の処理モジュールを前記第1データ処理パスで処理する状態から前記設定パスで処理する状態へ切り換える場合に、前記設定パスで処理する状態に切り換える切換データを前記第1データ処理パスで処理させる切換工程とを有することを特徴とするデータ処理方法。 - リング状に接続されている複数の処理モジュールに入力手段からデータを入力し、当該データを前記複数の処理モジュールの夫々が一方向に転送するデータ処理装置を制御するコンピュータを、
前記複数の処理モジュールが設定された順番で処理を行うようにデータを転送する第1データ処理パスと、前記複数の処理モジュールが接続された順番で処理を行うようにデータを転送する設定パスとを実現する通信手段と、
前記通信手段の受信したデータを処理して、前記通信手段に出力する処理手段と、
前記複数の処理モジュールを前記第1データ処理パスで処理する状態から前記設定パスで処理する状態へ切り換える場合に、前記設定パスで処理する状態に切り換える切換データを前記第1データ処理パスで処理させる切換手段として機能させることを特徴とするプログラム。
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