JP5260088B2 - インバータ装置 - Google Patents
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Description
複数のパラメータについて当該各パラメータの設定値をその識別情報と対応付けて記憶する書き換え可能な不揮発性メモリと、前記複数のパラメータの中から選択された1または複数のパラメータからなるパラメータ群を複数記憶するデータ記憶領域が設定されたフラッシュメモリおよび前記不揮発性メモリから読み出された前記複数のパラメータを記憶しインバータ動作の実行時に参照されるRAMを有するマイクロコンピュータとを備え、
前記マイクロコンピュータに前記パラメータに関する処理動作を実行させるパラメータ処理手段は、
複数のパラメータ群から読出対象または/および書込対象のパラメータ群を選択するパラメータ群選択手段と、
前記RAMに記憶されているパラメータのうちパラメータ群を構成するパラメータの識別情報と設定値を、前記パラメータ群選択手段により選択されたパラメータ群のために確保された前記フラッシュメモリのデータ記憶領域に書き込むパラメータ群書込手段と、
前記パラメータ群選択手段により選択されたパラメータ群を構成するパラメータの識別情報と設定値を前記フラッシュメモリのデータ記憶領域から読み出して、読み出したパラメータの設定値をその識別情報と対応付けて前記RAMに書き込むパラメータ群読出手段とを備えていることを特徴とする。
図1は、インバータ装置のうち制御部に係る概略構成図である。ダイオードを三相ブリッジ接続して構成されるコンバータ部およびスイッチング素子を三相ブリッジ接続して構成されるインバータ部からなる主回路部については図示を省略している。インバータ装置1の制御部は、マイクロコンピュータ2(以下、マイコン2と称す)、EEPROM3、例えば4桁の7セグメントLEDからなる表示部4(表示手段に相当)、表示部4を駆動する駆動回路5、複数のキー6a〜6fからなる操作部6、入力インターフェース7などを備えている。これらからなる制御部は、プリント配線基板に配設されて筐体内に収容されている。図2は、インバータ装置1の正面図である。
フラッシュメモリ10のデータメモリ領域12に記憶するパラメータ群の数は複数であればよい。また、各パラメータ群を構成するパラメータの数は1または複数でよい。
Claims (9)
- 複数のパラメータについて当該各パラメータの設定値をその識別情報と対応付けて記憶する書き換え可能な不揮発性メモリと、前記複数のパラメータの中から選択された1または複数のパラメータからなるパラメータ群を複数記憶するデータ記憶領域が設定されたフラッシュメモリおよび前記不揮発性メモリから読み出された前記複数のパラメータを記憶しインバータ動作の実行時に参照されるRAMを有するマイクロコンピュータとを備え、
前記マイクロコンピュータに前記パラメータに関する処理動作を実行させるパラメータ処理手段は、
複数のパラメータ群から読出対象または/および書込対象のパラメータ群を選択するパラメータ群選択手段と、
前記RAMに記憶されているパラメータのうちパラメータ群を構成するパラメータの識別情報と設定値を、前記パラメータ群選択手段により選択されたパラメータ群のために確保された前記フラッシュメモリのデータ記憶領域に書き込むパラメータ群書込手段と、
前記パラメータ群選択手段により選択されたパラメータ群を構成するパラメータの識別情報と設定値を前記フラッシュメモリのデータ記憶領域から読み出して、読み出したパラメータの設定値をその識別情報と対応付けて前記RAMに書き込むパラメータ群読出手段とを備えていることを特徴とするインバータ装置。 - 前記パラメータ群読出手段は、前記フラッシュメモリのデータ記憶領域から読み出したパラメータの設定値をその識別情報と対応付けて前記不揮発性メモリにも書き込むことを特徴とする請求項1記載のインバータ装置。
- 前記RAMにおいて、パラメータ群は、間接指定をするために設けられた特定の間接指定パラメータの設定値により指示された識別情報を持つパラメータにより構成されていることを特徴とする請求項1または2記載のインバータ装置。
- 前記パラメータ群選択手段は、書込指令をするために設けられた書込指令パラメータにパラメータ群の識別情報が設定されたことにより当該識別情報を持つパラメータ群を選択し、
前記パラメータ群書込手段は、前記書込指令パラメータにパラメータ群の識別情報が設定されたことに応じて、前記フラッシュメモリへの前記選択されたパラメータ群の書き込み処理を実行することを特徴とする請求項1ないし3の何れかに記載のインバータ装置。 - 前記パラメータ群選択手段は、読出指令をするために設けられた読出指令パラメータにパラメータ群の識別情報が設定されたことにより当該識別情報を持つパラメータ群を選択し、
前記パラメータ群読出手段は、前記読出指令パラメータにパラメータ群の識別情報が設定されたことに応じて、前記フラッシュメモリから前記選択されたパラメータ群の読み出し処理を実行することを特徴とする請求項1ないし4の何れかに記載のインバータ装置。 - 表示手段を備え、
前記パラメータ処理手段は、前記パラメータ群選択手段により読出対象のパラメータ群が選択されており、前記表示手段にパラメータの識別情報と設定値を表示する場合、前記RAMに記憶されているパラメータのうち前記パラメータ群を構成するパラメータだけを表示可能とする表示制御手段を備えていることを特徴とする請求項1ないし5の何れかに記載のインバータ装置。 - 前記表示制御手段は、前記パラメータ群選択手段により読出対象のパラメータ群が選択されておらず、前記表示手段にパラメータの識別情報と設定値を表示する場合、前記RAMに記憶されている全てのパラメータを前記表示手段に表示可能とすることを特徴とする請求項6記載のインバータ装置。
- 前記パラメータ群を構成するパラメータには、少なくとも前記読出指令パラメータが含まれていることを特徴とする請求項5記載のインバータ装置。
- 前記パラメータの識別情報は、アドレスまたはアドレスと名称データから構成されていることを特徴とする請求項1ないし8の何れかに記載のインバータ装置。
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JP2008056533A JP5260088B2 (ja) | 2008-03-06 | 2008-03-06 | インバータ装置 |
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JP2009213333A JP2009213333A (ja) | 2009-09-17 |
JP5260088B2 true JP5260088B2 (ja) | 2013-08-14 |
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Family Applications (1)
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JP2008056533A Active JP5260088B2 (ja) | 2008-03-06 | 2008-03-06 | インバータ装置 |
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