JP5158597B2 - 主装置 - Google Patents
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Description
12−1〜12−n オプションパッケージ
13 LAN I/F
14 電波時計
15 バス
16 PC
17 TEL
18 LAN
111 メインCPU
112 不揮発性メモリ
113 PC I/F
114 TEL I/F
121 MPU
122 不揮発性メモリ
123 PC I/F
Claims (4)
- メモリとCPUとを備えたメインパッケージを含む電話システムの主装置において、
起動時に登録日時情報を含む所定の情報が前記メモリに登録されているか否か判断する手段と、
前記所定の情報が前記メモリに登録されていないと判断されたとき、その後、前記メモリに前記所定の情報が登録されたと判断されるまで、前記メモリへの前記所定の情報の登録処理以外の処理を中止する手段と、
を有することを特徴とする主装置。 - 前記所定の情報が、ライセンス情報を含むことを特徴とする請求項1に記載の主装置。
- メモリとMPUとを備え、前記メインパッケージにバス接続されたオプションパッケージをさらに有し、
前記所定の情報の少なくとも一部を前記オプションパッケージのメモリに登録する手段を備えていることを特徴とする請求項1又は2に記載の主装置。 - 前記オプションパッケージの稼動開始日時情報を当該オプションパッケージのメモリに登録する手段を備えていることを特徴とする請求項3に記載の主装置。
Priority Applications (1)
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JP2008191298A JP5158597B2 (ja) | 2008-07-24 | 2008-07-24 | 主装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2008191298A JP5158597B2 (ja) | 2008-07-24 | 2008-07-24 | 主装置 |
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JP2010026999A JP2010026999A (ja) | 2010-02-04 |
JP5158597B2 true JP5158597B2 (ja) | 2013-03-06 |
Family
ID=41732738
Family Applications (1)
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JP2008191298A Active JP5158597B2 (ja) | 2008-07-24 | 2008-07-24 | 主装置 |
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- 2008-07-24 JP JP2008191298A patent/JP5158597B2/ja active Active
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