JP5133172B2 - Fm送信回路及びオーバーサンプリング処理回路 - Google Patents
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Description
入力されるオーディオディジタル信号に対してプリエンファシス処理するプリエンファシス手段と、
前記プリエンファシス手段から出力される信号に対して変調度制限のための振幅調整を行う非線形振幅制御手段と、
前記非線形振幅制御手段から出力される信号から高調波雑音を除去する低域通過フィルタ手段と、
前記低域通過フィルタ手段から出力される信号に従って、搬送波信号をFM変調して出力するFM変調手段とを備えたFM送信回路において、
前記非線形振幅制御手段と前記プリエンファシス手段との間に設けられ、所定の段数のカスケード積分くし形フィルタ(以下、CICフィルタという。)を用いて所定のアップサンプリング比でアップサンプリングを行うアップサンプラ手段と、
前記非線形振幅制御手段と前記低域通過フィルタ手段との間に設けられ、CICフィルタを用いて所定のダウンサンプリング比でダウンサンプリングを行うダウンサンプラ手段とを備えたことを特徴とする。
前記アップサンプリング比は8Mに設定され、
前記ダウンサンプリング比は1/8Mに設定され、
前記CICフィルタの段数はNに設定され、
前記M,Nはそれぞれ自然数であることを特徴とする。
前記オーバーサンプリング処理手段は、
FIRフィルタを用いて入力信号をアップサンプリングする第1のアップサンプラと、
前記第1のアップサンプラの後段に設けられ、CICフィルタを用いて入力信号をアップサンプリングする第2のアップサンプラとを備えたことを特徴とする。
FIRフィルタを用いて入力信号をアップサンプリングする第1のアップサンプラと、
前記第1のアップサンプラの後段に設けられ、CICフィルタを用いて入力信号をアップサンプリングする第2のアップサンプラとを備えたことを特徴とする。
(1)まず、スイッチ101,111,112をオンして1段目の遅延減算回路の動作をさせる。
(2)次いで、スイッチ101をオフし、スイッチ103,113,114をオンして2段目の遅延減算回路の動作をさせる。
(3)さらに、スイッチ111,112をオフし、スイッチ115,116,102をオンして3段目の遅延減算回路の動作をさせ、減算器34からの出力信号を出力させる。
本実施形態に係るFM送信回路では、図1に示すように、非線形振幅制御回路5の前段及び後段にそれぞれ、CICフィルタで構成したCICアップサンプラ4及びCICダウンサンプラ6を挿入したことを特徴としている。これによって、折り返し雑音を防止するためにオーバーサンプル処理で非線形処理をしても数個の加算器又は減算器のみで処理が可能となり、回路規模、消費電流を抑えることが可能となる。
2…帯域制限低域通過フィルタ(LPF)、
3…プリエンファシス回路、
4…CICアップサンプラ、
5…非線形利得制御回路、
6,6a,6b,6c…CICダウンサンプラ、
7…高調波雑音除去用低域通過フィルタ(LPF)、
8…パイロット信号発生器、
9…コンポジット信号生成回路、
10…周波数変調器、
11…DA変換器(DAC)、
12…RFアナログ回路、
13…オーバーサンプリング処理回路、
13a…FIRフィルタを用いたアップサンプラ、
13b…CICフィルタを用いたアップサンプラ、
21…入力端子、
22…プリエンファシス回路、
23…単純リミッタ、
24…低域通過フィルタ(LPF)、
25…デエンファシス回路、
26…出力端子、
31…加算器、
32,32a,32b,32c,33,33n,33a,33b,33c…遅延器、
34…減算器、
35…増幅器、
36,36a…ダウンサンプラ、
37…増幅器、
38a…アップサンプラ、
41,42,43,44…CICフィルタ回路、
41…CICフィルタ基本回路、
51,52,53,54…加算遅延回路、
51A,61A…フィルタ回路、
61,62,63,64,61n,62n,63n,64n…遅延減算回路、
71…クロック信号発生器、
72…タイミング信号発生器、
101,102,103,111〜116…スイッチ。
Claims (7)
- 入力されるオーディオディジタル信号に対してプリエンファシス処理するプリエンファシス手段と、
前記プリエンファシス手段から出力される信号に対して変調度制限のための振幅調整を行う非線形振幅制御手段と、
前記非線形振幅制御手段から出力される信号から高調波雑音を除去する低域通過フィルタ手段と、
前記低域通過フィルタ手段から出力される信号に従って、搬送波信号をFM変調して出力するFM変調手段とを備えたFM送信回路において、
前記非線形振幅制御手段と前記プリエンファシス手段との間に設けられ、所定の段数のカスケード積分くし形フィルタ(以下、CICフィルタという。)を用いて所定のアップサンプリング比でアップサンプリングを行うアップサンプラ手段と、
前記非線形振幅制御手段と前記低域通過フィルタ手段との間に設けられ、CICフィルタを用いて所定のダウンサンプリング比でダウンサンプリングを行うダウンサンプラ手段とを備えたことを特徴とするFM送信回路。 - 前記アップサンプリング比は8Mに設定され、
前記ダウンサンプリング比は1/8Mに設定され、
前記CICフィルタの段数はNに設定され、
前記M,Nはそれぞれ自然数であることを特徴とする請求項1記載のFM送信回路。 - 入力されるオーディオディジタル信号のサンプリング周波数を、有効オーディオ帯域(16kHz〜24kHz)の8倍に設定し、前記非線形振幅制御手段のアップサンプリング比を16倍に設定し、前記非線形振幅制御手段のダウンサンプリング比を1/16倍に設定し、M=2及びN=3に設定したことを特徴とする請求項2記載のFM送信回路。
- M及びNを変化できるように構成されたことを特徴とする請求項2記載のFM送信回路。
- 前記FM変調手段の前段に設けられ、入力信号に対してオーバーサンプリング処理を行うオーバーサンプリング処理手段をさらに備え、
前記オーバーサンプリング処理手段は、
FIRフィルタを用いて入力信号をアップサンプリングする第1のアップサンプラと、
前記第1のアップサンプラの後段に設けられ、CICフィルタを用いて入力信号をアップサンプリングする第2のアップサンプラとを備えたことを特徴とする請求項1乃至4のうちのいずれか1つに記載のFM送信回路。 - 前記アップサンプラ手段のCICフィルタ及び前記ダウンサンプラ手段のCICフィルタと、前記オーバーサンプリング処理手段のCICフィルタとを共用し、時系列で交互に選択的に切り換えるように構成したことを特徴とする請求項1乃至5のうちのいずれか1つに記載のFM送信回路。
- 前記各CICフィルタは、1つの加算器又は減算器と1つの遅延器とからなる回路を複数段カスケード接続してなるフィルタ回路を、1つの加算器又は減算器と複数の遅延器とからなるフィルタ回路で置き換えて構成し、前記各遅延器を順次選択的に前記加算器又は前記減算器に接続してシリアル処理を行うように構成したことを特徴とする請求項1乃至6のうちのいずれか1つに記載のFM送信回路。
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