JP4960846B2 - フレーム遅延発生装置 - Google Patents
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Description
この構成により、現在遅延時間が設定遅延時間と同じになるように、ライトバッファからメモリに対するデータの書込みを優先させるか、メモリからリードバッファに対するデータの転送を優先させることで、フレームの遅延発生機能を停止せずに遅延時間をリアルタイムに変更することができ、QoEを評価するための試験の効率を高めることができる。
この構成により、現在書き込んでいるメモリの書込位置と現在読み出しているメモリの読出位置との差分となる現在差分が、設定遅延時間から換算される書込位置と読出位置との差分となる目標差分を同じにするように制御することで、書込位置と読出位置との差分に基づいて遅延が制御できるため、遅延の制御が容易になる。
10 フレーム遅延発生装置
11 フレーム抽出部
12 第1遅延制御部
13 ライトバッファ
14 メモリ
15 リードバッファ
16 バス切替回路
17 メモリ制御部
18 第2遅延制御部
19 フレーム出力部
20 遅延時間制御部
21 データ選択回路
22 フレームギャップ識別回路
23 停止信号選択回路
Claims (2)
- 入力されたフレームのうち特定のフレームを抽出するフレーム抽出部(11)と、
前記フレーム抽出部によって抽出された特定のフレームを構成するデータが書込まれるライトバッファ(13)と、
前記ライトバッファに書込まれたデータを蓄積するメモリ(14)と、
前記メモリから出力されるデータを蓄積するリードバッファ(15)と、
前記ライトバッファから前記メモリに対するデータの書込みおよび前記メモリから前記リードバッファに対するデータの転送を制御するメモリ制御部(17)と、
フレームの伝送遅延の許容量を試験するために任意に設定された設定遅延時間に現在のフレームの遅延時間となる現在遅延時間が同じになるように、前記メモリ制御部に対して前記ライトバッファから前記メモリに対するデータの書込みと、前記メモリから前記リードバッファに対するデータの転送のいずれを優先させるかを制御する遅延時間制御部(20)と、
前記入力フレームから前記特定のフレームを抽出した後の残りのフレームに前記リードバッファから出力されたデータによって構成される前記特定のフレームを付加して出力するフレーム出力部(19)と、
前記ライトバッファと前記メモリとを接続した状態から前記リードバッファと前記メモリとを接続した状態に切り替える一方で、前記リードバッファと前記メモリとを接続した状態から前記ライトバッファと前記メモリとを接続した状態に切り替えるバス切替回路(16)と、
前記バス切替回路を通るデータがフレームか、フレームとフレームとの間を補うためのギャップデータかを識別し、前記バス切替回路を通るデータがギャップデータであると識別したとき、前記現在差分と前記目標差分とが同じになるまでメモリ制御信号を出力し続けるフレームギャップ識別回路(22)と、
前記フレームギャップ識別回路によって出力される前記メモリ制御信号が入力されている間、書込停止信号または読出停止信号を前記メモリ制御部に出力する停止信号選択回路(23)とを備えたことを特徴とするフレーム遅延発生装置。 - 前記遅延時間制御部は、現在書き込んでいる前記メモリの書込位置と現在読み出している前記メモリの読出位置との差分となる現在差分を求め、遅延対象となるフレームの伝送速度と前記設定遅延時間とに基づいて前記メモリに蓄積する際の遅延に必要なデータ量を求め、当該遅延時間に必要なデータ量から前記書込位置と前記読出位置との差分である目標差分を求め、
前記現在差分が前記目標差分よりも小さい場合には、前記現在差分と前記目標差分とが同じになるまで、前記メモリ制御部に対して前記ライトバッファから前記メモリに対するデータの書込みを優先させ、
前記現在差分が前記目標差分よりも大きい場合には、前記現在差分と前記目標差分とが同じになるまで、前記メモリ制御部に対して前記メモリから前記リードバッファに対するデータの転送を優先させることを特徴とする請求項1に記載のフレーム遅延発生装置。
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