JP4814556B2 - レギュレータ回路 - Google Patents
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図1は、本発明の第1の実施形態に係るレギュレータ回路の構成を示す回路図である。本発明の第1の実施形態に係るレギュレータ回路は、外部から供給される正の電源電圧VDDを参照電圧VREFに基づいて安定化し、安定化された電源電圧VREGを出力端子から負荷に供給する。図1に示すように、このレギュレータ回路は、差動アンプ10と、バイアス制御回路20と、出力回路30と、帰還用の抵抗R1及びR2とを有している。
VREG=VREF・(R1+R2)/R2
VR3=VR4 ・・・(1)
VGSN7=VGSN8=VGSN ・・・(2)
また、トランジスタQP5及びQP6のゲート・ソース間電圧VGSP5及びVGSP6に関しては、次式が成立する。
VGSP5=VGSP6=VGSP ・・・(3)
図2は、本発明の第2の実施形態に係るレギュレータ回路の構成を示す回路図である。本実施形態に係るレギュレータ回路は、外部から供給される負の電源電圧VSSを参照電圧VREFに基づいて安定化し、安定化された電源電圧VREGを出力端子から負荷に供給する。
VREG=−VREF・(R1+R2)/R2
Claims (2)
- 外部から第1の端子と第2の端子との間に供給される電源電圧を参照電圧に基づいて安定化し、安定化された電源電圧を第3の端子から負荷に供給するレギュレータ回路であって、
参照電圧と帰還電圧との間の誤差を増幅する差動増幅回路と、
前記第3の端子に電流を供給する最終段と該最終段を駆動するドライブ段とを含む出力回路であって、前記最終段が、前記第1の端子に接続されたソース及び前記第3の端子に接続されたドレインを有する出力トランジスタを有し、前記ドライブ段が、所定の電圧が印加されるゲート及び前記出力トランジスタのゲートに接続されたドレインを有し、前記出力トランジスタを駆動する第1のトランジスタと、前記差動増幅回路の出力電圧が印加されるゲート、前記第1の端子に接続されたソース、及び、前記第1のトランジスタのソースに接続されたドレインを有し、前記第1のトランジスタと共にカスコード増幅回路を構成する第2のトランジスタと、前記第1の端子に接続されたソース及び前記第1のトランジスタのドレインに接続されたドレインを有し、前記第1のトランジスタに電流を流す電流源の第3のトランジスタと、前記第1のトランジスタのソースに接続されたドレイン及び前記第2の端子に接続されたソースを有し、前記第1のトランジスタに電流を流す電流源の第4のトランジスタとを有する、前記出力回路と、
前記第3の端子に発生する電圧に基づいて帰還電圧を生成し、該帰還電圧を前記差動増幅回路に入力する帰還回路と、
参照電圧と帰還電圧との間の誤差に基づいて前記第3及び第4のトランジスタのゲート電圧を制御することにより、前記第3の端子の電圧を設定値に近付ける制御回路と、
を具備するレギュレータ回路。 - 前記第1の端子の電位が前記第2の端子の電位よりも高い場合に、前記最終段の前記出力トランジスタと、前記ドライブ段の前記第2及び第3のトランジスタとが、PチャネルMOSトランジスタであり、前記ドライブ段の第1及び第4のトランジスタが、NチャネルMOSトランジスタであり、前記制御回路が、帰還電圧が参照電圧よりも小さいときに、前記第3のトランジスタの電流を減少させると共に、前記第4のトランジスタの電流を増加させ、帰還電圧が参照電圧よりも大きいときに、前記第3のトランジスタの電流を増加させると共に、前記第4のトランジスタの電流を減少させ、
前記第1の端子の電位が前記第2の端子の電位よりも低い場合に、前記最終段の前記出力トランジスタと、前記ドライブ段の前記第2及び第3のトランジスタとが、NチャネルMOSトランジスタであり、前記ドライブ段の第1及び第4のトランジスタが、PチャネルMOSトランジスタであり、前記制御回路が、帰還電圧が参照電圧よりも小さいときに、前記第3のトランジスタの電流を増加させると共に、前記第4のトランジスタの電流を減少させ、帰還電圧が参照電圧よりも大きいときに、前記第3のトランジスタの電流を減少させると共に、前記第4のトランジスタの電流を増加させる、
請求項1記載のレギュレータ回路。
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