JP4761828B2 - 表示装置 - Google Patents
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Description
{(Csc−Cpa)/(Cgs+Clc+Csc+Cpa)}・ΔVsc=VB−Vb/2 (i)
ΔVsc<VDD (ii)
Vpixel=Vvideo±{(Csc−Cpa)/(Cgs+Clc+Csc+Cpa)}・ΔVsc (1)
{(Csc−Cpa)/(Cgs+Clc+Csc+Cpa)}・ΔVsc=VB−Vb/2 (2)
ΔVsc<VDD (3)
[具体例]
Csc=320fF、Cpa=10fF、Clc=430fF、Cgs=3fF、ΔVsc=5.58,Vb=3.5V、Vb=2.5V,VDD=8.5V程度に構成すると、{(320−Cpa)/(3+430+320+Cpa)}・ΔVsc=3.5−2.5/2となる。また、ΔVsc<8.5である。
Claims (4)
- 画素回路がマトリクス状に配置された表示装置であって、
各画素回路は、
一端がデータ信号が供給されるデータラインに接続され、ゲートが選択ラインに接続され、選択ラインの選択信号をHレベルまたはLレベルに設定することによってオンオフされる画素TFTと、
一端が画素TFTの他端に接続され、他端が保持容量ラインに接続され、データラインから供給されたデータ信号の電圧を保持する保持容量と、
一方の電極が画素TFTの他端に接続され、他方の電極が共通電極電位に保持される液晶素子と、
を備えるとともに、
前記保持容量ラインは、前記画素TFTをオンして、データライン上のデータ信号を保持容量に書き込んだ後、第1のレベルから第2のレベルに変化し、これによって液晶素子に印加する電圧をシフトさせ、
前記保持容量ラインは、各画素回路の行に対応して2本設けられ、行方向に配置されている複数の画素回路は、2本の保持容量ラインのいずれか一方に接続されているとともに、2本の保持容量ラインは、それぞれHレベル電位とLレベル電位を有し、
前記保持容量の容量値をCsc、前記保持容量ラインであって、隣接する画素回路に接続されるものと前記画素電極のノードに発生する寄生容量の容量値をCpa、前記画素TFTのゲートと前記画素電極のノードに発生するゲート容量の容量値をCgs、前記液晶素子の容量値をClc、前記保持容量ラインにおいてシフトさせる電圧値をΔVsc、前記データ信号の黒レベル電圧と白レベル電圧の電位差をVb、電圧シフト後における黒レベル電圧を
VB、画素回路を動作させる電力を供給する電源の電源電圧をVDDとしたときに、下記(i)、(ii)式を満足することを特徴とする表示装置。
{(Csc−Cpa)/(Cgs+Clc+Csc+Cpa)}・ΔVsc=VB−Vb/2 (i)
ΔVsc<VDD (ii) - 請求項1に記載の表示装置において、
前記2種類の電位は、一方の電位が正から負の方向、または負から正の方向へシフトしたときに、他方の電位はその逆方向へシフトすることを特徴とする表示装置。 - 請求項1に記載の表示装置において、
前記Cscを前記Cpaより大きく設定することを特徴とする表示装置。 - 請求項3に記載の表示装置において、
前記Cpaは、前記画素TFTのゲート電極と同一層に前記保持容量ラインが設けられ、前記補助容量ラインと前記画素電極の間に絶縁膜が設けられることで形成され、
前記Cscは、前記画素TFTのソースを構成する前記電極と、前記容量ラインの一部が酸化膜を介して対向することで形成され、
前記絶縁膜を厚くし、かつ、前記酸化膜を薄くすることで、前記Cscを前記Cpaより大きく設定することを特徴とする表示装置。
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