JP4747155B2 - メモリ制御システム - Google Patents
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Description
(実施形態1)
図1は、本発明によるメモリ制御システムの実施形態1の系統構成を示すブロック図である。本メモリ制御システムは、SDRAMコントローラ1と、マイクロプロセッサMPU2と、シンクロナスDRAM(SDRAM)3と、電源監視手段4と、リードオンリメモリROM5とを有している。
さらに、電源監視手段4は、主電源が遮断状態でかつSDRAM3がバックアップ電源によるバックアップ状態にある時に、バックアップ電源の電圧が所定値よりも低下した場合には、バックアップ喪失と判断し、BUP信号41を非アクティブLowにする。
(実施形態2)
図7は、本発明によるメモリ制御システムの実施形態2の系統構成を示すブロック図である。本実施形態2は、実施形態1にリセット手段7とANDゲート111とを追加した系統構成である。本メモリ制御システムは、SDRAMコントローラ1と、マイクロプロセッサMPU2と、シンクロナスDRAM(SDRAM)3と、電源監視手段4と、リードオンリメモリROM5と、リセット手段7と、ANDゲート111とを有している。
さらに、電源監視手段4は、主電源が遮断状態でかつSDRAM3がバックアップ電源によるバックアップ状態にある時に、バックアップ電源の電圧が所定値よりも低下した場合には、バックアップ喪失と判断し、BUP信号41を非アクティブLowにする。
(実施形態3)
図8は、本発明によるメモリ制御システムの実施形態3の系統構成を示すブロック図である。本実施形態3は、実施形態1の電源監視手段4のDRAMバックアップ(BUP)信号41を出力する機能をSDRAMコントローラ1に内蔵したバックアップ状態フラグSBP16に持たせた系統構成である。
(実施形態4)
図9は、本発明によるメモリ制御システムの実施形態4の系統構成を示すブロック図である。本実施形態4は、実施形態1にSELFR信号104を追加した系統構成である。本メモリ制御システムは、SDRAMコントローラ1と、マイクロプロセッサMPU2と、シンクロナスDRAM(SDRAM)3と、電源監視手段4と、リードオンリメモリROM5とを有している。
(実施形態5)
図10は、本発明によるメモリ制御システムの実施形態5の系統構成を示すブロック図である。本実施形態5は、実施形態1に初期化完了フラグレジスタINITS16と、セルフリフレッシュ遷移完了フラグレジスタSELFS17と、デジタル出力ポートDOA201及びDOB202とを追加した系統構成である。本メモリ制御システムは、SDRAMコントローラ1と、マイクロプロセッサMPU2と、シンクロナスDRAM(SDRAM)3と、電源監視手段4と、リードオンリメモリROM5とを有している。
2 マイクロプロセッサMPU
3 シンクロナスDRAM(SDRAM)
4 電源監視手段
5 リードオンリメモリROM
6 点線
7 リセット手段
10 SDRAM制御手段
11 クロックイネーブルCKE信号生成手段
12 SDRAM設定レジスタINITSET
13 リフレッシュ間隔設定レジスタREF
14 セルフリフレッシュ制御レジスタSELF
15 クロックイネーブルセットレジスタCKESET
16 バックアップ状態フラグSBP
111 ANDゲート
Claims (11)
- プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択して、前記SDRAMへのコマンドを発行するとともに前記SDRAMのクロックイネーブルCKE信号の元になるCKE元信号を生成するSDRAM制御手段と、前記プロセッサMPUによりセットされるCKEセットフラグと、前記電源監視手段からの通知と前記CKE元信号と前記CKEセットフラグとに基づいて前記SDRAMのクロックイネーブルCKE信号を生成するCKE信号生成手段とを備えることを特徴とするメモリ制御システム。 - 請求項1に記載のメモリ制御システムにおいて、
前記CKE信号生成手段が、CKE元信号が非アクティブの場合にはCKE信号をLowとし、CKE元信号がアクティブでかつ前記電源監視手段が非バックアップを示している場合には前記CKE信号をHighとし、前期CKE元信号がアクティブでかつ前記電源監視手段がバックアップを示している場合には、前記CKEセットフラグがクリアされているとCKE信号をLowとし、前記CKEセットフラグがセットされているとCKE信号をHighとすることを特徴とするメモリ制御システム。 - 請求項1に記載のメモリ制御システムにおいて、
前記SDRAMの初期化に必要なコマンドを発行させる初期化レジスタを備え、
電源が復電した時に前記MPUが、前記CKEセットフラグ,前記初期化レジスタの順に設定することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択するとともに、前記SDRAMの初期化が完了した時に前記電源監視手段にSDRAM初期化完了を通知し、
前記電源監視手段が、前記メモリコントローラからのSDRAM初期化完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択するとともに、前記SDRAMのセルフリフレッシュ遷移が完了した時に前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記電源監視手段が、前記メモリコントローラからのSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択するとともに、前記SDRAMの初期化が完了した時に前記電源監視手段にSDRAM初期化完了を通知し、前記SDRAMのセルフリフレッシュ遷移が完了した時に前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記電源監視手段が、前記メモリコントローラからのSDRAM初期化完了通知を検知してさらにSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択する手段と、前記SDRAMの初期化に必要なコマンドを発行させる初期化レジスタと、前記SDRAMの初期化が完了した時にセットされるSDRAM初期化完了フラグとを備え、
前記プロセッサMPUが、前記初期化レジスタをセットした後、前記SDRAM初期化完了フラグがセットされたことを検知すると前記電源監視手段にSDRAM初期化完了を通知し、
前記電源監視手段が、前記プロセッサMPUからのSDRAM初期化完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択する手段と、前記SDRAMのセルフリフレッシュ遷移に必要なコマンドを発行させるセルフリフレッシュ遷移レジスタと、前記SDRAMのセルフリフレッシュ遷移が完了した時にセットされるSDRAMセルフリフレッシュ遷移完了フラグとを備え、
前記プロセッサMPUが、前記セルフリフレッシュ遷移レジスタをセットした後、前記SDRAMセルフリフレッシュ遷移完了フラグがセットされたことを検知すると前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記電源監視手段が、前記プロセッサMPUからのSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択する手段と、前記SDRAMの初期化に必要なコマンドを発行させる初期化レジスタと、前記SDRAMの初期化が完了した時にセットされるSDRAM初期化完了フラグと、前記SDRAMのセルフリフレッシュ遷移に必要なコマンドを発行させるセルフリフレッシュ遷移レジスタと、前記SDRAMのセルフリフレッシュ遷移が完了した時にセットされるSDRAMセルフリフレッシュ遷移完了フラグとを備え、
前記プロセッサMPUが、前記初期化レジスタをセットした後、前記SDRAM初期化完了フラグがセットされたことを検知すると前記電源監視手段にSDRAM初期化完了を通知し、
前記プロセッサMPUが、前記セルフリフレッシュ遷移レジスタをセットした後、前記SDRAMセルフリフレッシュ遷移完了フラグがセットされたことを検知すると前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記電源監視手段が、前記プロセッサMPUからのSDRAM初期化完了通知を検知してさらにSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択する手段と、前記SDRAMのセルフリフレッシュ遷移に必要なコマンドを発行させるセルフリフレッシュ遷移レジスタと、前記SDRAMのセルフリフレッシュ遷移が完了した時にセットされるSDRAMセルフリフレッシュ遷移完了フラグとを備え、
前記プロセッサMPUが、前記セルフリフレッシュ遷移レジスタをセットした後、前記SDRAMセルフリフレッシュ遷移完了フラグがセットされたことを検知すると前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記メモリコントローラが、前記SDRAMの初期化が完了した時に前記電源監視手段にSDRAM初期化完了を通知し、
前記電源監視手段が、前記メモリコントローラからのSDRAM初期化完了通知を検知してさらに前記プロセッサMPUからのSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。 - プロセッサMPUと、セルフリフレッシュ機能を有するSDRAMと、SDRAM制御手段を内蔵するメモリコントローラとを含むメモリ制御システムにおいて、
前記SDRAMがバックアップ状態であるか否かを検知して前記メモリコントローラに通知する電源監視手段を備え、
前記メモリコントローラが、前記電源監視手段からの通知に基づいてシステムパワーオン時における前記SDRAMのクロック無効化期間を選択する手段と、前記SDRAMの初期化に必要なコマンドを発行させる初期化レジスタと、前記SDRAMの初期化が完了した時にセットされるSDRAM初期化完了フラグとを備え、
前記プロセッサMPUが、前記初期化レジスタをセットした後、前記SDRAM初期化完了フラグがセットされたことを検知すると前記電源監視手段にSDRAM初期化完了を通知し、
前記メモリコントローラが、前記SDRAMのセルフリフレッシュ遷移が完了した時に前記電源監視手段にSDRAMセルフリフレッシュ遷移完了を通知し、
前記電源監視手段が、前記プロセッサMPUからのSDRAM初期化完了通知を検知してさらに前記メモリコントローラからのSDRAMセルフリフレッシュ遷移完了通知を検知したら、前記SDRAMがバックアップ状態であることを前記メモリコントローラに通知することを特徴とするメモリ制御システム。
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