JP4740144B2 - 直接デジタル合成方式による周波数合成器 - Google Patents
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Description
f0=M*R/2NB
fA>=2*fG
−加算器の出力における時間対離散の制限関数値と時間対離散の雑音信号からなる離散周波数信号の望ましくないオフセットを回避するため、雑音信号NSに直接成分がないこと、
−良好な信号−雑音マージンを達成するため、有用信号における可能な限り低い雑音レベル、及び
−最低周波数雑音信号成分とキャリア周波数との間の相互変調を回避し、かくして周波数スペクトルにおけるキャリア近くでの望ましくない二次線の形成を防ぐため、最低周波数領域における可能な限り低い雑音レベル。
Claims (12)
- 直接デジタル合成方式による周波数合成器であって、入力(3)に存在する位相増分(M)によって位相信号(P)を周期的に増加するための位相アキュムレータ(1)と、前記位相信号(P)の位相値に対応する正弦関数値を決定するため正弦関数値表をメモリーセルに記憶する記憶装置(6)と、前記時間対離散の正弦関数値を擬似アナログ正弦時間関数に変換するためのデジタル−アナログ変換器(11)と、前記擬似アナログ正弦時間関数を平滑化するためのアンチエイリアシングローパスフィルタ(16)と、を備え、
前記記憶装置(6)と前記デジタル−アナログ変換器(11)との間に接続された加算器(19)によって前記時間対離散の正弦関数値に、雑音発生器(25)によって生成された雑音信号である非周期的信号(NS)を重ね合わせ、
前記雑音発生器(25)は、
共通の基準クロックパルス(R)と比較して数倍減少したクロックパルス周波数を有する雑音信号を生成するための擬似雑音発生器(29)、
前記擬似雑音発生器(29)によって生成された雑音信号を、前記共通の基準信号(R)と比較して数倍減少したクロックパルス周波数を有する雑音信号に補間するための第一の非巡回フィルタ(40)、
前記第一の非巡回フィルタ(40)によって生成された雑音信号から直接成分と低周波数成分とをフィルタするための微分器(45)、及び
前記微分器(45)によって生成された雑音信号を、前記共通の基準周波数(R)と一致するクロックパルス周波数を有する雑音信号に補間するための第二の非巡回フィルタ(41)を備えることを特徴とする周波数合成器。 - 前記非周期的信号(NS)は低周波領域でローパスフィルタされた雑音信号であることを特徴とする請求項1に記載の周波数合成器。
- 前記位相アキュムレータ(1)、前記記憶装置(6)、前記加算器(19)、及び前記デジタル−アナログ変換器(11)が共通の基準周波数(R)によって同期的に調時されることを特徴とする請求項1又は2に記載の周波数合成器。
- 前記雑音発生器(25)は、周波数分割器(27)の中間接続によって共通の基準クロックパルス(R)から得た周波数分割基準クロックパルス(RR)によって制御されることを特徴とする請求項1乃至3のいずれか一項に記載の周波数合成器。
- 前記周波数分割基準クロックパルス(RR)が、前記共通の基準クロックパルス(R)と比較して数倍減少した周波数を提供することを特徴とする請求項4に記載の周波数合成器。
- 前記周波数分割基準クロックパルス(RR)の周波数と前記擬似雑音発生器(29)によって生成された雑音信号の周波数制限とが前記共通の基準周波数(R)と比較して四倍減少し、前記第一の非巡回フィルタ(40)によって生成された雑音信号の周波数制限が前記共通の基準周波数(R)と比較して二倍減少することを特徴とする請求項1、2、5のいずれか一項に記載の周波数合成器。
- 前記擬似雑音発生器(29)が2つの並列接続擬似雑音発生器(30、31)から成り、前記2つの並列接続擬似雑音発生器の出力(32、33)が組み合わせ論理装置(36)を介して相互に接続することを特徴とする請求項6に記載の周波数合成器。
- 前記アンチエイリアシングローパスフィルタ(16)の出力信号における低周波数領域でバンドパスフィルタされた雑音信号を抑制するためのアナログハイパスフィルタ(52)が、前記アンチエイリアシングローパスフィルタ(16)の後に続くことを特徴とする請求項2に記載の周波数合成器。
- 前記ハイパスフィルタ(52)の前記出力(57)がフェーズロックループ(56)の第一の入力(59)に供給されることを特徴する請求項8に記載の周波数合成器。
- 前記フェーズロックループ(56)が、
前記アナログハイパスフィルタ(52)の前記出力(57)に存在する前記周波数合成器の出力周波数信号(FDDS)と、前記フェーズロックループ(56)の周波数分割出力周波数信号(FPLL)との間の制御偏差を判定するための位相検知器(60)と、
前記位相検知器(60)の出力(63)に存在する制御偏差の動的評価を行うための制御フィルタ(66)と、
前記制御フィルタ(66)の出力信号に依存して出力周波数信号(FPLL)を生成するための電圧制御周波数発振器(70)と、
混合器(74)と、前記混合器(74)に存在する粗グリッド混合周波数信号(FM)の値によって前記出力周波数信号を粗く変換するための直列接続ローパスフィルタ(77)とを提供することを特徴とする請求項9に記載の周波数合成器。 - 前記混合器(74)によって粗く変換された前記出力周波数信号(FPLL)を周波数分割するための周波数分割器(78)と、直接接続(84)を通じて前記周波数分割器(78)をブリッジすることができる切り替え素子(79)とが、前記混合器(74)の下流に接続されることを特徴とする請求項10に記載の周波数合成器。
- 前記フェーズロックループ(56)の前記混合器(74)に供給される前記粗グリッド混合周波数信号(FM)が、第二のフェーズロックループによって、または前記共通の基準周波数(R)からの変換によって生成されることを特徴とする請求項10または11に記載の周波数合成器。
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