JP4666980B2 - データ処理装置 - Google Patents
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14 …CPU
16,22 …クロック発生器
18 …ASIC
20,28 …バッファ回路
24 …SDRAM制御回路
26 …SDRAM
Claims (4)
- 複数の転送モードのいずれか1つを選択する選択手段、
トリガが発行されたとき前記選択手段によって選択された転送モードに従うデータ転送を内部クロックに応答して実行する転送手段、
前記内部クロックの周波数を前記選択手段によって選択された転送モードに対応する周波数に設定する設定手段、
前記選択手段によるモード選択が所定条件を満足するか否かを判別する判別手段、および
前記判別手段の判別結果が否定的である状態から肯定的である状態に変化したとき前記設定手段の設定動作が完了するまで前記トリガの発行タイミングを遅らせる遅延手段を備え、
前記所定条件は、前記選択手段によって今回選択された転送モードが外部クロックに応答するプロセサと協働して前記データ転送を実行する特定転送モードであるというモード条件を含む、データ処理装置。 - 前記転送手段はバースト転送態様でメモリにアクセスするアクセス手段を含む、請求項1記載のデータ処理装置。
- 前記所定条件は、前記選択手段によって今回選択された転送モードに対応する前記内部クロックの周波数が前記選択手段によって前回選択された転送モードに対応する前記内部クロックの周波数よりも低いという周波数条件をさらに含む、請求項2記載のデータ処理装置。
- 前記転送手段は前記データ転送に先立って転送要求を発生する発生手段を含み、
前記トリガは前記転送要求を承認する承認信号である、請求項1ないし3のいずれかに記載のデータ処理装置。
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