JP4612688B2 - 受信装置 - Google Patents
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Description
T(n+1)−T(n)≧188 ・・・(1)
一方、次式(2)が成り立つ場合、MPEG−2TSパケットP(n+1)のデータ転送の開始時に、サイクルタイマの値がタイムスタンプT(n+1)の値を超過しているという状況が起こってしまう。従って、MPEG−2TSパケットP(n+1)を正常なタイミングで出力できない。すなわち、MPEG−2TSパケットP(n)およびMPEG−2TSパケットP(n+1)の時間間隔を維持することができない。このため、MPEG−2TSパケットP(n+1)をLateパケット(正常なタイミングで出力できないパケット)とみなして破棄せざるを得ない。仮に、MPEG−2TSパケットP(n+1)を異常なタイミングであっても強制的に出力すると、MPEG−2TSパケットP(n+1)にPCRが組み込まれている場合、受信側基準クロックに不要な誤差が生じてしまう。
T(n+1)−T(n)<188 ・・・(2)
本発明は、このような問題点に鑑みてなされたものであり、受信側基準クロックに不要な誤差を生じさせることなくパケット破棄を回避できる受信装置を提供することを目的とする。
(ステップS101)パケット出力回路POCRは、サイクルタイマCTRの値がIEEE1394パケットに含まれるタイムスタンプの値以下であるか否かを判定する。サイクルタイマCTRの値がタイムスタンプの値以下であるとき、パケット出力処理はステップS102に移行する。サイクルタイマCTRの値がタイムスタンプの値より大きいとき、パケット出力処理はステップS105に移行する。
(ステップS102)パケット出力回路POCRは、サイクルタイマCTRの値がタイムスタンプの値と一致するか否かを判定する。サイクルタイマCTRの値がタイムスタンプの値と一致するとき、パケット出力処理はステップS103に移行する。サイクルタイマCTRの値がタイムスタンプの値と一致しないとき(すなわち、サイクルタイマCTRの値がタイムスタンプの値より小さいとき)、サイクルタイマCTRの値がタイムスタンプの値と一致するまで、ステップS102が繰り返し実施される。
(ステップS103)パケット出力回路POCRは、MPEG−2TSパケットを正常なタイミングで出力できると判断して、制御信号SYNCおよび制御信号ENBを”1”にそれぞれ設定するとともに、IEEE1394パケットに含まれるMPEG−2TSパケットの先頭1バイトを出力する。この後、パケット出力処理はステップS104に移行する。
(ステップS104)パケット出力回路POCRは、制御信号SYNCを”0”に設定するとともに、MPEG−2TSパケットの残り187バイトを出力する。この後、パケット出力処理はステップS106に移行する。
(ステップS105)パケット出力回路POCRは、MPEG−2TSパケットを正常なタイミングで出力できないと判断して、制御信号ENBを”1”に設定するとともに、IEEE1394パケットに含まれるMPEG−2TSパケットの全188バイトを出力する。この後、パケット出力処理はステップS106に移行する。
(ステップS106)パケット出力回路POCRは、MPEG−2TSパケットの出力が完了すると、制御信号ENBを”0”に設定する。これにより、パケット出力処理は完了する。
(ステップS201)クロック調整回路CACは、制御信号ENBの活性化期間に取り込まれたMPEG−2TSパケットにPCRが組み込まれているか否かを判定する。MPEG−2TSパケットにPCRが組み込まれているとき、クロック調整処理はステップS202に移行する。MPEG−2TSパケットにPCRが組み込まれていないとき、基準クロックCKRの調整が実施されることなく、クロック調整処理は完了する。
(ステップS202)クロック調整回路CACは、制御信号ENBの活性化に応答して記憶された制御信号SYNCの論理レベルが”1”であるか否かを判定する。制御信号SYNCの論理レベルが”1”であるとき(すなわち、MPEG−2TSパケットが正常なタイミングで出力されたものであるとき)、クロック調整処理はステップS203に移行する。制御信号SYNCの論理レベルが”0”であるとき(すなわち、MPEG−2TSパケットが正常なタイミングで出力されたものではないとき)、基準クロックCKRの調整が実施されることなく、クロック調整処理は完了する。
(ステップS203)クロック調整回路CACは、STCの値とPCRの値との差が予め設定された許容範囲内であるか否かを判定する。STCの値とPCRの値との差が許容範囲内であるとき、基準クロックCKRの調整が実施されることなく、クロック調整処理は完了する。STCの値とPCRの値との差が許容範囲外であるとき、クロック調整処理はステップS204に移行する。
(ステップS204)クロック調整回路CACは、STCの値がPCRの値より大きいか否かを判定する。STCの値がPCRの値より大きいとき、クロック調整処理はステップS205に移行する。STCの値がPCRの値より小さいとき、クロック調整処理はステップS206に移行する。
(ステップS205)クロック調整回路CACは、基準クロックCKRの周期が基準クロックCKTの周期より短いと判断して、基準クロックCKRの周期を長くする。これにより、クロック調整処理は完了する。
(ステップS206)クロック調整回路CACは、基準クロックCKRの周期が基準クロックCKTの周期より長いと判断して、基準クロックCKRの周期を短くする。これにより、クロック調整処理は完了する。
受信装置RDのパケット受信部PRU(パケット出力回路POCR)は、IEEE1394パケットPPaに対するパケット出力処理の完了に伴って、IEEE1394パケットPPbに対するパケット出力処理を実施可能な状態になると、バッファメモリからIEEE1394パケットPPbを読み出し、サイクルタイマCTRの値とIEEE1394パケットPPbのヘッダHに含まれるタイムスタンプの値(時刻Tb’に対応する値)とを比較する。この時点でのサイクルタイマCTRの値はタイムスタンプの値より大きいため、パケット受信部PRUは、IEEE1394パケットPPbに含まれるMPEG−2TSパケットPbをLateパケットとみなして破棄する。これにより、IEEE1394パケットPPbに対するパケット出力処理が完了する。
受信装置RDのパケット受信部PRU(パケット出力回路POCR)は、IEEE1394パケットPPaに対するパケット出力処理の完了に伴って、IEEE1394パケットPPbに対するパケット出力処理を実施可能な状態になると、バッファメモリからIEEE1394パケットPPbを読み出し、サイクルタイマCTRの値とIEEE1394パケットPPbのヘッダHに含まれるタイムスタンプの値(時刻Tb’に対応する値)とを比較する。この時点でのサイクルタイマCTRの値はタイムスタンプの値より大きいため、パケット受信部PRUは、即座に、IEEE1394パケットPPbに含まれるMPEG−2TSパケットPbを出力する。また、パケット受信部PRUは、MPEG−2TSパケットPbの出力に伴って、MPEG−2TSパケットPbの全188バイトの出力期間で制御信号ENBを”1”に活性化させ、MPEG−2TSパケットPbの先頭1バイトの出力期間で制御信号SYNCを”1”に活性化させる。これにより、IEEE1394パケットPPbに対するパケット出力処理が完了する。
以上、本発明について詳細に説明してきたが、前述の実施形態およびその変形例は発明の一例に過ぎず、本発明はこれらに限定されるものではない。本発明を逸脱しない範囲で変形可能であることは明らかである。
Claims (6)
- ネットワークを介して送信装置から第1パケットを受信し、前記第1パケットに含まれる第2パケットを出力する受信部と、
前記第2パケットを受信し、前記第2パケットに対して受信側基準クロックに基づく処理を実施する処理部とを備え、
前記受信部は、ネットワーククロックに同期して計時動作する計時回路と、前記計時回路の時刻と前記第1パケットに含まれる第1時刻情報の時刻との比較結果に基づいて、前記第2パケットを出力するとともに、前記第2パケットの出力タイミングの正常/異常を示す制御信号を出力するパケット出力回路とを備え、
前記処理部は、前記第2パケットが送信側基準クロックに基づく時刻を示す第2時刻情報を含み、かつ前記制御信号が正常を示す場合、前記受信側基準クロックに基づく時刻と前記第2時刻情報の時刻との比較結果に基づいて、前記受信側基準クロックを前記送信側基準クロックに同期させるクロック調整回路を備えていることを特徴とする受信装置。 - 請求項1記載の受信装置において、
前記パケット出力回路は、
前記計時回路の時刻が前記第1時刻情報の時刻より前であるとき、前記計時回路の時刻の変化により双方が一致するまで待機した後、前記第2パケットを出力するとともに、正常を示す前記制御信号を出力し、
前記計時回路の時刻が前記第1時刻情報の時刻と一致するとき、前記第2パケットを出力するとともに、正常を示す前記制御信号を出力し、
前記計時回路の時刻が前記第1時刻情報の時刻より後であるとき、前記第2パケットを出力するとともに、異常を示す前記制御信号を出力することを特徴とする受信装置。 - 請求項1記載の受信装置において、
前記クロック調整回路は、
前記第2パケットが前記第2時刻情報を含み、かつ前記制御信号が正常を示す場合、
前記受信側基準クロックに基づく時刻と前記第2時刻情報の時刻との差が許容範囲外であり、かつ前記受信側基準クロックに基づく時刻が前記第2時刻情報の時刻より前であるときに前記受信側基準クロックの周期を短くし、
前記受信側基準クロックに基づく時刻と前記第2時刻情報の時刻との差が許容範囲外であり、かつ前記受信側基準クロックに基づく時刻が前記第2時刻情報の時刻より後であるときに前記受信側基準クロックの周期を長くすることを特徴とする受信装置。 - 請求項1記載の受信装置において、
前記第1時刻情報は、前記送信装置により前記第1パケットに組み込まれ、前記ネットワーククロックに基づく時刻に前記ネットワークを介したパケット伝送により発生する最大遅延時間を加算した時刻を示すことを特徴とする受信装置。 - 請求項1記載の受信装置において、
前記第1時刻情報は、前記送信装置により前記第1パケットに組み込まれ、前記ネットワーククロックに基づく時刻に前記ネットワークを介したパケット伝送により発生する平均遅延時間を加算した時刻を示すことを特徴とする受信装置。 - 請求項1記載の受信装置において、
前記第2パケットは、MPEG−2規格に準拠するトランスポートストリームパケットであり、
前記処理部は、MPEG−2規格に従ってデコード処理を実施するMPEGデコード部であることを特徴とする受信装置。
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