JP4586031B2 - パケットメモリを有するアービトレーションシステムとハブに基づくメモリシステムにおけるメモリ応答の方法 - Google Patents
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Description
Claims (37)
- メモリハブへ直接接続されたメモリデバイス群に向かうローカルメモリ要求群と他のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群とを含むメモリ要求群を受信するよう動作可能なデコーダであって、前記デコーダは、各メモリ要求に関連したメモリ要求識別子を決定するよう動作可能なデコーダと、
前記デコーダと連結したパケットメモリであって、メモリ要求識別子群を前記デコーダから受信し、受信された前記メモリ要求識別子群を格納するよう動作可能な前記パケットメモリと、
前記リモートメモリ要求群に応答して受信された前記リモートメモリ応答群又は前記ローカルメモリ要求群に応答して受信されたローカルメモリ応答群をコントロール信号に応答する出力に連結させるよう動作可能なマルチプレクサと、
前記マルチプレクサと前記パケットメモリとに連結し、前記パケットメモリに格納された前記メモリ要求識別子群から前記受信されたリモートメモリ応答群と前記ローカルメモリ応答群とに対応する前記メモリ要求群の新しさを決定し、前記決定に基づいてコントロール信号を生成するよう動作可能なアービトレーションコントロールロジックとを備えたことを特徴とするメモリハブ。 - 前記アービトレーションコントロールロジックは、前記パケットメモリにおいて最も古いメモリ要求識別子に基づいて前記コントロール信号を生成することを特徴とする請求項1に記載のメモリハブ。
- 前記パケットメモリは、先入れ先出し(FIFO)メモリであることを特徴とする請求項1に記載のメモリハブ。
- 前記パケットメモリに格納された最も古いメモリ要求識別子がローカルメモリ要求のためであるときに、前記マルチプレクサがローカルメモリ応答を出力するように、前記アービトレーションコントロールロジックは、前記コントロール信号を生成することを特徴とする請求項1に記載のメモリハブ。
- 前記ローカルおよびリモートメモリ応答群は前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを含むことを特徴とする請求項1に記載のメモリハブ。
- メモリハブへ直接接続されたメモリデバイス群に向かうローカルメモリ要求群へのローカルメモリ応答群と、他のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群へのリモートメモリ応答群とを受信するよう動作可能なメモリハブであって、前記ローカルメモリ要求群と前記リモートメモリ要求群の各々は、前記メモリ要求を識別するメモリ要求識別子を含み、前記ローカルメモリ応答群と前記リモートメモリ応答群の各々は、前記応答が応答する前記メモリ要求を識別するメモリ要求識別子を含み、前記メモリハブは、前記メモリ要求識別子群を前記メモリハブに格納し、受信された前記ローカルおよびリモートメモリ要求群における個別の前記メモリ要求識別子群と格納された前記メモリ要求識別子群を比較し、アービトレーションアルゴリズムを適用するよう動作可能で、受信された前記ローカルおよびリモートメモリ応答群が、受信された前記ローカルおよびリモートメモリ応答群における前記メモリ要求識別子群と格納された前記メモリ要求識別子群との前記比較に基づいて、アップリンク上で出力として提供される順番を選択することを特徴とするメモリハブ。
- 前記メモリハブは、対応するメモリ要求群が受信される順番で、メモリ要求識別子群を格納するパケットメモリをさらに備えたことを特徴とする請求項6に記載のメモリハブ。
- 前記メモリハブは、前記パケットメモリに連結されたマルチプレクサであって、ローカル又はリモートメモリ応答群をコントロール信号に応答する出力において提供するマルチプレクサをさらに備えたことを特徴とする請求項7に記載のメモリハブ。
- アービトレーションロジックは、前記パケットメモリと前記マルチプレクサとに連結されており、前記コントロール信号を前記マルチプレクサに適用してどのメモリ応答群が前記出力上に提供されるかをコントロールすることを特徴とする請求項8に記載のメモリハブ。
- 前記ローカルおよびリモートメモリ応答群の各々は、前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを備えたことを特徴とする請求項6に記載のメモリハブ。
- 複数のメモリデバイス群と、
前記メモリデバイス群と連結したメモリハブであって、
前記メモリハブへ直接接続されたメモリデバイス群に向かうローカルメモリ要求群と他のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群とを含むメモリ要求群を受信するように適合され、各メモリ要求に関連したメモリ要求識別子を決定するよう動作可能なデコーダと、
メモリ要求識別子群を受信し、前記メモリ要求識別子群を格納するよう適合されたパケットメモリと、
前記リモートメモリ要求群に応答するリモートメモリ応答群と前記ローカルメモリ要求群に応答するローカルメモリ応答群とを受信するように適合され、コントロール信号に応答して前記リモートメモリ応答群又は前記ローカルメモリ応答群を選択するよう動作可能なマルチプレクサと、
前記マルチプレクサと前記パケットメモリとに連結し、前記パケットメモリに格納された前記メモリ要求識別子群から前記受信されたリモートメモリ応答群と前記ローカルメモリ応答群とに対応する前記メモリ要求群の新しさを決定し、前記決定に基づいて、どのメモリ応答が出力に応答するかについての選択をコントロールするコントロール信号を生成するよう動作可能なアービトレーションコントロールロジックとを含んだメモリハブとを備えたことを特徴とするメモリモジュール。 - 前記メモリデバイス群の各々は、SDRAMを含むことを特徴とする請求項11に記載のメモリモジュール。
- 前記アービトレーションコントロールロジックは、前記パケットメモリにおいて最も古いメモリ要求識別子に基づいて前記コントロール信号を生成することを特徴とする請求項11に記載のメモリモジュール。
- 前記パケットメモリは、先入れ先出し(FIFO)メモリであることを特徴とする請求項11に記載のメモリモジュール。
- 前記パケットメモリに格納された最も古いメモリ要求識別子がローカルメモリ要求のためであるときに、前記マルチプレクサがローカルメモリ応答を出力するように、前記アービトレーションコントロールロジックは、前記コントロール信号を生成することを特徴とする請求項11に記載のメモリモジュール。
- 前記ローカルおよびリモートメモリ応答群は、前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを含むことを特徴とする請求項11に記載のメモリモジュール。
- メモリハブコントローラと、
複数のメモリモジュール群において、各メモリモジュールは個別の高速リンク群を通して近接したメモリモジュール群に連結されていて、前記メモリモジュール群の少なくとも1つにおいて、個別の高速リンクを通して前記メモリハブコントローラに連結しており、
各メモリモジュールは、
複数のメモリデバイス群と、
前記メモリデバイス群に連結されたメモリハブであって、
前記メモリハブへ直接接続されたメモリデバイス群に向かうローカルメモリ要求群と他のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群とを含むメモリ要求群を受信するように適合され、各メモリ要求に関連したメモリ要求識別子を決定するように動作可能なデコーダと、
メモリ要求識別子群を受信し、前記メモリ要求識別子群を格納するように適合されたパケットメモリと、
前記リモートメモリ要求群に応答するリモートメモリ応答群と前記ローカルメモリ要求群に応答するローカルメモリ応答群とを受信するよう適合され、コントロール信号に応答して前記リモートメモリ応答群又は前記ローカルメモリ応答群を選択するよう動作可能なマルチプレクサと、
前記マルチプレクサと前記パケットメモリとに連結し、前記パケットメモリに格納された前記メモリ要求識別子群から前記受信されたリモートメモリ応答群と前記ローカルメモリ応答群とに対応する前記メモリ要求群の新しさを決定し、前記決定に基づいて、どのメモリ応答が出力に応答するかの選択をコントロールするコントロール信号を生成するよう動作可能なアービトレーションコントロールロジックと
を含む前記メモリハブと
を含む複数のメモリモジュール群とを備えたことを特徴とするメモリシステム。 - 前記高速リンク群の各々は、光学的通信リンクを含むことを特徴とする請求項17に記載のメモリシステム。
- 前記メモリデバイス群の少なくとも幾つかは、複数のSDRAMを含むことを特徴とする請求項17に記載のメモリシステム。
- 前記アービトレーションコントロールロジックは、前記パケットメモリに格納された前記メモリ要求識別子群の年齢に基づいて前記コントロール信号を生成することを特徴とする請求項17に記載のメモリシステム。
- 前記パケットメモリに格納された最も古いメモリ要求識別子がローカルメモリ要求のためであるときに、前記マルチプレクサがローカルメモリ応答を出力するように、前記アービトレーションコントロールロジックは、前記コントロール信号を生成することを特徴とする請求項20に記載のメモリシステム。
- 前記パケットメモリは、先入れ先出し(FIFO)メモリであることを特徴とする請求項17に記載のメモリシステム。
- 前記ローカルおよびリモートメモリ応答群の各々は、前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを含むことを特徴とする請求項17に記載のメモリシステム。
- プロセッサーと、
前記プロセッサーに連結されたシステムコントローラにおいて、メモリハブコントローラを含むシステムコントローラと、
前記システムコントローラを通して前記プロセッサーに連結された入力デバイスと、
前記システムコントローラを通して前記プロセッサーに連結された出力デバイスと、
前記システムコントローラを通して前記プロセッサーに連結されたストレージデバイスと、
複数のメモリモジュール群において、各メモリモジュールが近接したメモリモジュール群に個別の高速リンク群を通して連結され、少なくとも一つの前記メモリモジュールが前記メモリハブコントローラに個別の高速リンクを通して連結された複数のメモリモジュール群とを備え、各メモリモジュールは、
複数のメモリデバイス群と、
前記メモリデバイス群に連結され、対応する前記高速リンク群に連結されたメモリハブとを含み、前記メモリハブは、
前記メモリハブへ直接接続されたメモリデバイス群に向かうローカルメモリ要求群と他のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群とを含むメモリ要求群を受信するように適合され、各メモリ要求に関連したメモリ要求識別子を決定するように動作可能なデコーダと、
メモリ要求識別子群を受信し、前記メモリ要求識別子群を格納するように適合されたパケットメモリと、
前記リモートメモリ要求群に応答するリモートメモリ応答群と前記ローカルメモリ要求群に応答するローカルメモリ応答群とを受信するよう適合され、コントロール信号に応答して前記リモートメモリ応答群又は前記ローカルメモリ応答群を選択するよう動作可能なマルチプレクサと、
前記マルチプレクサと前記パケットメモリとに連結し、前記パケットメモリに格納された前記メモリ要求識別子群から前記受信されたリモートメモリ応答群と前記ローカルメモリ応答群とに対応する前記メモリ要求群の新しさを決定し、前記決定に基づいて、どのメモリ応答が出力に応答するかの選択をコントロールするコントロール信号を生成するよう動作可能なアービトレーションコントロールロジックとを含んだことを特徴とするコンピュータシステム。 - 前記高速リンク群は、光学的通信リンクを含むことを特徴とする請求項24に記載のコンピュータシステム。
- 前記メモリデバイス群の少なくとも幾つかは、複数のSDRAMを含むことを特徴とする請求項24に記載のコンピュータシステム。
- 前記プロセッサーは、中央処理装置(CPU)を含むことを特徴とする請求項24に記載のコンピュータシステム。
- ローカルおよびダウンストリームメモリ応答群の各々は、前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを含むことを特徴とする請求項24に記載のコンピュータシステム。
- 複数のメモリモジュール群を含むメモリシステムにおいて、各メモリモジュールは、メモリデバイス群と連結されたメモリハブを含み、各メモリモジュールの前記メモリハブにおけるメモリ応答群を処理しフォワードする方法は、
メモリ要求群であって、各メモリ要求がメモリ要求識別子を有し、前記メモリ要求群は、前記メモリハブへ接続されたメモリデバイス群に向かうローカルメモリ要求群と他のメモリモジュール群のメモリハブ群に連結されたメモリデバイス群に向かうリモートメモリ要求群とを含むメモリ要求群を受信するステップと、
前記メモリ要求識別子群を格納するステップと、
前記メモリデバイス群から受信されたローカルメモリ応答群を前記ローカルメモリ要求群に応答して格納するステップと、
前記他のメモリモジュール群から受信されたリモートメモリ応答群を前記リモートメモリ要求群に応答して格納するステップと、
少なくとも一つのハブにおいて、格納されたメモリ要求識別子群の年齢に基づいたアービトレーションアルゴリズムをアップストリームメモリモジュールに前記格納されたローカルおよびリモートメモリ応答群がフォワードされる順番を決定するために適用するステップと、
決定された前記順番に従って、前記ローカルおよびリモートメモリ応答群をフォワードするステップとを備えることを特徴とする方法。 - 前記ローカルおよびリモートメモリ応答群の各々は、前記メモリ応答に対応するメモリ要求を識別するデータとヘッダーとを含むことを特徴とする請求項29に記載の方法。
- 最も古い格納されたメモリ要求識別子に基づいて前記順番を示すコントロール信号を生成するステップをさらに備えることを特徴とする請求項29に記載の方法。
- 前記メモリ要求識別子は、先入れ先出し(FIFO)の原則で格納されアクセスされることを特徴とする請求項29に記載の方法。
- 最も古い格納されたメモリ要求がローカルメモリ要求であるとき、ローカルメモリ応答が、フォワードされるようにコントロール信号を生成するステップをさらに備えることを特徴とする請求項29に記載の方法。
- 前記パケットメモリに連結したパケット追跡器であって、前記パケットメモリは、前記リモートメモリ応答群を受信し、受信された各リモートメモリ応答を前記パケットメモリに格納されたメモリ要求識別子と関連させるように動作可能で、前記パケット追跡器は、前記メモリ要求識別子を前記パケットメモリから削除させるように動作可能なパケット追跡器をさらに備えたことを特徴とする請求項1に記載のメモリハブ。
- 前記リモートメモリ応答群を受信するように適合され、各リモートメモリ応答をメモリ要求識別子と関連させるよう動作可能で、前記パケットメモリから前記メモリ要求識別子を削除するように動作可能なパケット追跡器をさらに備えたことを特徴とする請求項11に記載のメモリモジュール。
- 前記リモートメモリ応答群を受信するように適合され、各リモートメモリ応答をメモリ要求識別子と関連させるよう動作可能で、前記パケットメモリから前記メモリ要求識別子を削除するように動作可能なパケット追跡器をさらに備えたことを特徴とする請求項17に記載のメモリシステム。
- 前記リモートメモリ応答群を受信するように適合され、各リモートメモリ応答をメモリ要求識別子と関連させるよう動作可能で、前記パケットメモリから前記メモリ要求識別子を削除するように動作可能なパケット追跡器をさらに備えたことを特徴とする請求項24に記載のコンピュータシステム。
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