JP3497067B2 - レギュレータ回路 - Google Patents
レギュレータ回路Info
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Description
いて出力を安定、調整するレギュレーター回路に関す
る。 【０００２】 【従来の技術】従来のボルテージレギュレータの回路と
して図２に示すような回路が知られていた。ボルテージ
レギュレータ １１０は電圧分割回路１２０、エラーア
ンプ１０１、基準電圧回路１０２、Ｐチャネルトランジ
スター１０４などから構成されている。また負荷１０５
は出力電圧端子１３０と接地端子１３３間に接続されて
いる。 【０００３】出力電圧端子１３０と接地端子１３３間に
電圧分割回路１２０が接続されている。電圧分割回路１
２０は端子電圧ＶＯＵＴに比例した電圧を取り出すため
の回路である。端子１３１の入力電圧ＳＴＲＢによって
スイッチ回路１２１をＯＮ／ＯＦＦさせると電圧分割回
路１２０の分割抵抗比が変化し、その結果端子電圧ＶＯ
ＵＴを変化させることが出来る。スイッチ回路１２１は
バイポーラ、ＣＭＯＳなどのデバイスは問わない。 【０００４】基準電圧回路１０２は一定の電圧を出力す
る回路である。端子電圧ＶＯＵＴは、電圧分割回路１２
０で適当な電圧値に分圧された後、エラーアンプ１０１
のプラス端子に入力される。一方マイナス端子には基準
電圧回路１０２の出力が入力される。エラーアンプ１０
１は両者の差電圧を増幅してトランジスタ１０４の抵抗
値を制御し、レギュレータの出力を一定電圧に保つよう
に調整する。 【０００５】またスイッチ回路１２１をＯＮ／ＯＦＦさ
せ、抵抗Ｒ3をショートするかしないかを選択して電圧
分割回路１２０の分圧抵抗比を変えることによって、異
なった端子電圧ＶＯＵＴを出力することが出来る。スイ
ッチ回路１２１のＯＮ／ＯＦＦは端子１３１の入力電圧
ＳＴＲＢによって変化する。端子１３１の入力電圧ＳＴ
ＲＢがハイレベル、ローレベルどちらでスイッチ回路１
２１がＯＮ／ＯＦＦするかは任意である。 【０００６】端子電圧ＶＯＵＴはスイッチ回路１２１の
ＯＮ／ＯＦＦによって次に示す（１）式、（２）式のよ
うになる。 Ｖｏｕｔ１ ＝ （（Ｒ１＋Ｒ２＋Ｒ３）／Ｒ１）×Ｖｒｅｆ （１） Ｖｏｕｔ２ ＝ （（Ｒ１＋Ｒ２）／Ｒ１）×Ｖｒｅｆ （２） ここで、Ｒ１，Ｒ２，Ｒ３はそれぞれ図2のＲ１，Ｒ
２，Ｒ３の抵抗値であり、Ｖｒｅｆは基準電圧回路１０
２の出力電圧である。また（１）式はスイッチ回路１２
１をＯＦＦしたときの端子電圧ＶＯＵＴであり、（２）
式はスイッチ回路１２１をＯＮしたときの端子電圧ＶＯ
ＵＴである。 【０００７】 【発明が解決しようとする課題】しかし従来のボルテー
ジレギュレータでは、出力電圧を変化させる際、スイッ
チ回路によって電圧分割回路の分圧抵抗比を変えるた
め、エラーアンプの入力が短時間に大きく変化する。そ
の結果エラーアンプの出力が極端に大きく変化し、レギ
ュレータの出力電圧にオーバーシュートまたはアンダー
シュートを引き起こす。 【０００８】そこでこの発明の目的は従来のこのような
問題点を解決するために、電圧分割回路の分圧抵抗比を
スイッチ回路を用いて出力を変化させるときに、エラー
アンプの入力をゆっくり変化させるようにし、レギュレ
ータの出力電圧にオーバーシュート、アンダーシュート
を発生させにくくすることを目的としている。 【０００９】 【課題を解決するための手段】上記問題点を解決するた
めに本発明は、電圧分割回路とエラーアンプの入力の間
にロ−パスフィルター回路を挿入し、電圧分割回路の抵
抗比を変化させてから、一定時間だけ前記ロ−パスフィ
ルター回路を動作させ、エラーアンプへの入力電圧の変
化を緩やかにすることで問題点を解決した。 【００１０】 【発明の実施の形態】電圧分割回路とエラーアンプの入
力の間にロ−パスフィルター回路を挿入し、電圧分割回
路の抵抗比を変化させてから、一定時間だけ前記ロ−パ
スフィルター回路を動作させ、エラーアンプへの入力電
圧の変化を緩やかにする。 【００１１】 【実施例】以下に本発明の実施例を図面に基づいて説明
する。図１は本発明のボルテージレギュレータ回路の第
１の実施例の回路ブロック図である。ボルテージレギュ
レータ回路１１０を構成する回路のうち、電圧分割回路
１２０、エラーアンプ１０１、基準電圧回路１０２、Ｐ
ＭＯＳトランジスタ１０４、レギュレータとしての負荷
１０５は従来と同様である。電圧分割回路１２０とエラ
ーアンプ１０１のプラス端子の間には、端子１３１の入
力電圧ＳＴＲＢによって一定時間ＯＮされるローパスフ
ィルター回路１４０が挿入されている。 【００１２】端子１３１の入力電圧ＳＴＲＢによって、
一定時間ＯＮさせるローパスフィルター回路１４０はコ
ンデンサー１４１、スイッチ回路１４２、単安定マルチ
バイブレータ回路１４３、抵抗１４４からなる。コンデ
ンサー１４１の一端は接地端子１３３に接続され、他端
はスイッチ回路１４２に接続されている。通常コンデン
サー１４１はスイッチ回路１４２によって基準電圧回路
１０２と接続され、基準電圧回路１０２の出力電圧と同
電位に充電されている。端子１３１に入力電圧ＳＴＲＢ
が入ると、電圧分割回路１２０のスイッチ回路１２１が
ＯＮ／ＯＦＦすると同時に単安定マルチバイブレータ回
路１４３が動作し、その出力で一定時間だけコンデンサ
ー１４１をエラーアンプ１０１のプラス端子と接地端子
１３３間に接続する。 【００１３】エラーアンプ１０１のプラス端子電圧をＶ
ｂとすると、端子１３１に入力信号ＳＴＲＢが入りコン
デンサー１４１がエラーアンプ１０１のプラス端子に接
続されたとき、プラス端子電圧Ｖｂはコンデンサー１４
１と抵抗１４４で構成されるローパスフィルターの時定
数に従って滑らかに変化する。図４は端子１３１を
“Ｌ”から“Ｈ”変化させた時の各端子の電圧変化を示
したものである。ここでは端子１３１が“Ｈ”になると
スイッチ回路１２１がＯＮする場合について示してい
る。これに比較して、従来のボルテージレギュレータの
端子１３１の入力電圧ＳＴＲＢを変化させた時の各端子
の電圧変化を図3に示す。 【００１４】図４よりエラーアンプ１０１の出力Ｖｅの
オーバーシュート、アンダーシュートは大幅に軽減され
ることになる。またエラーアンプ１０１のプラス端子に
コンデンサー１４１を接続するのは電圧分割回路１２０
の抵抗値をスイッチで切り替える短時間だけ、すなわち
単安定マルチバイブレータ１４３が動作している間のみ
であり、単安定マルチバイブレータ１４３がＯＦＦして
からは、従来のボルテージレギュレータと同じで、エラ
ーアンプ１０１のプラス端子への入力に対する出力の応
答性は落ちない。また端子１３１の入力電圧ＳＴＲＢを
“Ｈ”から“Ｌ”に変化させたときにも、一定時間単安
定マルチバイブレータを動作せることで同様の効果が得
られることは明らかである。 【００１５】図５は本発明のスイッチングレギュレータ
回路の第２の実施例の回路ブロック図である。電圧分割
回路１２０、エラーアンプ１０１、基準電圧回路１０
２、ＮＭＯＳトランジスタ１０３、ローパスフィルター
回路１４０等で構成されている。ローパスフィルター１
４０以外は従来のスイッチングレギュレータ回路と同じ
である。実際はコイル、ダイオード、コンデンサー等が
他に接続されているが、ここでは、それらを含めた動作
説明は割愛する。 【００１６】ＰＷＭコンパレータ１０６はＮＭＯＳトラ
ンジスタ１０３をＯＮ／ＯＦＦ制御する回路である。エ
ラーアンプ１０１の出力と発振回路１０７の出力をＰＷ
Ｍコンパレータ１０６が比較することによって、ＮＭＯ
Ｓトランジスタ１０３をＯＮ／ＯＦＦするパルス幅を調
整し、レギュレータの出力は一定電圧になるように調整
される。 【００１７】ローパスフィルター回路１４０の動作は実
施例1の時と同じように、端子１３１の入力電圧ＳＴＲ
Ｂが“Ｌ”または“Ｈ”に変化した場合、図4で示すよ
うにコンデンサー１４１の働きでエラーアンプのプラス
端子における入力の変化は緩やかになり、エラーアンプ
のオーバーシュート、アンダーシュートは軽減する。ス
イッチングレギュレータ回路でも本発明のレギュレータ
回路を用いることで、出力電圧を変化させた時のオーバ
ーシュート、アンダーシュートが軽減することは明らか
である。 【００１８】 【発明の効果】本発明のレギュレータ回路は、出力電圧
を電圧分割回路の分圧抵抗比をスイッチ回路を用いて変
化させたとき、エラーアンプの入力に一定時間ローパス
フィルターを挿入することで、出力電圧変化時のオーバ
ーシュート、アンダーシュートを抑制できるという効果
がある。
回路の説明図である。 【図２】従来のボルテージレギュレータ回路の説明図で
ある。 【図３】従来のボルテージレギュレータの端子１３１の
入力電圧ＳＴＲＢ変化時の動作説明図である。 【図４】本発明の端子１３１の入力電圧ＳＴＲＢ変化時
の説明図である。 【図５】本発明の第２の実施例の スイッチングレギュ
レータ回路の説明図である。 【符号の説明】 １０１ エラーアンプ １０２ 基準電圧回路 １０３ ＮＭＯＳトランジスタ １０４ ＰＭＯＳトランジスタ １０５ 負荷 １０６ ＰＷＭコンパレータ １０７ 発振回路 １１０ レギュレータ回路 １２０ 電圧分割回路 １２１ スイッチ回路 １３０ 出力電圧端子 １３１ ストロボ端子 １３２ コントロール端子 １３３ 接地端子 １３４ 入力電圧端子 １４０ ローパスフィルター回路 １４１ コンデンサー １４２ スイッチ回路 １４３ 単安定マルチバイブレータ回路 １４４ 抵抗
Claims (1)
- (57)【特許請求の範囲】 【請求項１】 基準電圧とブリーダ抵抗より成る電圧分
割回路の出力電圧との差電圧を増幅するエラーアンプ
と、 前記ブリーダ抵抗の抵抗値を変えるためのスイッチ手段
と、 前記スイッチ手段で前記ブリーダ抵抗の抵抗値を変化さ
せる際に、前記出力電圧の変化を緩やかにして、前記エ
ラーアンプに出力するためのローパスフィルタとからな
り、 前記ローパスフィルタは、前記スイッチ手段にて前記電
圧分割回路の抵抗値を変化させた時に、単安定マルチバ
イブレータ回路を動作させ、前記単安定マルチバイブレ
ータ回路の出力で一定時間だけ容量を前記エラーアンプ
の入力に接続することで、前記エラーアンプの入力を徐
々に変化させることを特徴とするレギュレータ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27918497A JP3497067B2 (ja) | 1997-10-13 | 1997-10-13 | レギュレータ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27918497A JP3497067B2 (ja) | 1997-10-13 | 1997-10-13 | レギュレータ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11119845A JPH11119845A (ja) | 1999-04-30 |
| JP3497067B2 true JP3497067B2 (ja) | 2004-02-16 |
Family
ID=17607619
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27918497A Expired - Lifetime JP3497067B2 (ja) | 1997-10-13 | 1997-10-13 | レギュレータ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3497067B2 (ja) |
Families Citing this family (4)
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|---|---|---|---|---|
| JP3494635B2 (ja) | 2001-09-19 | 2004-02-09 | 沖電気工業株式会社 | 内部降圧電源回路 |
| JP3818231B2 (ja) | 2002-07-12 | 2006-09-06 | 株式会社デンソー | 電源回路 |
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-
1997
- 1997-10-13 JP JP27918497A patent/JP3497067B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
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| JPH11119845A (ja) | 1999-04-30 |
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