JP3424526B2 - Electronic component mounting method - Google Patents

Electronic component mounting method

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JP3424526B2
JP3424526B2 JP29064197A JP29064197A JP3424526B2 JP 3424526 B2 JP3424526 B2 JP 3424526B2 JP 29064197 A JP29064197 A JP 29064197A JP 29064197 A JP29064197 A JP 29064197A JP 3424526 B2 JP3424526 B2 JP 3424526B2
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  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Manufacturing Of Printed Wiring (AREA)
  • Wire Bonding (AREA)

Description

【発明の詳細な説明】 【0001】 【発明の属する技術分野】本発明は電子部品の実装方法
に関するものである。 【0002】 【従来の技術】近年、半導体製品の小型化・高機能化に
伴い、BGA(Ball GridArray)・CS
P(Chip Size Package)等のように
実装面に半田ボールの形成された裏面接合タイプの電子
部品を実装基板上に実装することが多くなっている。 【0003】ここで、このような裏面接合タイプの電子
部品が実装される実装基板の構造について説明する。 【0004】図11(a)は従来の実装基板を示す斜視
図、図11(b)は図11(a)の一部を拡大して示す
斜視図である。また、図12は図11(a)におけるXI
I−XII線に沿った断面図である。 【0005】図11(a)に示すように、実装基板10
1は絶縁性を有する基材102を有している。基材10
2上にはソルダーレジスト103が積層されている。こ
のソルダーレジスト103に覆われるようにして配線1
05が基材102上に形成されている。そして、ランド
104がソルダーレジスト103から露出して配線10
5と一体に形成されている。 【0006】図11(b)に示すように、ランド104
はソルダーレジスト103に形成された貫通孔から露出
しており、ソルダーレジスト103は所定量の隙間を空
けてランド104の周囲を包囲している。そして、図1
2に示すように、相互に一体に形成されたランド104
と配線105の上面は同一平面上にあり、断面において
両者の境界ははっきりしていない。 【0007】このように構成された従来の実装基板に電
子部品を実装した場合について説明する。 【0008】図13は図11の実装基板に裏面接合タイ
プの電子部品が実装された状態を示す断面図である。 【0009】図13に示すように、裏面接合タイプの電
子部品6の裏面には、電子部品6とランド104とを電
気的・機械的に接続する半田ボール7が形成されてい
る。そして、一般にランド104の直径は半田ボール7
の直径よりも小さいため、ランド104は半田ボール7
によってその全体が覆われる構造になる。したがって、
ランド104の配線105と反対方向における半田ボー
ル7との境界部Aにおける半田ボール7とランド104
とでなす界面角αは鈍角となる。一方、ランド104の
上面と配線5の上面は同一平面であるために半田ボール
7は配線5の上面に向けて濡れようとするが、レジスト
103が妨げとなる。したがって、ランド104の配線
方向における半田ボール7との境界部Bにおける半田ボ
ール7とランド104とでなす界面角βは鋭角となる。 【0010】ところで、半導体製品の実際の使用時や信
頼性試験時に半田ボール7とランド104とで構成され
る接合部が高温あるいは低温になると、電子部品6と基
材102との線膨張係数の差により接合部に熱応力が生
じる。ここで、熱応力について説明する。 【0011】図14は図13における半田ボールと実装
基板との接合部に作用する熱応力を示す説明図である。 【0012】図14に示すように、熱応力の作用時には
相対的に接合部に対して剪断力Fが作用する。この剪断
力Fは材料内部で剪断応力τとなり、半田ボール7とラ
ンド104との界面に剪断応力τが作用することにな
る。図14において、実装基板101の平面に沿った方
向にx軸を、平面と直交する方向にy軸をとると、x軸
方向の面には剪断応力τyxが、y軸方向の面には剪断応
力τxyがそれぞれ作用する。 【0013】 【発明が解決しようとする課題】ここで、前述した境界
部Aにおける界面角αが鈍角となり、境界部Bにおける
界面角βが鋭角となっているので、境界部Bにおいて界
面角βが鋭角となる界面端が存在する。異種材の界面端
の応力場は界面角が小さいほど応力集中が生じ、鋭角の
場合には応力特異場となる。そして、応力特異場では熱
応力作用時に極度の応力集中を生じる。 【0014】このため、実使用時あるいは信頼性試験時
において繰り返し熱応力が作用した場合や実装時の半田
溶融温度からの冷却過程において、鋭角となった界面端
βで剪断応力τyxによる極度の応力集中を生じ、境界部
Bに亀裂が生じる。これでは、実装信頼性が著しく損な
われてしまう。 【0015】特に、電子部品6と基材102の膨張方向
と配線105の延在方向が一致する場合には亀裂の発生
が顕著になるので、これを防止するためには配線105
の引き回し方向に制約が生じ、自由度の高い配線設計が
できなくなっていた。 【0016】そこで、本発明は、半田ボールとランドと
の接合により生じる熱応力に起因した亀裂の発生を防止
することのできる実装基板についての技術を提供するこ
とを目的とする。 【0017】 【課題を解決するための手段】この課題を解決するため
に、本発明は、絶縁性を有する基材上に形成された配線
と、前記基材および前記配線を覆うソルダーレジスト
と、前記配線から連続し且つ前記ソルダーレジストから
突出して形成されるとともに前記ソルダーレジストによ
り側面が所定の高さにわたって隙間なく包囲され、前記
半田ボールが固定されるランドとを有し、前記半田ボー
ルが突出した前記ランドの側面全周を覆い得るようにし
た実装基板を用意し、前記ランドに対応した位置に貫通
孔が形成されるとともに前記実装基板を取り付けた際に
おける前記ランドとの干渉を避ける回避部が少なくとも
前記貫通孔の周囲に形成されたプレートを用意し、前記
ランドが前記貫通孔から露出するように位置合わせして
前記プレートを前記実装基板に取り付け、前記貫通孔内
に半田ペーストを充填した後に前記プレートを前記実装
基板から取り外し、一方面に半田ボールの形成された電
子部品を、前記半田ペーストが形成された前記ランドに
前記半田ボールを位置合わせして搭載し、前記ランドの
側面全周を覆うように前記半田ボールと前記半田ペース
トとをリフローするようにしたものである。 【0018】これにより、半田ボールとランドとでなす
界面角は全ての箇所で鈍角になるので、半田ボールとラ
ンドとの接合により熱応力が生じた場合にも亀裂が発生
しない。 【0019】 【0020】 【0021】 【0022】 【0023】 【0024】 【0025】 【0026】【発明の実施の形態】 以下、本発明の実施の形態につい
て、図1から図10を用いて説明する。なお、これらの
図面において同一の部材には同一の符号を付しており、
また、重複した説明は省略されている。 【0027】(実施の形態1)図1は本発明の一実施の
形態における実装基板を示す断面図、図2は図1の実装
基板に電子部品が実装された状態を示す断面図、図3は
図2における熱応力の作用を示す説明図、図4は図1の
実装基板の製造プロセスを連続して示す断面図である。 【0028】図1に示すように、本実施の形態の実装基
板1は、たとえばガラス布基材エポキシ樹脂積層板等で
構成された絶縁性を有する基材2を有している。基材2
上には、たとえば銅から構成されて所定の形状を有する
配線5が形成されている。そして、配線5および配線5
の形成されていない箇所の基材2を覆うようにしてソル
ダーレジスト3が積層されている。 【0029】配線5から連続し、且つソルダーレジスト
3から突出して、後述する電子部品の半田ボールが接合
されるランド8が形成されている。したがって、ランド
8の高さは配線5の高さよりも高くなっている。そし
て、たとえば円形の形状を有するこのランド8は、ソル
ダーレジスト3によりその側面が所定の高さにわたって
隙間なく包囲されている。 【0030】このような構造を有する本実施の形態の実
装基板に裏面接合タイプの電子部品を実装した場合につ
いて説明する。 【0031】図2に示すように、たとえばBGA・CS
P等の裏面接合タイプの電子部品6の裏面には、電子部
品6とランド8とを電気的・機械的に接続する半田ボー
ル7が形成されている。そして、ランド8と半田ボール
7とが接合したときにランド8の全体が半田ボール7に
よって覆われるように、ランド8の直径は半田ボール7
の直径よりも小さくなっている。 【0032】ここで、前述のように、ランド8の側面は
ソルダーレジスト3によって隙間なく包囲され、ランド
8はソルダーレジスト3より突出した形状になってい
る。したがって、図示するように、ランド8に接合され
た半田ボール7は、配線5の方向とは無関係にランド8
の上面全体から側面の全周を覆う。これにより、ランド
8と半田ボール7との境界部分は、基材2の表面に対し
て垂直に延びるランド8の側面に形成される。このた
め、半田ボール7とランド8とでなす界面角は、配線方
向以外の境界部Aの界面角αのみならず、配線方向の境
界部Bの界面角βにおいても鈍角になる。すなわち、半
田ボール7とランド8のなす界面角は全ての箇所におい
て鈍角になる。 【0033】このような接合形状における熱応力の作用
について以下に説明する。実際の使用時や信頼性試験時
などにおける熱応力作用時には、図3に示すように、相
対的に接合部に対して剪断力Fが作用する。そして、剪
断力Fは材料内部で剪断応力τとなり、半田ボール7と
ランド8の界面にこの剪断応力τが作用する。 【0034】ここで、前述のように、半田ボール7とラ
ンド8とでなす界面角は、全ての箇所において鈍角とな
っているので、実装基板1の平面に沿った方向にx軸
を、平面と直交する方向にy軸をとると、剪断応力τは
y軸方向の面に作用する剪断応力τxyのみとなる。 【0035】したがって、熱応力が作用した場合でも応
力特異場が形成されて極度の応力集中が生じることがな
くなり、半田ボール7とランド8との接合により熱応力
が生じた場合にも亀裂が発生しない。また、配線5の方
向とは無関係に半田ボール7とランド8とでなす界面角
は鈍角になるので、配線5を任意の方向に引き回すこと
ができる。 【0036】次に、このような構造を有する実装基板1
の製造方法について図4を参照して説明する。 【0037】先ず、図4(a)に示すように、基材2お
よびこの基材2に導体である銅箔(薄膜)10が形成さ
れた銅張り積層板9を用意する。なお、銅箔10の厚さ
は後述する配線5の厚さのたとえば約2倍から3倍であ
る。 【0038】次に、図4(b)に示すように、ドライフ
ィルムフォトレジスト等からなりエッチング時にエッチ
ング不要部を保護するためのエッチングマスク11を銅
箔10の上面のランド形成位置に形成する。そして、図
4(c)に示すように、ランド形成位置を残して、銅箔
10を深さ方向に所定量ハーフエッチングを行い、必要
な配線高さにする。これにより、ランド8が形成され
る。ここで、必要な配線高さとは一般に9μmから18
μmである。なお、エッチングにはたとえば塩化鉄や塩
化銅等が用いられる。 【0039】次に、図4(d)に示すように、ランド8
および配線形成位置上にエッチングマスク11を形成す
る。このとき、ランド8の形成時に用いられたエッチン
グマスク11は、前もって除去していてもいなくても良
い。 【0040】次に、図4(e)に示すように、ランド8
と配線形成位置を残して銅箔10をエッチングにて完全
に除去する。これにより、ランド8に連続する配線5が
形成される。 【0041】ランド8および配線5が形成されたなら
ば、図4(f)に示すように、エッチングマスク11の
除去を行う。 【0042】最後に、図4(g)に示すように、ランド
8が突出するようにして、基材2および配線5上にソル
ダーレジスト3を形成する。ここで、ソルダーレジスト
3はランド8の側面まで隙間なく形成するとともに、ラ
ンド8はソルダーレジスト3の上面からたとえば5μm
以上突出するようにする。 【0043】このようにして、図1に示す実装基板1が
製造される。 (実施の形態2)図5は本発明の他の実施の形態におけ
る実装基板の製造プロセスを連続して示す断面図であ
る。 【0044】本実施の形態においては、ランド8が配線
5の材質である銅とメッキ性の良い金属、たとえば、半
田やニッケル等で形成されたものである。 【0045】このような構造を有する実装基板の製造方
法について説明する。先ず、前述した実施の形態1の場
合と同様に、図5(a)に示すように、基材2およびこ
の基材2に導体である銅箔(薄膜)10が形成された銅
張り積層板9を用意する。なお、銅箔10をハーフエッ
チングすることなくそのまま配線5の厚さとする本実施
の形態の場合では、銅箔10の厚さはたとえば9μmか
ら18μmとなっている。 【0046】次に、図5(b)に示すように、銅箔10
の上面のランド形成位置および配線形成位置にエッチン
グマスク11を形成する。なお、このとき、ランド形成
位置のエッチングマスク11の寸法はランド8の寸法よ
り小さくても良い。 【0047】次に、図5(c)に示すように、ランド形
成位置および配線形成位置を残して銅箔10を完全に除
去し、その後、図5(d)に示すように、エッチングマ
スク11を除去する。これにより、配線5が形成され
る。 【0048】次に、図5(e)に示すように、配線の一
部をなすランド形成位置以外にメッキマスク12を形成
する。ランド形成位置はメッキマスク12に形成された
開口部13から露出した状態にする。そして、図5
(f)に示すように、開口部13内をメッキで充填する
ようにしてランド8を形成する。なお、このようにラン
ド8をメッキにて形成するために、メッキマスク12に
はメッキ耐性のある高分子材料などが用いられる。この
ようにしてランド8を形成した後に、図5(g)に示す
ように、メッキマスク12を除去する。 【0049】最後に、図5(h)に示すように、ランド
8が突出するようにして、基材2および配線5上にソル
ダーレジスト3を形成する。ここで、本実施の形態にお
いても、ソルダーレジスト3はランド8の側面まで隙間
なく形成するとともに、ランド8はソルダーレジスト3
の上面からたとえば5μm以上突出するようにする。 【0050】このように、配線5上にランド8を形成す
るようにしてもよい。そして、配線5上にランド8を形
成するようにすれば、銅箔10の厚さがそのまま配線5
の厚さになるので、厚い特殊仕様の銅張り積層板を用い
る必要がない。 【0051】なお、ランド8は、メッキではなく、金属
のペースト材を用いて形成することもできる。この場合
には、前述したメッキによるランド形成のプロセスがペ
ースト塗布によるランド形成のプロセスになり、開口部
13にペースト材を塗布することでランド8が形成され
る。 【0052】(実施の形態3)図6は本発明のさらに他
の実施の形態における実装基板の製造プロセスを連続し
て示す断面図である。 【0053】本実施の形態においては、ランド8および
配線5がともに銅により形成されたものである。なお、
このような構造を有する実装基板の製造方法において、
図6(a)〜(e)に示す工程および図6(g),
(h)に示す工程は実施の形態2における図5(a)〜
(e)に示す工程および図5(g),(h)に示す工程
と同様である。したがって、図6(f)に示す工程のみ
について説明する。 【0054】すなわち、図6(f)に示すように、開口
部13内を配線5の材質と同じ銅メッキで充填するよう
にしてランド8を形成するものである。なお、本実施の
形態においても、ランド8をペースト材により形成する
ことができる。 【0055】このように、ランド8と配線5の材質を同
じ銅にすると、ランド8と配線5との間の剥離強度が大
きくなる。 【0056】(実施の形態4)図7は本発明のさらに他
の実施の形態における実装基板の製造プロセスを連続し
て示す断面図である。 【0057】本実施の形態においては、あらかじめ配線
パターンが構成された実装基板を用意し、これに突出し
たランド8を形成するものである。 【0058】つまり、図7(a)に示すように、基材2
および配線5がソルダーレジスト3に覆われ、基材2を
覆うソルダーレジスト3との間に隙間を空けて配線5と
同じ高さに露出形成された陥没ランドを有する実装基板
を用意する。 【0059】次に、図7(b)に示すように、ランド形
成位置以外にメッキマスク12を形成する。そして、ラ
ンド形成位置には開口部13を形成しておく。 【0060】次に、図7(c)に示すように、開口部1
3内をメッキで充填し、ランド8を形成する。このと
き、ランド8がソルダーレジスト3の上面からたとえば
5μm以上突出するまでメッキを成長させる。なお、ラ
ンド8は、配線5の材質である銅とメッキ性の良い金
属、たとえば、半田やニッケル等で構成される。 【0061】そして、図7(d)に示すように、最後に
メッキマスク12を除去すると、ランド8の突出した実
装基板が得られる。 【0062】このようにすれば、従来の実装基板を用い
てランド8の突出した亀裂の発生しない実装基板を作成
することができる。 【0063】なお、ここにおいても、ランド8は、メッ
キではなく、金属のペースト材を用いて形成することも
できる。この場合には、前述したメッキによるランド形
成のプロセスがペースト塗布によるランド形成のプロセ
スになり、開口部13にペースト材を塗布することでラ
ンド8が形成される。 【0064】(実施の形態5)図8は本発明のさらに他
の実施の形態における実装基板の製造プロセスを連続し
て示す断面図である。 【0065】本実施の形態においては、ランド8および
配線5がともに銅により形成されたものである。なお、
この実施の形態5に示す実装基板の製造方法において、
図8(a),(b),(d)に示す工程は前述の実施の
形態4における図7(a),(b),(h)に示す工程
と同様である。したがって、ここでは図8(c)に示す
工程のみについて説明する。 【0066】すなわち、図8(c)に示すように、開口
部13内を配線5の材質と同じ銅メッキで充填するよう
にしてランド8を形成するものである。なお、本実施の
形態においても、ランド8をペースト材により形成する
ことができる。 【0067】このように、ランド8と配線5の材質を同
じ銅にすると、従来の実装基板を用いてランド8の突出
した亀裂の発生しない実装基板を作成することが可能に
なることに加えて、ランド8と配線5との間の剥離強度
が大きくなる。 【0068】(実施の形態6)図9は本発明の一実施の
形態における電子部品実装用のプレートを示す断面図、
図10は図9のプレートを用いて電子部品を実装基板に
実装して行くプロセスを連続して示す断面図である。 【0069】図9に示すプレート15はたとえばステン
レス等の金属で形成されている。プレート15には、実
装基板1のランド8に対応した位置に貫通孔16が形成
されており、プレート15を実装基板1に位置合わせし
て貫通孔16内に半田ペーストが充填される。なお、こ
の貫通孔16の直径はランド8の直径より小さくなって
いる。 【0070】貫通孔16の周囲には、ランド8とプレー
ト15との干渉を避けるためにプレート15の裏面をハ
ーフエッチングした回避部17が形成されている。な
お、回避部17のハーフエッチング深さは、ランド8の
ソルダーレジスト3からの突出寸法と同じになってい
る。 【0071】このようなプレート15を用いて電子部品
を実装基板に実装して行く手順を説明する。 【0072】先ず、図10(a)に示すように、ランド
8が貫通孔16から露出するように位置合わせしてプレ
ート15を実装基板に取り付ける。ここで、プレート1
5に形成された回避部17のハーフエッチング深さは、
ランド8がソルダーレジスト3の上面から突出している
寸法と同じとなっているので、ランド8がプレート15
を突き上げることによるプレート15の反りは発生しな
い。また、貫通孔16の直径はランド8の直径より小さ
く、回避部17のハーフエッチング深さがランド8の突
出寸法と同じでなので、貫通孔16とランド8の上面と
の間には隙間が存在しない。これにより、半田ペースト
18が回避部17に入り込んで隣接するランド8との間
に短絡を生じる恐れもない。 【0073】そして、この状態でスキージ19を用いて
半田ペースト18を貫通孔に充填する)。 【0074】次に、図10(b)に示すようにプレート
15を実装基板1から取り外すと、ランド8の上面にの
み半田ペースト18が印刷された状態となる。 【0075】このように半田ペースト18をランド8上
に形成したならば、図10(c)に示すように、半田ボ
ール7が半田ペースト18の印刷されたランド8上に位
置するようにして裏面接合タイプの電子部品6を実装基
板1上に搭載する。このとき、印刷された半田ペースト
18の厚さの50%以上の深さまで半田ボール7が入り
込むまで電子部品6を実装基板1側に押圧する。これに
より、半田ペースト18はランド8の上面からはみ出し
て、ランド8の側面を取り囲む形状となる。 【0076】最後に、図10(d)に示すように、リフ
ロー装置によって半田ボール7と半田ペースト18とを
溶融、冷却すると、半田ペースト18が半田ボール7に
吸収されて突出したランド8の側面を取り囲んだ形状の
半田ボール7が形成される。 【0077】これにより、半田ボール7とランド8とで
なす界面角は全ての箇所で鈍角になり、半田ボール7と
ランド8との接合により熱応力が生じた場合にも亀裂は
発生しない。 【0078】 【発明の効果】以上のように、本発明によれば、ランド
を突出形成することによって半田ボールによって電子部
品を実装基板に実装した際に、半田ボールが突出したラ
ンドの側面を全周にわたって覆うようにしているので、
半田ボールとランドとでなす界面角は全ての箇所で鈍角
になる。これにより、半田ボールとランドとの接合によ
り熱応力が生じた場合にも、当該熱応力による亀裂は発
生しないという有効な効果が得られる。 【0079】また、ランドおよび配線をともに銅で構成
することにより、ランドと配線間の剥離強度を大きくす
ることができるという有効な効果が得られる。
BACKGROUND OF THE INVENTION [0001] [Technical Field of the Invention The present invention relates to method for mounting electronic components. 2. Description of the Related Art In recent years, as semiconductor products have become smaller and more sophisticated, BGA (Ball Grid Array) CS
2. Description of the Related Art An electronic component of a back surface bonding type having a solder ball formed on a mounting surface, such as P (Chip Size Package), is often mounted on a mounting substrate. Here, the structure of a mounting board on which such a back surface bonding type electronic component is mounted will be described. FIG. 11A is a perspective view showing a conventional mounting board, and FIG. 11B is an enlarged perspective view showing a part of FIG. 11A. FIG. 12 shows the XI in FIG.
It is sectional drawing along the I-XII line. [0005] As shown in FIG.
1 has a base material 102 having an insulating property. Base material 10
2, a solder resist 103 is laminated. The wiring 1 is covered with the solder resist 103.
05 is formed on the base material 102. Then, the land 104 is exposed from the solder resist 103 and the wiring 10
5 are formed integrally. [0006] As shown in FIG.
Are exposed from the through holes formed in the solder resist 103, and the solder resist 103 surrounds the periphery of the land 104 with a predetermined gap. And FIG.
As shown in FIG. 2, the lands 104 are formed integrally with each other.
And the upper surface of the wiring 105 are on the same plane, and the boundary between them is not clear in the cross section. A case in which electronic components are mounted on a conventional mounting board configured as described above will be described. FIG. 13 is a cross-sectional view showing a state in which a back surface bonding type electronic component is mounted on the mounting board of FIG. As shown in FIG. 13, a solder ball 7 for electrically and mechanically connecting the electronic component 6 and the land 104 is formed on the back surface of the electronic component 6 of the back surface bonding type. In general, the diameter of the land 104 is
Is smaller than the diameter of the solder ball 7.
The entire structure is thereby covered. Therefore,
The solder ball 7 and the land 104 at the boundary A between the land 105 and the solder ball 7 in the direction opposite to the wiring 105
Is an obtuse angle. On the other hand, since the upper surface of the land 104 and the upper surface of the wiring 5 are flush with each other, the solder ball 7 tends to wet toward the upper surface of the wiring 5, but the resist 103 hinders. Therefore, the interface angle β between the solder ball 7 and the land 104 at the boundary B between the land 104 and the solder ball 7 in the wiring direction is an acute angle. By the way, when the junction formed by the solder ball 7 and the land 104 becomes high or low temperature during the actual use or reliability test of the semiconductor product, the linear expansion coefficient between the electronic component 6 and the base material 102 becomes lower. The difference causes thermal stress in the joint. Here, the thermal stress will be described. FIG. 14 is an explanatory diagram showing the thermal stress acting on the joint between the solder ball and the mounting board in FIG. As shown in FIG. 14, when a thermal stress is applied, a shearing force F relatively acts on the joint. This shear force F becomes a shear stress τ inside the material, and the shear stress τ acts on the interface between the solder ball 7 and the land 104. In FIG. 14, when the x-axis is taken in a direction along the plane of the mounting substrate 101 and the y-axis is taken in a direction perpendicular to the plane, the shear stress τ yx is applied to the surface in the x-axis direction, and the y-axis is applied to the surface in the y-axis direction. Shear stress τ xy acts on each. Here, the interface angle α at the boundary portion A is an obtuse angle, and the interface angle β at the boundary portion B is an acute angle. There is an interface edge at which the angle becomes acute. The stress field at the interface end of the dissimilar material has a higher stress concentration as the interface angle is smaller. Then, in the stress singular field, extreme stress concentration occurs during the action of thermal stress. For this reason, when thermal stress is repeatedly applied during actual use or during a reliability test, or during the cooling process from the solder melting temperature during mounting, an extreme angle β due to the shear stress τ yx at the interface edge β becomes acute. Stress concentration occurs, and a crack occurs at the boundary portion B. In this case, mounting reliability is significantly impaired. In particular, when the direction of expansion of the electronic component 6 and the base material 102 and the direction of extension of the wiring 105 coincide with each other, the occurrence of cracks becomes remarkable.
In this case, there is a restriction in the wiring direction, and it is impossible to design wiring with a high degree of freedom. SUMMARY OF THE INVENTION It is an object of the present invention to provide a technology for a mounting substrate which can prevent cracks caused by thermal stress generated by joining a solder ball and a land. [0017] In order to solve this problem, the present invention provides a wiring formed on an insulating base material.
And a solder resist covering the base material and the wiring
And continuous from the wiring and from the solder resist
It is formed so as to protrude and is
The side surface is surrounded without gap over a predetermined height,
A land to which a solder ball is fixed;
So that it can cover the entire side of the protruding land.
Prepared mounting board, and penetrated to the position corresponding to the land
When a hole is formed and the mounting board is attached
At least avoiding interference with the land
Prepare a plate formed around the through hole,
Align so that the land is exposed from the through hole
Attach the plate to the mounting board,
After mounting the solder paste on the plate, mount the plate
Remove from the board, and place the solder ball on one side.
Child component to the land where the solder paste is formed
The solder balls are aligned and mounted, and the land is
The solder ball and the solder pace so as to cover the entire side surface.
And the door is what you so that you reflow. As a result, since the interface angle between the solder ball and the land becomes obtuse at all points, no crack occurs even when thermal stress is generated by joining the solder ball and the land. An embodiment of the present invention will be described below with reference to FIGS. 1 to 10. I do. In these drawings, the same members are denoted by the same reference numerals,
In addition, duplicate description is omitted. (Embodiment 1) FIG. 1 is a sectional view showing a mounting board according to an embodiment of the present invention, FIG. 2 is a sectional view showing a state where electronic components are mounted on the mounting board of FIG. 1, and FIG. FIG. 4 is an explanatory view showing the action of thermal stress in FIG. 2, and FIG. As shown in FIG. 1, the mounting board 1 of the present embodiment has a base material 2 having an insulating property, for example, made of a glass cloth base epoxy resin laminate or the like. Substrate 2
A wiring 5 made of, for example, copper and having a predetermined shape is formed thereon. Then, the wiring 5 and the wiring 5
The solder resist 3 is laminated so as to cover the base material 2 at the portion where no is formed. A land 8 is formed which is continuous from the wiring 5 and protrudes from the solder resist 3 and to which solder balls of electronic components to be described later are joined. Therefore, the height of the land 8 is higher than the height of the wiring 5. The land 8 having, for example, a circular shape has its side surface surrounded by the solder resist 3 over a predetermined height without any gap. A case in which a back surface bonding type electronic component is mounted on the mounting board of this embodiment having such a structure will be described. As shown in FIG. 2, for example, BGA / CS
A solder ball 7 for electrically and mechanically connecting the electronic component 6 and the land 8 is formed on the back surface of the electronic component 6 of the back surface joining type such as P. The diameter of the land 8 is adjusted so that the entire land 8 is covered with the solder ball 7 when the land 8 and the solder ball 7 are joined.
Is smaller than the diameter. Here, as described above, the side surface of the land 8 is surrounded by the solder resist 3 without any gap, and the land 8 has a shape protruding from the solder resist 3. Therefore, as shown in the figure, the solder balls 7 bonded to the lands 8
Cover the entire circumference of the side surface from the entire top surface of the. As a result, the boundary between the land 8 and the solder ball 7 is formed on the side surface of the land 8 extending perpendicular to the surface of the base material 2. For this reason, the interface angle between the solder ball 7 and the land 8 becomes obtuse not only at the interface angle α of the boundary portion A other than the wiring direction but also at the interface angle β of the boundary portion B in the wiring direction. That is, the interface angle between the solder ball 7 and the land 8 becomes obtuse at all points. The action of thermal stress in such a joint shape will be described below. At the time of thermal stress during actual use or during a reliability test, as shown in FIG. 3, a shear force F relatively acts on the joint. Then, the shear force F becomes a shear stress τ inside the material, and this shear stress τ acts on the interface between the solder ball 7 and the land 8. Here, as described above, since the interface angle between the solder ball 7 and the land 8 is obtuse at all points, the x-axis is set in the direction along the plane of the mounting When the y-axis is taken in a direction orthogonal to the above, the shear stress τ is only the shear stress τ xy acting on the surface in the y-axis direction. Therefore, even when a thermal stress is applied, a stress singular field is not formed and an extreme stress concentration does not occur. Even when a thermal stress is generated by joining the solder ball 7 and the land 8, a crack is generated. do not do. Further, since the interface angle between the solder ball 7 and the land 8 becomes obtuse irrespective of the direction of the wiring 5, the wiring 5 can be routed in any direction. Next, the mounting board 1 having such a structure will be described.
Will be described with reference to FIG. First, as shown in FIG. 4A, a substrate 2 and a copper-clad laminate 9 having a copper foil (thin film) 10 as a conductor formed on the substrate 2 are prepared. The thickness of the copper foil 10 is, for example, about two to three times the thickness of the wiring 5 described later. Next, as shown in FIG. 4B, an etching mask 11 made of a dry film photoresist or the like and protecting an unnecessary portion during etching is formed at the land forming position on the upper surface of the copper foil 10. Then, as shown in FIG. 4C, the copper foil 10 is half-etched by a predetermined amount in the depth direction, leaving a land formation position, to obtain a required wiring height. Thereby, the lands 8 are formed. Here, the required wiring height generally ranges from 9 μm to 18 μm.
μm. For the etching, for example, iron chloride or copper chloride is used. Next, as shown in FIG.
Then, an etching mask 11 is formed on the wiring formation position. At this time, the etching mask 11 used in forming the land 8 may or may not have been removed in advance. Next, as shown in FIG.
The copper foil 10 is completely removed by etching except for the wiring formation position. As a result, the wiring 5 continuous to the land 8 is formed. After the lands 8 and the wirings 5 are formed, the etching mask 11 is removed as shown in FIG. Finally, as shown in FIG. 4G, a solder resist 3 is formed on the substrate 2 and the wiring 5 so that the lands 8 protrude. Here, the solder resist 3 is formed without any gap up to the side surface of the land 8, and the land 8 is, for example, 5 μm from the upper surface of the solder resist 3.
So that it protrudes. Thus, the mounting board 1 shown in FIG. 1 is manufactured. (Embodiment 2) FIG. 5 is a cross-sectional view showing successively a manufacturing process of a mounting board according to another embodiment of the present invention. In the present embodiment, the lands 8 are formed of copper, which is the material of the wiring 5, and a metal having good plating properties, such as solder or nickel. A method for manufacturing a mounting board having such a structure will be described. First, in the same manner as in the first embodiment, as shown in FIG. 5A, a copper-clad laminate in which a base material 2 and a copper foil (thin film) 10 as a conductor are formed on the base material 2 9 is prepared. Note that, in the case of the present embodiment in which the thickness of the wiring 5 is directly changed without half-etching the copper foil 10, the thickness of the copper foil 10 is, for example, 9 μm to 18 μm. Next, as shown in FIG.
An etching mask 11 is formed at the land formation position and the wiring formation position on the upper surface of the substrate. At this time, the dimension of the etching mask 11 at the land formation position may be smaller than the dimension of the land 8. Next, as shown in FIG. 5C, the copper foil 10 is completely removed except for the land formation position and the wiring formation position, and thereafter, as shown in FIG. Is removed. Thereby, the wiring 5 is formed. Next, as shown in FIG. 5E, a plating mask 12 is formed at a position other than the land forming part of the wiring. The land formation position is set so as to be exposed from the opening 13 formed in the plating mask 12. And FIG.
As shown in (f), the land 8 is formed so as to fill the inside of the opening 13 with plating. In order to form the lands 8 by plating, a polymer material having plating resistance is used for the plating mask 12. After the lands 8 are thus formed, the plating mask 12 is removed as shown in FIG. Finally, as shown in FIG. 5H, the solder resist 3 is formed on the base material 2 and the wiring 5 so that the lands 8 protrude. Here, also in the present embodiment, the solder resist 3 is formed without any gap up to the side surface of the land 8 and the land 8 is
Projecting from the upper surface of, for example, 5 μm or more. As described above, the land 8 may be formed on the wiring 5. If the land 8 is formed on the wiring 5, the thickness of the copper foil
Therefore, it is not necessary to use a thick copper-clad laminate of special specification. The lands 8 can be formed by using a metal paste instead of plating. In this case, the land forming process by plating described above becomes a land forming process by paste application, and the land 8 is formed by applying a paste material to the opening 13. (Embodiment 3) FIG. 6 is a cross-sectional view showing a manufacturing process of a mounting board according to still another embodiment of the present invention. In this embodiment, both the lands 8 and the wirings 5 are formed of copper. In addition,
In a method of manufacturing a mounting board having such a structure,
The steps shown in FIGS. 6A to 6E and FIGS.
Steps shown in (h) are shown in FIGS.
This is the same as the step shown in (e) and the steps shown in FIGS. 5 (g) and 5 (h). Therefore, only the step shown in FIG. That is, as shown in FIG. 6F, the lands 8 are formed by filling the inside of the opening 13 with the same copper plating as the material of the wiring 5. Note that, also in the present embodiment, the lands 8 can be formed of a paste material. As described above, when the material of the land 8 and the wiring 5 is the same copper, the peel strength between the land 8 and the wiring 5 increases. (Embodiment 4) FIG. 7 is a cross-sectional view showing successively a manufacturing process of a mounting board according to still another embodiment of the present invention. In the present embodiment, a mounting substrate on which a wiring pattern has been formed is prepared in advance, and a protruding land 8 is formed on the mounting substrate. That is, as shown in FIG.
The wiring 5 is covered with the solder resist 3, and a mounting board having a depressed land exposed at the same height as the wiring 5 is prepared with a gap between the wiring 5 and the solder resist 3 covering the base material 2. Next, as shown in FIG. 7B, a plating mask 12 is formed at a position other than the land formation position. An opening 13 is formed at the land formation position. Next, as shown in FIG.
3 is filled with plating to form lands 8. At this time, plating is grown until the land 8 protrudes from the upper surface of the solder resist 3 by, for example, 5 μm or more. The lands 8 are made of copper, which is a material of the wiring 5, and a metal having good plating properties, such as solder or nickel. Then, as shown in FIG. 7D, when the plating mask 12 is finally removed, a mounting board with the lands 8 protruding is obtained. In this way, it is possible to prepare a mounting board in which the protruding crack of the land 8 does not occur using the conventional mounting board. Here, also in this case, the land 8 can be formed by using a metal paste material instead of plating. In this case, the land forming process by plating described above becomes a land forming process by paste application, and the land 8 is formed by applying a paste material to the opening 13. (Embodiment 5) FIG. 8 is a cross-sectional view showing successively a manufacturing process of a mounting board according to still another embodiment of the present invention. In the present embodiment, the lands 8 and the wirings 5 are both formed of copper. In addition,
In the method for manufacturing a mounting board according to the fifth embodiment,
The steps shown in FIGS. 8A, 8B, and 8D are the same as the steps shown in FIGS. 7A, 7B, and 7H in the fourth embodiment. Therefore, only the step shown in FIG. 8C will be described here. That is, as shown in FIG. 8C, the lands 8 are formed by filling the inside of the opening 13 with the same copper plating as the material of the wiring 5. Note that, also in the present embodiment, the lands 8 can be formed of a paste material. As described above, when the material of the land 8 and the wiring 5 is made of the same copper, it becomes possible to prepare a mounting board in which the protruding crack of the land 8 does not occur using a conventional mounting board. In addition, the peel strength between the land 8 and the wiring 5 increases. (Embodiment 6) FIG. 9 is a sectional view showing an electronic component mounting plate according to an embodiment of the present invention.
FIG. 10 is a cross-sectional view continuously showing a process of mounting an electronic component on a mounting board using the plate of FIG. The plate 15 shown in FIG. 9 is formed of, for example, a metal such as stainless steel. A through hole 16 is formed in the plate 15 at a position corresponding to the land 8 of the mounting substrate 1, and the plate 15 is aligned with the mounting substrate 1, and the through hole 16 is filled with a solder paste. The diameter of the through hole 16 is smaller than the diameter of the land 8. Around the through hole 16, an avoiding portion 17 is formed by half-etching the back surface of the plate 15 in order to avoid interference between the land 8 and the plate 15. Note that the half etching depth of the avoidance portion 17 is the same as the protrusion size of the land 8 from the solder resist 3. A procedure for mounting an electronic component on a mounting board using such a plate 15 will be described. First, as shown in FIG. 10A, the plate 15 is mounted on the mounting board by aligning the lands 8 so that the lands 8 are exposed from the through holes 16. Here, plate 1
The half-etching depth of the avoidance portion 17 formed at 5 is:
Since the land 8 has the same size as that protruding from the upper surface of the solder resist 3, the land 8 is
No warping of the plate 15 due to pushing up occurs. Further, since the diameter of the through hole 16 is smaller than the diameter of the land 8 and the half etching depth of the avoidance portion 17 is the same as the protrusion size of the land 8, a gap exists between the through hole 16 and the upper surface of the land 8. do not do. Accordingly, there is no possibility that the solder paste 18 enters the avoidance portion 17 and causes a short circuit between the adjacent land 8. Then, in this state, the through-hole is filled with the solder paste 18 using the squeegee 19). Next, when the plate 15 is removed from the mounting board 1 as shown in FIG. 10B, the solder paste 18 is printed only on the upper surface of the land 8. When the solder paste 18 is formed on the land 8 as described above, the solder ball 7 is positioned on the land 8 on which the solder paste 18 is printed, as shown in FIG. The bonding type electronic component 6 is mounted on the mounting board 1. At this time, the electronic component 6 is pressed toward the mounting board 1 until the solder ball 7 enters into a depth of 50% or more of the thickness of the printed solder paste 18. As a result, the solder paste 18 protrudes from the upper surface of the land 8 and has a shape surrounding the side surface of the land 8. Finally, as shown in FIG. 10D, when the solder ball 7 and the solder paste 18 are melted and cooled by the reflow device, the solder paste 18 is absorbed by the solder ball 7 and the side surface of the land 8 protrudes. Is formed in a shape surrounding the solder ball 7. As a result, the interface angle between the solder ball 7 and the land 8 becomes obtuse at all points, and no crack occurs even when thermal stress is generated by joining the solder ball 7 and the land 8. As described above, according to the present invention, when an electronic component is mounted on a mounting board by a solder ball by forming a land so as to protrude, the side surface of the land from which the solder ball protrudes is completely removed. Because I cover it around the circumference,
The interface angle between the solder ball and the land becomes obtuse at all points. Thus, even when a thermal stress is generated due to the joining between the solder ball and the land, an effective effect that a crack due to the thermal stress does not occur can be obtained. Further, when both the land and the wiring are made of copper, an effective effect that the peel strength between the land and the wiring can be increased can be obtained.

【図面の簡単な説明】 【図1】本発明の実施の形態1における実装基板を示す
断面図 【図2】図1の実装基板に電子部品が実装された状態を
示す断面図 【図3】図2における熱応力の作用を示す説明図 【図4】(a)〜(g)は図1の実装基板の製造プロセ
スを連続して示す断面図 【図5】(a)〜(h)は本発明の実施の形態2におけ
る実装基板の製造プロセスを連続して示す断面図 【図6】(a)〜(h)は本発明の実施の形態3におけ
る実装基板の製造プロセスを連続して示す断面図 【図7】(a)〜(d)は本発明の実施の形態4におけ
る実装基板の製造プロセスを連続して示す断面図 【図8】(a)〜(d)は本発明の実施の形態5におけ
る実装基板の製造プロセスを連続して示す断面図 【図9】本発明の一実施の形態における電子部品実装用
のプレートを示す断面図 【図10】(a)〜(d)は図9のプレートを用いて電
子部品を実装基板に実装して行くプロセスを連続して示
す断面図 【図11】(a)は従来の実装基板を示す斜視図、
(b)は(a)の一部を拡大して示す斜視図 【図12】図11(a)におけるXII−XII線に沿った断
面図 【図13】図11の実装基板に裏面接合タイプの電子部
品が実装された状態を示す断面図 【図14】図13における半田ボールと実装基板との接
合部に作用する熱応力を示す説明図 【符号の説明】 1 実装基板 2 基材 3 ソルダーレジスト 5 配線 6 電子部品 7 半田ボール 8 ランド 15 プレート 16 貫通孔 17 回避部 18 半田ペースト
BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a cross-sectional view showing a mounting board according to Embodiment 1 of the present invention. FIG. 2 is a cross-sectional view showing a state where electronic components are mounted on the mounting board in FIG. FIG. 4A to FIG. 4G are cross-sectional views successively showing a manufacturing process of the mounting substrate of FIG. 1. FIG. 5A to FIG. FIG. 6A to FIG. 6H are cross-sectional views sequentially illustrating a manufacturing process of a mounting substrate according to a second embodiment of the present invention. 7 (a) to 7 (d) are cross-sectional views successively showing a manufacturing process of a mounting board according to Embodiment 4 of the present invention. FIGS. 8 (a) to 8 (d) show an embodiment of the present invention. FIG. 9 is a cross-sectional view showing the manufacturing process of the mounting substrate in Embodiment 5 continuously. FIG. 10A to FIG. 10D are cross-sectional views showing a process of mounting an electronic component on a mounting board using the plate of FIG. 9 continuously. (A) is a perspective view showing a conventional mounting board,
(B) is a perspective view showing a part of (a) in an enlarged scale. [FIG. 12] A cross-sectional view taken along the line XII-XII in FIG. 11 (a). [FIG. 13] FIG. FIG. 14 is a cross-sectional view showing a state in which electronic components are mounted. FIG. 14 is an explanatory view showing thermal stress acting on a joint between a solder ball and a mounting board in FIG. 13. 5 Wiring 6 Electronic component 7 Solder ball 8 Land 15 Plate 16 Through hole 17 Avoidance section 18 Solder paste

フロントページの続き (51)Int.Cl.7 識別記号 FI H01L 21/92 604B (56)参考文献 特開 平7−211722(JP,A) 特開 平9−275271(JP,A) 特開 昭52−12575(JP,A) 特開 平5−29363(JP,A) 特開 平5−144816(JP,A) 特開 平5−226502(JP,A) 特開 平6−204290(JP,A) 特開 平8−111578(JP,A) 特開 平11−67820(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 21/60 H05K 3/34 H01L 23/12 Continuation of the front page (51) Int.Cl. 7 Identification symbol FI H01L 21/92 604B (56) References JP-A-7-121722 (JP, A) JP-A 9-275271 (JP, A) JP 52-12575 (JP, A) JP-A-5-29363 (JP, A) JP-A-5-144816 (JP, A) JP-A-5-226502 (JP, A) JP-A-6-204290 (JP, A) A) JP-A-8-111578 (JP, A) JP-A-11-67820 (JP, A) (58) Fields investigated (Int. Cl. 7 , DB name) H01L 21/60 H05K 3/34 H01L 23 / 12

Claims (1)

(57)【特許請求の範囲】 【請求項1】絶縁性を有する基材上に形成された配線
と、前記基材および前記配線を覆うソルダーレジスト
と、前記配線から連続し且つ前記ソルダーレジストから
突出して形成されるとともに前記ソルダーレジストによ
り側面が所定の高さにわたって隙間なく包囲され、前記
半田ボールが固定されるランドとを有し、前記半田ボー
ルが突出した前記ランドの側面全周を覆い得るようにし
実装基板を用意し、 前記ランドに対応した位置に貫通孔が形成されるととも
に前記実装基板を取り付けた際における前記ランドとの
干渉を避ける回避部が少なくとも前記貫通孔の周囲に形
成されたプレートを用意し、 前記ランドが前記貫通孔から露出するように位置合わせ
して前記プレートを前記実装基板に取り付け、 前記貫通孔内に半田ペーストを充填した後に前記プレー
トを前記実装基板から取り外し、 一方面に半田ボールの形成された電子部品を、前記半田
ペーストが形成された前記ランドに前記半田ボールを位
置合わせして搭載し、 前記ランドの側面全周を覆うように前記半田ボールと前
記半田ペーストとをリフローすることを特徴とする電子
部品の実装方法。
(57) Claims 1. A wiring formed on an insulating base material, a solder resist covering the base material and the wiring, and a solder resist continuous from the wiring and from the solder resist. A land that is formed so as to protrude and is surrounded by the solder resist without any gap over a predetermined height, and that has a land to which the solder ball is fixed. Prepare a mounting board as described above, and form a through hole at a position corresponding to the land.
With the land when the mounting board is attached to
An avoidance part for avoiding interference is formed at least around the through hole.
Prepare the formed plate and align it so that the lands are exposed from the through holes
Then, the plate is attached to the mounting substrate, and the solder paste is filled in the through-holes.
The electronic component having a solder ball formed on one surface is removed from the mounting board.
Place the solder ball on the land where the paste is formed.
The solder balls are placed side by side, and the solder balls are
An electronic device characterized by reflowing a solder paste.
Component mounting method.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100743233B1 (en) * 2005-07-18 2007-07-27 엘지전자 주식회사 Pad of printed circuit board and making method the same

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001077500A (en) * 1999-06-30 2001-03-23 Murata Mfg Co Ltd Electronic component, dielectric filter, dielectric duplexer and manufacture of the electronic component
JP3506233B2 (en) 2000-06-28 2004-03-15 シャープ株式会社 Semiconductor device and manufacturing method thereof
JP4732009B2 (en) * 2005-06-01 2011-07-27 株式会社 大昌電子 Printed wiring board
JP2009117600A (en) * 2007-11-06 2009-05-28 Nippon Mektron Ltd Method of manufacturing wiring circuit board with bumps
US9345148B2 (en) 2008-03-25 2016-05-17 Stats Chippac, Ltd. Semiconductor device and method of forming flipchip interconnection structure with bump on partial pad
US7759137B2 (en) 2008-03-25 2010-07-20 Stats Chippac, Ltd. Flip chip interconnection structure with bump on partial pad and method thereof
JP2010135347A (en) * 2008-10-28 2010-06-17 Kyocer Slc Technologies Corp Wiring substrate, and method for manufacturing the same
WO2015050164A1 (en) * 2013-10-03 2015-04-09 シャープ株式会社 Substrate for light-emitting device, light-emitting device, and method for producing substrate for light-emitting device
CN107613666B (en) * 2017-07-28 2021-06-22 青岛海尔智能技术研发有限公司 QFN chip PCB packaging method and PCB
JP7038534B2 (en) * 2017-12-08 2022-03-18 オリンパス株式会社 Manufacturing method of molded circuit parts and molded circuit parts

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100743233B1 (en) * 2005-07-18 2007-07-27 엘지전자 주식회사 Pad of printed circuit board and making method the same

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