JP3368271B2 - 選択的電気化学エッチング方法およびそれに用いるエッチング液 - Google Patents

選択的電気化学エッチング方法およびそれに用いるエッチング液

Info

Publication number
JP3368271B2
JP3368271B2 JP2001323511A JP2001323511A JP3368271B2 JP 3368271 B2 JP3368271 B2 JP 3368271B2 JP 2001323511 A JP2001323511 A JP 2001323511A JP 2001323511 A JP2001323511 A JP 2001323511A JP 3368271 B2 JP3368271 B2 JP 3368271B2
Authority
JP
Japan
Prior art keywords
solder
metal
concentration
sulfate
etching
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2001323511A
Other languages
English (en)
Other versions
JP2002180299A (ja
Inventor
リサ・エイ・ファンティ
ジョン・マイケル・コット
デビッド・イーライ・アイクスタット
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
International Business Machines Corp
Original Assignee
International Business Machines Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by International Business Machines Corp filed Critical International Business Machines Corp
Publication of JP2002180299A publication Critical patent/JP2002180299A/ja
Application granted granted Critical
Publication of JP3368271B2 publication Critical patent/JP3368271B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • CCHEMISTRY; METALLURGY
    • C25ELECTROLYTIC OR ELECTROPHORETIC PROCESSES; APPARATUS THEREFOR
    • C25FPROCESSES FOR THE ELECTROLYTIC REMOVAL OF MATERIALS FROM OBJECTS; APPARATUS THEREFOR
    • C25F3/00Electrolytic etching or polishing
    • C25F3/02Etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/3213Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
    • H01L21/32133Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
    • H01L21/32134Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by liquid etching only
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/03Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/11Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/0502Disposition
    • H01L2224/05022Disposition the internal layer being at least partially embedded in the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/0502Disposition
    • H01L2224/05026Disposition the internal layer being disposed in a recess of the surface
    • H01L2224/05027Disposition the internal layer being disposed in a recess of the surface the internal layer extending out of an opening
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05075Plural internal layers
    • H01L2224/0508Plural internal layers being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05166Titanium [Ti] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05171Chromium [Cr] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05184Tungsten [W] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/0556Disposition
    • H01L2224/05571Disposition the external layer being disposed in a recess of the surface
    • H01L2224/05572Disposition the external layer being disposed in a recess of the surface the external layer extending out of an opening
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05647Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/06Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
    • H01L2224/061Disposition
    • H01L2224/0612Layout
    • H01L2224/0616Random array, i.e. array with no symmetry
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/11001Involving a temporary auxiliary member not forming part of the manufacturing apparatus, e.g. removable or sacrificial coating, film or substrate
    • H01L2224/11009Involving a temporary auxiliary member not forming part of the manufacturing apparatus, e.g. removable or sacrificial coating, film or substrate for protecting parts during manufacture
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13075Plural core members
    • H01L2224/1308Plural core members being stacked
    • H01L2224/13082Two-layer arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/1354Coating
    • H01L2224/1357Single coating layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L24/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00013Fully indexed content
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01004Beryllium [Be]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01011Sodium [Na]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01013Aluminum [Al]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01015Phosphorus [P]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01019Potassium [K]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01022Titanium [Ti]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01023Vanadium [V]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01024Chromium [Cr]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01029Copper [Cu]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01033Arsenic [As]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01047Silver [Ag]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01074Tungsten [W]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01075Rhenium [Re]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01082Lead [Pb]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01084Polonium [Po]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/0132Binary Alloys
    • H01L2924/01322Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Manufacturing & Machinery (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Materials Engineering (AREA)
  • Electrochemistry (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • General Chemical & Material Sciences (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • ing And Chemical Polishing (AREA)
  • Weting (AREA)
  • Preventing Corrosion Or Incrustation Of Metals (AREA)

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は金属の選択エッチン
グに関し、詳細には、様々なはんだの存在下における金
属の電気化学エッチングに関する。
【0002】
【従来の技術】C4は、先進のマイクロエレクトロニク
ス・チップ実装/接続技術である。「C4」は、コント
ロールド・コラプス・チップ・コネクション(Controll
ed Collapse Chip Connection)を表す。C4は、「は
んだバンプ」、「はんだボール」および「フリップ・チ
ップ」としても知られ、これらの用語は、「C4はんだ
バンプ」などのように組み合わせて使用されることもあ
る。
【0003】C4の基本的着想は、チップ(半導体デバ
イス)、チップ・パッケージまたはその他のチップ・ユ
ニットを、これらのユニットの2つの表面間のはんだバ
ンプによって接続するというものである。導電性はんだ
から成るこれらの小さなバンプは、接続するユニット上
のそれぞれ対をなす金属パッド間のギャップを埋める。
それぞれのパッドは、他方のユニットの表面に対応する
パッドを有する。パッドの配置は鏡像配置である。これ
らのユニットを一緒にプレスし加熱すると、第1のユニ
ットのパッド上のはんだバンプが第2のユニット上の
(バンプを持たない)対応する導電性パッドと接触し、
はんだバンプが再溶融し、これによってはんだバンプが
部分的につぶれ、それぞれのパッド間が接続される。
【0004】C4では、一方のユニットの金属パッド上
にはんだバンプが直接に形成される。パッドは、それぞ
れのパッドを取り囲む絶縁基板によってその他の構成要
素から電気的に分離される。絶縁基板は、シリコン(S
i)またはその他の材料とすることができる。パッドの
底面はチップ回路に電気的に接続される。
【0005】C4の主な応用は、担体またはパッケージ
へのチップの接合である。チップは通常、「ウェハ」と
呼ばれる単結晶シリコン・スラブ上の長方形アレイとし
て製作される。それぞれのウェハ上には多くのチップが
形成され、次いでウェハは個々のチップに分割され、チ
ップは、取扱い可能な十分な大きさのユニットに「パッ
ケージング」される。C4バンプは、チップがまだ1枚
のウェハとして接合されたままのときにチップ上に配置
される。
【0006】ある数のチップを製作するために処理しな
ければならないウェハの数を減らすため、ウェハは可能
な限り大きく作られる。同じ理由からチップはできるだ
け小さく作られる(理由はこれだけではない)。したが
って、最良のC4製造システムは、非常に狭い間隔を置
いて配置された非常に小さな数千のはんだバンプを広い
面積にわたって正確に製作することができるシステムで
ある。
【0007】C4はんだバンプは、パッドに機械的に十
分に固定されなければならず、さもないと2つの表面が
互いに押しつけられたときにバンプが剥がれる可能性が
ある。コンピュータなどの複雑な装置は、数十のチップ
および数百ないし数千のC4はんだボール接続を有し、
たった1つのバンプに障害が起こるだけで装置全体が役
に立たなくなる可能性があることを理解されたい。C4
バンプの取付けには慎重な設計を要する。
【0008】はんだバンプを形成する1つ方法はスパッ
タリングまたは真空付着を使用する方法である。この方
法では、真空チャンバ内ではんだ金属を蒸発させる。こ
の金属蒸気は、蒸発金属の薄い膜でチャンバ内を覆い尽
くす。基板上にはんだバンプを形成するためには、この
蒸気を、基板の上に保持された金属マスクの穴に通す。
この穴を通過するはんだ蒸気は冷たい基板の表面で凝結
し、はんだバンプとなる。この方法には、基板、マスク
およびフラッシュ蒸発器を保持する高真空チャンバが必
要である。
【0009】電着は、はんだバンプを製作する代替技法
であり、電気化学めっきまたは電気めっきとも呼ばれ
る。この方法もマスクを使用し、選択した場所だけには
んだバンプを形成するが、この技法は先の蒸発法とは非
常に異なる。
【0010】C4はんだバンプを電解によって形成する
最初の段階は、金属膜の連続スタックを、バンプを形成
するウェハ全面に付着させる段階である。このいわゆる
「シード層」は2つの機能を果たす。第1に、シード層
は、はんだバンプの電解付着中の電流の導電経路とな
る。第2に、シード層ははんだバンプの下に残り、C4
のボール・リミッティング・メタラジ(BLM)の基礎
を形成する。したがってシード層は、ウェハの面全体に
わたって均一な電着を可能にする十分な導電性を有する
少なくとも1つの層を含まなければならない。その最下
層は、その下の半導体デバイス・パッシベーションに十
分に接着しなければならず、その最上層は、はんだと十
分に相互作用して信頼性の高い結合を形成しなければな
らない。さらに、BLMは、はんだがその下のデバイス
構成要素と有害に相互作用することを防ぐバリア層を含
むことができる。最後に、様々な熱および機械応力全般
にわたってC4接合の信頼性を維持するため、この複合
スタックによって生み出される応力が十分に低くなけれ
ばならない。これらの因子を考慮して、シード層はたい
てい2層以上の金属層から成り、これらの様々な層は、
この相互接続を電気的に分離するため、処理中のある時
点でC4間からエッチングによって除かなければならな
い。
【0011】シード層を構築した後の第2の段階は、フ
ォトリソグラフィによってマスクを形成する段階であ
る。シード層上にフォトレジスト層を塗布し、露光す
る。次いで、露光させなかったフォトレジスト(ネガ型
フォトレジストの場合)を洗い流し、硬化したフォトレ
ジストをマスクとして残す。このマスクは、はんだバン
プを付着させるための穴の列を有する。
【0012】第3の段階は、マスクの穴の中にはんだを
電着させる(電気めっきする)段階である。
【0013】はんだバンプを形成した後、硬化したフォ
トレジスト・マスクを除去する。このとき基板は、連続
したシード層および多数のはんだバンプで覆われてい
る。次いで、適当なウェット・エッチングおよび/また
はエレクトロエッチング・プロセスによってはんだバン
プ間のシード層を除去して、はんだバンプを電気的に分
離する。
【0014】C4はんだバンプに一般に使用されるはん
だは、Pb97重量パーセント、Sn3重量パーセント
のはんだである。一般的なシード層は、TiW層、フェ
ーズドCr/Cu層またはCr/Cu合金、およびCu
層を含む。Cr/Cu層およびCu層の同時除去に利用
されるプロセスは、米国特許第5486292号明細書
に開示されているグリセリンおよび硫酸カリウムを含ん
だ水溶液を含むエレクトロエッチング・プロセスであ
る。この明細書の開示は参照によって本明細書に組み込
まれる。グリセリンは湿潤剤の働きをするが、硫酸カリ
ウムの目的は2通りある。第1に、硫酸カリウムは溶液
に電解導電性を与える。第2に、遊離の硫酸イオンは高
Pbはんだバンプと容易に錯体を形成し、エレクトロエ
ッチング・プロセス中にはんだバンプが溶解するのを防
ぐ保護クラストを形成する。次いで、米国特許第546
2638号明細書および米国特許第6015505号明
細書に開示されている過酸化水素、EDTAおよび硫酸
カリウムを含んだ水性エッチング液を含むウェット・エ
ッチング・プロセスを使用してTiW層をエッチングす
る。これらの明細書の開示は参照によって本明細書に組
み込まれる。次の洗浄プロセスではんだバンプ上の「ク
ラスト」を除去する。
【0015】より最近の応用では、より低温でのチップ
接合を可能にするため、C4バンプに対してより融点の
低いはんだが使用される。このような低融点はんだは、
Snを63重量パーセント、Pbを37重量パーセント
含む鉛/スズはんだ組成物とすることができる。
【0016】米国特許第5800726号明細書には、
共晶はんだの存在下でTiWなどの様々な金属をウェッ
ト・エッチングするための水溶液が提案されている。こ
の明細書の開示は参照によって本明細書に組み込まれ
る。この溶液は、リン酸カリウム、過酸化水素、EDT
Aおよびシュウ酸を含む。
【0017】本発明の発明者らは、現行のエレクトロエ
ッチング・プロセスが高Snはんだバンプに対して有効
でないことを確認した。その理由は、Snと硫酸イオン
との反応性がそれほど高くなく、そのため、米国特許第
5486282号明細書に開示されている従来技術のエ
レクトロエッチング溶液では、エレクトロエッチング中
にはんだバンプに保護クラストが形成されないためであ
る。その望ましくない結果は、多量のSnがはんだバン
プから浸出することである。さらに、溶解したSnがT
iW上に自由に再付着し、TiWと錯体を形成して、T
iW層を従来のウェット・エッチングに対して不浸透性
とする。
【0018】階層はんだ構造、例えば高融点高Pbはん
だバンプの上に低融点高Snはんだバンプを付着させた
階層はんだ構造によって問題はさらに複雑になる。
【0019】したがって本発明の発明者らは、金属を効
果的にエレクトロエッチングし、一方で、少なくとも一
部が高Snはんだを含むはんだバンプに影響を及ぼさな
いことの必要性を確認した。
【0020】
【発明が解決しようとする課題】したがって本発明の目
的は、エレクトロエッチングする金属およびエッチング
しない高Snはんだバンプを有する基板をエレクトロエ
ッチングすることにある。
【0021】本発明の他の目的は、エレクトロエッチン
グする金属、ならびに高Snはんだバンプおよび高鉛は
んだバンプを含むエッチングしないはんだ階層構造を有
する基板をエレクトロエッチングすることにある。
【0022】本発明のこれらの目的および他の目的は、
以下の説明を添付図面とともに検討することによってよ
り明白となろう。
【0023】
【課題を解決するための手段】本発明の目的は、本発明
の第1の態様に基づいて、エッチングしない1種または
数種の第1の金属の存在下で第2の金属をエッチングす
るための水性電気化学エッチング液を提供することによ
って達成される。このエッチング液は、濃度1.30か
ら1.70Mのグリセリンと、硫酸イオン濃度0から
0.5Mの硫酸塩化合物と、リン酸イオン濃度0.1か
ら0.5Mのリン酸塩化合物とを含む。
【0024】本発明の第2の態様によれば、溶解させな
い1種または数種の第1の金属の存在下で、物品中の溶
解させる1種または数種の第2の金属を選択的に溶解さ
せる方法が提供される。この方法は、溶解させる前記金
属を、濃度1.30から1.70Mのグリセリンと、硫
酸イオン濃度0から0.5Mの硫酸塩化合物と、リン酸
イオン濃度0.1から0.5Mのリン酸塩化合物を含む
水性エッチング液を用いて電気化学的にエッチングする
段階を含む。
【0025】本発明の第3の態様によれば、物品を選択
的にエッチングする方法が提供される。この方法は、溶
解させない1種または数種の第1の金属の存在下で溶解
させる1種または数種の第2の金属を有する物品を用意
する段階と、溶解させる1種または数種の前記第2の金
属を、濃度1.30から1.70Mのグリセリンと、硫
酸イオン濃度0から0.5Mの硫酸塩化合物と、リン酸
イオン濃度0.1から0.5Mのリン酸塩化合物を含む
水性エッチング液を用いて電気化学的にエッチングする
段階とを含む。
【0026】新規であると考えられる本発明の特徴およ
び本発明を特徴づける要素は、添付請求項に具体的に記
載した。図は、単に例示が目的であるにすぎず、原寸に
比例して示されていない。尺度も一定ではない。本発明
は、その編成と操作方法の両方に関して、添付図面に関
連した以下の詳細な説明を参照することによって最もよ
く理解される。
【0027】
【発明の実施の形態】図面を詳細に参照する。特に図1
を参照すると、半導体材料12、シード層14およびは
んだバンプ24から成る第1のチップ10が示されてい
る。先に述べたように、シード層14は実際には複数の
層から成る。一般的な1つの層群は、TiW合金(例え
ばTi10重量パーセントおよびタングステン90重量
パーセント)の第1の層16、フェーズドCr/Cuま
たはCr/Cu合金の第2の層18およびCuの第3の
層20である。ただしこれは例示的なものであり、これ
に限定されるわけではない。バリア層22、例えばニッ
ケルのバリア層があることもある。
【0028】チップ10上のはんだバンプ24はおもに
Snはんだを含む。このようなはんだは、Sn60重量
パーセント以上、Pb40重量パーセント以下といった
中Sn含量はんだ、またはSn95重量パーセント以
上、残りがPbといった高Sn含量はんだとすることが
できる。また、ほんの少し例を挙げれば、Sn/Ag、
Sn/Cu、Sn/Ag/Cu、Sn/Bi合金などの
おもにSnを含む無鉛合金を含むはんだとすることもで
きる。
【0029】次に図2を参照すると、半導体材料12、
シード層14およびはんだバンプ32から成る第2のチ
ップ30が示されている。シード層14は応用に応じ
て、図1に示したものと同じでもよいし、または図1に
示したものとは異なったものでもよい。第2のチップ3
0も同様にバリア層22を有することができる。第2の
チップ30ははんだバンプ32を含む。しかしこのケー
スでは、はんだバンプ32が、高融点はんだ34および
低融点はんだ36から成るはんだ階層構造を含む。図2
に示したはんだ階層構造は例示目的のものなので、所望
ならば追加のはんだ層を追加することができる。
【0030】高融点はんだ34は、95から97重量パ
ーセントのPbを有し、残りがSnである高Pbはんだ
とすることができる。低融点はんだ36は、先に述べた
中Sn含有または高Sn含有のはんだ、あるいは無鉛合
金とすることができる。
【0031】残りの議論では第2のチップ30に集中す
るが、本発明は第1のチップ10にも等しく適用可能で
あることを理解されたい。
【0032】次に図3を参照する。第2のチップ30
を、グリセリンおよび硫酸カリウムを含む従来の水性エ
ッチング液を用いてエレクトロエッチングした。このエ
ッチング液の組成は、グリセリン1.5MおよびK2
4(硫酸カリウム)0.35Mである。槽電圧は1
4.0ボルト、ワークピースと電極の間の電極間隔は
3.0mm、デューティ・サイクルは20%とした。
【0033】図3から分かるとおり、エレクトロエッチ
ングの間、高融点はんだ34は保護クラスト38によっ
て保護され、一方、この間に低融点はんだ36は腐食さ
れて、望ましくないSnの損失およびその結果としての
はんだバンプ32の組成の変化が生じた。さらに、低融
点はんだ36のSnの一部39がシード層の第1の層1
6上に再付着した。これがこの層と錯体を形成する可能
性もある。
【0034】続いて、第2のチップ30を、過酸化水素
30重量%、K−EDTA7.8g/lおよび硫酸カリ
ウム1.1Mを含む従来の水性エッチング液中で330
秒間、ウェット・エッチングした。浴温は50℃に設定
した。ウェット・エッチング後の結果を図4および5に
示す。第1の層16はほとんど除去され、その後に第1
の層16がほとんどない第2のチップ30の表面42が
残された。一方、Sn付着物39(図3)はある領域の
第1の層16のエッチングを妨げ、これによって第1の
層16の領域40がエッチングされずに残った。
【0035】図3から5に示したようなチップ構造は望
ましいものではなく、その結果、歩留りの低下が大きく
なる。このチップ処理段階における歩留り損は大きなコ
スト高につながることを理解されたい。
【0036】次に図6を参照する。第2のチップ30を
本発明に基づく水性エッチング液を用いてエレクトロエ
ッチングした。
【0037】本発明に使用する水性電気化学エッチング
液は、グリセリン(HOCH2(OH)CH2OH)1.
30から1.70M(好ましくは1.5M)、硫酸イオ
ン濃度0から0.5M(好ましくは0.35M)、およ
びリン酸イオン濃度0.1から0.5M(好ましくは
0.15M)を含む組成を有する。pHは4から9(公
称5)、槽電圧は13から17V(公称14.5)と
し、電極間隔は3.0mm、デューティ・サイクルは1
0から30%(好ましくは20%)であった。
【0038】硫酸イオンおよびリン酸イオンは任意の塩
から得ることができる。これらには、硫酸カリウムおよ
びリン酸カリウムが含まれるが、本発明の目的上、硫酸
ナトリウムまたはリン酸ナトリウムを使用することもで
きる。
【0039】硫酸イオンとリン酸イオンの相対量は、存
在する高Pbおよび高Snはんだの量に基づいて調整さ
れる。高Pbはんだと高Snはんだの両方が存在する場
合には、これらのはんだを保護するために硫酸イオンと
リン酸イオンの両方が存在しなければならない。高Pb
はんだが存在しない場合、硫酸イオンが存在する必要は
ない。最低でも、硫酸イオンとリン酸イオンの合計量
が、合理的な電圧でエレクトロエッチングを実施するの
に十分な溶液導電率を提供しなければならない。
【0040】これらのはんだバンプの存在下でエッチン
グすることができる金属にはチタン、タングステン、ク
ロム、銅、ニッケルおよびこれらの合金が含まれる。こ
れらのはんだバンプの存在下でエレクトロエッチングす
ることができる金属には、Cu、Cr/Cu、Cu/N
iおよびCr/Cu/Ni合金を含む様々な金属スタッ
クが含まれる。
【0041】本発明の好ましいエッチング液の一例とし
て、第2のチップ30をエレクトロエッチングするのに
使用するエッチング液は、グリセリン1.5M、K2
4(硫酸カリウム)0.35MおよびK3PO4(リン
酸カリウム)0.15Mを含む。pHはリン酸を使用し
て5.0に調整した。槽電圧は14.0ボルト、電極間
隔は3.0mm、デューティ・サイクルは20%であっ
た。それぞれのはんだバンプ全体がクラスト38によっ
て保護される。第2および第3の層18、20をそれぞ
れ除去した。第1の層16の上に残留物は残らなかっ
た。
【0042】次いで第2のチップ30を、過酸化水素3
0重量%、K−EDTA7.8g/lおよび硫酸カリウ
ム1.1Mを含む従来の水性エッチング液中で330秒
間、ウェット・エッチングした。浴温は50℃に設定し
た。結果を図7および8に示す。第1の層16が完全に
除去され、残留物の全くない第2のチップ30の表面4
2が残されていることが分かる。
【0043】ウェット・エッチング後も保護クラスト3
8は残り、これは、ウェット・エッチング完了後にメタ
ンスルホン酸を用いて除去する。
【0044】本発明の使用が、エレクトロエッチング・
プロセスの歩留りを大幅に高めることが分かった。
【0045】この開示を検討した当業者には、本明細書
に具体的に記載した実施形態を越えるその他の修正を、
本発明の趣旨から逸脱することなしに実施することがで
きることは明白であろう。したがってこのような修正は
本発明の範囲に含まれるとみなされる。本発明の範囲は
添付の請求項によってのみ制限される。
【0046】まとめとして、本発明の構成に関して以下
の事項を開示する。
【0047】(1)エッチングしない第1の金属の存在
下で第2の金属をエッチングするための水性電気化学エ
ッチング液であって、濃度1.30から1.70Mのグ
リセリンと、硫酸イオン濃度0から0.5Mの硫酸塩化
合物と、リン酸イオン濃度0.1から0.5Mのリン酸
塩化合物とを含むエッチング液。 (2)エッチング液のpHが4から9である、上記
(1)に記載の電気化学エッチング液。 (3)前記第1の金属が、鉛、スズおよびこれらの合金
から成るグループから選択される、上記(1)に記載の
電気化学エッチング液。 (4)前記第1の金属が、95重量パーセント超の鉛を
有し、残りがスズの高鉛/スズはんだと、40重量パー
セント未満の鉛を有し、残りがスズの中鉛/スズはんだ
と、95重量パーセント超のスズを有し、残りが鉛の高
スズ/低鉛はんだと、95重量パーセント超のスズ含量
を有する無鉛はんだと、これらの組合せとから成るグル
ープから選択される、上記(1)に記載の電気化学エッ
チング液。 (5)前記第2の金属が、クロム、銅、ニッケルおよび
これらの合金から成るグループから選択される、上記
(1)に記載の電気化学エッチング液。 (6)前記硫酸塩化合物の濃度が0.2から0.5Mで
ある、上記(1)に記載の電気化学エッチング液。 (7)前記グリセリン濃度が約1.4M、前記硫酸塩濃
度が約0.35M、前記リン酸塩濃度が約0.15Mで
ある、上記(1)に記載の電気化学エッチング液。 (8)溶解させない1種または数種の第1の金属の存在
下で、物品中の溶解させる1種または数種の第2の金属
を選択的に溶解させる方法であって、前記第2の金属
を、濃度1.30から1.70Mのグリセリンと、硫酸
イオン濃度0から0.5Mの硫酸塩化合物と、リン酸イ
オン濃度0.1から0.5Mのリン酸塩化合物を含む水
性エッチング液を用いて電気化学的にエッチングする段
階を含む方法。 (9)前記エッチング液のpHが4から9である、上記
(8)に記載の方法。 (10)前記第1の金属が、鉛、スズおよびこれらの合
金から成るグループから選択される、上記(8)に記載
の方法。 (11)前記第1の金属が、95重量パーセント超の鉛
を有し、残りがスズの高鉛/スズはんだと、40重量パ
ーセント未満の鉛を有し、残りがスズの中鉛/スズはん
だと、95重量パーセント超のスズを有し、残りが鉛の
高スズ/低鉛はんだと、95重量パーセント超のスズ含
量を有する無鉛はんだと、これらの組合せとから成るグ
ループから選択される、上記(8)に記載の方法。 (12)前記第2の金属が、クロム、銅、ニッケルおよ
びこれらの合金から成るグループから選択される、上記
(8)に記載の方法。 (13)前記硫酸塩化合物の濃度が0.2から0.5M
である、上記(8)に記載の方法。 (14)前記グリセリン濃度が約1.4M、前記硫酸塩
濃度が約0.35M、前記リン酸塩濃度が約0.15M
である、上記(8)に記載の方法。 (15)選択的エッチングする方法であって、溶解させ
ない1種または数種の第1の金属および第2の金属を有
する物品を用意する段階と、前記第2の金属を、濃度
1.30から1.70Mのグリセリンと、硫酸イオン濃
度0から0.5Mの硫酸塩化合物と、リン酸イオン濃度
0.1から0.5Mのリン酸塩化合物を含む水性エッチ
ング液を用いて電気化学的にエッチングする段階とを含
む方法。 (16)前記エッチング液のpHが4から9である、上
記(15)に記載の方法。 (17)前記第1の金属が、鉛、スズおよびこれらの合
金から成るグループから選択される、上記(15)に記
載の方法。 (18)前記第1の金属が、95重量パーセント超の鉛
を有し、残りがスズの高鉛/スズはんだと、40重量パ
ーセント未満の鉛を有し、残りがスズの中鉛/スズはん
だと、95重量パーセント超のスズを有し、残りが鉛の
高スズ/低鉛はんだと、95重量パーセント超のスズ含
量を有する無鉛はんだと、これらの組合せとから成るグ
ループから選択される、上記(15)に記載の方法。 (19)前記第2の金属が、クロム、銅、ニッケルおよ
びこれらの合金から成るグループから選択される、上記
(15)に記載の方法。 (20)前記硫酸塩化合物の濃度が0.2から0.5M
である、上記(15)に記載の方法。 (21)前記グリセリン濃度が約1.4M、前記硫酸塩
濃度が約0.35M、前記リン酸塩濃度が約0.15M
である、上記(15)に記載の方法。
【図面の簡単な説明】
【図1】シード層ならびに主としてSnを含むはんだだ
けを含む第1のはんだ階層構造を示す、チップの側面図
である。
【図2】シード層ならびに高Snはんだおよび高Pbは
んだを含む第2のはんだ階層構造を示す、チップの側面
図である。
【図3】従来技術のエッチング液を用いてエレクトロエ
ッチングした後の図2のチップの側面図である。
【図4】最後のシード層を除去するウェット・エッチン
グ後の図3のチップの側面図である。
【図5】シード層の不完全なエッチングを示す、図4の
チップの表面の図である。
【図6】本発明に基づくエッチング液を用いてエレクト
ロエッチングした後の図2のチップの側面図である。
【図7】最後のシード層を除去するウェット・エッチン
グ後の図6のチップの側面図である。
【図8】シード層の完全なエッチングを示す、図7のチ
ップの表面の図である。
【符号の説明】
10 第1のチップ 12 半導体材料 14 シード層 16 第1のシード層 18 第2のシード層 20 第3のシード層 22 バリア層 24 はんだバンプ 30 第2のチップ 32 はんだバンプ 34 高融点はんだ 36 低融点はんだ 38 保護クラスト 39 低融点はんだ 40 第1のシード層 42 第2のチップの表面
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ジョン・マイケル・コット アメリカ合衆国06812 コネチカット州 ニュー・フェアフィールド クローバー リーフ・ドライブ 6 (72)発明者 デビッド・イーライ・アイクスタット アメリカ合衆国12590 ニューヨーク州 ワッピンガー・フォールズ シャーウッ ド・フォレスト・レーン 11 アパート メント ナンバー・シー (56)参考文献 特開 昭57−174463(JP,A) 特開 昭54−103746(JP,A) 特開 平8−3799(JP,A) 特許3172501(JP,B2) 特許3065508(JP,B2) (58)調査した分野(Int.Cl.7,DB名) C25F 1/00 - 7/02 H01L 21/3063

Claims (15)

    (57)【特許請求の範囲】
  1. 【請求項1】エッチングしない第1の金属の存在下で第
    2の金属をエッチングするための水性電気化学エッチン
    グ液であって、 濃度1.30から1.70Mのグリセリンと、 硫酸イオン濃度0から0.5Mの硫酸塩化合物と、 リン酸イオン濃度0.1から0.5Mのリン酸塩化合物
    とを含むエッチング液。
  2. 【請求項2】エッチング液のpHが4から9である、請
    求項1に記載の電気化学エッチング液。
  3. 【請求項3】前記第1の金属が、鉛、スズおよびこれら
    の合金から成るグループから選択される、請求項1に記
    載の電気化学エッチング液。
  4. 【請求項4】前記第2の金属が、クロム、銅、ニッケル
    およびこれらの合金から成るグループから選択される、
    請求項1に記載の電気化学エッチング液。
  5. 【請求項5】前記硫酸塩化合物の濃度が0.2から0.
    5Mである、請求項1に記載の電気化学エッチング液。
  6. 【請求項6】溶解させない1種または数種の第1の金属
    の存在下で、物品中の溶解させる1種または数種の第2
    の金属を選択的に溶解させる方法であって、 前記第2の金属を、濃度1.30から1.70Mのグリ
    セリンと、硫酸イオン濃度0から0.5Mの硫酸塩化合
    物と、リン酸イオン濃度0.1から0.5Mのリン酸塩
    化合物を含む水性エッチング液を用いて電気化学的にエ
    ッチングする段階を含む方法。
  7. 【請求項7】前記エッチング液のpHが4から9であ
    る、請求項6に記載の方法。
  8. 【請求項8】前記第1の金属が、鉛、スズおよびこれら
    の合金から成るグループから選択される、請求項6に記
    載の方法。
  9. 【請求項9】前記第2の金属が、クロム、銅、ニッケル
    およびこれらの合金から成るグループから選択される、
    請求項6に記載の方法。
  10. 【請求項10】前記硫酸塩化合物の濃度が0.2から
    0.5Mである、請求項6に記載の方法。
  11. 【請求項11】選択的エッチングする方法であって、 第1の金属および第2の金属を有する物品を用意する段
    階と、 前記第2の金属を、濃度1.30から1.70Mのグリ
    セリンと、硫酸イオン濃度0から0.5Mの硫酸塩化合
    物と、リン酸イオン濃度0.1から0.5Mのリン酸塩
    化合物を含む水性エッチング液を用いて電気化学的にエ
    ッチングする段階とを含む方法。
  12. 【請求項12】前記エッチング液のpHが4から9であ
    る、請求項11に記載の方法。
  13. 【請求項13】前記第1の金属が、鉛、スズおよびこれ
    らの合金から成るグループから選択される、請求項11
    に記載の方法。
  14. 【請求項14】前記第2の金属が、クロム、銅、ニッケ
    ルおよびこれらの合金から成るグループから選択され
    る、請求項11に記載の方法。
  15. 【請求項15】前記硫酸塩化合物の濃度が0.2から
    0.5Mである、請求項11に記載の方法。
JP2001323511A 2000-10-26 2001-10-22 選択的電気化学エッチング方法およびそれに用いるエッチング液 Expired - Fee Related JP3368271B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US09/697333 2000-10-26
US09/697,333 US6468413B1 (en) 2000-10-26 2000-10-26 Electrochemical etch for high tin solder bumps

Publications (2)

Publication Number Publication Date
JP2002180299A JP2002180299A (ja) 2002-06-26
JP3368271B2 true JP3368271B2 (ja) 2003-01-20

Family

ID=24800725

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2001323511A Expired - Fee Related JP3368271B2 (ja) 2000-10-26 2001-10-22 選択的電気化学エッチング方法およびそれに用いるエッチング液

Country Status (5)

Country Link
US (1) US6468413B1 (ja)
JP (1) JP3368271B2 (ja)
CN (1) CN1184362C (ja)
SG (1) SG94868A1 (ja)
TW (1) TW555886B (ja)

Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6876052B1 (en) * 2000-05-12 2005-04-05 National Semiconductor Corporation Package-ready light-sensitive integrated circuit and method for its preparation
JP4293500B2 (ja) * 2001-05-07 2009-07-08 第一電子工業株式会社 電子部品の製造方法
US6854636B2 (en) * 2002-12-06 2005-02-15 International Business Machines Corporation Structure and method for lead free solder electronic package interconnections
US6900142B2 (en) * 2003-07-30 2005-05-31 International Business Machines Corporation Inhibition of tin oxide formation in lead free interconnect formation
US20060021974A1 (en) * 2004-01-29 2006-02-02 Applied Materials, Inc. Method and composition for polishing a substrate
US6995084B2 (en) * 2004-03-17 2006-02-07 International Business Machines Corporation Method for forming robust solder interconnect structures by reducing effects of seed layer underetching
CN110310939B (zh) * 2018-03-27 2021-04-30 矽品精密工业股份有限公司 基板结构及其制法及导电凸块
CN111621787B (zh) * 2020-04-27 2022-07-12 江苏富乐华半导体科技股份有限公司 一种蚀刻液体系及一种氮化铝基板的刻蚀方法

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3065508B2 (ja) 1994-06-15 2000-07-17 インターナショナル・ビジネス・マシーンズ・コーポレ−ション C4製造のためのTiWの選択的エッチング
JP3172501B2 (ja) 1997-10-30 2001-06-04 インターナショナル・ビジネス・マシーンズ・コーポレ−ション チタン・タングステン合金のエッチング方法およびエッチャント溶液

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3134054A1 (de) * 1981-08-28 1983-05-05 Hoechst Ag, 6230 Frankfurt Elektrochemisches entwicklungsverfahren fuer reproduktionsschichten
US5318677A (en) * 1991-02-13 1994-06-07 Future Automation, Inc. Process and solutions for removing resin bleed from electronic components
US5486282A (en) 1994-11-30 1996-01-23 Ibm Corporation Electroetching process for seed layer removal in electrochemical fabrication of wafers
US5800726A (en) 1995-07-26 1998-09-01 International Business Machines Corporation Selective chemical etching in microelectronics fabrication

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3065508B2 (ja) 1994-06-15 2000-07-17 インターナショナル・ビジネス・マシーンズ・コーポレ−ション C4製造のためのTiWの選択的エッチング
JP3172501B2 (ja) 1997-10-30 2001-06-04 インターナショナル・ビジネス・マシーンズ・コーポレ−ション チタン・タングステン合金のエッチング方法およびエッチャント溶液

Also Published As

Publication number Publication date
CN1354285A (zh) 2002-06-19
JP2002180299A (ja) 2002-06-26
US6468413B1 (en) 2002-10-22
TW555886B (en) 2003-10-01
CN1184362C (zh) 2005-01-12
SG94868A1 (en) 2003-03-18

Similar Documents

Publication Publication Date Title
US6015505A (en) Process improvements for titanium-tungsten etching in the presence of electroplated C4's
US4087314A (en) Bonding pedestals for semiconductor devices
EP0687751B1 (en) Selective etching of TiW for C4 fabrication
US6750133B2 (en) Selective ball-limiting metallurgy etching processes for fabrication of electroplated tin bumps
US5508229A (en) Method for forming solder bumps in semiconductor devices
KR100334593B1 (ko) 반도체 소자 및 그 제조 방법
US6989326B2 (en) Bump manufacturing method
US20080157395A1 (en) Interconnections for flip-chip using lead-free solders and having improved reaction barrier layers
JP2001308129A (ja) 鉛フリーバンプの形成方法
JP2003007755A (ja) 下部バンプ金属のためのバリアキャップ
US6664128B2 (en) Bump fabrication process
US5800726A (en) Selective chemical etching in microelectronics fabrication
TW200846497A (en) Selective etch of TiW for capture pad formation
TW201000687A (en) Method of producing electronic component
JP3368271B2 (ja) 選択的電気化学エッチング方法およびそれに用いるエッチング液
US20210242146A1 (en) Flip chip packaging rework
US7425278B2 (en) Process of etching a titanium/tungsten surface and etchant used therein
US20080119056A1 (en) Method for improved copper layer etching of wafers with c4 connection structures
US6716739B2 (en) Bump manufacturing method
US6900142B2 (en) Inhibition of tin oxide formation in lead free interconnect formation
JPS6112047A (ja) 半導体装置の製造方法
JP2002327279A (ja) 電子部品の接合方法
JP2002334897A (ja) 半導体装置のバンプ構造及びその製造方法
JP3308882B2 (ja) 半導体装置の電極構造の製造方法
JP2002076046A (ja) 半導体装置の製造方法

Legal Events

Date Code Title Description
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20071108

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20081108

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20081108

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20091108

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20091108

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101108

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101108

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111108

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111108

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121108

Year of fee payment: 10

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121108

Year of fee payment: 10

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131108

Year of fee payment: 11

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313113

R360 Written notification for declining of transfer of rights

Free format text: JAPANESE INTERMEDIATE CODE: R360

R360 Written notification for declining of transfer of rights

Free format text: JAPANESE INTERMEDIATE CODE: R360

R371 Transfer withdrawn

Free format text: JAPANESE INTERMEDIATE CODE: R371

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313113

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees