JP3250166B2 - 積層複合電子部品 - Google Patents
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Description
を組み込み、一つの機能ブロックを形成した積層複合電
子部品に関する。
要望を満たすために、電子部品の小型化と、電子部品を
近接して搭載する高密度実装技術の開発が進められてい
る。電子部品の小型化は、部品単体を小さくすること
と、その小さくした複数の電子素子を一つの積層電子部
品に組み込む、いわゆる複合化が進められ、その技術は
セラミック積層技術の発展とともに急速に進展し、その
完成部品は積層複合電子部品として他の個別部品と一緒
にプリント基板に搭載して使用されている。
示すように、フェライト磁性体内にコイルを埋設し、外
部電極20、20を有する積層インダクタ21の主面上
に抵抗体等の受動素子を有する導体回路を形成し、この
回路の導体ランドにトランジスタ、半導体IC等の能動
素子として例えば半導体ICのベアチップ22を導電性
接着剤23により接着する、いわゆるダイボンデングを
行い、一方該ベアチップの電極と上記導体回路の電極2
4、24を金線25、25・・で接続する、いわゆるワ
イヤボンデングを行い、そしてこの主面上の回路全体を
樹脂層26により埋め込んで複数の素子の機能を複合化
し、一つの電子回路を構成した電子部品とすることが広
く行われている。また、積層インダクタの代わりに、誘
電体磁器内にコンテンサを埋設した積層コンデンサや、
さらには積層インダクタと積層コンデンサを一体化して
得た積層体素子を上記に準じて用いることも広く行われ
ている。
証する一つの目安として、ヒートサイクルテストという
加速試験方法がある。この方法は、試験対象の部品を−
55℃の温度雰囲気中に30分間放置した後、速やかに
125℃の温度雰囲気中に移行させ、その温度で30分
放置する操作を1サイクルとし、連続500サイクル繰
り返し、試験前後の特性を比較してJIS等に定める規
格以内であるかどうかをみるものであり、規格内であれ
ば信頼性が保証されたとするものである。
載した積層複合電子部品に上記ヒートサイクルテストを
行うと、半導体ベアチップにクラックが入り、その特性
が低下することがあるという課題があった。
行ってもチップ部品の特性を低下させることのない積層
複合電子部品を提供することにある。
決するために、コイル、コンデンサ及び抵抗体の少なく
とも一つの素子を内部に有する積層体素子の主面に電子
回路を有する積層複合電子部品において、該積層体素子
の両主面を構成する最外層の内少なくとも電子回路を搭
載する側の最外層は該最外層に隣接する該積層体素子の
素地の線膨張係数より小さく、該電子回路に接続される
チップ部品の線膨張係数より大きい線膨張係数を有する
熱応力緩和層であり、該熱応力緩和層の線膨張係数が2
〜7×10 -6 /℃であり、かつ該熱応力緩和層と該チッ
プ部品との線膨張係数の比が2.5より小さい積層複合
電子部品を提供するものである。この際、積層体素子の
両主面を構成する両方の最外層が当該それぞれの最外層
に隣接する該積層体素子の素地の線膨張係数より小さ
く、該電子回路に接続されるチップ部品の線膨張係数よ
り大きい線膨張係数を有する熱応力緩和層であること、
この熱応力緩和層と積層体素子の素地との間に両者の各
成分が拡散した拡散層を有することが好ましい。
接する積層体素子の素地の線膨脹係数より小さく、電子
回路に接続されるチップ部品の線膨脹係数より大きい線
膨脹係数を有するが、積層体素子の素地は、例えばフェ
ライト磁性体層の線膨脹係数が10〜11×10-6/
℃、セラミック誘電体層の線膨脹係数が9〜10×10
-6/℃であり、一方チップ部品、例えは半導体ベアチッ
プの線膨脹係数はシリコーン基板が用いられるので2〜
3×10-6/℃であるから、積層体素子の素地の線膨脹
係数と半導体ベアチップの線膨脹係数の中間の線膨脹係
数である、2〜7×10-6/℃の線膨脹係数を有するこ
とが好ましい。熱応力緩和層の線膨脹係数が2×10-6
/℃より小さいと、熱応力緩和層と積層体素子の素地と
の間にクラックが入り易く、7×10-6/℃より大きい
とチップ部品にクラックが入り易い。熱応力緩和層と積
層体素子に搭載されるチップ部品との線膨脹係数の比が
3程度であれば、チップ部品にクラックの入ることが少
なく、5を越えるとクラックの入る割合が多くなり、不
良率が大きくなる。フェライト磁性体層にベアチップを
搭載した際の不良率は、セラミック誘電体層にベアチッ
プを搭載した際の不良率より高い。シリコーンを基板と
する他のチップ部品やその他のチップ部品についても上
記のことに準じて考えられる。熱応力緩和層としての材
料としては、アルミナ粉末その他の無機粉末、ホウケイ
酸鉛ガラスその他のガラス粉末、これらの混合物その他
のセラミック粉末が挙げられる。
異なり、熱による伸縮の割合が大きく異なってもその応
力をその中間の線膨脹係数を有する熱応力緩和層により
緩和できる。特にこの中間の線膨脹係数を有する熱応力
緩和層は、これと接する積層体素子の素地と互いに各成
分が拡散しあい、両者の中間の線膨脹係数を有する拡散
層が形成され、熱応力緩和層と積層体素子の素地のそれ
ぞれとの応力を緩和する効果がある。
イト磁性体グリーンシートを作成し、その何枚かにスル
ホールを形成するとともに導電ペーストのAg─Pdペ
ーストをスクリーン印刷することにより、それぞれに全
体としてコイルを形成するようにそのコイルの一部を形
成するコイル導体バターン塗膜を形成し、それらをコイ
ル導体バターン塗膜がコイルを形成するように重ね合わ
せ、さらにカバーシートとして上記フェライト磁性体グ
リーンシーの複数枚をその両端に重ね合わせ、積層イン
ダクタ未焼成体を作成する。なお、コイルの両端に当た
るコイル導体バターン塗膜はフェライト磁性体グリーン
シートの端部まで引き出され、後に外部電極と接続され
る。一方、Al2 O3 とホウケイ酸鉛ガラスを主成分と
する厚さ100μmの絶縁体グリーンシートを作成す
る。次に、上記積層インダクタ未焼成体の両主面のそれ
ぞれに上記絶縁体グリーンシートを重ね、ついで圧着
し、積層インダクタ未焼成圧着体を作成する。実際には
上記積層インダクタ未焼成圧着体は個々に作成されるの
ではなく、1単位のシート重ね体にその多数が形成さ
れ、圧着後個々の積層インダクタ未焼成圧着体に切断さ
れる。
900℃、60分焼成し、図1に示す複合用積層インダ
クタ1を得る。この複合用積層インダクタ1について、
各部分を削り取って線膨脹係数を測定したところ、積層
インダクタ本体2と、それぞれ50μmの拡散層3、3
と、 それぞれ75μmのセラミック絶縁体層4、4に
分かれることがわかった。すなわち、積層インダクタ本
体2はその素地の線膨脹係数が11×10-6/℃であ
り、セラミック絶縁体層4、4の線膨脹係数は5×10
-6/℃であり、拡散層3、3の線膨脹係数は8×10-6
/℃であった。なお、後述の半導体ベアチップの線膨脹
係数は2.4×10-6/℃であった。
に導体ランド塗膜を有する厚膜導体塗膜、厚膜抵抗体塗
膜をスクリーン印刷により形成し、焼き付け、それぞれ
導体ランドを有する配線導体と抵抗体を有する厚膜回路
を形成する。ついで、コイル導体塗膜の焼成体からなる
コイル導体が導出されている積層インダクタ本体2の外
側面及び上記拡散層3、3、セラミック絶縁体層4、4
の対応する外側面にそのコイル導体の端部に接続する外
部電極塗膜をスクリーン印刷法により形成して焼付け、
外部電極5、5・・を形成する。
インダクタ1のセラミック絶縁体層4、4の一方の主面
に形成した導体ランド6に半導体ベアチップ7を導電性
エポキシ樹脂接着剤8でダイボンデングし、この半導体
ベアチップ7の他の電極と配線導体の電極9、9とを金
線10、10・・でワイヤボンデングする。そしてその
主面内に形成された半導体ベアチップ7を含む電子回路
全体を樹脂層11により埋め込む。このようにして、複
合用積層インダクタ1の一方の主面に電子回路を設け、
フェライト磁性体内のインダクタと接続した積層複合電
子部品ができあがる。
DCコンバータを50個作成し、その出力特性を測定し
たところ、いずれも規格を満足していた。また、上述の
ヒートサイクルテストを行ない、連続して500サイク
ル繰り返した後、DC−DCコンバータの出力特性を測
定した結果、規格を越えて異常と判断されるものは皆無
であった。
クタ1を作成し、その一方の主面に実施例1と同様の方
法で異なる導体回路を形成し、その電極12、12に面
実装型半導体ICチップ13のバンプ14、14をはん
だ付けにより接続し、その主面周縁にこのチップを含む
全体の電子回路を囲う枠体15を設ける。
5×10-6/℃とするように、Al2 O3 とホウケイ酸
鉛ガラスの比率を変えた絶縁体グリーンシートを用いた
以外は同様にしてDC−DCコンバータを50個作成
し、これらについても実施例1と同様に試験したとこ
ろ、異常と判断されるものは皆無であった。
を多数作成し、その何枚かにスクリーン印刷法により導
電ベーストからなる内部電極塗膜を印刷し、それらをそ
れぞれの誘電体グリーンシートを介して内部電極塗膜が
対向するように重ね、さらにその重ね体の上下両端にカ
バーシートとして複数の上記誘電体グリーンシートを重
ね、積層コンデンサ未焼成体を作成する。なお、両端の
内部電極塗膜はシートの端部まで引き出し、後述の外部
電極と接続できるようにする。そして、この積層コンデ
ンサ未焼成体と実施例1で作成したと同様の積層インダ
クタ未焼成体とを重ね、さらにその両端にそれぞれ実施
例1で用いた絶縁体グリーンシートを重ね、圧着して積
層LC未焼成圧着体を作成する。実際には、積層LC未
焼成圧着体は個々に作成するのではなく、1単位のシー
ト重ね体にその多数が形成され、圧着後個々の積層LC
未焼成圧着体に切断される。この積層LC未焼成圧着体
を焼成し、積層インダクタと積層コンデンサからなる複
合用積層LC体を作成した。実施例1と同様に、この複
合用積層LC体に積層インダクタの両端のコイル導体、
積層コンデンサの両端の内部電極に接続する外部電極を
形成するとともに、その一方の主面に導体回路を形成し
て半導体ベアチップを接続し、積層複合電子部品を作成
した。このような積層複合電子部品としてドルビ─ノイ
ズリダクションをを50個作成し、そのレスポンス特性
を測定したところ、異常と判断されるものは皆無であっ
た。
8×10-6/℃とするように、Al2 O3 とホウケイ酸
鉛ガラスの比率を変えた絶縁体グリーンシートを用いた
以外は同様にしてDC−DCコンバータを50個作成
し、これらについても実施例1と同様に試験したとこ
ろ、異常と判断されるものは5個あった。
9×10-6/℃とするように、Al2 O3 とホウケイ酸
鉛ガラスの比率を変えた絶縁体グリーンシートを用いた
以外は同様にしてDC−DCコンバータを50個作成
し、これらについても実施例1と同様に試験したとこ
ろ、異常と判断されるものは10個あった。
1×10-6/℃とするように、Al2 O3 、ホウケイ酸
鉛ガラス、石英ガラスの比率を変えた絶縁体グリーンシ
ートを用いた以外は同様にしてDC−DCコンバータを
50個作成し、これらについても実施例1と同様に試験
したところ、異常と判断されるものは5個あった。
膨張係数より小さく、積層体素子に設けられる電子回路
に接続されるチップ部品の線膨張係数より大きい線膨張
係数を有する熱応力緩和層を積層体素子とチップ部品の
間に設け、その熱応力緩和層の線膨張係数を2〜7×1
0 -6 /℃とし、かつこの熱応力緩和層と上記チップ部 品
との線膨張係数の比を2.5より小さくしたので、上記
したヒートサイクルテストにも耐える積層複合電子部品
を提供することができ、例えば半導体ベアチップにクラ
ックが入ることがなく、熱応力(ヒートショック)に対
する信頼性を向上することができる。
断面図である。
図である。
Claims (3)
- 【請求項1】 コイル、コンデンサ及び抵抗体の少なく
とも一つの素子を内部に有する積層体素子の主面に電子
回路を有する積層複合電子部品において、該積層体素子
の両主面を構成する最外層の内少なくとも電子回路を搭
載する側の最外層は該最外層に隣接する該積層体素子の
素地の線膨張係数より小さく、該電子回路に接続される
チップ部品の線膨張係数より大きい線膨張係数を有する
熱応力緩和層であり、該熱応力緩和層の線膨張係数が2
〜7×10 -6 /℃であり、かつ該熱応力緩和層と該チッ
プ部品との線膨張係数の比が2.5より小さい積層複合
電子部品。 - 【請求項2】 積層体素子の両主面を構成する両方の最
外層が当該それぞれの最外層に隣接する該積層体素子の
素地の線膨張係数より小さく、該電子回路に接続される
チップ部品の線膨張係数より大きい線膨張係数を有する
熱応力緩和層である請求項1記載の積層複合電子部品。 - 【請求項3】 熱応力緩和層と積層体素子の素地との間
に両者の各成分が拡散した拡散層を有する請求項1又は
2記載の積層複合電子部品。
Priority Applications (1)
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---|---|---|---|
JP26840593A JP3250166B2 (ja) | 1993-09-30 | 1993-09-30 | 積層複合電子部品 |
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---|---|---|---|
JP26840593A JP3250166B2 (ja) | 1993-09-30 | 1993-09-30 | 積層複合電子部品 |
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JPH07106717A JPH07106717A (ja) | 1995-04-21 |
JP3250166B2 true JP3250166B2 (ja) | 2002-01-28 |
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Country | Link |
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JP (1) | JP3250166B2 (ja) |
-
1993
- 1993-09-30 JP JP26840593A patent/JP3250166B2/ja not_active Expired - Fee Related
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JPH07106717A (ja) | 1995-04-21 |
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