JP3207986B2 - 負荷制御装置 - Google Patents
負荷制御装置Info
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- JP3207986B2 JP3207986B2 JP30565293A JP30565293A JP3207986B2 JP 3207986 B2 JP3207986 B2 JP 3207986B2 JP 30565293 A JP30565293 A JP 30565293A JP 30565293 A JP30565293 A JP 30565293A JP 3207986 B2 JP3207986 B2 JP 3207986B2
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- JP
- Japan
- Prior art keywords
- power supply
- circuit
- microcomputer
- short
- control device
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Description
【０００１】
【産業上の利用分野】本発明は、通常同時に通電される
ことのない複数の負荷装置それぞれをマイクロコンピュ
ータによって制御される駆動回路とそれら駆動回路の個
々に接続したリレーによってＯＮ−ＯＦＦする負荷制御
装置に関するものである。
ことのない複数の負荷装置それぞれをマイクロコンピュ
ータによって制御される駆動回路とそれら駆動回路の個
々に接続したリレーによってＯＮ−ＯＦＦする負荷制御
装置に関するものである。
【０００２】
【従来の技術】複数の負荷装置を備えるとともにそれら
複数の負荷装置を同時に作動させないようにしたものに
おいて、故障によって一つの負荷が作動しているときで
も、他の負荷を作動させると、禁止されているはずの複
数の負荷の作動が行なわれてしまっていた。
複数の負荷装置を同時に作動させないようにしたものに
おいて、故障によって一つの負荷が作動しているときで
も、他の負荷を作動させると、禁止されているはずの複
数の負荷の作動が行なわれてしまっていた。
【０００３】
【発明が解決しようとする課題】複数の負荷の同時通電
によって定格電流を越える負荷電流が流れることにな
り、危険状態に突入してしまう問題があった。
によって定格電流を越える負荷電流が流れることにな
り、危険状態に突入してしまう問題があった。
【０００４】
【課題を解決するための手段】本発明は上述の課題を解
決するためになされたもので、同時に通電されることの
ない複数の負荷手段のそれぞれをマイクロコンピュータ
によって制御される駆動回路とそれら駆動回路の個々に
接続したリレーによってＯＮ−ＯＦＦする負荷制御装置
において、同時にＯＮすべきでない複数のリレーが同時
にＯＮした場合に制御装置の電源を短絡させて電源電圧
を降下させる短絡手段と、その電源電圧レベルが所定の
値まで低下したときにマイクロコンピュータにリセット
をかけるリセット回路とを備えて負荷制御装置を構成す
る。
決するためになされたもので、同時に通電されることの
ない複数の負荷手段のそれぞれをマイクロコンピュータ
によって制御される駆動回路とそれら駆動回路の個々に
接続したリレーによってＯＮ−ＯＦＦする負荷制御装置
において、同時にＯＮすべきでない複数のリレーが同時
にＯＮした場合に制御装置の電源を短絡させて電源電圧
を降下させる短絡手段と、その電源電圧レベルが所定の
値まで低下したときにマイクロコンピュータにリセット
をかけるリセット回路とを備えて負荷制御装置を構成す
る。
【０００５】
【作用】同時にＯＮすべきでない複数のリレーが同時に
ＯＮして複数の負荷が同時に作動すると、短絡手段が短
絡して電源電圧を降下させる。そしてリセット回路がマ
イクロコンピュータに対してリセットをかけ、マイクロ
コンピュータによる負荷の複数同時駆動制御つまり複数
同時通電制御が停止される。
ＯＮして複数の負荷が同時に作動すると、短絡手段が短
絡して電源電圧を降下させる。そしてリセット回路がマ
イクロコンピュータに対してリセットをかけ、マイクロ
コンピュータによる負荷の複数同時駆動制御つまり複数
同時通電制御が停止される。
【０００６】
【実施例】図１に本発明の一実施例による負荷制御装置
の回路図を示す。この図１において、１はマイクロコン
ピュータ、２、３は負荷（図示せず）の接続されたリレ
ー、４、５はそれらリレー２、３を駆動するための駆動
用トランジスタ、６は駆動用トランジスタ４、５が同時
にＯＮした場合に電源電圧を短絡するためのトランジス
タ、７はマイクロコンピュータ１を初期化するためのリ
セット回路、８は制御装置の電源、そして９は制御装置
の電源８からマイクロコンピュータ１用の電源を作るレ
ギュレータである。
の回路図を示す。この図１において、１はマイクロコン
ピュータ、２、３は負荷（図示せず）の接続されたリレ
ー、４、５はそれらリレー２、３を駆動するための駆動
用トランジスタ、６は駆動用トランジスタ４、５が同時
にＯＮした場合に電源電圧を短絡するためのトランジス
タ、７はマイクロコンピュータ１を初期化するためのリ
セット回路、８は制御装置の電源、そして９は制御装置
の電源８からマイクロコンピュータ１用の電源を作るレ
ギュレータである。
【０００７】なお、電源８の電圧は負電源とし、その電
圧を−２４Ｖに、レギュレータ９の電圧を−５Ｖとす
る。リセット回路７は電源８の電圧が−１５Ｖ以上にな
った場合にマイクロコンピュータ１のリセット端子に対
して−５Ｖを印加し、マイクロコンピュータ１をリセッ
トするものとする。また、制御装置の電源８は、電源短
絡状態で−１０Ｖ以下まで電圧降下する電源容量のもの
とする。
圧を−２４Ｖに、レギュレータ９の電圧を−５Ｖとす
る。リセット回路７は電源８の電圧が−１５Ｖ以上にな
った場合にマイクロコンピュータ１のリセット端子に対
して−５Ｖを印加し、マイクロコンピュータ１をリセッ
トするものとする。また、制御装置の電源８は、電源短
絡状態で−１０Ｖ以下まで電圧降下する電源容量のもの
とする。
【０００８】さて、駆動用トランジスタ４が作動してそ
れに接続しているリレー２がＯＮしている状態では、短
絡用トランジスタ６には十分なベース電流が供給されて
おり、そのコレクタ−エミッタ間は導通可能状態となっ
ている。
れに接続しているリレー２がＯＮしている状態では、短
絡用トランジスタ６には十分なベース電流が供給されて
おり、そのコレクタ−エミッタ間は導通可能状態となっ
ている。
【０００９】つぎに、駆動用トランジスタ４の作動が停
止して駆動用トランジスタ５がＯＮした場合は、短絡用
トランジスタ６にはベース電流が供給されないので、そ
のコレクタ−エミッタ間は遮断状態となっており、リレ
ー３のＯＮが保たれる。
止して駆動用トランジスタ５がＯＮした場合は、短絡用
トランジスタ６にはベース電流が供給されないので、そ
のコレクタ−エミッタ間は遮断状態となっており、リレ
ー３のＯＮが保たれる。
【００１０】駆動用トランジスタ４に短絡するという異
常が発生してリレー２のＯＮが解除されない状態で駆動
用トランジスタ５がＯＮすると、短絡用トランジスタ６
によって電源８の短絡回路が生成され、つまり電源８の
電圧が降下し、電源電圧が−１５Ｖ以上になったところ
でリセット回路７によりマイクロコンピュータ１にリセ
ットがかかり、駆動用トランジスタ５がＯＦＦする。
常が発生してリレー２のＯＮが解除されない状態で駆動
用トランジスタ５がＯＮすると、短絡用トランジスタ６
によって電源８の短絡回路が生成され、つまり電源８の
電圧が降下し、電源電圧が−１５Ｖ以上になったところ
でリセット回路７によりマイクロコンピュータ１にリセ
ットがかかり、駆動用トランジスタ５がＯＦＦする。
【００１１】同様に、駆動用トランジスタ５が短絡状態
の場合にも、短絡用トランジスタ６のエミッタ−コレク
タ間には電源電圧が印可されており、駆動用トランジス
タ４がＯＮすればそのベースに電流が供給されるので、
コレクタ−エミッタ間が導通し、短絡電流が流れて電源
８の電圧が降下する。上述の場合と同様に、電源電圧が
−１５Ｖ以上になったところでリセット回路７によりマ
イクロコンピュータ１にリセットがかかり、駆動用トラ
ンジスタ４がＯＦＦする。
の場合にも、短絡用トランジスタ６のエミッタ−コレク
タ間には電源電圧が印可されており、駆動用トランジス
タ４がＯＮすればそのベースに電流が供給されるので、
コレクタ−エミッタ間が導通し、短絡電流が流れて電源
８の電圧が降下する。上述の場合と同様に、電源電圧が
−１５Ｖ以上になったところでリセット回路７によりマ
イクロコンピュータ１にリセットがかかり、駆動用トラ
ンジスタ４がＯＦＦする。
【００１２】
【発明の効果】以上本発明によれば、複数の負荷装置に
同時に通電されることがなくなるので、定格を越える負
荷電流が流れて危険状態に立ち至ることが防止できるよ
うになった。
同時に通電されることがなくなるので、定格を越える負
荷電流が流れて危険状態に立ち至ることが防止できるよ
うになった。
【図１】本発明の一実施例を示す負荷制御装置の回路図
である。
である。
１ マイクロコンピュータ ２ リレー ３ リレー ４ 駆動用トランジスタ ５ 駆動用トランジスタ ６ 短絡用トランジスタ ７ リセット回路 ８ 電源
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平４−371728（ＪＰ，Ａ) 特開 平４−138023（ＪＰ，Ａ) 特開 昭61−258627（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H02J 1/00
Claims (1)
- 【請求項１】 同時に通電されることのない複数の負荷
手段のそれぞれをマイクロコンピュータ（１）によって
制御される駆動回路（４）、（５）とそれら駆動回路
（４）、（５）の個々に接続したリレー（２）、（３）
によってＯＮ−ＯＦＦする負荷制御装置において、同時
にＯＮすべきでない前記複数のリレー（２）、（３）が
同時にＯＮした場合に制御装置の電源（８）を短絡させ
て電源電圧を降下させる短絡手段（６）と、その電源電
圧レベルが所定の値まで低下したときに前記マイクロコ
ンピュータ（１）にリセットをかけるリセット回路
（７）とを備えたことを特徴とする負荷制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30565293A JP3207986B2 (ja) | 1993-12-07 | 1993-12-07 | 負荷制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30565293A JP3207986B2 (ja) | 1993-12-07 | 1993-12-07 | 負荷制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07163049A JPH07163049A (ja) | 1995-06-23 |
| JP3207986B2 true JP3207986B2 (ja) | 2001-09-10 |
Family
ID=17947719
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30565293A Expired - Fee Related JP3207986B2 (ja) | 1993-12-07 | 1993-12-07 | 負荷制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3207986B2 (ja) |
-
1993
- 1993-12-07 JP JP30565293A patent/JP3207986B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07163049A (ja) | 1995-06-23 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
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| R360 | Written notification for declining of transfer of rights |
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| R371 | Transfer withdrawn |
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