JP3113476B2 - ピーク値検出保持回路 - Google Patents
ピーク値検出保持回路Info
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Description
れたアナログ信号のピーク値を検出して保持するピーク
値検出保持回路に関するものである。
検出保持回路の一例を示す。本図に示す回路は、ＣＣＤ
などの撮像素子によって読み取られた画像信号のピーク
値を検出保持し、１ライン走査毎のピーク値をデジタル
信号として出力するものである。
ｎをデジタル信号に変換するＡ／Ｄコンバータ、４はＡ
／Ｄコンバータ２に参照電圧Ｖｒｅｆを供給するピーク
値検出／保持用参照電圧発生器、６はアナログ入力信号
Ａｉｎと参照電圧Ｖｒｅｆ（＝Ｐｏｕｔ）の大小関係を
比較するコンパレータ、８はコンパレータ６の特定出力
に応答してカウントアップを行い、かつ、ライン走査信
号に同期したＤＯＷＮ制御信号に応答してカウントダウ
ンを行うＵＰ／ＤＯＷＮカウンタである。
形図である。本図において、横軸は時間（ｔ）を、縦軸
は出力電圧（Ｖ）を示す。ここで、縦軸の電圧（Ｖ）の
うち高い方の電圧は白側（背景もしくは下地に対応した
濃度を表わす）を、より低い方の電圧は黒側（文字・図
形などの画像に対応した濃度を表わす）を示している。
する。ピーク値検出／保持用参照電圧発生器４からは出
力電圧ＰｏｕｔがＡ／Ｄコンバータ２の参照電圧Ｖｒｅ
ｆとして供給され（Ｖｒｅｆ＝Ｐｏｕｔ）、これと同時
に、このＰｏｕｔはコンパレータ６にてアナログ入力電
圧Ａｉｎと比較される。そして、Ａｉｎ＞Ｐｏｕｔなら
ば、ＵＰ／ＤＯＷＮカウンタ８をカウントアップさせる
ための出力信号がコンパレータ６から送出される。この
ことにより、Ｐｏｕｔは既定のＵＰ定数だけ上昇する
（すなわち、白側に追従する）。他方、Ａｉｎ＞Ｐｏｕ
ｔでなければ、Ｐｏｕｔは不変となる。この場合、白側
への追従速度を表わす上記のＵＰ定数は、ピーク値検出
保持回路の回路規模と検出精度の関係から、１画素で１
ＬＳＢだけ変化するのが望ましい。
イン走査信号に同期したＤＯＷＮ制御信号がＵＰ／ＤＯ
ＷＮカウンタ８に供給され、そのカウント値が一定のＤ
ＯＷＮ定数に相当する値だけ下がる。このことにより、
Ｐｏｕｔは一定のＤＯＷＮ定数ぶんだけ黒側に追従す
る。
コンバータ２の参照電圧として用いられるので、光源や
ＣＣＤの特性に変動が生じた場合、あるいは、原稿の下
地の色が変化した場合などにおいても、Ａ／Ｄ変換の精
度が劣化するのを防止している。
３９１４１号公報、特開昭６３−３９１４２号公報、特
開昭６３−６４１１号公報に記載されている。
よび図５に示した従来のピーク値検出保持回路では、黒
側への追従速度を表わすＤＯＷＮ定数を設定するにあた
り、ＣＣＤセンサの特性・光源・原稿などの種別に応じ
て、個別に選択しなければならないという欠点がみられ
る。
Ｎ定数を小さく選定した場合には、入力アナログ信号Ａ
ｉｎが減少しているにも拘らず、なかなか黒側への追従
が完了せず（図中、×印で示した）、適切なＡ／Ｄ変換
が不可能になるという問題が生じる。
ように、ＤＯＷＮ定数を大きく選定した場合には、各ラ
イン毎においてなかなか白側追従が完了せず（図中、×
印で示した）、Ａ／Ｄ変換の精度が損われるという問題
が生じる。
ナログ信号のピーク値への追従性を最適にすることがで
きるピーク値検出保持回路を提供することにある。
めに、本発明は、ライン走査により得られたアナログ信
号のピーク値を検出して保持するピーク値検出保持回路
において、ライン走査毎に生じるピーク値を表すカウン
ト値を出力し、かつライン走査に同期して該カウント値
をリセットするピーク値検出回路と、前記カウント値を
記憶するメモリと、前記メモリに記憶されたカウント値
に所定の演算処理を施す演算回路と、前記演算された値
を格納するレジスタと、前記レジスタに格納された値に
基づいて、前記アナログ信号をデジタル信号化するＡ／
Ｄコンバータの参照電圧として出力する参照電圧発生回
路と、を具備したものである。
グ信号のピーク値をカウント値、すなわちデジタル値に
変換し、このデジタル値に基づいてＡ／Ｄコンバータの
参照電圧を発生させることとしているので、このアナロ
グ値−デジタル値への変換時のスピードあるいは分解能
を最適化にすることにより、アナログ信号のピーク値へ
の追従性を最適にすることができる。
するのに先立って、図１を参照して、前提的な説明を行
う。図１に示したＡ／Ｄコンバータ２と、ピーク値検出
用参照電圧発生器４′と、コンパレータ６は、図４に示
したＡ／Ｄコンバータ２、ピーク値検出／保持用参照電
圧発生器４およびコンパレータ６とそれぞれ同一構成を
有し、その動作も先に説明したとおりである。ただし、
図１に示した回路では、コンパレータ６の出力をＵＰカ
ウンタ１０に入力しており、このＵＰカウンタ１０はラ
イン走査に同期してリセットされる。従って、ピーク値
検出用参照電圧発生器４′から出力されるＰｏｕｔは１
ライン走査毎に初期値にリセットされる。
ジスタ１２にも併せて供給され、ＵＰカウンタ１０に印
加されるリセット信号よりわずか前に発生されるロード
制御信号に応答して、レジスタ１２内にそのカウント値
が格納される。
は、先の述べたピーク値検出用参照電圧発生器４′と同
等の構成を有するピーク値保持用参照電圧発生器１４に
入力される。そして、このピーク値保持用参照電圧発生
器１４から出力された電圧ＰＨｏｕｔは、Ａ／Ｄコンバ
ータ２の参照電圧Ｖｒｅｆとして使用される（Ｖｒｅｆ
＝ＰＨｏｕｔ）。
入力信号のピーク値検出に関しては、ピーク値検出回路
２０において従来（図４参照）と同様の白側追従が段階
的に行われる。ただし、ライン毎に検出されたピーク値
は、各ラインの終わりでピーク値保持回路３０のレジス
タ１２に移され、保持されたピーク値として、ピーク値
保持用参照電圧発生器１４からＰＨｏｕｔがＡ／Ｄコン
バータ２に供給される。このことにより、次のラインに
おけるＡ／Ｄ変換用参照電圧Ｖｒｅｆとして、上記ＰＨ
ｏｕｔが使用されることになる。
波形図である。
Ａｉｎに引き続いて低レベルの信号が連続した場合の動
作を示す。本図に示すように、ピーク値（Ｐｏｕｔ）を
表わすカウント値はレジスタ１２に格納された後、直ち
にリセットされる（すなわち、大きく黒側追従する）の
で、次ラインからは新たなピーク値検出が行われ、良好
なピーク値追従特性を呈する。ただし、図中の×印で示
したラインについては黒側への追従が不十分となるが、
図６の（Ａ）に示した従来例と比べてみれば、その追従
特性がきわめて良好なものとなっていることが明らかで
ある。
た図６（Ｂ）とを比較すれば明らかなように、図１の回
路ではＤＯＷＮ定数を選定する必要がないので、白側へ
の追従が不十分になるという問題も生じない。
回路構成に加えて、演算回路３０およびメモリ３２を備
えている。
ト値をそのままレジスタ１２に格納するのではなく、過
去の数ラインぶんのカウント値をメモリ３２に記憶さ
せ、その平均値を演算回路３０で算出してからレジスタ
１２に格納することにより、用途に応じた黒側追従速度
を得ることが可能となる。
のではなく、ＵＰカウンタ１０のカウント値に所定の一
定値を乗じて、その演算結果をレジスタ１２に格納させ
ることも可能である。
されるアナログ信号のピーク値をカウント値、すなわち
デジタル値に変換し、このデジタル値に基づいてＡ／Ｄ
コンバータの参照電圧を発生させる構成としてあるの
で、このアナログ値−デジタル値への変換時のスピード
あるいは分解能を最適化にすることにより、アナログ信
号のピーク値への追従性を最適にすることができる。こ
の追従性を最適にコントロールできるという点は、ビデ
オ信号処理においては非常に重要なファクタであり、追
従性が速すぎても遅すぎてもノイズとなってしまう、と
いう問題を回避することが可能となる。また、レジスタ
ヘ格納された値（デジタル値）を参照電圧発生回路で参
照電圧に変換する際にも、レンジや絶対値を変えること
が可能となる。さらに、ライン走査毎に生じるピーク値
を表すカウント値は、デジタル値であることから、乗算
や平均などの演算が容易であり、その結果として、本ピ
ーク値検出保持回路の性能を変更することも容易に可能
になる。
回路を示したブロック図である。
Claims (1)
- 【請求項１】 ライン走査により得られたアナログ信号
のピーク値を検出して保持するピーク値検出保持回路に
おいて、 ライン走査毎に生じるピーク値を表すカウント値を出力
し、かつライン走査に同期して該カウント値をリセット
するピーク値検出回路と、 前記カウント値を記憶するメモリと、 前記メモリに記憶されたカウント値に所定の演算処理を
施す演算回路と、 前記演算された値を格納するレジスタと、 前記レジスタに格納された値に基づいて、前記アナログ
信号をデジタル信号化するＡ／Ｄコンバータの参照電圧
として出力する参照電圧発生回路と、 を具備したことを特徴とするピーク値検出保持回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05322057A JP3113476B2 (ja) | 1993-12-21 | 1993-12-21 | ピーク値検出保持回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05322057A JP3113476B2 (ja) | 1993-12-21 | 1993-12-21 | ピーク値検出保持回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07177033A JPH07177033A (ja) | 1995-07-14 |
| JP3113476B2 true JP3113476B2 (ja) | 2000-11-27 |
Family
ID=18139436
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP05322057A Expired - Lifetime JP3113476B2 (ja) | 1993-12-21 | 1993-12-21 | ピーク値検出保持回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3113476B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6275259B1 (en) | 1998-02-02 | 2001-08-14 | International Business Machines Corporation | Digital automatic gain control circuit for image system |
-
1993
- 1993-12-21 JP JP05322057A patent/JP3113476B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07177033A (ja) | 1995-07-14 |
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