JP3048923B2 - 液晶表示装置 - Google Patents
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Description
【０００１】
【発明の属する技術分野】本発明は液晶表示装置、例え
ばカイラルスメクチック、特に強誘電性液晶の示す双安
定状態を利用してマトリクス駆動を行う液晶表示装置に
関するものである。
ばカイラルスメクチック、特に強誘電性液晶の示す双安
定状態を利用してマトリクス駆動を行う液晶表示装置に
関するものである。
【０００２】
【従来の技術】従来、マトリクス電極構造をなす走査電
極群を有する電極基板と情報電極群を有する電極基板の
間に液晶混合物を充填し、多数の画素を形成して画像情
報の表示を行う液晶表示素子はよく知られている。なか
でも双安定性を有し、電界に対する応答の速いカイラル
スメクチック液晶、特に強誘電性液晶を用いた素子は、
高速かつ記憶型の表示素子として期待されており、例え
ば、特開昭５６−１０７２１６号公報等に提案されてい
る。また、これをマトリクス駆動する際の駆動方法につ
いても、これまで多数提案されている。例えば、特開平
２−２８１２３３号公報等に実用的な駆動方法が開示さ
れている。
極群を有する電極基板と情報電極群を有する電極基板の
間に液晶混合物を充填し、多数の画素を形成して画像情
報の表示を行う液晶表示素子はよく知られている。なか
でも双安定性を有し、電界に対する応答の速いカイラル
スメクチック液晶、特に強誘電性液晶を用いた素子は、
高速かつ記憶型の表示素子として期待されており、例え
ば、特開昭５６−１０７２１６号公報等に提案されてい
る。また、これをマトリクス駆動する際の駆動方法につ
いても、これまで多数提案されている。例えば、特開平
２−２８１２３３号公報等に実用的な駆動方法が開示さ
れている。
【０００３】ところで、従来の強誘電性液晶素子を用い
た表示素子には、片方の安定状態で長時間放置しておく
と、基板と液晶層の界面での相互作用によって表示素子
としての閾値特性が変化するという問題点があり、これ
を解決するため、例えば情報電極群に印加する情報信号
に休止区間を設けるようにした駆動方法が提案されてい
る。図１はこの提案による駆動信号の波形を示す。この
駆動信号は、走査選択信号Ａと情報電極群に印加する、
明および暗を表示するための情報信号の波形ＣおよびＤ
であって、ΔＴ幅の選択パルスと、その前後に配した１
／２ΔＴ幅の補助パルスおよびこの補助パルスが連続す
ることのないように配した１／２ΔＴ幅の休止区間を有
する情報信号を備える。
た表示素子には、片方の安定状態で長時間放置しておく
と、基板と液晶層の界面での相互作用によって表示素子
としての閾値特性が変化するという問題点があり、これ
を解決するため、例えば情報電極群に印加する情報信号
に休止区間を設けるようにした駆動方法が提案されてい
る。図１はこの提案による駆動信号の波形を示す。この
駆動信号は、走査選択信号Ａと情報電極群に印加する、
明および暗を表示するための情報信号の波形ＣおよびＤ
であって、ΔＴ幅の選択パルスと、その前後に配した１
／２ΔＴ幅の補助パルスおよびこの補助パルスが連続す
ることのないように配した１／２ΔＴ幅の休止区間を有
する情報信号を備える。
【０００４】
【発明が解決しようとする課題】図２は駆動信号の休止
期間と駆動マージンの関係を示すグラフである。これ
は、液晶表示素子の温度を１０℃、図１における駆動条
件を例えば、Ｖ１＝１４．３ｖ、Ｖ２＝１４．３ｖ、Ｖ
３＝５．７ｖ、Ｖ４＝５．７ｖ、Ｖ５＝６．４ｖ、ＶＣ
＝０ｖに設定した液晶表示素子が良好な表示をし得る範
囲（駆動マージン）を測定したものである。表示素子に
表示する画質の向上のためにはフレーム周波数は高い方
が好ましく、このため休止期間は短い方がよい。駆動マ
ージンとフレーム周波数の両方の観点から休止期間は１
／２ΔＴ付近が適切であるが最適値はそれとΔＴとの間
にある。
期間と駆動マージンの関係を示すグラフである。これ
は、液晶表示素子の温度を１０℃、図１における駆動条
件を例えば、Ｖ１＝１４．３ｖ、Ｖ２＝１４．３ｖ、Ｖ
３＝５．７ｖ、Ｖ４＝５．７ｖ、Ｖ５＝６．４ｖ、ＶＣ
＝０ｖに設定した液晶表示素子が良好な表示をし得る範
囲（駆動マージン）を測定したものである。表示素子に
表示する画質の向上のためにはフレーム周波数は高い方
が好ましく、このため休止期間は短い方がよい。駆動マ
ージンとフレーム周波数の両方の観点から休止期間は１
／２ΔＴ付近が適切であるが最適値はそれとΔＴとの間
にある。
【０００５】図３は休止区間を０．６ΔＴとした場合の
駆動波形である。この例では休止区間を０．６ΔＴに設
定するため、一水平走査期間を２６の区間で構成し、情
報信号にあってはこのうち１０区間でΔＴを、６区間で
休止区間を構成している。このように、駆動マージンの
確保をはかりながらフレーム周波数とのバランスをとる
ために休止区間を調整しようとすると、駆動波形を構成
する区間が著しく増大してしまう。したがって、駆動回
路の動作は高速で動作することを要求され、自由な休止
区間を構成できない。
駆動波形である。この例では休止区間を０．６ΔＴに設
定するため、一水平走査期間を２６の区間で構成し、情
報信号にあってはこのうち１０区間でΔＴを、６区間で
休止区間を構成している。このように、駆動マージンの
確保をはかりながらフレーム周波数とのバランスをとる
ために休止区間を調整しようとすると、駆動波形を構成
する区間が著しく増大してしまう。したがって、駆動回
路の動作は高速で動作することを要求され、自由な休止
区間を構成できない。
【０００６】本発明の目的は、この従来技術の問題点に
鑑み、液晶表示装置において、駆動回路の動作速度を高
速化する必要なく最適な休止期間が得られるようにし、
もって良好な表示が行い得る駆動条件を容易に確保でき
るようにすることにある。
鑑み、液晶表示装置において、駆動回路の動作速度を高
速化する必要なく最適な休止期間が得られるようにし、
もって良好な表示が行い得る駆動条件を容易に確保でき
るようにすることにある。
【０００７】
【課題を解決するための手段】この目的を達成するため
本発明では、互いに対向して配置された走査電極群を有
する第一の基板と情報電極群を有する第二の基板の間に
液晶を配置した、前記走査電極群と情報電極群がマトリ
ックス電極構造をなす液晶表示素子と、クロック発生回
路と、このクロック発生回路から供給されるクロック毎
に走査信号を形成して前記走査電極に付与する走査電極
ドライバと、前記クロック発生回路から供給されるクロ
ック毎に情報信号を形成して前記情報電極に付与する情
報電極ドライバとを備える液晶表示装置において、前記
クロック発生回路から供給される一水平走査期間内の複
数のクロックパルスのうち、少なくとも一つのものの幅
が他のものの幅と異なることを特徴とする液晶表示装置
が提供される。
本発明では、互いに対向して配置された走査電極群を有
する第一の基板と情報電極群を有する第二の基板の間に
液晶を配置した、前記走査電極群と情報電極群がマトリ
ックス電極構造をなす液晶表示素子と、クロック発生回
路と、このクロック発生回路から供給されるクロック毎
に走査信号を形成して前記走査電極に付与する走査電極
ドライバと、前記クロック発生回路から供給されるクロ
ック毎に情報信号を形成して前記情報電極に付与する情
報電極ドライバとを備える液晶表示装置において、前記
クロック発生回路から供給される一水平走査期間内の複
数のクロックパルスのうち、少なくとも一つのものの幅
が他のものの幅と異なることを特徴とする液晶表示装置
が提供される。
【０００８】また、好ましくは、前記クロック発生回路
は、２値信号の出力手段と、与えられる原クロックをカ
ウントするカウンタ手段と、与えられる比較値を保持す
る保持手段と、前記カウンタ手段のカウント値と前記保
持手段の保持する比較値とを比較する比較手段とを有
し、前記比較値と前記カウント値が一致したとき前記出
力手段の出力値を反転することにより前記クロックパル
スを形成するとともに新たな比較値を前記保持手段に設
定するものであることを特徴とする。
は、２値信号の出力手段と、与えられる原クロックをカ
ウントするカウンタ手段と、与えられる比較値を保持す
る保持手段と、前記カウンタ手段のカウント値と前記保
持手段の保持する比較値とを比較する比較手段とを有
し、前記比較値と前記カウント値が一致したとき前記出
力手段の出力値を反転することにより前記クロックパル
スを形成するとともに新たな比較値を前記保持手段に設
定するものであることを特徴とする。
【０００９】本発明によれば、一水平走査期間を構成す
るクロックパルスのうち、少なくとも一つのクロックパ
ルスの幅を任意に変更することにより、駆動波形の特定
区間の長さを略連続的に可変することが可能となる。し
たがって、休止を必要とする駆動波形にあっては、回路
の動作速度を高速にすることなく例えば液晶駆動時の温
度変化に応じて最適な休止区間を得て、駆動マージンが
確保される。
るクロックパルスのうち、少なくとも一つのクロックパ
ルスの幅を任意に変更することにより、駆動波形の特定
区間の長さを略連続的に可変することが可能となる。し
たがって、休止を必要とする駆動波形にあっては、回路
の動作速度を高速にすることなく例えば液晶駆動時の温
度変化に応じて最適な休止区間を得て、駆動マージンが
確保される。
【００１０】
【発明の実施の形態】以下、図面に基づいて本発明の実
施形態を説明する。図４は本発明の一実施例に係る液晶
表示装置のブロック図である。同図において、５０４は
グラフィックコントローラであり、液晶表示素子５０１
に表示される画像データ５０５を生成する。画像データ
は５０５は表示制御回路５１０からのデータ要求信号５
０７を受けて転送クロック５０６と同期してラインバッ
ファ５１１と駆動制御回路５１２へ転送される。Ｓｃｏ
ｍおよびＳｓｅｇは表示制御回路５１０から走査信号ド
ライバ５０２と情報信号ドライバ５０３への信号群、Ｖ
ｃｏｍおよびＶｓｅｇは液晶駆動電源５１３から走査信
号ドライバ５０２と情報信号ドライバ５０３へ供給され
る電源群である。液晶表示素子５０１はこれらの信号お
よび電源を受けた走査信号ドライバ５０２と情報信号ド
ライバ５０３により駆動され、画像データを表示する。
施形態を説明する。図４は本発明の一実施例に係る液晶
表示装置のブロック図である。同図において、５０４は
グラフィックコントローラであり、液晶表示素子５０１
に表示される画像データ５０５を生成する。画像データ
は５０５は表示制御回路５１０からのデータ要求信号５
０７を受けて転送クロック５０６と同期してラインバッ
ファ５１１と駆動制御回路５１２へ転送される。Ｓｃｏ
ｍおよびＳｓｅｇは表示制御回路５１０から走査信号ド
ライバ５０２と情報信号ドライバ５０３への信号群、Ｖ
ｃｏｍおよびＶｓｅｇは液晶駆動電源５１３から走査信
号ドライバ５０２と情報信号ドライバ５０３へ供給され
る電源群である。液晶表示素子５０１はこれらの信号お
よび電源を受けた走査信号ドライバ５０２と情報信号ド
ライバ５０３により駆動され、画像データを表示する。
【００１１】図５は液晶表示素子５０１の要部を模式的
に示した図である。液晶表示素子５０１は、図示しない
対向する２枚のガラス基板に設けられた走査電極６０３
と情報電極６０４との間に図示しない液晶を挟持し、走
査電極６０３と情報電極６０４の交点に画素６１０を形
成する。走査信号ドライバ５０２には各走査電極を駆動
する走査電極ドライバ６０１が、情報信号ドライバ５０
２には各情報電極を駆動する情報電極ドライバ６０２が
設けられている。
に示した図である。液晶表示素子５０１は、図示しない
対向する２枚のガラス基板に設けられた走査電極６０３
と情報電極６０４との間に図示しない液晶を挟持し、走
査電極６０３と情報電極６０４の交点に画素６１０を形
成する。走査信号ドライバ５０２には各走査電極を駆動
する走査電極ドライバ６０１が、情報信号ドライバ５０
２には各情報電極を駆動する情報電極ドライバ６０２が
設けられている。
【００１２】図６は走査電極ドライバ６０１の構成を示
す図である。同図において、７０１はアナログスイッチ
回路で、駆動波形データＣＷＦＤｉ（ｉ＝０〜３）に従
い液晶電源群Ｖｃｏｍより供給される液晶電源電圧Ｖ
１、Ｖ５、ＶＣ、Ｖ２のうち一つを選択して出力する回
路であり、通常一つの走査電極ドライバ６０１に複数集
積され、複数の走査電極を駆動する。７０２は第１アド
レスレジスタ、７０３は第２アドレスレジスタである。
チップセレクト信号ＣＳで選択された走査電極ドライバ
６０１のアドレスレジスタ７０２は、信号ＬＡＴＣＨが
アサートされた期間の信号ＳＣＬＫ立ち上がりで保持し
ていたアドレスをアドレスレジスタ７０３へ転送すると
同時に走査アドレスＣＡをラッチする。複数集積された
アナログスイッチ回路７０１のうちアドレスレジスタ７
０２が指し示すアナログスイッチ回路７０１は、信号Ｓ
ＣＬＫの立ち上がり毎に駆動波形データＣＷＦＤ０およ
びＣＷＦＤ１のデータに従った液晶電源電圧を選択し出
力する。また、アドレスレジスタ７０３が指し示すアナ
ログスイッチ回路７０１は、信号ＳＣＬＫの立ち上がり
毎に駆動波形データＣＷＦＤ２およびＣＷＦＤ３のデー
タに従った液晶電源電圧を選択し出力する。
す図である。同図において、７０１はアナログスイッチ
回路で、駆動波形データＣＷＦＤｉ（ｉ＝０〜３）に従
い液晶電源群Ｖｃｏｍより供給される液晶電源電圧Ｖ
１、Ｖ５、ＶＣ、Ｖ２のうち一つを選択して出力する回
路であり、通常一つの走査電極ドライバ６０１に複数集
積され、複数の走査電極を駆動する。７０２は第１アド
レスレジスタ、７０３は第２アドレスレジスタである。
チップセレクト信号ＣＳで選択された走査電極ドライバ
６０１のアドレスレジスタ７０２は、信号ＬＡＴＣＨが
アサートされた期間の信号ＳＣＬＫ立ち上がりで保持し
ていたアドレスをアドレスレジスタ７０３へ転送すると
同時に走査アドレスＣＡをラッチする。複数集積された
アナログスイッチ回路７０１のうちアドレスレジスタ７
０２が指し示すアナログスイッチ回路７０１は、信号Ｓ
ＣＬＫの立ち上がり毎に駆動波形データＣＷＦＤ０およ
びＣＷＦＤ１のデータに従った液晶電源電圧を選択し出
力する。また、アドレスレジスタ７０３が指し示すアナ
ログスイッチ回路７０１は、信号ＳＣＬＫの立ち上がり
毎に駆動波形データＣＷＦＤ２およびＣＷＦＤ３のデー
タに従った液晶電源電圧を選択し出力する。
【００１３】図７は情報電極ドライバ６０２の構成を示
す図である。同図において、８０１はアナログスイッチ
回路で、駆動波形データＳＷＦＤｉ（ｉ＝０〜３）に従
い液晶電源群Ｖｓｅｇより供給される液晶電源電圧Ｖ
３、ＶＣ、Ｖ４のうち一つを選択して出力する回路であ
り、通常一つの情報電極ドライバ６０２に複数集積さ
れ、複数の情報電極を駆動する。８０２は第１データレ
ジスタ、８０３は第２データレジスタである。データレ
ジスタ８０２はデータ転送開始信号ＳＤＩを受けてデー
タ転送同期信号ＩＣＬＫに同期して送られる画像データ
ＩＤｉ（ｉ＝０〜７）を格納する。また、信号ＬＡＴＣ
Ｈがアサートされた期間のＳＣＬＫ信号立ち上がり時に
保持していたデータをデータレジスタ８０３へ転送す
る。複数集積されたアナログスイッチ回路８０１は、デ
ータレジスタ８０３のうち対応するデータが明状態を示
す１であれば駆動波形データＳＷＦＤ０およびＳＷＦＤ
１に従い、また対応するデータが暗状態を示す０であれ
ば駆動波形データＳＷＦＤ２およびＳＷＦＤ３に従って
ＳＣＬＫ信号の立ち上がり毎に液晶電源電圧を選択し出
力する。
す図である。同図において、８０１はアナログスイッチ
回路で、駆動波形データＳＷＦＤｉ（ｉ＝０〜３）に従
い液晶電源群Ｖｓｅｇより供給される液晶電源電圧Ｖ
３、ＶＣ、Ｖ４のうち一つを選択して出力する回路であ
り、通常一つの情報電極ドライバ６０２に複数集積さ
れ、複数の情報電極を駆動する。８０２は第１データレ
ジスタ、８０３は第２データレジスタである。データレ
ジスタ８０２はデータ転送開始信号ＳＤＩを受けてデー
タ転送同期信号ＩＣＬＫに同期して送られる画像データ
ＩＤｉ（ｉ＝０〜７）を格納する。また、信号ＬＡＴＣ
Ｈがアサートされた期間のＳＣＬＫ信号立ち上がり時に
保持していたデータをデータレジスタ８０３へ転送す
る。複数集積されたアナログスイッチ回路８０１は、デ
ータレジスタ８０３のうち対応するデータが明状態を示
す１であれば駆動波形データＳＷＦＤ０およびＳＷＦＤ
１に従い、また対応するデータが暗状態を示す０であれ
ば駆動波形データＳＷＦＤ２およびＳＷＦＤ３に従って
ＳＣＬＫ信号の立ち上がり毎に液晶電源電圧を選択し出
力する。
【００１４】図８には駆動波形データＣＷＦＤｉ（ｉ＝
０〜３）およびＳＷＦＤｉ（ｉ＝０〜３）と選択される
液晶電源電圧の関係を示す。
０〜３）およびＳＷＦＤｉ（ｉ＝０〜３）と選択される
液晶電源電圧の関係を示す。
【００１５】図９はドライバ制御回路５２０の構成を示
す図である。同図において、１００１は可変幅クロック
発生回路であり、クロック発生回路５１４から分配され
る原クロック信号１０１１をカウントし、内部のコンペ
アレジスタにセットされた値（比較値）と一致した場合
にその出力ＳＣＬＫを反転すると同時に、クロック幅レ
ジスタ１００３に予め格納された値を順にコンペアレジ
スタにセットし、カウンタをクリアする。本実施例で
は、例えば、クロック幅レジスタ１００３に格納される
値（もしくは比較値）を温度補償テーブルに応じて種々
異なる値とし、出力ＳＣＬＫの幅を駆動温度等の環境条
件に応じて可変とすることが好ましい。読み出されるク
ロック幅レジスタ１００３は、信号ＬＡＴＣＨがアサー
トされた期間に再度先頭に位置づけられる。信号ＳＣＬ
Ｋはラッチ回路１００７でクロック信号に同期される。
す図である。同図において、１００１は可変幅クロック
発生回路であり、クロック発生回路５１４から分配され
る原クロック信号１０１１をカウントし、内部のコンペ
アレジスタにセットされた値（比較値）と一致した場合
にその出力ＳＣＬＫを反転すると同時に、クロック幅レ
ジスタ１００３に予め格納された値を順にコンペアレジ
スタにセットし、カウンタをクリアする。本実施例で
は、例えば、クロック幅レジスタ１００３に格納される
値（もしくは比較値）を温度補償テーブルに応じて種々
異なる値とし、出力ＳＣＬＫの幅を駆動温度等の環境条
件に応じて可変とすることが好ましい。読み出されるク
ロック幅レジスタ１００３は、信号ＬＡＴＣＨがアサー
トされた期間に再度先頭に位置づけられる。信号ＳＣＬ
Ｋはラッチ回路１００７でクロック信号に同期される。
【００１６】１００２は信号ＬＡＴＣＨの生成回路であ
り、信号ＳＣＬＫの立ち下がりをカウントし、予め設定
されたコンペアレジスタと一致するとカウンタを０に戻
し、カウンタが０である期間、出力である信号ＬＡＴＣ
Ｈをアサートとする。信号ＬＡＴＣＨはラッチ回路１０
０８でクロック信号に同期される。図１０に可変幅クロ
ック発生回路１００１と信号ＬＡＴＣＨの発生回路１０
０２の動作のタイミングチャートを示す。同図に示す例
では、例えば、δｔ０の期間においてからカウントされ
る原クロックは周期ｃ０、δｔ１の期間にカウントされ
る原クロックは周期ｃ１としている。例えば、クロック
発生回路５１４から分配される原クロックが１０ＭＨ
ｚ、ｃ０＝３１２（１３８ｈ）、ｃ１＝２６０（１０４
ｈ）のときδｔ０＝６２．４μｓ、δｔ１＝５２μｓに
設定される。
り、信号ＳＣＬＫの立ち下がりをカウントし、予め設定
されたコンペアレジスタと一致するとカウンタを０に戻
し、カウンタが０である期間、出力である信号ＬＡＴＣ
Ｈをアサートとする。信号ＬＡＴＣＨはラッチ回路１０
０８でクロック信号に同期される。図１０に可変幅クロ
ック発生回路１００１と信号ＬＡＴＣＨの発生回路１０
０２の動作のタイミングチャートを示す。同図に示す例
では、例えば、δｔ０の期間においてからカウントされ
る原クロックは周期ｃ０、δｔ１の期間にカウントされ
る原クロックは周期ｃ１としている。例えば、クロック
発生回路５１４から分配される原クロックが１０ＭＨ
ｚ、ｃ０＝３１２（１３８ｈ）、ｃ１＝２６０（１０４
ｈ）のときδｔ０＝６２．４μｓ、δｔ１＝５２μｓに
設定される。
【００１７】１００６は駆動波形信号制御回路であり、
走査駆動波形レジスタ１００４および情報駆動波形レジ
スタ１００５に格納された駆動波形データを信号ＳＣＬ
Ｋ、信号ＬＡＴＣＨに従って出力する。出力であるＣＷ
ＦＤｉ（ｉ＝０〜３）およびＳＷＦＤｉ（ｉ＝０〜３）
はラッチ回路１００９および１０１０でクロック信号に
同期される。
走査駆動波形レジスタ１００４および情報駆動波形レジ
スタ１００５に格納された駆動波形データを信号ＳＣＬ
Ｋ、信号ＬＡＴＣＨに従って出力する。出力であるＣＷ
ＦＤｉ（ｉ＝０〜３）およびＳＷＦＤｉ（ｉ＝０〜３）
はラッチ回路１００９および１０１０でクロック信号に
同期される。
【００１８】図１１は表示制御回路５１０から走査信号
ドライバ５０２と情報信号ドライバ５０３への信号群Ｓ
ｃｏｍおよびＳｓｅｇと、走査電極ドライバ６０１と情
報電極ドライバ６０２の出力波形の関係を示すタイムチ
ャートである。同図に示すように、走査期間Ｔ（ｎ）に
走査アドレスＣＡとしてアドレスＬ（ｎ）が送出され
る。アドレスＬ（ｎ）に対応する走査電極ドライバはＣ
ＷＦＤ０およびＣＷＦＤ１に従い、信号ＳＣＬＫの立ち
上がり毎に液晶駆動電圧を出力する。一方、情報電極ド
ライバ６０２では、データレジスタ８０３に既にラッチ
されている画像データとＳＷＦＤｉ（ｉ＝０〜３）に従
いＳＣＬＫの立ち上がり毎に液晶駆動電圧を出力する。
この間にアドレスＬに表示する画像データが信号ＳＤＩ
と図示しない転送クロックに同期して転送され、データ
レジスタ８０２に格納される。
ドライバ５０２と情報信号ドライバ５０３への信号群Ｓ
ｃｏｍおよびＳｓｅｇと、走査電極ドライバ６０１と情
報電極ドライバ６０２の出力波形の関係を示すタイムチ
ャートである。同図に示すように、走査期間Ｔ（ｎ）に
走査アドレスＣＡとしてアドレスＬ（ｎ）が送出され
る。アドレスＬ（ｎ）に対応する走査電極ドライバはＣ
ＷＦＤ０およびＣＷＦＤ１に従い、信号ＳＣＬＫの立ち
上がり毎に液晶駆動電圧を出力する。一方、情報電極ド
ライバ６０２では、データレジスタ８０３に既にラッチ
されている画像データとＳＷＦＤｉ（ｉ＝０〜３）に従
いＳＣＬＫの立ち上がり毎に液晶駆動電圧を出力する。
この間にアドレスＬに表示する画像データが信号ＳＤＩ
と図示しない転送クロックに同期して転送され、データ
レジスタ８０２に格納される。
【００１９】走査期間Ｔ（ｎ＋１）には走査アドレスＣ
ＡとしてアドレスＬ（ｎ＋１）が送出される。アドレス
Ｌ（ｎ＋１）の走査電極ドライバ６０１は前述の通りＣ
ＷＦＤ０およびＣＷＦＤ１に従った駆動波形を、アドレ
スＬの走査電極ドライバ６０１はＣＷＦＤ２およびＣＷ
ＦＤ３に従った駆動波形を信号ＳＣＬＫの立ち上がり毎
に出力する。一方、情報電極ドライバ６０２では、信号
ＬＡＴＣＨがアサートされた期間の信号ＳＣＬＫの立ち
上がりでデータレジスタ８０２のデータがデータレジス
タ８０３転送され、この画像データとＳＷＦＤｉ（ｉ＝
０〜３）に従い信号ＳＣＬＫの立ち上がり毎に液晶駆動
電圧を出力する。図８で説明した通り、δｔ０＝６２．
４μｓ、δｔ１＝５２μｓであるから、ΔＴ＝１０４μ
ｓ、休止期間は０．６ΔＴとなる。
ＡとしてアドレスＬ（ｎ＋１）が送出される。アドレス
Ｌ（ｎ＋１）の走査電極ドライバ６０１は前述の通りＣ
ＷＦＤ０およびＣＷＦＤ１に従った駆動波形を、アドレ
スＬの走査電極ドライバ６０１はＣＷＦＤ２およびＣＷ
ＦＤ３に従った駆動波形を信号ＳＣＬＫの立ち上がり毎
に出力する。一方、情報電極ドライバ６０２では、信号
ＬＡＴＣＨがアサートされた期間の信号ＳＣＬＫの立ち
上がりでデータレジスタ８０２のデータがデータレジス
タ８０３転送され、この画像データとＳＷＦＤｉ（ｉ＝
０〜３）に従い信号ＳＣＬＫの立ち上がり毎に液晶駆動
電圧を出力する。図８で説明した通り、δｔ０＝６２．
４μｓ、δｔ１＝５２μｓであるから、ΔＴ＝１０４μ
ｓ、休止期間は０．６ΔＴとなる。
【００２０】本実施例の表示装置を、液晶表示素子の温
度を１０℃、駆動条件をＶ１＝１４．３ｖ、Ｖ２＝−１
４．３ｖ、Ｖ３＝５．７ｖ、Ｖ４＝−５．７ｖ、Ｖ５＝
６．４ｖ、ＶＣ＝０ｖ、ΔＴ＝１０４μｓに設定して駆
動したところ、液晶表示素子５０１の全面にわたって良
好な表示ができた。
度を１０℃、駆動条件をＶ１＝１４．３ｖ、Ｖ２＝−１
４．３ｖ、Ｖ３＝５．７ｖ、Ｖ４＝−５．７ｖ、Ｖ５＝
６．４ｖ、ＶＣ＝０ｖ、ΔＴ＝１０４μｓに設定して駆
動したところ、液晶表示素子５０１の全面にわたって良
好な表示ができた。
【００２１】本実施例では情報信号に設けられた休止期
間を最適にするようクロックパルス幅を調整する例につ
いて詳細に述べたが、本発明はこれに限定されることな
く、情報信号の補助パルス幅の調整、走査信号の補助パ
ルス幅の調整など、駆動信号波形のいずれの区間にも適
用可能である。また、パルス幅を調整する区間は１つの
クロック期間に限定されるものではなく、例えば、情報
信号の書き込みパルスの両端に設けられた二つの補助パ
ルスを同時にかつ独立に微妙に調整すること等も可能で
ある。
間を最適にするようクロックパルス幅を調整する例につ
いて詳細に述べたが、本発明はこれに限定されることな
く、情報信号の補助パルス幅の調整、走査信号の補助パ
ルス幅の調整など、駆動信号波形のいずれの区間にも適
用可能である。また、パルス幅を調整する区間は１つの
クロック期間に限定されるものではなく、例えば、情報
信号の書き込みパルスの両端に設けられた二つの補助パ
ルスを同時にかつ独立に微妙に調整すること等も可能で
ある。
【００２２】
【発明の効果】本発明によれば、一水平走査時間を構成
する複数のクロックパルスのうち少なくとも１つのもの
の幅を略連続的に可変することにより、駆動波形の各区
間を略連続的に可変することが可能となる。このため、
休止を必要とする駆動波形にあっては、回路の動作速度
を高速化することなく最適な休止区間を得ることがで
き、良好な表示をし得る駆動条件の選択範囲（駆動マー
ジン）の確保を図ることができる。
する複数のクロックパルスのうち少なくとも１つのもの
の幅を略連続的に可変することにより、駆動波形の各区
間を略連続的に可変することが可能となる。このため、
休止を必要とする駆動波形にあっては、回路の動作速度
を高速化することなく最適な休止区間を得ることがで
き、良好な表示をし得る駆動条件の選択範囲（駆動マー
ジン）の確保を図ることができる。
【図１】 液晶表示装置の駆動信号波形を示す図であ
る。
る。
【図２】 駆動信号の休止期間の長さと駆動マージンの
関係を示す図である。
関係を示す図である。
【図３】 液晶装置の別の駆動信号波形を示す図であ
る。
る。
【図４】 本発明の一実施例に係る液晶表示装置のブロ
ック図である。
ック図である。
【図５】 図４の表示装置における液晶表示素子を示す
図である。
図である。
【図６】 図４の表示装置における走査電極ドライバの
構成を示すブロック図である。
構成を示すブロック図である。
【図７】 図４の表示装置における情報電極ドライバの
構成を示すブロック図である。
構成を示すブロック図である。
【図８】 図４の表示装置における走査電極ドライバと
情報電極ドライバにおける駆動波形データと出力電圧の
関係を示す図である。
情報電極ドライバにおける駆動波形データと出力電圧の
関係を示す図である。
【図９】 図４の表示装置におけるドライバ制御回路の
構成を示すブロック図である。
構成を示すブロック図である。
【図１０】 図９のドライバ制御回路の動作を示すタイ
ムチャートである。
ムチャートである。
【図１１】 図４の表示装置における走査電極ドライバ
と情報電極ドライバの入力信号と出力信号波形の関係を
示すタイムチャートである。
と情報電極ドライバの入力信号と出力信号波形の関係を
示すタイムチャートである。
５０１：液晶表示素子、５０２：走査信号ドライバ、５
０３：情報信号ドライバ、５０４：グラフィックコント
ローラ、５１０：表示制御回路、５１１：ラインバッフ
ァ、５１２：駆動制御回路、５１３：液晶駆動電源、５
１４：クロック発生回路、５２０：ドライバ制御回路、
６０１：走査電極ドライバ、６０２：情報電極ドライ
バ、６０３：走査電極、６０４：情報電極、６１０：画
素、７０１：アナログスイッチ回路、７０２：第１アド
レスレジスタ、７０３：第２アドレスレジスタ、８０
１：アナログスイッチ回路、８０２：第１データレジス
タ、８０３：第２データレジスタ、１００１：可変幅ク
ロック発生回路、１００２：ＬＡＴＣＨ生成回路、１０
０３：クロック幅レジスタ、１００４：走査駆動波形レ
ジスタ、１００５：情報駆動波形レジスタ、１００６：
駆動波形信号制御回路、１００７：ラッチ回路、１００
８：ラッチ回路、１００９，１０１０：ラッチ回路。
０３：情報信号ドライバ、５０４：グラフィックコント
ローラ、５１０：表示制御回路、５１１：ラインバッフ
ァ、５１２：駆動制御回路、５１３：液晶駆動電源、５
１４：クロック発生回路、５２０：ドライバ制御回路、
６０１：走査電極ドライバ、６０２：情報電極ドライ
バ、６０３：走査電極、６０４：情報電極、６１０：画
素、７０１：アナログスイッチ回路、７０２：第１アド
レスレジスタ、７０３：第２アドレスレジスタ、８０
１：アナログスイッチ回路、８０２：第１データレジス
タ、８０３：第２データレジスタ、１００１：可変幅ク
ロック発生回路、１００２：ＬＡＴＣＨ生成回路、１０
０３：クロック幅レジスタ、１００４：走査駆動波形レ
ジスタ、１００５：情報駆動波形レジスタ、１００６：
駆動波形信号制御回路、１００７：ラッチ回路、１００
８：ラッチ回路、１００９，１０１０：ラッチ回路。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭61−278892（ＪＰ，Ａ) 特開 平２−61698（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) G02F 1/133 505 G09G 3/36
Claims (8)
- 【請求項１】 互いに対向して配置された走査電極群を
有する第一の基板と情報電極群を有する第二の基板間に
液晶を配置した、前記走査電極群及び情報電極群がマト
リックス電極構造をなす液晶表示素子と、クロック発生
回路と、このクロック発生回路から供給されるクロック
毎に走査信号を形成して前記走査電極に付与する走査電
極ドライバと、前記クロック発生回路から供給されるク
ロック毎に情報信号を形成して前記情報電極に付与する
情報電極ドライバとを備える液晶表示装置において、前
記クロック発生回路から供給される一水平走査期間内の
複数のクロックパルスのうち、少なくとも一つのものの
幅が他のものの幅と異なることを特徴とする液晶表示装
置。 - 【請求項２】 前記クロック発生回路は、２値信号の出
力手段と、与えられる原クロックをカウントするカウン
タ手段と、与えられる比較値を保持する保持手段と、前
記カウンタ手段のカウント値と前記保持手段の保持する
比較値とを比較する比較手段とを有し、前記比較値と前
記カウント値が一致したとき前記出力手段の出力値を反
転することにより前記クロックパルスを形成するととも
に新たな比較値を前記保持手段に設定するものであるこ
とを特徴とする請求項１記載の液晶表示装置。 - 【請求項３】 前記情報信号が休止期間を有し、前記一
クロックパルスの巾を他のクロックパルスの巾と異なる
ように設定することにより、該休止期間を調整する請求
項１記載の液晶表示装置。 - 【請求項４】 前記情報信号が制御パルス及び補助パル
スを有し、前記一クロックパルスの巾を他のクロックパ
ルスの巾と異なるように設定することにより、該補助パ
ルスの巾を調整する請求項１記載の液晶表示装置。 - 【請求項５】 前記情報信号において、前記制御パルス
の前後に２つの補助パルスが設けられており、該２つの
補助パルスの両方の巾を同時に且つ独立に調整する請求
項４記載の液晶表示装置。 - 【請求項６】 前記走査信号が制御パルス及び補助パル
スを有し、前記一クロックパルスの巾を他のクロックパ
ルスの巾と異なるように設定することにより、該補助パ
ルスの巾を調整する請求項１記載の液晶表示装置。 - 【請求項７】 前記液晶が、カイラルスメクチック相を
呈する液晶である請求項１記載の液晶表示装置。 - 【請求項８】 前記液晶が強誘電性液晶である請求項１
記載の液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8127716A JP3048923B2 (ja) | 1995-04-28 | 1996-04-25 | 液晶表示装置 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12745995 | 1995-04-28 | ||
| JP7-127459 | 1995-04-28 | ||
| JP8127716A JP3048923B2 (ja) | 1995-04-28 | 1996-04-25 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0915563A JPH0915563A (ja) | 1997-01-17 |
| JP3048923B2 true JP3048923B2 (ja) | 2000-06-05 |
Family
ID=26463415
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8127716A Expired - Fee Related JP3048923B2 (ja) | 1995-04-28 | 1996-04-25 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3048923B2 (ja) |
-
1996
- 1996-04-25 JP JP8127716A patent/JP3048923B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0915563A (ja) | 1997-01-17 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |