JP2985841B2 - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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Description
法に関し、特に半導体基板上に形成されたシリコン酸化
膜をシリコン窒化膜に対し選択的にエッチングするエッ
チング工程を含む半導体装置の製造方法に関する。
法の微細化が進む中、ホール径0.3μm以下の微細な
コンタクトホールの形成が要求されている。例えば、D
RAMデバイスにおけるコンタクトホールにおいては、
ゲート電極間にコンタクトホールを形成する必要があ
り、一般にはこのコンタクトホールは、絶縁膜であるシ
リコン酸化膜をプラズマを用いたエッチング方法により
開設している。従来のデバイスでは、コンタクトホール
径に比べてゲート電極間隔は十分に大きいため、シリコ
ン酸化膜をエッチングしてコンタクトホールを形成する
ことは比較的に容易である。しかしながら、次世代デバ
イスにおいては、求められる集積化に対応するために、
ゲート電極間隔はより狭くなり、そのため加工するコン
タクトホール径はゲート電極間隔よりやや小さい程度の
寸法となる。この場合、コンタクトホール加工時に、ホ
ール径が僅かに大きくなるといったような微妙なエッチ
ング加工精度の狂いが生じると、被エッチング対象物で
あるシリコン酸化膜をエッチングするとともに、コンタ
クトホール両隣に存在するゲート電極を露呈させてしま
うことがある。このようなゲート電極の露呈は、回路の
短絡の原因となり製品不良を引き起こす。
エッチングにおいては、エッチングマスクとしてリソグ
ラフィ法を用いて形成したレジストマスタを用いるが、
レジストマスク形成時には下地基板との重ね合わせ(目
合わせ)が必要となる。しかし、現状のリソグラフィ技
術においては僅かな目合わせのズレが生じることは避け
るられないため、ゲート電極間隔とコンタクトホール径
が同等のレベルにある高集積デバイスにおいては、僅か
な重ね合わせずれであっても、加工したホールの一部が
ゲート電極上にがかかってしまう状態となり、前記した
ようなゲート電極の露呈が生じ、短格を引き起こすこと
になる。この短絡不良を避けるために、ゲート電極の周
りにシリコン窒化膜を形成し、シリコン酸化膜のエッチ
ング時にエッチングストッパとして窒化膜を利用し、ゲ
ート電極の露呈を防止する事により自己整合的にコンタ
クトホールの加工を行うコンタクトエッチング方法(セ
ルフアラインコンタクト:SAC)が提案されている。
コン窒化膜をエッチングストッパとして用いるために
は、シリコン酸化膜/シリコン窒化膜選択比の高いエッ
チングプロセスが必要となる。シリコン酸化膜/シリコ
ン窒化膜選択比の高いプロセスとしては、例えば特開平
6−244152号公報に記された技術がある。この技
術では、エッチングガスとして炭素に対するフッ素の比
が3以下のエッチングガス、例えばC4 F8 ,C3 F8
等を用い、電子サイクロトロン共鳴(ECR)を利用し
たプラズマ源を用い、シリコン酸化膜/シリコン窒化膜
の高選択比エッチングを行っている。
てコンタクトホールを開設する工程を概念的に示す図で
あり、同図のように、シリコン基板61上に、上面及び
側面にシリコン窒化膜62が形成されたゲート電極63
が形成され、更に層間絶縁膜としてシリコン酸化膜64
が形成される。シリコン酸化膜上に、エッチングマスク
としてフォトレジストマスク65がリソグラフィ法を用
いて形成される。そして、前記フォトレジストマスク6
5をマスクにし、シリコン酸化膜のエッチングを行いコ
ンタクトホールの形成を行う。このコンタクトホールの
形成に際し、前記したシリコン酸化膜/シリコン窒化膜
の高選択比エッチングを行っている。
報に記載されている技術について本発明者が種々の実験
を行ったところ、微細ホールの形成、特に0.3μm以
下のホール径のコンタクトホールエッチングにおいて、
十分な加工精度とシリコン酸化膜/シリコン窒化膜の高
遠択比の両立が困難であり、高い加工精度を得ることが
できないという問題が発生した。その加工精度に関して
具体的には、コンタクトホールのエッチング時に微細ホ
ール途中においてエッチングが停止してしまうという現
象、いわゆるエッチストップ現象が生じた。すなわち、
図6(b)に示すように、シリコン酸化膜の途中でエッ
チングがストップしてしまうという現象が生じ、コンタ
クト導通不良の原因となる。このように、特に微細なホ
ールのエッチング加工において所期の加工精度が得られ
ずコンタクト導通不良が発生するという問題が生じてい
る。
の微細ホールエッチング加工において、加工精度を向上
させると共に、シリコン酸化膜をシリコン窒化膜に対し
高選択的にエッチングすることを可能にしたエッチング
方法を含む半導体装置の製造方法を提供することにあ
る。
ルのエッチング方法は、エッチングガスとしてC4 F8
/CO/O2 /Ar混合ガスを用い、C4 F8 ガス混合
量をトータルガス流量の3〜7%、Arガス混合量をト
ータルガス流量の75〜90%としプラズマエッチング
を行う。また、上記混合ガスにさらにCH2 F2 ガスを
混合し、そのガス流量をトータルガス流量の0〜5%と
しエッチングを行う。
の微細コンタクトホールのエッチング加工において、エ
ッチングが途中でストップする現象を抑制しエッチング
加工精度を向上させ、かつシリコン酸化膜をシリコン窒
化膜に対し遺択的にエッチング加工することが可能とな
る。
参照して説明する。本発明の第1の実施形態の製造工程
を図1に示す。先ず、図1(a)のように、シリコン基
板11上に7nmの膜厚のゲート酸化膜12を形成し、
さらに200nmの膜厚のポリシリコン膜13を形成
し、さらにこのポリシリコン膜13上にエッチングマス
クとなるシリコン窒化膜14を所要のパターンに形成す
る。次いで、図1(b)のように、前記シリコン窒化膜
14をマスクとして、前記ポリシリコン膜13のエッチ
ングを行い、ゲート電極15を形成する。この時のゲー
ト電極15のピッチ寸法は0.4μmとする。引き続
き、図1(c)のように、シリコン窒化膜14をウェハ
全面に成長させた後、このシリコン窒化膜14を異方性
エッチング法によりエツチバックを行うことにより、ゲ
ート電極15の側面にシリコン窒化膜サイドウォール1
6を形成する。
して700nmの膜厚のシリコン酸化膜17を形成し、
その後コンタクトホール形成用のエッチングマスクとし
て、リソグラフィ法を用いてレジストマスク18を所要
のパターンに形成する。この時の前記レジストマスクの
ホール径は0.25μmとする。このようにして作製し
たウェハを、図2に示すエッチング装置を用いプラズマ
エッチングを行う。このエッチング装置は、表面波を用
いプラズマを生成する表面波プラズマエッチング装置で
ある。
チング容器21で画成されるエッチング室25内のウェ
ハステージ27上に図1(d)に示したウェハ26を載
置し、かつエッチング室25の排気を十分に行う。続い
て、ガス導入口28よりエッチングガスとしてC4 F8
/CO/Ar/O2 混合ガスを導入し、圧力を20mT
orrに調整する。この時のガス流量は、C4 F4 /C
O/Ar/O2 =15/45/5/300sccmであ
る。そして、導波管22より2.45GHz,1500
Wのマイクロ波を誘電体であるテフロン板23に供給す
る。テフロン板23には定在波が形成され、このテフロ
ン板23の下部に表面波が形成され、形成された表面波
は石英板24を介してエッチング室25に伝搬され、エ
ッチング室25にプラズマを発生させる。更に、前記ウ
ェハステージ27に高周波電源29より400kHz,
600Wの電力を供給し、プラズマ中で形成されたイオ
ンがウェハに入射するエネルギを調整する。
ッチング処理を行なうことにより、前記ウェハ26は、
図1(e)に示すように、シリコン酸化膜17をシリコ
ン窒化膜14及びシリコン窒化膜サイドウォール16に
対し高選択比でエッチングすることが可能となり、0.
2μmのコンタクトホール19がエッチストップが生じ
ることなく加工精度良く形成することが可能となる。
シリコン窒化膜選択比、及びシリコン酸化膜/レジスト
選択比のArガス混合量依存性を図3に示す。Arガス
混合量の増加に伴い、シリコン酸化摸/シリコン窒化膜
選択比、及び、シリコン酸化膜/レジスト選択比が増加
している。Arガス流量を増加させることが選択比向上
のために効果的であるが、過度のArガス混合は、エッ
チング形状が樽型(ボーイング)になるという問題を生
じる。一方、Arガス流量の低い領域においては、シリ
コン酸化膜/シリコン窒化膜選択比、シリコン酸化膜/
レジスト選択比が低く、かつエッチストップが生じやす
い。この結果より、Arガス混合量を75〜90%とす
ることが高い加工精度と高選択比を得るために有効であ
ることが確認された。
択比、及びシリコン酸化膜/レジスト選択比のC4 F8
ガス混合量依存性を図4に示す。低C4 F8 混合量にお
いては、シリコン酸化膜/シリコン窒化膜、及びシリコ
ン酸化膜/レジスト選択比が低い。C4 F8 を高流量に
することで選択比の向上が見られた。しかし一方で、過
度にC4 F8 ガスを混合した場合にはエッチングストッ
プが生じた。本実験では、C4 F8 混合量を3〜7%に
することで高い加工精度と高選択比が得られている。
第1の実施形態においては、C4 F8 /CO/Ar/O
2 混合ガスを用いたが、第2の実施形態では、前記C4
F8/CO/O2 /Ar混合ガスにCH2 F2 ガスを添
加するエッチング方法を用いる。第1の実施形態に用い
たものと同様のウェハ、及びエッチング装置を用い、エ
ッチングガスとしてC4 F8 /CO/O2 /Ar/CH
2 F2 混合ガスを用いエッチングを行う。そのガス流量
はC4 F8 /CO/O2 /Ar/CH2 F2 =20/3
0/10/300/5sccmである。
択比、及びシリコン酸化膜/レジスト選択比のCH2 F
2 ガス添加量依存性のグラフを示す。CH2 F2 添加量
の増加と共に、両選択比が共に向上される。CH2 F2
ガスを添加した系を用いることにより、更にシリコン酸
化膜/シリコン窒化膜の選択比向上、及びシリコン酸化
険/レジストの選択比向上が達成される。CH2 F2 添
加量を最適化した結果、エッチストップを抑制しつつ高
選択比を得るためにCH2 F2 添加量は5%以下とする
ことが効果的であることが確認された。
置のシリコン酸化膜をシリコン窒化膜に対して高選択比
でエッチングする際のエッチングガスとしてC4 F8 /
CO/O2 /Ar混合ガスを用い、C4 F8 ガス混合量
をトータルガス流量の3〜7%、Arガス混合量をトー
タルガス流量の75〜90%としエッチングを行うこと
により、高いシリコン酸化膜/シリコン窒化膜選択比を
実現すると共に、微細コンタクトホールにおけるエッチ
ストップを抑制して加工精度を改善することが可能とな
る。また、前記混合ガスにさらにCH2 F2 ガスを混合
し、そのガス流量をトータルガス流量の0〜5%としエ
ッチングを行うことにより、前記した高選択比と加工精
度をさらに向上することが可能となる。
である。
置の概略構成図である。
コン酸化膜/レジスト選択比のArガス混合量依存性を
示す図である。
コン酸化膜/レジスト選択比のC4 F8 ガス混合量依存
性を示す図である。
コン酸化膜/レジスト選択比のCH2 F2 ガス混合量依
存性を示す図である。
断面図である。
Claims (6)
- 【請求項1】 半導体基板上にシリコン窒化膜とシリコ
ン酸化膜が形成され、前記シリコン酸化膜を前記シリコ
ン窒化膜に対して選択的にエッチングする工程を含む半
導体装置の製造方法において、前記シリコン酸化膜のエ
ッチングガスとしてC4 F8 /CO/O2 /Ar混合ガ
スを用い、かつ前記C4 F8 ガス混合量をトータルガス
流量の3〜7%、前記Arガス混合量をトータルガス流
量の75〜90%とすることを特徴とする半導体装置の
製造方法。 - 【請求項2】 前記エッチングガスとして、前記C4 F
8 /CO/O2 /Ar混合ガスにCH2 F2 ガスを混合
したガスを用い、かつ前記CH2 F2 ガス混合量をトー
タルガス流量の0〜5%とすることを特徴とする請求項
1に記載の半導体装置の製造方法。 - 【請求項3】 前記エッチングは、前記混合ガスを用い
たプラズマエッチング方法である請求項1または2に記
載の半導体装置の製造方法。 - 【請求項4】 シリコン基板の表面上に形成された第1
のシリコン絶縁膜上に導電膜を形成する工程と、この導
電膜上に第1のシリコン窒化膜を所要のパターンに形成
し、この第1のシリコン窒化膜をマスクにして前記導電
膜をエッチングして電極を形成する工程と、全面に第2
のシリコン窒化膜を堆積し、かつ異方性エッチングして
前記電極の側面に第2のシリコン窒化膜を残す工程と、
全面に第2のシリコン酸化膜を形成する工程と、前記第
2及び第1のシリコン酸化膜を前記第1及び第2のシリ
コン窒化膜に対して選択的にエッチングして前記シリコ
ン基板の表面に達するコンタクトホールを開設するエッ
チング工程とを含む請求項1ないし3のいずれかに記載
の半導体装置の製造方法。 - 【請求項5】 前記エッチング工程は、シリコン酸化膜
に0.3μm以下のコンタクトホールを開設する工程で
ある請求項4に記載の半導体装置の製造方法。 - 【請求項6】 前記電極はMOSトランジスタのゲート
電極であり、前記コンタクトホールは前記ゲート電極間
に位置されて前記シリコン基板に形成された不純物領域
に電気接続を行うためのコンタクトホールである請求項
5に記載の半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9225969A JP2985841B2 (ja) | 1997-08-22 | 1997-08-22 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9225969A JP2985841B2 (ja) | 1997-08-22 | 1997-08-22 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH1167731A JPH1167731A (ja) | 1999-03-09 |
JP2985841B2 true JP2985841B2 (ja) | 1999-12-06 |
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
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Country | Link |
---|---|
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6268293B1 (en) * | 1999-11-18 | 2001-07-31 | International Business Machines Corporation | Method of forming wires on an integrated circuit chip |
-
1997
- 1997-08-22 JP JP9225969A patent/JP2985841B2/ja not_active Expired - Fee Related
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