JP2849271B2 - ディスク装置 - Google Patents
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- JP2849271B2 JP2849271B2 JP4113734A JP11373492A JP2849271B2 JP 2849271 B2 JP2849271 B2 JP 2849271B2 JP 4113734 A JP4113734 A JP 4113734A JP 11373492 A JP11373492 A JP 11373492A JP 2849271 B2 JP2849271 B2 JP 2849271B2
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- instruction
- data
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/102—Programmed access in sequence to addressed parts of tracks of operating record carriers
- G11B27/105—Programmed access in sequence to addressed parts of tracks of operating record carriers of operating discs
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
- G11B27/3027—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording used signal is digitally coded
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F2003/0697—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers device management, e.g. handlers, drivers, I/O schedulers
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、ディスクのセクタアク
セスが連続的に行なわれるディスク装置に関するもので
ある。
セスが連続的に行なわれるディスク装置に関するもので
ある。
【０００２】キャッシュバッファを内蔵しデータ転送の
待ち時間を大幅に改善するＳＣＳＩ，ＩＰＩ−２などの
インタフェースの採用でディスク装置の性能が大幅に高
められており、また、そのフォーマット容量もプログラ
ムやデータの大規模化に伴い飛躍的に増加している。
待ち時間を大幅に改善するＳＣＳＩ，ＩＰＩ−２などの
インタフェースの採用でディスク装置の性能が大幅に高
められており、また、そのフォーマット容量もプログラ
ムやデータの大規模化に伴い飛躍的に増加している。
【０００３】
【従来の技術】図１１では従来のハードディスクにおけ
る物理セクタが説明されており、各セクタ０，１，２，
３・・・の領域ＩＤにはセクタ位置の情報（トラック上
のセクタアドレス）が、領域ＤＡＴＡにはデータが各々
書き込まれ、それらセクタ０，１，２，３・・・が順に
連続してアクセスされる。
る物理セクタが説明されており、各セクタ０，１，２，
３・・・の領域ＩＤにはセクタ位置の情報（トラック上
のセクタアドレス）が、領域ＤＡＴＡにはデータが各々
書き込まれ、それらセクタ０，１，２，３・・・が順に
連続してアクセスされる。
【０００４】図１２では各セクタのフォーマットが説明
されており、領域ＩＤの前にはギャップＧ１が、領域Ｉ
Ｄ，ＤＡＴＡ間にはギャップＧ２が、領域ＤＡＴＡの後
にギャップＤＧが、装置内部のアクセス制御を行なうた
めに設けられる。
されており、領域ＩＤの前にはギャップＧ１が、領域Ｉ
Ｄ，ＤＡＴＡ間にはギャップＧ２が、領域ＤＡＴＡの後
にギャップＤＧが、装置内部のアクセス制御を行なうた
めに設けられる。
【０００５】また、回転待ちすることなく次のセクタを
連続アクセスするために、ギャップＣＧがセクタ後尾の
部分に設けられており、このギャップ部分で上位の制御
装置（コントローラ）から次のセクタに対するアクセス
命令が発行される。
連続アクセスするために、ギャップＣＧがセクタ後尾の
部分に設けられており、このギャップ部分で上位の制御
装置（コントローラ）から次のセクタに対するアクセス
命令が発行される。
【０００６】
【発明が解決しようとする課題】ここで、ギャップＧ
１，Ｇ２，ＤＧ，ＣＧ及び領域ＩＤが領域ＤＡＴＡの他
に必要となるので、ディスク容量の全てをデータの格納
に利用できず、その結果、実際のフォーマット容量は全
容量の６０〜８０％となる。
１，Ｇ２，ＤＧ，ＣＧ及び領域ＩＤが領域ＤＡＴＡの他
に必要となるので、ディスク容量の全てをデータの格納
に利用できず、その結果、実際のフォーマット容量は全
容量の６０〜８０％となる。
【０００７】例えば、全容量が２，６４８，１３６，２
４０Ｂｙｔｅｓ（６６，０９６Ｂｙｔｅｓ／Ｔｒａｃｋ
×１５Ｈｅａｄ×２，６７１Ｃｙｌｉｎｄｅｒ）で、ギ
ャップＧ１が２２Ｂｙｔｅｓ，ギャップＧ２が２６Ｂｙ
ｔｅｓ，ギャップＤＧが２６Ｂｙｔｅｓ，ギャップＣＧ
が８４Ｂｙｔｅｓ，領域ＩＤが１２Ｂｙｔｅｓ，領域Ｄ
ＡＴＡが５１４Ｂｙｔｅｓとされたハードディスク装置
の場合、Ｂｙｔｅｓ／Ｓｅｃｔｏｒの値が６８４Ｂｙｔ
ｅｓ（２２＋２６＋２６＋８４）＋（１２＋５１４）と
なり、Ｓｅｃｔｏｒｓ／Ｔｒａｃｋの値が９６（２＝６
６，０９６Ｂｙｔｅｓ÷６８４Ｂｙｔｅｓ）となるの
で、フォーマット効率比は７４．６５５％（５１４Ｂｙ
ｔｅｓ×９６ＳＣＴ×１５ＨＤ×２，６７１Ｃｙｌ÷
２，６４８，１３６，２４０Ｂｙｔｅｓ）となる。
４０Ｂｙｔｅｓ（６６，０９６Ｂｙｔｅｓ／Ｔｒａｃｋ
×１５Ｈｅａｄ×２，６７１Ｃｙｌｉｎｄｅｒ）で、ギ
ャップＧ１が２２Ｂｙｔｅｓ，ギャップＧ２が２６Ｂｙ
ｔｅｓ，ギャップＤＧが２６Ｂｙｔｅｓ，ギャップＣＧ
が８４Ｂｙｔｅｓ，領域ＩＤが１２Ｂｙｔｅｓ，領域Ｄ
ＡＴＡが５１４Ｂｙｔｅｓとされたハードディスク装置
の場合、Ｂｙｔｅｓ／Ｓｅｃｔｏｒの値が６８４Ｂｙｔ
ｅｓ（２２＋２６＋２６＋８４）＋（１２＋５１４）と
なり、Ｓｅｃｔｏｒｓ／Ｔｒａｃｋの値が９６（２＝６
６，０９６Ｂｙｔｅｓ÷６８４Ｂｙｔｅｓ）となるの
で、フォーマット効率比は７４．６５５％（５１４Ｂｙ
ｔｅｓ×９６ＳＣＴ×１５ＨＤ×２，６７１Ｃｙｌ÷
２，６４８，１３６，２４０Ｂｙｔｅｓ）となる。
【０００８】特に、２ＨＰ（２ Ｈｅａｄ Ｐａｒａｌ
ｌｅｌ）方式が採用された高速な磁気ディスク装置で
は、セクタ数が２倍となるので、フォーマット効率がさ
らに低下する。
ｌｅｌ）方式が採用された高速な磁気ディスク装置で
は、セクタ数が２倍となるので、フォーマット効率がさ
らに低下する。
【０００９】本発明は上記従来の事情に鑑みてなされた
ものであり、ディスク容量をより効率良く使用すること
が可能となるディスク装置を提供することにある。
ものであり、ディスク容量をより効率良く使用すること
が可能となるディスク装置を提供することにある。
【００１０】
【課題を解決するための手段】上記目的を達成するため
に、本発明にかかる装置は図１のように構成されてお
り、第１発明の装置は、連続セクタに対するアクセスの
要求となる命令を上位側から受信する命令受信手段１０
と、前記の命令が受信されたときにセクタ飛び越しの連
続アクセスを指令するアクセス指令手段１２と、前記の
指令が与えられたときに１セクタ間隔でセクタの連続ア
クセスを連続して行ないアクセスされなかった飛び越し
の各セクタ部分でアクセス命令の受け渡しを行う連続ア
クセス実行手段１４と、を有する。
に、本発明にかかる装置は図１のように構成されてお
り、第１発明の装置は、連続セクタに対するアクセスの
要求となる命令を上位側から受信する命令受信手段１０
と、前記の命令が受信されたときにセクタ飛び越しの連
続アクセスを指令するアクセス指令手段１２と、前記の
指令が与えられたときに１セクタ間隔でセクタの連続ア
クセスを連続して行ないアクセスされなかった飛び越し
の各セクタ部分でアクセス命令の受け渡しを行う連続ア
クセス実行手段１４と、を有する。
【００１１】また、第２発明にかかる装置は、連続セク
タに対するアクセスの要求と２ヘッドの一方を指定する
内容が含まれた命令を上位側から受信する命令受信手段
１０と、前記の命令が受信されたときに奇数または偶数
セクタの連続アクセスを指定のヘッドに応じて指令する
アクセス指令手段１２と、前記の指令に従い奇数セクタ
または偶数セクタのみを単一のヘッドに連続アクセスさ
せてアクセスされなかった飛び越しの各セクタ部分でア
クセス命令の受け渡しを行う連続アクセス実行手段１４
と、を有する。
タに対するアクセスの要求と２ヘッドの一方を指定する
内容が含まれた命令を上位側から受信する命令受信手段
１０と、前記の命令が受信されたときに奇数または偶数
セクタの連続アクセスを指定のヘッドに応じて指令する
アクセス指令手段１２と、前記の指令に従い奇数セクタ
または偶数セクタのみを単一のヘッドに連続アクセスさ
せてアクセスされなかった飛び越しの各セクタ部分でア
クセス命令の受け渡しを行う連続アクセス実行手段１４
と、を有する。
【００１２】
【作用】第１発明においては、１セクタ間隔で連続アク
セスが行なわれ、このため、その間にアクセスされなか
った飛び越しの各セクタ部分で前述した命令の受渡しを
行なえる。したがって、飛び越しの各セクタ部分を図１
２のギャップＣＧとして利用することが可能となる。
セスが行なわれ、このため、その間にアクセスされなか
った飛び越しの各セクタ部分で前述した命令の受渡しを
行なえる。したがって、飛び越しの各セクタ部分を図１
２のギャップＣＧとして利用することが可能となる。
【００１３】また第２発明は、指定されたヘッドに応じ
て奇数セクタまたは偶数セクタのみが単一のヘッドで連
続アクセスされる。したがって、偶数セクタまたは奇数
セクタを前記のギャップＤＧとして利用でき、しかも、
物理的に単一のヘッドが論理的に奇数セクタアクセス用
と偶数セクタアクセス用の２つとなる。
て奇数セクタまたは偶数セクタのみが単一のヘッドで連
続アクセスされる。したがって、偶数セクタまたは奇数
セクタを前記のギャップＤＧとして利用でき、しかも、
物理的に単一のヘッドが論理的に奇数セクタアクセス用
と偶数セクタアクセス用の２つとなる。
【００１４】
【実施例】以下、図面に基づいて本発明にかかるディス
ク装置の好適な実施例を説明する。
ク装置の好適な実施例を説明する。
【００１５】図２には実施例の全体構成が示されてお
り、ディスクスピンドル駆動用のＤＣモータ２００，ヘ
ッド位置決め用のボイスコイルモータ２０２，ディスク
アクセス用のヘッド励磁回路２０４はメイン基板２０６
に搭載されたＬＳＩ２０８，２１０，リード／ライト制
御回路２１２で各々制御される。
り、ディスクスピンドル駆動用のＤＣモータ２００，ヘ
ッド位置決め用のボイスコイルモータ２０２，ディスク
アクセス用のヘッド励磁回路２０４はメイン基板２０６
に搭載されたＬＳＩ２０８，２１０，リード／ライト制
御回路２１２で各々制御される。
【００１６】そしてＬＳＩ２０８，２１０にはＭＰＵ２
１４，２１６からモータ制御指示が各々与えられ、ＭＰ
Ｕ２１４，２１６にはＬＳＩ２１８を介してインタフェ
ース基板２２０のＭＰＵ２２２からモータ制御指令が与
えられる。
１４，２１６からモータ制御指示が各々与えられ、ＭＰ
Ｕ２１４，２１６にはＬＳＩ２１８を介してインタフェ
ース基板２２０のＭＰＵ２２２からモータ制御指令が与
えられる。
【００１７】また、リード／ライト制御回路２１２には
エンコーダ／デコーダ２２４を介してインタフェース基
板２２０のＬＳＩ２２６からディスクアクセスの制御指
示が与えられ、それらリード／ライト制御回路２１２，
ＬＳＩ２２６間でアクセスデータの送受信が行なわれ
る。
エンコーダ／デコーダ２２４を介してインタフェース基
板２２０のＬＳＩ２２６からディスクアクセスの制御指
示が与えられ、それらリード／ライト制御回路２１２，
ＬＳＩ２２６間でアクセスデータの送受信が行なわれ
る。
【００１８】このＬＳＩ２２６及びＭＰＵ２２２にはＤ
Ｃモータ２００，ボイスコールモータ２０２，ヘッド励
磁回路２０４の制御命令がプロトコルＬＳＩ２２８，２
３０，ドライバ／レシーバ２３２，２３４を介して上位
側から与えられる。
Ｃモータ２００，ボイスコールモータ２０２，ヘッド励
磁回路２０４の制御命令がプロトコルＬＳＩ２２８，２
３０，ドライバ／レシーバ２３２，２３４を介して上位
側から与えられる。
【００１９】さらに、上位側から送出された制御命令の
パラメータはドライバ／レシ−バ２３２，２３４，トラ
ンシーバ２３６，２３８を介してトランスファバッファ
のＬＳＩ２４０で受信され、ＭＰＵ２２２，ＬＳＩ２２
６に与えられる。
パラメータはドライバ／レシ−バ２３２，２３４，トラ
ンシーバ２３６，２３８を介してトランスファバッファ
のＬＳＩ２４０で受信され、ＭＰＵ２２２，ＬＳＩ２２
６に与えられる。
【００２０】そして、ディスクアクセスのデータはトラ
ンシーバ２３６，２３８，ドライバ／レシーバ２３２，
２３４を介して上位側とＬＳＩ２２６との間で送受信さ
れており、このＬＳＩ２２６ではエンコーダ／デコーダ
２２４との間で転送されるデータの幅とインタフェース
基板２２０内で取り扱われるデータの幅を変換する処理
（エンコーダ／デコーダ２２４との間では１バイト幅，
基板内では２バイト幅）が行なわれる。
ンシーバ２３６，２３８，ドライバ／レシーバ２３２，
２３４を介して上位側とＬＳＩ２２６との間で送受信さ
れており、このＬＳＩ２２６ではエンコーダ／デコーダ
２２４との間で転送されるデータの幅とインタフェース
基板２２０内で取り扱われるデータの幅を変換する処理
（エンコーダ／デコーダ２２４との間では１バイト幅，
基板内では２バイト幅）が行なわれる。
【００２１】図３ではＬＳＩ２２６の構成が説明されて
おり、データ送受信回路部３００は図２のエンコーダ／
コーダ２２４と接続され、データ送受信制御回路部３０
０とエンコーダ／デコーダ２２４との間でディスクアク
セスのデータが転送される。
おり、データ送受信回路部３００は図２のエンコーダ／
コーダ２２４と接続され、データ送受信制御回路部３０
０とエンコーダ／デコーダ２２４との間でディスクアク
セスのデータが転送される。
【００２２】そのアクセスデータはＦｉＦｏバッファ３
０２を介して上位側と送受信されており、上位側から送
出された制御命令はコマンドデコード回路３０４で受信
される。
０２を介して上位側と送受信されており、上位側から送
出された制御命令はコマンドデコード回路３０４で受信
される。
【００２３】コマンドデコード回路部３０４にはシンク
アウト信号ＳＹＣＯＴ（ＦｉＦｏバッファ３０２にも供
給されている），マスタアウト信号ＭＳＴＯＴ，セレク
トアウト信号ＳＬＴＯＴが供給され、ライト信号ＷＲＩ
ＴＥ，リード信号ＲＥＡＤ，ベリファイ信号ＶＥＲＦ
Ｙ，スキップ信号ＳＫＩＰ，ターゲット信号ＴＲＧＥ
Ｔ，セクタ内フィールド（ＩＤ／ＤＡＴＡ）の選択信号
ＦＬＤ０，ＦＬＤ１，ＦＬＤ２がコマンドデコード回路
部３０４からリード／ライト制御処理部３０６へ送出さ
れる。
アウト信号ＳＹＣＯＴ（ＦｉＦｏバッファ３０２にも供
給されている），マスタアウト信号ＭＳＴＯＴ，セレク
トアウト信号ＳＬＴＯＴが供給され、ライト信号ＷＲＩ
ＴＥ，リード信号ＲＥＡＤ，ベリファイ信号ＶＥＲＦ
Ｙ，スキップ信号ＳＫＩＰ，ターゲット信号ＴＲＧＥ
Ｔ，セクタ内フィールド（ＩＤ／ＤＡＴＡ）の選択信号
ＦＬＤ０，ＦＬＤ１，ＦＬＤ２がコマンドデコード回路
部３０４からリード／ライト制御処理部３０６へ送出さ
れる。
【００２４】また、セクタ／フィールドパルス作成回路
部３０８にはインデックス信号ＩＮＤＥＸ，バイトクロ
ック信号ＢＹＴＣＬが供給され、セクタパルス信号ＳＣ
ＴＰＬ，フィールドパルス信号ＦＬＤＰＬがセクタ／フ
ィールドパルス作成回路部３０８からリード／ライト制
御処理部３０６へ送出される。
部３０８にはインデックス信号ＩＮＤＥＸ，バイトクロ
ック信号ＢＹＴＣＬが供給され、セクタパルス信号ＳＣ
ＴＰＬ，フィールドパルス信号ＦＬＤＰＬがセクタ／フ
ィールドパルス作成回路部３０８からリード／ライト制
御処理部３０６へ送出される。
【００２５】リード／ライト制御処理部３０６にはフィ
ールド（ＩＤ／ＤＡＴＡ）の先頭検出信号ＳＢＦＮＤも
データ送受信制御回路部３００から与えられ、フィール
ドアクセスのクロック信号ＦＲＤＣＬ，ＦＷＴＣＬがＦ
ｉＦｏバッファ３０２へ、ライトゲート信号ＷＴＧＴ，
リードゲート信号ＲＤＧＴ，ギャップパディング用のゲ
ート信号ＰＡＤＧＴ，シングルバイトゲート信号ＳＢＧ
Ｔ，データゲート信号ＤＴＧＴがデータ送受信制御回路
３００へ、リード／ライト制御処理部３０６から送出さ
れる。
ールド（ＩＤ／ＤＡＴＡ）の先頭検出信号ＳＢＦＮＤも
データ送受信制御回路部３００から与えられ、フィール
ドアクセスのクロック信号ＦＲＤＣＬ，ＦＷＴＣＬがＦ
ｉＦｏバッファ３０２へ、ライトゲート信号ＷＴＧＴ，
リードゲート信号ＲＤＧＴ，ギャップパディング用のゲ
ート信号ＰＡＤＧＴ，シングルバイトゲート信号ＳＢＧ
Ｔ，データゲート信号ＤＴＧＴがデータ送受信制御回路
３００へ、リード／ライト制御処理部３０６から送出さ
れる。
【００２６】さらに、リード／ライト制御処理部３０６
のシンクイン信号ＳＹＣＩＮは上位側へ送信され、セク
タ／フィールドパルス作成回路部３０８のセクタパルス
信号ＳＣＴＰＬはＲＰＳインタラプト回路部３１０へ出
力される。
のシンクイン信号ＳＹＣＩＮは上位側へ送信され、セク
タ／フィールドパルス作成回路部３０８のセクタパルス
信号ＳＣＴＰＬはＲＰＳインタラプト回路部３１０へ出
力される。
【００２７】そのＲＰＳインタラプト回路部３１０には
ゲート出力制御信号ＳＴＲＰＳが入力され、ＲＰＳイン
タラプト回路部３１０で得られた割り込み通知信号ＲＰ
ＳＩＴは上位側へ送信される。
ゲート出力制御信号ＳＴＲＰＳが入力され、ＲＰＳイン
タラプト回路部３１０で得られた割り込み通知信号ＲＰ
ＳＩＴは上位側へ送信される。
【００２８】図４ではリード／ライト制御処理部３０６
の構成が説明されており、このリード／ライト制御処理
部３０６にはフリップフロップ４００，カウンタ４０
２，レジスタ４０４が設けられている。
の構成が説明されており、このリード／ライト制御処理
部３０６にはフリップフロップ４００，カウンタ４０
２，レジスタ４０４が設けられている。
【００２９】そして、セクタ／フィールドパルス作成回
路部３０８に設けられたセクタパルス作成回路４０６に
はバイトクロック信号ＢＹＴＣＬと図５のインデックス
信号ＩＮＤＥＸが供給され、図５に示されたセクタパル
ス信号ＳＣＴＰＬがこのセクタパルス作成回路３０８で
得られる。
路部３０８に設けられたセクタパルス作成回路４０６に
はバイトクロック信号ＢＹＴＣＬと図５のインデックス
信号ＩＮＤＥＸが供給され、図５に示されたセクタパル
ス信号ＳＣＴＰＬがこのセクタパルス作成回路３０８で
得られる。
【００３０】また、インデックス信号ＩＮＤＥＸはイン
バータ４０８を介してセクタパルス信号ＳＣＴＰＬとと
もにフリップフロップ４００へ与えられ、フリップフロ
ップ４００の反転出力，インバータ４０８の出力はカウ
ンタ４０２に与えらる。
バータ４０８を介してセクタパルス信号ＳＣＴＰＬとと
もにフリップフロップ４００へ与えられ、フリップフロ
ップ４００の反転出力，インバータ４０８の出力はカウ
ンタ４０２に与えらる。
【００３１】さらに、カウンタ４０２の出力ＥＳＣＮＴ
１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８とフリ
ップフロップ４００の正転出力がレジスタ４０４に与え
られ、そのレジスタ４０４からは出力ＯＳＣＮＴ１，Ｏ
ＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣＮＴ８が得られる。
１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８とフリ
ップフロップ４００の正転出力がレジスタ４０４に与え
られ、そのレジスタ４０４からは出力ＯＳＣＮＴ１，Ｏ
ＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣＮＴ８が得られる。
【００３２】ここで、フリップフロップ４００が２本の
セクタパルスＳＣＴＰＬを１周期として動作し、カウン
タ４０２がフリップフロップ４００の反転出力をアップ
カウントし、レジスタ４０４がフリップフロップ４００
の正転出力でカウンタ４０２の出力ＥＳＣＮＴ１，ＥＳ
ＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８を取り込むの
で、カウンタ４０２の出力ＥＳＣＮＴ１，ＥＳＣＮＴ
２，ＥＳＣＮＴ４，ＥＳＣＮＴ８とレジスタ４０４の出
力ＯＳＣＮＴ１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣ
ＮＴ８との間に１セクタ分の位相差が生ずる（図５参
照）。
セクタパルスＳＣＴＰＬを１周期として動作し、カウン
タ４０２がフリップフロップ４００の反転出力をアップ
カウントし、レジスタ４０４がフリップフロップ４００
の正転出力でカウンタ４０２の出力ＥＳＣＮＴ１，ＥＳ
ＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８を取り込むの
で、カウンタ４０２の出力ＥＳＣＮＴ１，ＥＳＣＮＴ
２，ＥＳＣＮＴ４，ＥＳＣＮＴ８とレジスタ４０４の出
力ＯＳＣＮＴ１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣ
ＮＴ８との間に１セクタ分の位相差が生ずる（図５参
照）。
【００３３】図４において、カウンタ４０２の出力ＥＳ
ＣＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８
とレジスタ４０４の出力ＯＳＣＮＴ１，ＯＳＣＮＴ２，
ＯＳＣＮＴ４，ＯＳＣＮＴ８はマルチプレクサ４１０に
入力されており、マルチプレクサ４１０では入力ＥＳＣ
ＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８と
入力ＯＳＣＮＴ１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳ
ＣＮＴ８の一方がセクタカウント信号ＳＣＣＮＴ１，Ｓ
ＣＣＮＴ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８として選択出
力される。
ＣＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８
とレジスタ４０４の出力ＯＳＣＮＴ１，ＯＳＣＮＴ２，
ＯＳＣＮＴ４，ＯＳＣＮＴ８はマルチプレクサ４１０に
入力されており、マルチプレクサ４１０では入力ＥＳＣ
ＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８と
入力ＯＳＣＮＴ１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳ
ＣＮＴ８の一方がセクタカウント信号ＳＣＣＮＴ１，Ｓ
ＣＣＮＴ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８として選択出
力される。
【００３４】この切替は（物理的な）ヘッドアドレスＩ
ＦＨＤ８，ＩＦＨＤ４，ＩＦＨＤ２，ＨＦＨＤ１のうち
不使用とされた最下位ビットＩＦＨＤ１に応じて行なわ
れており、レジスタ４１２には上位側から（論理的な）
ヘッドアドレスＩＦＢＳ３，ＩＦＢＦ２，ＩＦＢＦ１，
ＩＦＢＳ０が与えられる。
ＦＨＤ８，ＩＦＨＤ４，ＩＦＨＤ２，ＨＦＨＤ１のうち
不使用とされた最下位ビットＩＦＨＤ１に応じて行なわ
れており、レジスタ４１２には上位側から（論理的な）
ヘッドアドレスＩＦＢＳ３，ＩＦＢＦ２，ＩＦＢＦ１，
ＩＦＢＳ０が与えられる。
【００３５】すなわち、レジスタ４１２では計１６のヘ
ッドアドレスが計８の物理アドレスに変換され、マルチ
プレクサ４１０では２セクタパルス長のカウンタ出力Ｅ
ＳＣＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ
８またはレジスタ出力ＯＳＣＮＴ１，ＯＳＣＮＴ２，Ｏ
ＳＣＮＴ４，ＯＳＣＮＴ８が選択出力ＳＣＣＮＴ１，Ｓ
ＣＣＮＴ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８として得られ
る。
ッドアドレスが計８の物理アドレスに変換され、マルチ
プレクサ４１０では２セクタパルス長のカウンタ出力Ｅ
ＳＣＮＴ１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ
８またはレジスタ出力ＯＳＣＮＴ１，ＯＳＣＮＴ２，Ｏ
ＳＣＮＴ４，ＯＳＣＮＴ８が選択出力ＳＣＣＮＴ１，Ｓ
ＣＣＮＴ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８として得られ
る。
【００３６】さらに、リード／ライト制御処理部３０６
はマルチプレクサ４１０の出力ＳＣＣＮＴ１，ＳＣＣＮ
Ｔ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８をセクタアクセスの
単位として取り扱っており、したがって、連続セクタの
ディスクアクセスは１セクタ間隔で行なわれる。
はマルチプレクサ４１０の出力ＳＣＣＮＴ１，ＳＣＣＮ
Ｔ２，ＳＣＣＮＴ４，ＳＣＣＮＴ８をセクタアクセスの
単位として取り扱っており、したがって、連続セクタの
ディスクアクセスは１セクタ間隔で行なわれる。
【００３７】図６では本実施例におけるライトアクセス
の動作が説明されており、信号ＷＲＩＴＥ，ＦＬＤ０，
ＦＬＤ１が立ち上げられてから信号ＩＮＤＥＸが発生す
ると、クロック信号ＢＹＴＣＬを用いて期間の経過が
監視される。
の動作が説明されており、信号ＷＲＩＴＥ，ＦＬＤ０，
ＦＬＤ１が立ち上げられてから信号ＩＮＤＥＸが発生す
ると、クロック信号ＢＹＴＣＬを用いて期間の経過が
監視される。
【００３８】この期間が経過すると、信号ＷＴＧＴ，
ＰＡＤＧＴが立ち上げられ、期間に亘りデータ信号Ｒ
ＷＤＡＴでパディング用のギャップパターン（ＰＡＤ）
が書き込まれる。
ＰＡＤＧＴが立ち上げられ、期間に亘りデータ信号Ｒ
ＷＤＡＴでパディング用のギャップパターン（ＰＡＤ）
が書き込まれる。
【００３９】そして、ＩＤデータの先頭が検出されて信
号ＳＢＧＴが期間で得られると、期間に亘り信号Ｄ
ＴＧＴが立ち上がり、データ信号ＲＷＤＡＴでフィール
ド０のデータＩＤが書き込まれる。
号ＳＢＧＴが期間で得られると、期間に亘り信号Ｄ
ＴＧＴが立ち上がり、データ信号ＲＷＤＡＴでフィール
ド０のデータＩＤが書き込まれる。
【００４０】データＩＤの書き込みが完了すると、信号
ＰＡＤＧＴが期間に亘って立ち上げられ、その間にデ
ータ信号ＲＷＤＡＴでパディング用のギャップデータ
（ＰＡＤ）が書き込まれる。
ＰＡＤＧＴが期間に亘って立ち上げられ、その間にデ
ータ信号ＲＷＤＡＴでパディング用のギャップデータ
（ＰＡＤ）が書き込まれる。
【００４１】なお、信号ＳＹＣＩＮの送出で上位側に対
してデータＩＤの送信が要求され、信号ＳＹＣＯＴで上
位側からデータの送信が通知され、クロックＦＲＤＣＬ
でＦｉＦｏ３０２から２バイト幅のデータ信号ＦＤＡＴ
Ａが送出され、データ送受信制御回路部３００で１バイ
ト幅のデータ信号ＲＷＤＡＴに変換される。
してデータＩＤの送信が要求され、信号ＳＹＣＯＴで上
位側からデータの送信が通知され、クロックＦＲＤＣＬ
でＦｉＦｏ３０２から２バイト幅のデータ信号ＦＤＡＴ
Ａが送出され、データ送受信制御回路部３００で１バイ
ト幅のデータ信号ＲＷＤＡＴに変換される。
【００４２】このようにしてデータＩＤの書き込みが完
了すると、ライトアクセスの本体となるデータ部分ＤＡ
ＴＡが同様にして書き込まれる。ただし、データＩＤ，
ＤＡＴＡの書き込みはセクタパルスＳＣＴＰＬが出力さ
れるまでの１セクタ内で行なわれており、このことは図
７に示されたリードアクセスの動作時にも同様である。
了すると、ライトアクセスの本体となるデータ部分ＤＡ
ＴＡが同様にして書き込まれる。ただし、データＩＤ，
ＤＡＴＡの書き込みはセクタパルスＳＣＴＰＬが出力さ
れるまでの１セクタ内で行なわれており、このことは図
７に示されたリードアクセスの動作時にも同様である。
【００４３】図８（Ｂ）ではカウンタ出力ＥＳＣＮＴ
１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８がマル
チプレクサ４１０で選択出力されたときのライトアクセ
ス動作が、また同図（Ｃ）ではレジスタ出力ＯＳＣＮＴ
１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣＮＴ８が選択
出力されたときのライトアクセス動作が各々説明されて
おり、同図（Ｂ）においては偶数セクタのみがライトア
クセスされ、同図（Ｃ）においては奇数セクタのみがラ
イトアクセスされる。
１，ＥＳＣＮＴ２，ＥＳＣＮＴ４，ＥＳＣＮＴ８がマル
チプレクサ４１０で選択出力されたときのライトアクセ
ス動作が、また同図（Ｃ）ではレジスタ出力ＯＳＣＮＴ
１，ＯＳＣＮＴ２，ＯＳＣＮＴ４，ＯＳＣＮＴ８が選択
出力されたときのライトアクセス動作が各々説明されて
おり、同図（Ｂ）においては偶数セクタのみがライトア
クセスされ、同図（Ｃ）においては奇数セクタのみがラ
イトアクセスされる。
【００４４】そして、同図（Ｂ）においては奇数セクタ
が、同図（Ｃ）においては偶数セクタがギャップＣＧと
して利用されており、したがって、ライトアクセスされ
ないギャップセクタで命令の受渡しが行なわれる（リー
ドアクセスについても同様である）。
が、同図（Ｃ）においては偶数セクタがギャップＣＧと
して利用されており、したがって、ライトアクセスされ
ないギャップセクタで命令の受渡しが行なわれる（リー
ドアクセスについても同様である）。
【００４５】なお、アクセス飛び越しのギャップセクタ
ではデータライトは行なわれず、このため、図８（Ｂ）
のように偶数セクタのみが連続してライトアクセスされ
る動作と同図（Ｃ）のように奇数セクタのみが連続して
ライトアクセスされる動作との繰り返しで、同図（Ａ）
のように全セクタをライトアクセス（もしくはリードア
クセス）することが可能となる。
ではデータライトは行なわれず、このため、図８（Ｂ）
のように偶数セクタのみが連続してライトアクセスされ
る動作と同図（Ｃ）のように奇数セクタのみが連続して
ライトアクセスされる動作との繰り返しで、同図（Ａ）
のように全セクタをライトアクセス（もしくはリードア
クセス）することが可能となる。
【００４６】図９では本実施例における物理セクタのフ
ォーマットが説明されており、アクセス飛び越しのセク
タがギャップＣＧとして取り扱われるので、アクセスさ
れるセクタには同図のようにギャップＣＧが設けられ
ず、このため、実際のフォーマット容量が高められる
（図１０参照）。
ォーマットが説明されており、アクセス飛び越しのセク
タがギャップＣＧとして取り扱われるので、アクセスさ
れるセクタには同図のようにギャップＣＧが設けられ
ず、このため、実際のフォーマット容量が高められる
（図１０参照）。
【００４７】例えばギャップＧ１，Ｇ２，ＤＧの長さ及
びデータＩＤ，ＤＡＴＡの長さが前述と同様な場合、Ｂ
ｙｔｅｓ／Ｓｅｃｔｏｒの値が６００Ｂｙｔｅｓ（２２
＋２６＋２６＋１２＋５１４）で、Ｓｅｃｔｏｒｓ／Ｔ
ｒａｃｋの値が１１０（＝６６，０９６Ｂｙｔｅｓ÷６
００Ｂｙｔｅｓ）となることから、全ディスク容量に対
する全データ領域の割合は８４．５４％（＝５１４Ｂｙ
ｔｅｓ×１１０ＳＣＴ×１５ＨＤ×２，６７１Ｃｙｌ÷
２，６４８，１３６，２４０Ｂｙｔｅｓ）となり、１０
％以上の容量増加となる。
びデータＩＤ，ＤＡＴＡの長さが前述と同様な場合、Ｂ
ｙｔｅｓ／Ｓｅｃｔｏｒの値が６００Ｂｙｔｅｓ（２２
＋２６＋２６＋１２＋５１４）で、Ｓｅｃｔｏｒｓ／Ｔ
ｒａｃｋの値が１１０（＝６６，０９６Ｂｙｔｅｓ÷６
００Ｂｙｔｅｓ）となることから、全ディスク容量に対
する全データ領域の割合は８４．５４％（＝５１４Ｂｙ
ｔｅｓ×１１０ＳＣＴ×１５ＨＤ×２，６７１Ｃｙｌ÷
２，６４８，１３６，２４０Ｂｙｔｅｓ）となり、１０
％以上の容量増加となる。
【００４８】しかも、論理的なヘッドアドレスから物理
的なヘッドアドレスへの変換時に最下位の物理アドレス
ＩＦＨＤ１で偶数セクタの連続アクセスと奇数セクタの
連続アドレスとの切替が行なわれ、上位装置がセクタア
クセスを意識することなく制御が行われる。
的なヘッドアドレスへの変換時に最下位の物理アドレス
ＩＦＨＤ１で偶数セクタの連続アクセスと奇数セクタの
連続アドレスとの切替が行なわれ、上位装置がセクタア
クセスを意識することなく制御が行われる。
【００４９】
【発明の効果】以上説明したように、ディスクの連続ア
クセスが１セクタ間隔で行なわれるので、アクセスされ
ない飛び越しの各セクタを命令の受渡しに利用できる。
クセスが１セクタ間隔で行なわれるので、アクセスされ
ない飛び越しの各セクタを命令の受渡しに利用できる。
【００５０】したがって、命令の受渡しに必要なギャッ
プをアクセスされる各セクタで省略でき、このため、図
１０（Ａ），（Ｂ）の比較からも理解されるように、デ
ィスクに書き込めるデータ量を増加させて実際のフォー
マット効率をより高めることが可能となる。
プをアクセスされる各セクタで省略でき、このため、図
１０（Ａ），（Ｂ）の比較からも理解されるように、デ
ィスクに書き込めるデータ量を増加させて実際のフォー
マット効率をより高めることが可能となる。
【００５１】また、指定されたヘッドに応じて奇数また
は偶数のセクタのみが連続して飛び越しアクセスされ、
上位装置が１セクタ間隔でのセクタアクセスを意識する
ことなく従来通りの制御を行うことが可能となる。
は偶数のセクタのみが連続して飛び越しアクセスされ、
上位装置が１セクタ間隔でのセクタアクセスを意識する
ことなく従来通りの制御を行うことが可能となる。
【図１】発明の原理説明図である。
【図２】実施例の全体構成説明図である。
【図３】データ幅変換用ＬＳＩの構成説明図である。
【図４】リード／ライト制御処理部の構成説明図であ
る。
る。
【図５】リード／ライト制御処理部の入出波形説明図で
ある。
ある。
【図６】実施例のライトアクセス動作説明図である。
【図７】実施例のリードアクセス動作説明図である。
【図８】実施例における物理セクタのアクセス作用説明
図である。
図である。
【図９】実施例における物理セクタのフォーマット説明
図である。
図である。
【図１０】発明の適用による容量増加の効果説明図であ
る。
る。
【図１１】従来における物理セクタ説明図である。
【図１２】従来例における物理セクタのフォーマット説
明図である。
明図である。
２００ ＤＣモータ、 ２０２ ボイスコイルモータ ２０４ ヘッド励磁回路 ２０６ メイン基板 ２０８，２１０ ＬＳＩ ２１２ リード／ライト制御回路 ２１４，２１６ ＭＰＵ ２１８ ＬＳＩ ２２０ インタフェース基板 ２２２ ＭＰＵ ２２４ エンコーダ／デコーダ ２２６ ＬＳＩ ２２８，２３０ プロトコルＬＳＩ ２３２，２３４ ドライバ／レシーバ ２３６，２３８ トランシーバ ３００ データ送受信制御回路部 ３０２ ＦｉＦｏバッファ ３０４ コマンドデコード回路 ３０６ リード／ライト制御処理部 ３０８ セクタ／フィールドパルス作成回路部 ３１０ ＲＰＳインタラプト回路部
Claims (2)
- 【請求項１】 連続セクタに対するアクセスの要求とな
る命令を上位側から受信する命令受信手段と、 前記の命令が受信されたときにセクタ飛び越しの連続ア
クセスを指令するアクセス指令手段と、 前記の指令が与えられたときに１セクタ間隔でセクタの
アクセスを連続して行ないアクセスされなかった飛び越
しの各セクタ部分でアクセス命令の受け渡しを行う連続
アクセス実行手段と、 を有する、ことを特徴としたディスク装置。 - 【請求項２】 連続セクタに対するアクセスの要求と２
ヘッドの一方を指定する内容が含まれた命令を上位側か
ら受信する命令受信手段と、 前記の命令が受信されたときに奇数または偶数セクタの
連続アクセスを指定のヘッドに応じて指令するアクセス
指令手段と、 前記の指令に従い奇数セクタまたは偶数セクタのみを単
一のヘッドに連続アクセスさせてアクセスされなかった
飛び越しの各セクタ部分でアクセス命令の受け渡しを行
う連続アクセス実行手段と、 を有する、ことを特徴としたディスク装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4113734A JP2849271B2 (ja) | 1992-05-06 | 1992-05-06 | ディスク装置 |
| US08/057,312 US5696640A (en) | 1992-05-06 | 1993-05-04 | Disk drive using virtual hands for continuous access and execution |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4113734A JP2849271B2 (ja) | 1992-05-06 | 1992-05-06 | ディスク装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05314650A JPH05314650A (ja) | 1993-11-26 |
| JP2849271B2 true JP2849271B2 (ja) | 1999-01-20 |
Family
ID=14619787
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4113734A Expired - Lifetime JP2849271B2 (ja) | 1992-05-06 | 1992-05-06 | ディスク装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5696640A (ja) |
| JP (1) | JP2849271B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3255887B2 (ja) * | 1999-02-15 | 2002-02-12 | 松下電器産業株式会社 | 磁気ディスク装置およびそのディスクアクセス方法 |
| US6356915B1 (en) | 1999-02-22 | 2002-03-12 | Starbase Corp. | Installable file system having virtual file system drive, virtual device driver, and virtual disks |
Family Cites Families (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4112258A (en) * | 1977-10-12 | 1978-09-05 | Bell Telephone Laboratories, Incorporated | Communication system using intelligent network processor |
| US4500965A (en) * | 1982-06-04 | 1985-02-19 | Cipher Data Products, Inc. | Capstanless magnetic tape drive with electronic equivalent to length of tape |
| US4862295A (en) * | 1985-06-27 | 1989-08-29 | Matsushita Electric Industrial Co., Ltd. | Method of formatting a storage medium and drive unit for controlling the reading and writing of data on the formatted storage medium |
| US4858034A (en) * | 1987-05-20 | 1989-08-15 | Plus Development Corporation | Modular unitary disk file subsystem with differing density zones |
| JPH01173480A (ja) * | 1987-12-28 | 1989-07-10 | Toshiba Corp | 磁気ディスク制御装置 |
| US5077736A (en) * | 1988-06-28 | 1991-12-31 | Storage Technology Corporation | Disk drive memory |
| JPH0337875A (ja) * | 1989-07-04 | 1991-02-19 | Toshiba Corp | データ記録再生装置のヘッド駆動制御装置 |
| JPH03212884A (ja) * | 1990-01-17 | 1991-09-18 | Nec Corp | 磁気ディスク装置 |
| US5018095A (en) * | 1990-02-15 | 1991-05-21 | Seagate Technology, Inc. | Universal disk drive type emulation for IBM PC-AT computers |
| US5247638A (en) * | 1990-06-18 | 1993-09-21 | Storage Technology Corporation | Apparatus for compressing data in a dynamically mapped virtual data storage subsystem |
-
1992
- 1992-05-06 JP JP4113734A patent/JP2849271B2/ja not_active Expired - Lifetime
-
1993
- 1993-05-04 US US08/057,312 patent/US5696640A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US5696640A (en) | 1997-12-09 |
| JPH05314650A (ja) | 1993-11-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19981027 |