JP2823015B2 - 映像信号の情報信号読み取り回路 - Google Patents
映像信号の情報信号読み取り回路Info
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- JP2823015B2 JP2823015B2 JP61172564A JP17256486A JP2823015B2 JP 2823015 B2 JP2823015 B2 JP 2823015B2 JP 61172564 A JP61172564 A JP 61172564A JP 17256486 A JP17256486 A JP 17256486A JP 2823015 B2 JP2823015 B2 JP 2823015B2
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はビデオデイスクプレーヤーのピクチヤーナン
バーの読み取り回路に使用して好適な映像信号の情報信
号読み取り回路に関する。 〔発明の概要〕 本発明はビデオデイスクプレーヤーのピクチヤーナン
バーの読み取り回路に使用して好適な映像信号の情報信
号読み取り回路であつて、垂直帰線期間の所定水平期間
に所定ビツト数の情報信号（例えばピクチヤーナンバー
信号）が挿入された映像信号が供給されるデータレジス
タと、この映像信号の１水平期間毎のビツト数を計数す
るカウンタとを有し、このカウンタの１水平期間の計数
が上記所定ビツト数の一致したとき、このデータレジス
タを読み取る様にしたことにより、例えばビデオデイス
クプレーヤーの速度変動に係りなく常に正しい情報を得
ることができる。 〔従来の技術〕 一般にビデオデイスクに記録されている映像信号に於
いては、第２図Ａに示す如くその垂直帰線期間の垂直同
期信号（１）より第17番目の水平期間と第18番目の水平
期間に夫々第２図Ｂに示す如き24ビツトのバイフエイス
コード（ビツト期間TBの中央部立上るものが“1"、この
中央部で立下るものが“0"である。）に衣りピクチヤー
ナンバーを示すデイジタル信号のピクチヤーナンバー信
号（２）が挿入されており、このピクチヤーナンバー信
号（２）によりビデオデイスクの所望映像信号の記録位
置を容易に選定することができる。この場合このピクチ
ヤーナンバー信号（２）の第１番目のビツトは常に“1"
となる如く決められている。図に於いて（1a）は水平同
期信号である。 従来斯るビデオデイスクよりの映像信号のピクチヤー
ナンバー信号（２）を読み取るのに第３図に示す如きピ
クチヤーナンバー信号読み取り回路が使用されていた。
この第３図に於いて、（３）は垂直帰線期間の垂直同期
信号（１）より第17及び第18番目の水平期間にピクチヤ
ーナンバー信号（２）が挿入されたビデオデイスクより
再生した映像信号が供給される映像信号入力端子を示
し、この映像信号入力端子（３）に供給される映像信号
を所定レベルでスライスしてデイジタル信号であるピク
チヤーナンバー信号（２）の雑音を除去するスライサー
（４）を介してゲート回路（５）に供給すると共にこの
映像信号入力端子（３）に供給される映像信号を垂直同
期分離回路（６）に供給し、この垂直同期分離回路
（６）の出力側に得られる垂直同期信号（１）を16水平
期間16Hの遅延回路を構成するモノマルチバイブレータ
（７）に供給し、このモノマルチバイブレータ（７）の
16水平期間16H遅延した信号を１水平期間のゲート信号
を得る為のモノマルチバイブレータ（８）に供給する。
従つてこのモノマルチバイブレータ（８）の出力側には
垂直同期信号（１）より第17番目の水平期間に相当する
ゲート信号が得られる。このモノマルチバイブレータ
（８）の出力側に得られるゲート信号をゲート回路
（５）に供給して、このゲート回路（５）を垂直同期信
号（１）より第17番目の水平期間毎に導通とし、その他
の期間を不導通とする。このゲート回路（５）の出力信
号を例えば24ビツトのデータレジスタ（９）に供給し、
このデータレジスタ（９）をデコーダ（10）により読み
取る如くする。従つてこの第３図例に於いては垂直同期
信号（１）より第17番目の水平期間に挿入されたピクチ
ヤーナンバー信号（22）を読み取ることができる。 〔発明が解決しようとする問題点〕 然しながら斯る第３図例に於いては遅延時間が一定16
Hの遅延回路（７）を使用しており、ビデオデイスクプ
レーヤーに於いてモータの立ち上がり時等駆動モータが
サーボロツクしていないときには映像信号の時間的長さ
が一定とならず変動するのでピクチヤーナンバー信号
（２）の挿入されている時間的位置が変動し、このとき
はゲート回路（５）よりデータレジスタ（９）に供給さ
れる信号はピクチヤーナンバー信号（２）ではなくな
り、正しくピクチヤーナンバー信号（２）を読むことが
できず、正しい情報を得ることができない不都合があつ
た。 本発明は斯る点に鑑み映像信号の時間的変動に係りな
く、常に正しい情報を得ることができる様にすることを
目的とする。 〔問題点を解決するための手段〕 本発明映像信号の情報信号読み取り回路は第１図に示
す如く垂直帰線期間の所定水平期間に所定ビット数の情
報信号が挿入された映像信号が供給されるデータレジス
タ（９）と、この情報信号が供給され、この情報信号の
ビット数と等しい数のクロックパルスを発生するクロッ
ク発生回路（15）と、このクロック発生回路（15）から
出力されるクロックパルスの数を直接計数するカウンタ
（11）と、このカウンタ（11）の１水平期間の計数値を
判別する判別回路（16）とを有し、このカウンタ（11）
の１水平期間の計数値が上述の所定ビット数と一致した
とき、このデータレジスタ（９）を読み取る様にしたも
のである。 〔作用〕 本発明に依れば情報信号のビツト数をカウンタ（11）
で計数して、情報信号がどうかを判別しているので、映
像信号の時間的変動に関係なく常に正しく読み取ること
ができ、常に正しい情報を得ることができる。 〔実施例〕 以下第１図を参照しながら本発明映像信号の情報信号
読み取り回路の一実施例につき説明しよう。この第１図
に於いて第３図に対応する部分には同一符号を付し、そ
の詳細説明は省略する。 第１図例に於いては映像信号入力端子（３）に供給さ
れる第２図Ａに示す如き垂直帰線期間の垂直同期信号
（１）より第17及び第18番目の水平期間にピクチヤーナ
ンバー信号（２）が挿入されたビデオデイスクより再生
した映像信号をスライサー（４）を介してスイツチ回路
（12）に供給する。この場合、このピクチヤーナンバー
信号（２）は１水平期間に第２図Ｂに示す如く24ビツト
のバイフエイスコードのデイジタル信号でピクチヤーナ
ンバーを指示する如くなしたものである。 またこの映像信号入力端子（３）に供給される映像信
号を垂直同期分離回路（６）に供給し、この垂直同期分
離回路（６）の出力側に得られる垂直同期信号を例えば
10水平期間の遅延回路を構成するモノマルチバイブレー
タ（13）に供給し、このモノマルチバイブレータ（13）
の出力信号の立下りによりスイツチ回路（12）をオンと
する如くする。従つてこのスイツチ回路（12）は垂直同
期信号（１）より10水平期間10H後にオンとなる。この
場合、スイツチ回路（12）を映像信号に時間変動があつ
てもピクチヤーナンバー信号（２）の挿入部即ち垂直同
期信号（１）より第17番目の水平期間の検出に関係ない
時間早く、本例では垂直同期信号（１）より10水平期間
後にオンとする如くしている。また映像信号入力端子
（３）に供給される映像信号を水平同期分離回路（14）
に供給する。このスイツチ回路（12）の出力側に得られ
る所定レベルでスライスされた映像信号をデータレジス
タ（９）に供給すると共にクロツク信号発生回路（15）
に供給する。このクロツク信号発生回路（15）はパルス
の立上り及び立下りの両方によりトリガされる両エツジ
トリガのモノマルチバイブレータで構成し、このモノマ
ルチバイブレータの時定数をピクチヤーナンバー信号
（２）の１ビツト期間TBの3/4の時間3/4TBとする。この
場合、このモノマルチバイブレータの時定数を3/4TBと
したときには映像信号の時間的変動が±25％までは良好
に動作させることができる。またこのときスイツチ回路
（12）の出力側に得られるピクチヤーナンバー信号
（２）は第２図Ｂに示す如く第１番目のビツトが中央部
が立上がる“1"となつているので、このクロツク発生回
路（15）の出力側には第２図Ｃに示す如くピクチヤーナ
ンバー信号の立上り及び立下りでトリガされたパルス幅
3/4TBのクロツクパルスが得られる。このクロツク発生
回路（15）の出力側に得られるクロツクパルスをクロツ
ク信号としてデータレジスタ（９）に供給すると共に、
このクロツクパルスを計数信号としてカウンタ（11）に
供給する。このカウンタ（11）は水平同期分離回路（1
4）よりの水平同期信号（1a）によりセツトする如くな
され、１水平期間のクロツクパルスの数を計数する如く
なされている。このカウンタ（11）の出力信号を取捨判
別回路（16）に供給する。この取捨判別回路（16）に於
いては水平同期信号（1a）が供給される毎にカウンタ
（11）のリセツト直前の計数値と設定値本例では「24」
とを比較し、これが一致したときには一致信号を出力
し、この一致信号によりデータレジスタ（９）を読み取
る様に指令すると共にこの一致信号によりスイツチ回路
（12）をオフとする如くする。その他は第３図と同様に
構成する。 本例は上述の如く構成されているので、今映像信号入
力端子（３）にビデオデイスクより再生した第２図Ａに
示す如き垂直帰線期間の垂直同期信号（１）より第17及
び第18番目の水平期間にピクチヤーナンバー信号（２）
が挿入された映像が供給されたときはこの映像信号がス
ライサー（４）を介してスイツチ回路（12）に供給され
ると共に、この映像信号の垂直同期信号（１）より第17
番目の水平期間よりかなり前の10水平期間後にこのスイ
ツチ回路（12）をオンとして、このスライサー（４）よ
りの映像信号がデータレジスタ（９）及びクロツク発生
回路（15）に供給される。この場合にスイツチ回路（1
2）の出力側に第２図Ｂに示す如き第17番目の水平期間
のピクチヤーナンバー信号（２）が得られたときはクロ
ツク発生回路（15）の出力側に第２図Ｃに示す如きクロ
ツクパルスが得られ、このクロツクパルスがデータレジ
スタ（９）及びカウンタ（11）に供給され、このカウン
タ（11）の１水平期間の計数値がピクチヤーナンバー信
号（２）のビツト数例えば「24」であつたときに取捨判
別回路（16）より一致信号を出力してこのときデータレ
ジスタ（９）を読み取ると共に、この一致信号によりス
イツチ回路（12）をオフとする。この場合第17番目の水
平期間のピクチヤーナンバー信号（２）により一致信号
が得られないときにはスイツチ回路（12）はオンのまま
なので第18番目の水平期間のピクチヤーナンバー信号
（２）を上述同様にしてこれを読み取る動作を行う。ま
たピクチヤーナンバー信号以外の部分では取捨判別回路
（16）の出力側に一致信号が得られないのでデータレジ
スタ（９）を読み取ることがない。 本例は上述の如く水平同期信号（1a）と水平同期信号
（1a）との間のピクチヤーナンバー信号（２）のビツト
数を計数して正誤を判断し、正しいときにピクチヤーナ
ンバー信号を読み取つているので、映像信号に時間的変
動があつてもピクチヤーナンバー信号（２）のビツト数
は変ることがなく、常に正しいピクチヤーナンバー信号
（２）を読み取ることができ、常に正しい情報を得るこ
とが出来る。 尚、上述実施例に於いては垂直帰線期間に挿入された
ピクチヤーナンバー信号を読み取る例につき述べたが、
垂直帰線期間に挿入された、その他の情報信号を読み取
る場合にも本発明が使用できることが勿論である。また
上述例ではデイジタル信号としてバイフエイズコードを
使用した例につき述べたが、この代りにその他のビツト
数の計数できるコードを使用するものであれば良いこと
は勿論である。また本発明は上述実施例に限らず本発明
の要旨を逸脱することなく、その他種々の構成が取り得
ることは勿論である。 〔発明の効果〕 本発明に依れば情報信号のビツト数を計数して情報信
号かどうかを判別しているので、映像信号の時間的変動
に関係なく常に正しく読み取ることができ、常に正しい
情報を得ることができる利益がある。
バーの読み取り回路に使用して好適な映像信号の情報信
号読み取り回路に関する。 〔発明の概要〕 本発明はビデオデイスクプレーヤーのピクチヤーナン
バーの読み取り回路に使用して好適な映像信号の情報信
号読み取り回路であつて、垂直帰線期間の所定水平期間
に所定ビツト数の情報信号（例えばピクチヤーナンバー
信号）が挿入された映像信号が供給されるデータレジス
タと、この映像信号の１水平期間毎のビツト数を計数す
るカウンタとを有し、このカウンタの１水平期間の計数
が上記所定ビツト数の一致したとき、このデータレジス
タを読み取る様にしたことにより、例えばビデオデイス
クプレーヤーの速度変動に係りなく常に正しい情報を得
ることができる。 〔従来の技術〕 一般にビデオデイスクに記録されている映像信号に於
いては、第２図Ａに示す如くその垂直帰線期間の垂直同
期信号（１）より第17番目の水平期間と第18番目の水平
期間に夫々第２図Ｂに示す如き24ビツトのバイフエイス
コード（ビツト期間TBの中央部立上るものが“1"、この
中央部で立下るものが“0"である。）に衣りピクチヤー
ナンバーを示すデイジタル信号のピクチヤーナンバー信
号（２）が挿入されており、このピクチヤーナンバー信
号（２）によりビデオデイスクの所望映像信号の記録位
置を容易に選定することができる。この場合このピクチ
ヤーナンバー信号（２）の第１番目のビツトは常に“1"
となる如く決められている。図に於いて（1a）は水平同
期信号である。 従来斯るビデオデイスクよりの映像信号のピクチヤー
ナンバー信号（２）を読み取るのに第３図に示す如きピ
クチヤーナンバー信号読み取り回路が使用されていた。
この第３図に於いて、（３）は垂直帰線期間の垂直同期
信号（１）より第17及び第18番目の水平期間にピクチヤ
ーナンバー信号（２）が挿入されたビデオデイスクより
再生した映像信号が供給される映像信号入力端子を示
し、この映像信号入力端子（３）に供給される映像信号
を所定レベルでスライスしてデイジタル信号であるピク
チヤーナンバー信号（２）の雑音を除去するスライサー
（４）を介してゲート回路（５）に供給すると共にこの
映像信号入力端子（３）に供給される映像信号を垂直同
期分離回路（６）に供給し、この垂直同期分離回路
（６）の出力側に得られる垂直同期信号（１）を16水平
期間16Hの遅延回路を構成するモノマルチバイブレータ
（７）に供給し、このモノマルチバイブレータ（７）の
16水平期間16H遅延した信号を１水平期間のゲート信号
を得る為のモノマルチバイブレータ（８）に供給する。
従つてこのモノマルチバイブレータ（８）の出力側には
垂直同期信号（１）より第17番目の水平期間に相当する
ゲート信号が得られる。このモノマルチバイブレータ
（８）の出力側に得られるゲート信号をゲート回路
（５）に供給して、このゲート回路（５）を垂直同期信
号（１）より第17番目の水平期間毎に導通とし、その他
の期間を不導通とする。このゲート回路（５）の出力信
号を例えば24ビツトのデータレジスタ（９）に供給し、
このデータレジスタ（９）をデコーダ（10）により読み
取る如くする。従つてこの第３図例に於いては垂直同期
信号（１）より第17番目の水平期間に挿入されたピクチ
ヤーナンバー信号（22）を読み取ることができる。 〔発明が解決しようとする問題点〕 然しながら斯る第３図例に於いては遅延時間が一定16
Hの遅延回路（７）を使用しており、ビデオデイスクプ
レーヤーに於いてモータの立ち上がり時等駆動モータが
サーボロツクしていないときには映像信号の時間的長さ
が一定とならず変動するのでピクチヤーナンバー信号
（２）の挿入されている時間的位置が変動し、このとき
はゲート回路（５）よりデータレジスタ（９）に供給さ
れる信号はピクチヤーナンバー信号（２）ではなくな
り、正しくピクチヤーナンバー信号（２）を読むことが
できず、正しい情報を得ることができない不都合があつ
た。 本発明は斯る点に鑑み映像信号の時間的変動に係りな
く、常に正しい情報を得ることができる様にすることを
目的とする。 〔問題点を解決するための手段〕 本発明映像信号の情報信号読み取り回路は第１図に示
す如く垂直帰線期間の所定水平期間に所定ビット数の情
報信号が挿入された映像信号が供給されるデータレジス
タ（９）と、この情報信号が供給され、この情報信号の
ビット数と等しい数のクロックパルスを発生するクロッ
ク発生回路（15）と、このクロック発生回路（15）から
出力されるクロックパルスの数を直接計数するカウンタ
（11）と、このカウンタ（11）の１水平期間の計数値を
判別する判別回路（16）とを有し、このカウンタ（11）
の１水平期間の計数値が上述の所定ビット数と一致した
とき、このデータレジスタ（９）を読み取る様にしたも
のである。 〔作用〕 本発明に依れば情報信号のビツト数をカウンタ（11）
で計数して、情報信号がどうかを判別しているので、映
像信号の時間的変動に関係なく常に正しく読み取ること
ができ、常に正しい情報を得ることができる。 〔実施例〕 以下第１図を参照しながら本発明映像信号の情報信号
読み取り回路の一実施例につき説明しよう。この第１図
に於いて第３図に対応する部分には同一符号を付し、そ
の詳細説明は省略する。 第１図例に於いては映像信号入力端子（３）に供給さ
れる第２図Ａに示す如き垂直帰線期間の垂直同期信号
（１）より第17及び第18番目の水平期間にピクチヤーナ
ンバー信号（２）が挿入されたビデオデイスクより再生
した映像信号をスライサー（４）を介してスイツチ回路
（12）に供給する。この場合、このピクチヤーナンバー
信号（２）は１水平期間に第２図Ｂに示す如く24ビツト
のバイフエイスコードのデイジタル信号でピクチヤーナ
ンバーを指示する如くなしたものである。 またこの映像信号入力端子（３）に供給される映像信
号を垂直同期分離回路（６）に供給し、この垂直同期分
離回路（６）の出力側に得られる垂直同期信号を例えば
10水平期間の遅延回路を構成するモノマルチバイブレー
タ（13）に供給し、このモノマルチバイブレータ（13）
の出力信号の立下りによりスイツチ回路（12）をオンと
する如くする。従つてこのスイツチ回路（12）は垂直同
期信号（１）より10水平期間10H後にオンとなる。この
場合、スイツチ回路（12）を映像信号に時間変動があつ
てもピクチヤーナンバー信号（２）の挿入部即ち垂直同
期信号（１）より第17番目の水平期間の検出に関係ない
時間早く、本例では垂直同期信号（１）より10水平期間
後にオンとする如くしている。また映像信号入力端子
（３）に供給される映像信号を水平同期分離回路（14）
に供給する。このスイツチ回路（12）の出力側に得られ
る所定レベルでスライスされた映像信号をデータレジス
タ（９）に供給すると共にクロツク信号発生回路（15）
に供給する。このクロツク信号発生回路（15）はパルス
の立上り及び立下りの両方によりトリガされる両エツジ
トリガのモノマルチバイブレータで構成し、このモノマ
ルチバイブレータの時定数をピクチヤーナンバー信号
（２）の１ビツト期間TBの3/4の時間3/4TBとする。この
場合、このモノマルチバイブレータの時定数を3/4TBと
したときには映像信号の時間的変動が±25％までは良好
に動作させることができる。またこのときスイツチ回路
（12）の出力側に得られるピクチヤーナンバー信号
（２）は第２図Ｂに示す如く第１番目のビツトが中央部
が立上がる“1"となつているので、このクロツク発生回
路（15）の出力側には第２図Ｃに示す如くピクチヤーナ
ンバー信号の立上り及び立下りでトリガされたパルス幅
3/4TBのクロツクパルスが得られる。このクロツク発生
回路（15）の出力側に得られるクロツクパルスをクロツ
ク信号としてデータレジスタ（９）に供給すると共に、
このクロツクパルスを計数信号としてカウンタ（11）に
供給する。このカウンタ（11）は水平同期分離回路（1
4）よりの水平同期信号（1a）によりセツトする如くな
され、１水平期間のクロツクパルスの数を計数する如く
なされている。このカウンタ（11）の出力信号を取捨判
別回路（16）に供給する。この取捨判別回路（16）に於
いては水平同期信号（1a）が供給される毎にカウンタ
（11）のリセツト直前の計数値と設定値本例では「24」
とを比較し、これが一致したときには一致信号を出力
し、この一致信号によりデータレジスタ（９）を読み取
る様に指令すると共にこの一致信号によりスイツチ回路
（12）をオフとする如くする。その他は第３図と同様に
構成する。 本例は上述の如く構成されているので、今映像信号入
力端子（３）にビデオデイスクより再生した第２図Ａに
示す如き垂直帰線期間の垂直同期信号（１）より第17及
び第18番目の水平期間にピクチヤーナンバー信号（２）
が挿入された映像が供給されたときはこの映像信号がス
ライサー（４）を介してスイツチ回路（12）に供給され
ると共に、この映像信号の垂直同期信号（１）より第17
番目の水平期間よりかなり前の10水平期間後にこのスイ
ツチ回路（12）をオンとして、このスライサー（４）よ
りの映像信号がデータレジスタ（９）及びクロツク発生
回路（15）に供給される。この場合にスイツチ回路（1
2）の出力側に第２図Ｂに示す如き第17番目の水平期間
のピクチヤーナンバー信号（２）が得られたときはクロ
ツク発生回路（15）の出力側に第２図Ｃに示す如きクロ
ツクパルスが得られ、このクロツクパルスがデータレジ
スタ（９）及びカウンタ（11）に供給され、このカウン
タ（11）の１水平期間の計数値がピクチヤーナンバー信
号（２）のビツト数例えば「24」であつたときに取捨判
別回路（16）より一致信号を出力してこのときデータレ
ジスタ（９）を読み取ると共に、この一致信号によりス
イツチ回路（12）をオフとする。この場合第17番目の水
平期間のピクチヤーナンバー信号（２）により一致信号
が得られないときにはスイツチ回路（12）はオンのまま
なので第18番目の水平期間のピクチヤーナンバー信号
（２）を上述同様にしてこれを読み取る動作を行う。ま
たピクチヤーナンバー信号以外の部分では取捨判別回路
（16）の出力側に一致信号が得られないのでデータレジ
スタ（９）を読み取ることがない。 本例は上述の如く水平同期信号（1a）と水平同期信号
（1a）との間のピクチヤーナンバー信号（２）のビツト
数を計数して正誤を判断し、正しいときにピクチヤーナ
ンバー信号を読み取つているので、映像信号に時間的変
動があつてもピクチヤーナンバー信号（２）のビツト数
は変ることがなく、常に正しいピクチヤーナンバー信号
（２）を読み取ることができ、常に正しい情報を得るこ
とが出来る。 尚、上述実施例に於いては垂直帰線期間に挿入された
ピクチヤーナンバー信号を読み取る例につき述べたが、
垂直帰線期間に挿入された、その他の情報信号を読み取
る場合にも本発明が使用できることが勿論である。また
上述例ではデイジタル信号としてバイフエイズコードを
使用した例につき述べたが、この代りにその他のビツト
数の計数できるコードを使用するものであれば良いこと
は勿論である。また本発明は上述実施例に限らず本発明
の要旨を逸脱することなく、その他種々の構成が取り得
ることは勿論である。 〔発明の効果〕 本発明に依れば情報信号のビツト数を計数して情報信
号かどうかを判別しているので、映像信号の時間的変動
に関係なく常に正しく読み取ることができ、常に正しい
情報を得ることができる利益がある。
【図面の簡単な説明】
第１図は本発明映像信号の情報信号読み取り回路の一実
施例を示す構成図、第２図は本発明の説明に供する線
図、第３図は従来の映像信号の情報信号読み取り回路の
例を示す構成図である。 （２）はピクチヤーナンバー信号、（３）は映像信号入
力端子、（６）は垂直同期分離回路、（９）はデータレ
ジスタ、（10）はデコーダ、（11）はカウンタ、（12）
はスイツチ回路、（14）は水平同期分離回路、（15）は
クロツク発生回路、（16）は取捨判別回路である。
施例を示す構成図、第２図は本発明の説明に供する線
図、第３図は従来の映像信号の情報信号読み取り回路の
例を示す構成図である。 （２）はピクチヤーナンバー信号、（３）は映像信号入
力端子、（６）は垂直同期分離回路、（９）はデータレ
ジスタ、（10）はデコーダ、（11）はカウンタ、（12）
はスイツチ回路、（14）は水平同期分離回路、（15）は
クロツク発生回路、（16）は取捨判別回路である。
Claims (1)
- (57)【特許請求の範囲】 １．垂直帰線期間の所定水平期間に所定ビット数の情報
信号が挿入された映像信号が供給されるデータレジスタ
と、 上記情報信号が供給され、上記情報信号のビット数と等
しい数のクロックパルスを発生するクロック発生回路
と、 該クロック発生回路から出力されるクロックパルスの数
を直接計数するカウンタと、 該カウンタの１水平期間の計数値を判別する判別回路と
を有し、 上記カウンタの１水平期間の計数値が上記所定ビット数
と一致したとき、上記データレジスタを読み取る様にし
たことを特徴とする映像信号の情報信号読み取り回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61172564A JP2823015B2 (ja) | 1986-07-22 | 1986-07-22 | 映像信号の情報信号読み取り回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61172564A JP2823015B2 (ja) | 1986-07-22 | 1986-07-22 | 映像信号の情報信号読み取り回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6328178A JPS6328178A (ja) | 1988-02-05 |
| JP2823015B2 true JP2823015B2 (ja) | 1998-11-11 |
Family
ID=15944181
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61172564A Expired - Lifetime JP2823015B2 (ja) | 1986-07-22 | 1986-07-22 | 映像信号の情報信号読み取り回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2823015B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2661775B1 (fr) * | 1990-05-04 | 1994-03-04 | Telemecanique | Contacteur-disjoncteur. |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55120273A (en) * | 1979-03-09 | 1980-09-16 | Matsushita Electric Ind Co Ltd | Recording and reproducing device |
-
1986
- 1986-07-22 JP JP61172564A patent/JP2823015B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6328178A (ja) | 1988-02-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |