JP2817856B2 - 画像処理装置 - Google Patents
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- JP2817856B2 JP2817856B2 JP2325897A JP32589790A JP2817856B2 JP 2817856 B2 JP2817856 B2 JP 2817856B2 JP 2325897 A JP2325897 A JP 2325897A JP 32589790 A JP32589790 A JP 32589790A JP 2817856 B2 JP2817856 B2 JP 2817856B2
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- image data
- memory
- cpu
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T11/00—2D [Two Dimensional] image generation
- G06T11/60—Editing figures and text; Combining figures or text
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K2215/00—Arrangements for producing a permanent visual presentation of the output data
- G06K2215/0002—Handling the output data
- G06K2215/0005—Accepting output data; Preparing data for the controlling system
- G06K2215/0011—Accepting output data; Preparing data for the controlling system characterised by a particular command or data flow, e.g. Page Description Language, configuration commands
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K2215/00—Arrangements for producing a permanent visual presentation of the output data
- G06K2215/0002—Handling the output data
- G06K2215/0062—Handling the output data combining generic and host data, e.g. filling a raster
- G06K2215/0065—Page or partial page composition
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/36—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
- G09G5/39—Control of the bit-mapped memory
Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は画像処理装置に関し、例えばポストスクリプ
ト等のページ記述言語（以下「PDL」という）で記述さ
れた情報を、画像データに変換するためのインタープリ
ター（変換）の機能を有する画像処理装置に関するもの
である。
ト等のページ記述言語（以下「PDL」という）で記述さ
れた情報を、画像データに変換するためのインタープリ
ター（変換）の機能を有する画像処理装置に関するもの
である。
［従来の技術］ 従来、ポストスクリプト等のページ記述言語で書かれ
た画像情報と多値自然画像との合成方法として、あらか
じめホストコンピユータによつて自然画像を一時記憶装
置に記録しておき、次にページ記述言語で書かれた画像
情報をページメモリの所望の位置に展開する際、一時記
憶装置に記録しておいた自然画像を読み出しながらバツ
フアメモリ上に合成する方法が考えられている。
た画像情報と多値自然画像との合成方法として、あらか
じめホストコンピユータによつて自然画像を一時記憶装
置に記録しておき、次にページ記述言語で書かれた画像
情報をページメモリの所望の位置に展開する際、一時記
憶装置に記録しておいた自然画像を読み出しながらバツ
フアメモリ上に合成する方法が考えられている。
または、あらかじめホストコンピユータによつて自然
画像をページメモリの所望の位置に記録しておき、次に
ページ記述言語で書かれた画像情報をページメモリ上に
展開する際、上書きするようにする方法も考えられる。
画像をページメモリの所望の位置に記録しておき、次に
ページ記述言語で書かれた画像情報をページメモリ上に
展開する際、上書きするようにする方法も考えられる。
かかる技術によると、ホストコンピユータが直接多値
自然画像を扱わねばならず、CPUの負荷が重くなってい
た。
自然画像を扱わねばならず、CPUの負荷が重くなってい
た。
一方、上記技術の欠点を回避する例として、カラーPD
Lデータを受信してカラー画像を出力するカラープリン
タがある。これは２値画像と多値画像とを合成し画像の
形成を行う画像形成装置として提案されている（特願平
2-159950）。この提案には、複数の出力色成分を有する
第一の画像から各出力色成分の有無を判定し、その結果
に応じて第一または第二の画像を優先させて各出力色成
分を合成し、そして、合成された各出力色成分に基づい
て画像形成を行う装置が開示されている。
Lデータを受信してカラー画像を出力するカラープリン
タがある。これは２値画像と多値画像とを合成し画像の
形成を行う画像形成装置として提案されている（特願平
2-159950）。この提案には、複数の出力色成分を有する
第一の画像から各出力色成分の有無を判定し、その結果
に応じて第一または第二の画像を優先させて各出力色成
分を合成し、そして、合成された各出力色成分に基づい
て画像形成を行う装置が開示されている。
［発明が解決しようとしている課題］ しかしながら、上述従来例では、ホストコンピユータ
が多値自然画像データを直接扱うため、あるいは画像の
有り無しを記憶するためのビツトマツプメモリにも、CP
Uが直接書き込む必要があり次のような欠点があつた。
が多値自然画像データを直接扱うため、あるいは画像の
有り無しを記憶するためのビツトマツプメモリにも、CP
Uが直接書き込む必要があり次のような欠点があつた。
（１）ホストコンピユータが多値自然画像を直接扱わな
ければならず、CPUの負荷が重くなる。
ければならず、CPUの負荷が重くなる。
（２）画像有り無しを記憶するためのビツトマツプメモ
リを使わず、各出力色成分を同時に読みだして各画素毎
に各出力色成分のORをとつて各出力色成分の出力に同期
してORをとつたデータを出力する場合、ハードウエアの
規模が大きくなるか、あるいはCPUの負荷が大きくな
る。
リを使わず、各出力色成分を同時に読みだして各画素毎
に各出力色成分のORをとつて各出力色成分の出力に同期
してORをとつたデータを出力する場合、ハードウエアの
規模が大きくなるか、あるいはCPUの負荷が大きくな
る。
（３）画像有り無しを記憶するためのビツトマツプメモ
リをCPUが直接扱う必要があるため、CPUの負荷が多くな
る。
リをCPUが直接扱う必要があるため、CPUの負荷が多くな
る。
本発明は、上述した従来例の欠点に鑑みてなされたも
のであり、その目的とするところは、PDLで記述された
画像情報と、他の画像情報との合成を効率良く行うこと
ができる画像処理装置を提供することにある。
のであり、その目的とするところは、PDLで記述された
画像情報と、他の画像情報との合成を効率良く行うこと
ができる画像処理装置を提供することにある。
［課題を解決するための手段］ 上記課題を解決するために本発明の画像処理装置によ
れば、ページ記述言語により記述されたコマンドデータ
を入力し、該コマンドデータから第１画像データに展開
する展開手段と、該展開手段により展開された第１画像
データを記憶する記憶手段と、該記憶手段に記憶された
第１画像データの有効、無効を示す情報を生成する生成
手段と、前記第１画像データとは異なる第２画像データ
を入力する入力手段と、前記生成手段により生成された
情報に応じて、前記第１の画像データと第２の画像デー
タを合成する合成手段と、を有することを特徴とする。
れば、ページ記述言語により記述されたコマンドデータ
を入力し、該コマンドデータから第１画像データに展開
する展開手段と、該展開手段により展開された第１画像
データを記憶する記憶手段と、該記憶手段に記憶された
第１画像データの有効、無効を示す情報を生成する生成
手段と、前記第１画像データとは異なる第２画像データ
を入力する入力手段と、前記生成手段により生成された
情報に応じて、前記第１の画像データと第２の画像デー
タを合成する合成手段と、を有することを特徴とする。
［作用］ かかる構成によれば、展開手段はページ記述言語によ
り記述されたコマンドデータから第１画像データを展開
し、記憶手段は前記展開手段により展開された第１画像
データを記憶し、生成手段は前記記憶手段に記憶された
第１画像データの有効、無効を示す情報を生成し、入力
手段は前記第１画像データとは異なる第２画像データを
入力し、合成手段は前記生成手段により生成された情報
に応じて、前記第１の画像データと第２の画像データを
合成する。
り記述されたコマンドデータから第１画像データを展開
し、記憶手段は前記展開手段により展開された第１画像
データを記憶し、生成手段は前記記憶手段に記憶された
第１画像データの有効、無効を示す情報を生成し、入力
手段は前記第１画像データとは異なる第２画像データを
入力し、合成手段は前記生成手段により生成された情報
に応じて、前記第１の画像データと第２の画像データを
合成する。
［実施例］ 以下に添付図面を参照して、本発明の好適な実施例を
詳細に説明する。
詳細に説明する。
〈第１実施例〉 第１図は本発明に係る画像処理装置の第１実施例の構
成を示すブロツク図である。同図において、11はPDLで
書かれた画像情報を出力するホストコンピユータ、12は
PDLで書かれた画像情報を通信するための信号線、13は
上記信号12の通信用インターフエース、14は上記通信用
インターフエース13で受け取つたPDLで書かれた画像情
報を解釈してラスターイメージに展開したり通信制御を
行うCPU、15はCPU14のCPUバス、16はPDLで書かれた画像
情報を解釈してラスターイメージに展開したりシーケン
ス制御や通信制御を行つたりするためのプログラムやフ
オントデータ等を格納するためのROM、17はCPU14のプロ
グラムを一時的に格納したり一時的なワーク領域として
使うRAMをそれぞれ示している。
成を示すブロツク図である。同図において、11はPDLで
書かれた画像情報を出力するホストコンピユータ、12は
PDLで書かれた画像情報を通信するための信号線、13は
上記信号12の通信用インターフエース、14は上記通信用
インターフエース13で受け取つたPDLで書かれた画像情
報を解釈してラスターイメージに展開したり通信制御を
行うCPU、15はCPU14のCPUバス、16はPDLで書かれた画像
情報を解釈してラスターイメージに展開したりシーケン
ス制御や通信制御を行つたりするためのプログラムやフ
オントデータ等を格納するためのROM、17はCPU14のプロ
グラムを一時的に格納したり一時的なワーク領域として
使うRAMをそれぞれ示している。
18は第１の色のページデータを展開するための第１の
メモリ、19は第２の色のページデータを展開するための
第２のメモリ、20は第３の色のページデータを展開する
ための第３のメモリ、21は第４の色のページデータを展
開するための第４のメモリ、22は画像合成時の合成情報
を格納するための白抜きビツトマツプメモリ、23は画像
合成時の合成情報であるところの白抜きデータ、24は白
抜きデータ23にもとづいてCPU14によつて送られてくる
画像データと外部の多値ビデオメモリ34から送られてく
る多値画像データ33を合成するとともに、プリンタ28か
らの同期信号に基づいてプリンタとの同期をとつて処理
データを出力するためのビデオ処理回路、32はビデオ処
理回路24によつて合成された画像データ、33は多値画像
ビデオメモリ34から出力される多値画像データ、34は多
値画像ビデオメモリ、35はビデオ信号をそれぞれ示して
いる。
メモリ、19は第２の色のページデータを展開するための
第２のメモリ、20は第３の色のページデータを展開する
ための第３のメモリ、21は第４の色のページデータを展
開するための第４のメモリ、22は画像合成時の合成情報
を格納するための白抜きビツトマツプメモリ、23は画像
合成時の合成情報であるところの白抜きデータ、24は白
抜きデータ23にもとづいてCPU14によつて送られてくる
画像データと外部の多値ビデオメモリ34から送られてく
る多値画像データ33を合成するとともに、プリンタ28か
らの同期信号に基づいてプリンタとの同期をとつて処理
データを出力するためのビデオ処理回路、32はビデオ処
理回路24によつて合成された画像データ、33は多値画像
ビデオメモリ34から出力される多値画像データ、34は多
値画像ビデオメモリ、35はビデオ信号をそれぞれ示して
いる。
ここで、CPU14について説明する。
第５図は第１実施例によるCPU14の動作を説明するフ
ローチヤートである。
ローチヤートである。
CPU14は通信用インターフエース13を介してホストコ
ンピユータ11から例えばポストスクリプト等のPDL言語
で記述された画像データを受信し（ステツプS1,ステツ
プS2）、RAM17をワーク領域として使用して、ROM16に格
納されているPDLのインタープリタープログラムを駆動
して、通信用インターフエース13を介して送られてくる
画像データを次々に解読する（ステツプS4）。この解読
処理に従つて、ラスターイメージ化された画像データ
は、RAM17を利用しながら18から21の第1,第2,第3,第４
のメモリ上に展開される（ステツプS5）。以上の処理
は、１ページ分の受信が終了するまで繰り返し行われる
（ステツプS6）。尚、次ページが続く場合には、再度ス
テツプS1より処理が行われる。またステツプS2でPDL以
外の画像データの受信が確認された場合、従来の方法に
従つて、各メモリへの記憶が行われる。
ンピユータ11から例えばポストスクリプト等のPDL言語
で記述された画像データを受信し（ステツプS1,ステツ
プS2）、RAM17をワーク領域として使用して、ROM16に格
納されているPDLのインタープリタープログラムを駆動
して、通信用インターフエース13を介して送られてくる
画像データを次々に解読する（ステツプS4）。この解読
処理に従つて、ラスターイメージ化された画像データ
は、RAM17を利用しながら18から21の第1,第2,第3,第４
のメモリ上に展開される（ステツプS5）。以上の処理
は、１ページ分の受信が終了するまで繰り返し行われる
（ステツプS6）。尚、次ページが続く場合には、再度ス
テツプS1より処理が行われる。またステツプS2でPDL以
外の画像データの受信が確認された場合、従来の方法に
従つて、各メモリへの記憶が行われる。
第１のメモリ18〜第４のメモリ21に画像データが記憶
されると同時に、白抜きビツトマツプメモリ22上には、
展開された画像データの各色成分の内、“1"である画
素、すなわち、ドツトが打たれる画素に対して、“1"の
データが書き込まれる。白抜きビットマップメモリ22上
に書き込まれたデータのうち“1"のデータは多値画像ビ
デオメモリ34から出力されるイメージ状態の多値画像デ
ータ33の有効性を禁止する。別の言い方をすると、白抜
きビツトマツプメモリ22上に書き込まれたデータのうち
“1"のデータは、第１から第４のメモリ18〜21上に展開
された画像データを多値画像ビデオメモリ34から出力さ
れる多値画像データ33に対して優先させて上書きするこ
とを意味する。
されると同時に、白抜きビツトマツプメモリ22上には、
展開された画像データの各色成分の内、“1"である画
素、すなわち、ドツトが打たれる画素に対して、“1"の
データが書き込まれる。白抜きビットマップメモリ22上
に書き込まれたデータのうち“1"のデータは多値画像ビ
デオメモリ34から出力されるイメージ状態の多値画像デ
ータ33の有効性を禁止する。別の言い方をすると、白抜
きビツトマツプメモリ22上に書き込まれたデータのうち
“1"のデータは、第１から第４のメモリ18〜21上に展開
された画像データを多値画像ビデオメモリ34から出力さ
れる多値画像データ33に対して優先させて上書きするこ
とを意味する。
逆に、“0"のデータは、多値画像データ33を第１から
第４のメモリ上に展開された画像データに対して優先さ
せて上書きすることを意味する。
第４のメモリ上に展開された画像データに対して優先さ
せて上書きすることを意味する。
このようにして、CPU14がPDLで書かれた画像データを
第１から第４のメモリ18〜21に展開する際に、白抜きビ
ツトマツプメモリ22上では自動的にかつ同時に白抜きデ
ータが作成され、CPU14がPDLで書かれた画像データを第
１から第４のメモリに展開し終わると、白抜きビツトマ
ツプメモリ22上には、第１から第４のメモリ上に展開さ
れた画像データを多値画像ビデオメモリ34から出力され
る多値画像データ33に対して優先させて上書きすること
を意味する白抜きデータの作成が完了する。
第１から第４のメモリ18〜21に展開する際に、白抜きビ
ツトマツプメモリ22上では自動的にかつ同時に白抜きデ
ータが作成され、CPU14がPDLで書かれた画像データを第
１から第４のメモリに展開し終わると、白抜きビツトマ
ツプメモリ22上には、第１から第４のメモリ上に展開さ
れた画像データを多値画像ビデオメモリ34から出力され
る多値画像データ33に対して優先させて上書きすること
を意味する白抜きデータの作成が完了する。
つぎに、第５図のフローチヤートには図示せぬが、CP
U14は、プリンタ28に起動をかけるとともに、プリンタ2
8の動作に同期して、第１から第４のメモリ18〜21上に
展開された、たとえばY,M,C,Kのよう各色成分の画像デ
ータを面順時に、CPUバス15を介してビデオ処理回路24
に順々に転送してゆく。このとき各色成分のデータが第
１のメモリ18,第二のメモリ19,第三のメモリ20,第４の
メモリ21から順に読み出されると同時に、毎色成分の読
み出し時に繰り返し、白抜きビツトマツプメモリ22から
白抜きデータ23が出力されてビデオ処理回路24に印加さ
れる。
U14は、プリンタ28に起動をかけるとともに、プリンタ2
8の動作に同期して、第１から第４のメモリ18〜21上に
展開された、たとえばY,M,C,Kのよう各色成分の画像デ
ータを面順時に、CPUバス15を介してビデオ処理回路24
に順々に転送してゆく。このとき各色成分のデータが第
１のメモリ18,第二のメモリ19,第三のメモリ20,第４の
メモリ21から順に読み出されると同時に、毎色成分の読
み出し時に繰り返し、白抜きビツトマツプメモリ22から
白抜きデータ23が出力されてビデオ処理回路24に印加さ
れる。
ビデオ処理回路24では多値画像ビデオメモリ34からプ
リンタ28に同期して出力される多値画像データ33と、上
記CPUバス15を介して印加される画像データとを白抜き
ビツトマツプメモリ22から出力される白抜きデータ23に
基づいて合成する。ビデオ処理回路24で合成された画像
データ32はプリンタ28に印加されてプリントアウトされ
る。
リンタ28に同期して出力される多値画像データ33と、上
記CPUバス15を介して印加される画像データとを白抜き
ビツトマツプメモリ22から出力される白抜きデータ23に
基づいて合成する。ビデオ処理回路24で合成された画像
データ32はプリンタ28に印加されてプリントアウトされ
る。
第２図は本発明の第１実施例の白抜きビツトマツプメ
モリ22の詳細を示す図である。同図において、36は白抜
きデータを格納する為のRAM、37はアドレス制御回路、3
8はオフセツトアドレス発生回路、39は加算回路、40は
アドレスバス上位、41はアドレスバス下位、42はR/W制
御信号、43はライト信号、44はリード信号、45はチツプ
セレクト信号、46はオフセツト選択信号、47はオフセツ
トアドレス、48は白抜きRAMアドレス信号、49は出力バ
ツフア制御信号、50はラツチ制御信号をそれぞれ示して
いる。51はラツチ、52はオア回路、53は出力バツフア、
54はCPUデータバス、55はRAMデータバス、56は白抜きデ
ータ出力バツフアをそれぞれ示している。
モリ22の詳細を示す図である。同図において、36は白抜
きデータを格納する為のRAM、37はアドレス制御回路、3
8はオフセツトアドレス発生回路、39は加算回路、40は
アドレスバス上位、41はアドレスバス下位、42はR/W制
御信号、43はライト信号、44はリード信号、45はチツプ
セレクト信号、46はオフセツト選択信号、47はオフセツ
トアドレス、48は白抜きRAMアドレス信号、49は出力バ
ツフア制御信号、50はラツチ制御信号をそれぞれ示して
いる。51はラツチ、52はオア回路、53は出力バツフア、
54はCPUデータバス、55はRAMデータバス、56は白抜きデ
ータ出力バツフアをそれぞれ示している。
上記構成の白抜きビツトマツプメモリ22は、内部に白
抜きデータを格納するためのRAM36を有し、このRAM36の
書き込み／読み出しはアドレス制御回路37やデータ変換
回路57等を介して行われる。CPU14のCPUバス15に含まれ
るアドレスバス（上位）40、アドレスバス（下位）41、
データバス54は、それぞれアドレス制御回路37,加算回
路39,データ変換回路57を介してRAM36の書き込み・読み
だし制御線（ライト信号43,リード信号44,チツプセレク
ト信号45）、RAMアドレス信号48,白抜きRAMデータバス5
5に接続される。
抜きデータを格納するためのRAM36を有し、このRAM36の
書き込み／読み出しはアドレス制御回路37やデータ変換
回路57等を介して行われる。CPU14のCPUバス15に含まれ
るアドレスバス（上位）40、アドレスバス（下位）41、
データバス54は、それぞれアドレス制御回路37,加算回
路39,データ変換回路57を介してRAM36の書き込み・読み
だし制御線（ライト信号43,リード信号44,チツプセレク
ト信号45）、RAMアドレス信号48,白抜きRAMデータバス5
5に接続される。
第３図は第１実施例によるRAMのアドレスマツプを示
す図である。
す図である。
白抜きRAM36は、第３図のように、物理アドレス“BAS
EW"から一定のアドレス幅“WBAND"で割り当てられてい
て、通常のRAMのようにCPUから直接アクセスできるよう
になつている。そして、上記アドレスへデータを書き込
むときはラツチ制御信号50によつてラツチ51の視つデー
タを“0"にしCPUデータバス54のデータがそのまま白抜
きRAMデータバス55に印加されるように制御される。逆
に上記アドレスからデータが読まれるときは出力バツフ
ア53を介して白抜きRAM36のデータがCPUデータバスに読
みだされる。
EW"から一定のアドレス幅“WBAND"で割り当てられてい
て、通常のRAMのようにCPUから直接アクセスできるよう
になつている。そして、上記アドレスへデータを書き込
むときはラツチ制御信号50によつてラツチ51の視つデー
タを“0"にしCPUデータバス54のデータがそのまま白抜
きRAMデータバス55に印加されるように制御される。逆
に上記アドレスからデータが読まれるときは出力バツフ
ア53を介して白抜きRAM36のデータがCPUデータバスに読
みだされる。
また、白抜きRAM36は、あらかじめ設定されている四
つのオフセツトアドレス“BASE1",“BASE2",“BASE3",
“BASE4"から一定のアドレス幅“ABAMD"を持つた四つの
メモリ空間へのデータ書き込みに際しては、白抜きRAM3
6のデータをラツチ51を介してOR回路52に印加し、CPUデ
ータバス54のデータとの各ビツト毎の論理演算をOR回路
52によつて行い、白抜きRAM36に再書き込みするように
なつている。OR回路52には出力バツフアが付いていてア
ドレス制御回路37から出力される出力バツフア制御信号
49によつて制御される。
つのオフセツトアドレス“BASE1",“BASE2",“BASE3",
“BASE4"から一定のアドレス幅“ABAMD"を持つた四つの
メモリ空間へのデータ書き込みに際しては、白抜きRAM3
6のデータをラツチ51を介してOR回路52に印加し、CPUデ
ータバス54のデータとの各ビツト毎の論理演算をOR回路
52によつて行い、白抜きRAM36に再書き込みするように
なつている。OR回路52には出力バツフアが付いていてア
ドレス制御回路37から出力される出力バツフア制御信号
49によつて制御される。
一方、あらかじめ設定されている４つのオフセツトア
ドレス“BASE1",“BASE2",“BASE3",“BASE4"から一定
のアドレス幅“ABAND"を持つた４つのメモリ空間からの
データ読みだしに際しては、白抜きRAM36に格納されて
いるデータが白抜きRAMデータバス55を介して白抜きデ
ータ出力バツフア56に印加され出力バツフア制御信号49
によつて制御されて白抜きデータ出力はバツフア56から
白抜きデータ23として出力される。
ドレス“BASE1",“BASE2",“BASE3",“BASE4"から一定
のアドレス幅“ABAND"を持つた４つのメモリ空間からの
データ読みだしに際しては、白抜きRAM36に格納されて
いるデータが白抜きRAMデータバス55を介して白抜きデ
ータ出力バツフア56に印加され出力バツフア制御信号49
によつて制御されて白抜きデータ出力はバツフア56から
白抜きデータ23として出力される。
アドレス制御回路38はCPUアドレスバス（上位）40,CP
Uアドレスバス（下位）41,CPUバスのR/W信号42、及びあ
らかじめ設定されている上記メモリマツプ情報によりオ
フセツトアドレス発生回路38に対してオフセツト選択信
号46を出力するとともに、白抜きRAM36に対して書き込
み・読みだし制御信号（ライト信号43,リード信号44,チ
ツプセレクト信号45）を出力する。
Uアドレスバス（下位）41,CPUバスのR/W信号42、及びあ
らかじめ設定されている上記メモリマツプ情報によりオ
フセツトアドレス発生回路38に対してオフセツト選択信
号46を出力するとともに、白抜きRAM36に対して書き込
み・読みだし制御信号（ライト信号43,リード信号44,チ
ツプセレクト信号45）を出力する。
オフセツトアドレス発生回路38は、オフセツト選択信
号46に基づきオフセツトアドレス47を出力し、加算回路
39でアドレスバス（下位）41のアドレスを変換してRAM
アドレス信号48として、白抜きRAM36に印加される。
号46に基づきオフセツトアドレス47を出力し、加算回路
39でアドレスバス（下位）41のアドレスを変換してRAM
アドレス信号48として、白抜きRAM36に印加される。
第４図は本発明の第１実施例によるビデオ処理回路24
の詳細を示すブロツク図である。同図において、60はCP
Uデータバス54のデータと白抜きデータ23を同時に入力
され、不図示のプリンタとの同期信号に同期して出力さ
れるFIFOメモリ、61はCPUデータバス54から送られてき
た画像信号と、白抜きデータ23とのFIFO60の出力を各々
１ワードパラレルデータから１ビツトシリアルデータに
変換するパラシリ変換器、62はパラシリ変換器61から出
力される１ビツト白抜きデータに基づいて“1"の時はCP
Uデータバス54から送られてきた画像信号を、“0"の時
は多値画像ビデオメモリ34から送られてくる多値画像デ
ータ33を選択するセレクタをそれぞれ示している。
の詳細を示すブロツク図である。同図において、60はCP
Uデータバス54のデータと白抜きデータ23を同時に入力
され、不図示のプリンタとの同期信号に同期して出力さ
れるFIFOメモリ、61はCPUデータバス54から送られてき
た画像信号と、白抜きデータ23とのFIFO60の出力を各々
１ワードパラレルデータから１ビツトシリアルデータに
変換するパラシリ変換器、62はパラシリ変換器61から出
力される１ビツト白抜きデータに基づいて“1"の時はCP
Uデータバス54から送られてきた画像信号を、“0"の時
は多値画像ビデオメモリ34から送られてくる多値画像デ
ータ33を選択するセレクタをそれぞれ示している。
以上説明したように、第１実施例によれば、画像合成
情報を格納するための白抜きビツトマツププレーンを設
けるとともに、そのビツトマツププレーン上に、文字等
の毛抜き情報を同時に展開する手段を設け、画像形成時
に毛抜き情報を使つて画像読み取り装置等で読み取られ
た画像データとページメモリ上に展開された２値画像情
報を合成する手段を設けることにより、多値自然画像と
２値画像情報とを合成するようにしたので、 （１）ホストコンピユータが、多値自然画像を直接扱わ
なくて済み負荷が軽くなる。
情報を格納するための白抜きビツトマツププレーンを設
けるとともに、そのビツトマツププレーン上に、文字等
の毛抜き情報を同時に展開する手段を設け、画像形成時
に毛抜き情報を使つて画像読み取り装置等で読み取られ
た画像データとページメモリ上に展開された２値画像情
報を合成する手段を設けることにより、多値自然画像と
２値画像情報とを合成するようにしたので、 （１）ホストコンピユータが、多値自然画像を直接扱わ
なくて済み負荷が軽くなる。
（２）大きなバツフアメモリを必要としない。
（３）画像合成情報を記憶するためのビツトマツプメモ
リをCPUが直接扱う必要がなくCPUの負荷が軽くなる。
リをCPUが直接扱う必要がなくCPUの負荷が軽くなる。
〈第２実施例〉 第６図は本発明に係る画像処理装置の第２実施例の構
成を示すブロツク図である。尚、第１実施例と同様の構
成については説明を省略する。同図において、１はイン
タープリター装置、２は電子写真方式のカラー複写機、
24′はホストコンピユータから送られてきたPDL言語で
記述された画像情報を展開した画像データをカラー複写
機に出力するためのビデオ処理回路、25はビデオ処理回
路から送られてきたビデオ情報35を受信するとともにビ
デオ処理回路24′を介してインタープリター１のCPU14
と通信するビデオインターフエースをそれぞれ示してい
る。26はプリンタ28に同期して原稿画像を読みとつて多
値自然画像データ31を出力する電子写真方式のカラー複
写機のリーダ部、27は電子写真方式のカラー複写機の画
像処理部、28は電子写真方式のカラー複写機のプリンタ
部、29は通信や画像処理部の各部の設定を行つたりする
シーケンスコントローラ、30はビデオインターフエース
25を介して入力される内部ビデオ情報、31はリーダ部で
読み取られた多値画像データ、35はビデオデータと同期
信号と通信データを含む外部ビデオ情報をそれぞれ示し
ている。
成を示すブロツク図である。尚、第１実施例と同様の構
成については説明を省略する。同図において、１はイン
タープリター装置、２は電子写真方式のカラー複写機、
24′はホストコンピユータから送られてきたPDL言語で
記述された画像情報を展開した画像データをカラー複写
機に出力するためのビデオ処理回路、25はビデオ処理回
路から送られてきたビデオ情報35を受信するとともにビ
デオ処理回路24′を介してインタープリター１のCPU14
と通信するビデオインターフエースをそれぞれ示してい
る。26はプリンタ28に同期して原稿画像を読みとつて多
値自然画像データ31を出力する電子写真方式のカラー複
写機のリーダ部、27は電子写真方式のカラー複写機の画
像処理部、28は電子写真方式のカラー複写機のプリンタ
部、29は通信や画像処理部の各部の設定を行つたりする
シーケンスコントローラ、30はビデオインターフエース
25を介して入力される内部ビデオ情報、31はリーダ部で
読み取られた多値画像データ、35はビデオデータと同期
信号と通信データを含む外部ビデオ情報をそれぞれ示し
ている。
本実施例では、例えばカラーレーザー複写機のように
画像の合成処理が複写機内部で行える装置と本発明のイ
ンタープリターを接続してリーダで読みとつた画像との
合成をする場合に適している。
画像の合成処理が複写機内部で行える装置と本発明のイ
ンタープリターを接続してリーダで読みとつた画像との
合成をする場合に適している。
第７図は第２実施例によるビデオ処理回路24′の詳細
を示すブロツク図である。同図において、63はコード発
生回路であつて、“00H”〜“FFH”までのあらかじめ決
めておいた二つのコードを２値データ64の値に応じて出
力できるように構成され、例えば２値データ64が“0"の
時、“00"が濃度データ65として出力され、２値データ6
4が“1"の時“FF"が濃度データ65として出力される。
を示すブロツク図である。同図において、63はコード発
生回路であつて、“00H”〜“FFH”までのあらかじめ決
めておいた二つのコードを２値データ64の値に応じて出
力できるように構成され、例えば２値データ64が“0"の
時、“00"が濃度データ65として出力され、２値データ6
4が“1"の時“FF"が濃度データ65として出力される。
上記コード発生回路63の出力は、“20H”と“A0H”と
いつたような値も設定可能であり、この時が処理回路27
ではインタープリター１からの出力データの濃度を変調
するか、リーダで読みとつた画像データ31との濃度比を
上記コード65に基づいて決定し合成する。
いつたような値も設定可能であり、この時が処理回路27
ではインタープリター１からの出力データの濃度を変調
するか、リーダで読みとつた画像データ31との濃度比を
上記コード65に基づいて決定し合成する。
なお、上述のプリンタとしては、カラーレーザープリ
ンタの他、カラー熱転写プリンタ、カラーインクジエツ
トプリンタ、カラードツトプリンタなどを用いることが
できる。
ンタの他、カラー熱転写プリンタ、カラーインクジエツ
トプリンタ、カラードツトプリンタなどを用いることが
できる。
以上説明したように、本発明の上記実施例によれば、
画像合成情報を格納するための白抜きビツトマツププレ
ーンを設けるとともに、そのビツトマツププレーン上
に、文字等の毛抜き情報を同時に展開する手段を設け、
画像形成時に毛抜き情報を使つて画像読み取り装置等で
読み取られた画像データとページメモリ上に展開された
２値画像情報を合成する手段を設けることにより、多値
自然画像と２値画像情報とを合成するようにしたので、 （１）ホストコンピユータが、多値自然画像を直接扱わ
なくて済み負荷が軽くなる。
画像合成情報を格納するための白抜きビツトマツププレ
ーンを設けるとともに、そのビツトマツププレーン上
に、文字等の毛抜き情報を同時に展開する手段を設け、
画像形成時に毛抜き情報を使つて画像読み取り装置等で
読み取られた画像データとページメモリ上に展開された
２値画像情報を合成する手段を設けることにより、多値
自然画像と２値画像情報とを合成するようにしたので、 （１）ホストコンピユータが、多値自然画像を直接扱わ
なくて済み負荷が軽くなる。
（２）大きなバツフアメモリを必要としない。
（３）画像合成情報を記憶するためのビツトマツプメモ
リをCPUが直接扱う必要がなくCPUの負荷が軽くなる。
リをCPUが直接扱う必要がなくCPUの負荷が軽くなる。
［発明の効果］ 以上の様に、本発明によれば、PDLで記述された画像
情報と、他の画像情報とを効率良く合成することができ
る。
情報と、他の画像情報とを効率良く合成することができ
る。
第１図は本発明に係る画像処理装置の第１実施例の構成
を示すブロツク図、 第２図は本発明の第１実施例の白抜きビツトマツプメモ
リ22の詳細を示す図、 第３図は第１実施例によるRAMのアドレスマツプを示す
図、 第４図は本発明の第１実施例によるビデオ処理回路24の
詳細を示すブロツク図、 第５図は第１実施例によるCPU14の動作を説明するフロ
ーチヤート、 第６図は本発明に係る画像処理装置の第２実施例の構成
を示すブロツク図、 第７図は第２実施例によるビデオ処理回路24′の詳細を
示すブロツク図である。 図中、11……ホストコンピユータ、12……通信用の信号
線、13……通信用インターフエース、14……CPU、15…
…CPUバス、16……ROM、17……RAM、18……第１のビデ
オメモリ、19……第２のビデオメモリ、20……第３のビ
デオメモリ、21……第４のビデオメモリ、22……白抜き
ビツトマツプメモリ、23……白抜きデータ、24……ビデ
オ処理回路、25……ビデオインターフエース、26……リ
ーダ部、27……画像処理部、28……プリンタ部、29……
シーケンスコントローラ、30……外部ビデオ情報、31…
…リーダ部で読み取られた多値画像データ、32……合成
された画像データ、33……多値画像データ、34……多値
画像ビデオメモリ、35……内部ビデオ情報、36……白抜
きデータを格納する為のRAM、37……アドレス制御回
路、38……オフセツトアドレス発生回路、39……加算回
路、40……アドレスバス上位、41……アドレスバス下
位、42……R/W制御信号、43……ライト信号、44……リ
ード信号、45……チツプセレクト信号、46……オフセツ
ト選択信号、47……オフセツトアドレス、48……白抜き
RAMアドレス信号、49……出力バツフア制御信号、50…
…ラツチ制御信号、51……ラツチ、52……オア回路、53
……出力バツフア、54……CPUデータバス、55……RAMデ
ータバス、56……白抜きデータ出力バツフア、57データ
変換回路、60……FIFOメモリ、61……パラシリ変換器、
62……セレクタ、63……コード発生回路、64……２値デ
ータ、65……コードデータである。
を示すブロツク図、 第２図は本発明の第１実施例の白抜きビツトマツプメモ
リ22の詳細を示す図、 第３図は第１実施例によるRAMのアドレスマツプを示す
図、 第４図は本発明の第１実施例によるビデオ処理回路24の
詳細を示すブロツク図、 第５図は第１実施例によるCPU14の動作を説明するフロ
ーチヤート、 第６図は本発明に係る画像処理装置の第２実施例の構成
を示すブロツク図、 第７図は第２実施例によるビデオ処理回路24′の詳細を
示すブロツク図である。 図中、11……ホストコンピユータ、12……通信用の信号
線、13……通信用インターフエース、14……CPU、15…
…CPUバス、16……ROM、17……RAM、18……第１のビデ
オメモリ、19……第２のビデオメモリ、20……第３のビ
デオメモリ、21……第４のビデオメモリ、22……白抜き
ビツトマツプメモリ、23……白抜きデータ、24……ビデ
オ処理回路、25……ビデオインターフエース、26……リ
ーダ部、27……画像処理部、28……プリンタ部、29……
シーケンスコントローラ、30……外部ビデオ情報、31…
…リーダ部で読み取られた多値画像データ、32……合成
された画像データ、33……多値画像データ、34……多値
画像ビデオメモリ、35……内部ビデオ情報、36……白抜
きデータを格納する為のRAM、37……アドレス制御回
路、38……オフセツトアドレス発生回路、39……加算回
路、40……アドレスバス上位、41……アドレスバス下
位、42……R/W制御信号、43……ライト信号、44……リ
ード信号、45……チツプセレクト信号、46……オフセツ
ト選択信号、47……オフセツトアドレス、48……白抜き
RAMアドレス信号、49……出力バツフア制御信号、50…
…ラツチ制御信号、51……ラツチ、52……オア回路、53
……出力バツフア、54……CPUデータバス、55……RAMデ
ータバス、56……白抜きデータ出力バツフア、57データ
変換回路、60……FIFOメモリ、61……パラシリ変換器、
62……セレクタ、63……コード発生回路、64……２値デ
ータ、65……コードデータである。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 ＦＩ Ｇ０９Ｇ 5/36 ５２０ Ｇ０９Ｇ 5/36 ５２０Ｎ Ｈ０４Ｎ 1/21 Ｈ０４Ｎ 1/21 1/387 1/387
Claims (1)
- 【請求項１】ページ記述言語により記述されたコマンド
データを入力し、該コマンドデータから第１画像データ
に展開する展開手段と、 該展開手段により展開された第１画像データを記憶する
記憶手段と、 該記憶手段に記憶された第１画像データの有効、無効を
示す情報を生成する生成手段と、 前記第１画像データとは異なる第２画像データを入力す
る入力手段と、 前記生成手段により生成された情報に応じて、前記第１
の画像データと第２の画像データを合成する合成手段
と、 を有することを特徴とする画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2325897A JP2817856B2 (ja) | 1990-11-29 | 1990-11-29 | 画像処理装置 |
| US08/465,190 US5737620A (en) | 1990-11-29 | 1995-06-05 | Image processing method and apparatus having an interpreter function for converting information described in a page description language into image data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2325897A JP2817856B2 (ja) | 1990-11-29 | 1990-11-29 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04205069A JPH04205069A (ja) | 1992-07-27 |
| JP2817856B2 true JP2817856B2 (ja) | 1998-10-30 |
Family
ID=18181821
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2325897A Expired - Lifetime JP2817856B2 (ja) | 1990-11-29 | 1990-11-29 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5737620A (ja) |
| JP (1) | JP2817856B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5638186A (en) * | 1991-12-19 | 1997-06-10 | Ricoh Company Ltd. | Multi-function machine for combining and routing image data |
| JP4360084B2 (ja) * | 2002-12-20 | 2009-11-11 | 富士ゼロックス株式会社 | 画像形成装置 |
| JP4300512B2 (ja) * | 2003-03-20 | 2009-07-22 | 富士ゼロックス株式会社 | 画像処理装置およびその方法 |
| JP6546474B2 (ja) | 2015-07-31 | 2019-07-17 | キヤノン株式会社 | 撮像装置およびその制御方法 |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4949279A (en) * | 1984-03-22 | 1990-08-14 | Sharp Kabushiki Kaisha | Image processing device |
| JPH0688427B2 (ja) * | 1987-04-15 | 1994-11-09 | キヤノン株式会社 | 出力装置 |
| JPH01236869A (ja) * | 1988-03-17 | 1989-09-21 | Fuji Photo Film Co Ltd | カラースキャナの画像処理方法 |
| GB8812891D0 (en) * | 1988-05-31 | 1988-07-06 | Crosfield Electronics Ltd | Image generating apparatus |
| US5018085A (en) * | 1988-06-16 | 1991-05-21 | Hallmark Cards, Inc. | Color printing system usable for reproduction of computer-generated images |
| GB8814288D0 (en) * | 1988-06-16 | 1988-07-20 | Crosfield Electronics Ltd | Method & apparatus for generating composite images |
| US5058185A (en) * | 1988-06-27 | 1991-10-15 | International Business Machines Corporation | Object management and delivery system having multiple object-resolution capability |
| US5025396A (en) * | 1989-03-21 | 1991-06-18 | International Business Machines Corporation | Method and apparatus for merging a digitized image with an alphanumeric character string |
| US5191406A (en) * | 1990-04-20 | 1993-03-02 | Nikon Corporation | Method and apparatus for rapid scanning of color images |
-
1990
- 1990-11-29 JP JP2325897A patent/JP2817856B2/ja not_active Expired - Lifetime
-
1995
- 1995-06-05 US US08/465,190 patent/US5737620A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04205069A (ja) | 1992-07-27 |
| US5737620A (en) | 1998-04-07 |
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