JP2759896B2 - テレビジョン信号装置の制御方法 - Google Patents
テレビジョン信号装置の制御方法Info
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- H04N5/00—Details of television systems
- H04N5/222—Studio circuitry; Studio devices; Studio equipment
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- Signal Processing (AREA)
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- Controls And Circuits For Display Device (AREA)
- Studio Circuits (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、電子装置の設定を制御
する方法、特に、テレビジョン・エンコーダ（コンポー
ネント・テレビジョン信号をコンポジット（複合）テレ
ビジョン信号に変換するエンコーダ）又はテレビジョン
・デコーダ（コンポジット・テレビジョン信号をコンポ
ーネント・テレビジョン信号に変換するデコーダ）に固
有のタイミング、フォーマット変換、レベル調整、信号
処理技法、及びフィルタを制御するテレビジョン信号装
置の制御方法に関する。
する方法、特に、テレビジョン・エンコーダ（コンポー
ネント・テレビジョン信号をコンポジット（複合）テレ
ビジョン信号に変換するエンコーダ）又はテレビジョン
・デコーダ（コンポジット・テレビジョン信号をコンポ
ーネント・テレビジョン信号に変換するデコーダ）に固
有のタイミング、フォーマット変換、レベル調整、信号
処理技法、及びフィルタを制御するテレビジョン信号装
置の制御方法に関する。
【０００２】
【従来の技術】米国カリフォルニア州グラス・バレーの
ザ・グラス・バレー・グループ・インコーポレイテッド
が製造しているＣＶ−２５型エンコーダやＣＶ−２４型
デコーダの如き従来のテレビジョン信号エンコーダ及び
デコーダ（テレビジョン信号装置）は、簡単なスイッチ
やノブにより制御され、オペレータは、単一の特定方法
でそのユニットが動作するように構成（設定）及び調整
できる。一般に、オペレータが構成を変更する必要があ
る場合、そのオペレータは、新たな構成にするまで、１
度に１つずつ制御位置を物理的に変更しなければならな
い。特に、この変更に微調整用テスト装置が必要な場
合、ビデオの各フレームの速度と比較すると、この処理
は非常に遅い。また、構成を変更すると、元の構成に戻
すのが容易でない。
ザ・グラス・バレー・グループ・インコーポレイテッド
が製造しているＣＶ−２５型エンコーダやＣＶ−２４型
デコーダの如き従来のテレビジョン信号エンコーダ及び
デコーダ（テレビジョン信号装置）は、簡単なスイッチ
やノブにより制御され、オペレータは、単一の特定方法
でそのユニットが動作するように構成（設定）及び調整
できる。一般に、オペレータが構成を変更する必要があ
る場合、そのオペレータは、新たな構成にするまで、１
度に１つずつ制御位置を物理的に変更しなければならな
い。特に、この変更に微調整用テスト装置が必要な場
合、ビデオの各フレームの速度と比較すると、この処理
は非常に遅い。また、構成を変更すると、元の構成に戻
すのが容易でない。
【０００３】上述のザ・グラス・バレー・グループ・イ
ンコーポレイテッドが製造しているEMPHASYSエンコーダ
／デコーダの如きエンコーダ及びデコーダの最新の改良
は、エンコード及びデコードに共通の欠陥を除去したり
削減したりするための改良された信号処理技法となって
いる。一般に、これら処理は、クロス・カラー・エラー
及びクロス・ルミナンス・エラー、即ち、不適切に分離
されたクロミナンス（クロマ）及びルミナンスによる欠
点を減らし、細かな細部の鮮明度を増し、ノイズなどを
減少させる。これら改良された信号処理技術のいくつか
は、米国特許第４８１９０６１号及び第４８４７６８３
号に詳細に記述されている。
ンコーポレイテッドが製造しているEMPHASYSエンコーダ
／デコーダの如きエンコーダ及びデコーダの最新の改良
は、エンコード及びデコードに共通の欠陥を除去したり
削減したりするための改良された信号処理技法となって
いる。一般に、これら処理は、クロス・カラー・エラー
及びクロス・ルミナンス・エラー、即ち、不適切に分離
されたクロミナンス（クロマ）及びルミナンスによる欠
点を減らし、細かな細部の鮮明度を増し、ノイズなどを
減少させる。これら改良された信号処理技術のいくつか
は、米国特許第４８１９０６１号及び第４８４７６８３
号に詳細に記述されている。
【０００４】
【発明が解決しようとする課題】これら従来技術による
処理は、ほとんどの画像に対して大幅な改善を行うが、
いくつかのイメージ又はイメージ部分は、これら処理に
より、しばしば歪むか、悪影響がある。要するに、どの
処理も、総べてのビデオ画像に対して、又は総べての観
察者の主観的なテストに対して、理想的ではない。よっ
て、エンコーダ／デコーダの構成（設定）を制御するこ
とが望ましい。
処理は、ほとんどの画像に対して大幅な改善を行うが、
いくつかのイメージ又はイメージ部分は、これら処理に
より、しばしば歪むか、悪影響がある。要するに、どの
処理も、総べてのビデオ画像に対して、又は総べての観
察者の主観的なテストに対して、理想的ではない。よっ
て、エンコーダ／デコーダの構成（設定）を制御するこ
とが望ましい。
【０００５】したがって、本発明の目的は、信号処理技
術を含むエンコーダ及びデコーダなどのテレビジョン信
号装置の構成を迅速且つ容易に変更でき、画像の変化に
一致する程、充分高速に構成を呼び戻せるテレビジョン
信号装置の制御方法の提供にある。
術を含むエンコーダ及びデコーダなどのテレビジョン信
号装置の構成を迅速且つ容易に変更でき、画像の変化に
一致する程、充分高速に構成を呼び戻せるテレビジョン
信号装置の制御方法の提供にある。
【０００６】
【課題を解決するための手段】本発明のテレビジョン信
号装置の制御方法によれば、信号処理技法を含んだエン
コーダ又はデコーダの構成（設定）を実時間で制御し、
種々のインタフェースを介して種々の設定のパラメータ
を蓄積すると共に呼び戻せる（読み出せる）。これらイ
ンタフェースには、局部制御用のフロント・パネル・イ
ンタフェースと、並列及び直列遠隔インタフェース構造
があり、これらインタフェースが、直接制御用のスイッ
チ・パネルとの接続を行い、汎用コンピュータとの接続
を行い、更に、テレビジョン信号編集器又はテレビジョ
ン信号スイチャなどのより特殊化されたコンピュータと
の接続も行う。付随したプログラム及び動作メモリを有
するマイクロプロセッサ・システムは、入力ビデオ信号
から得た垂直同期パルスからタイミングを得る。なお、
この垂直同期パルスは、マイクロプロセッサ・システム
への割り込みとして作用する。データ・バスをマイクロ
プロセッサ・システム及び複数のレジスタ間に結合す
る。これらレジスタを被制御エンコーダ又はデコーダに
結合する。また、アドレス・バスをマイクロプロセッサ
・システム及び適切なアドレス・デコーダ間に結合す
る。このアドレス・デコーダは、ストローブを発生し
て、データ・バス上のデータを適切なラッチ回路にラッ
チするか、又は被制御装置からのデータを適切なレジス
タにラッチして、マイクロプロセッサ・システムに転送
する。この結果がテレビジョン信号装置（エンコーダ／
デコーダ）用制御器となる。この制御器は、フロント・
パネル又は遠隔制御装置からの入力に応答して、ビデオ
信号の垂直期間（垂直インターバル）中に、エンコーダ
又はデコーダに新たなパラメータ情報を供給する。特定
構成に関するパラメータ、即ち、テレビジョン信号装置
（エンコーダ／デコーダ）の各構成回路の設定を制御す
るパラメータ（構成パラメータ）をメモリに蓄積するの
で、この構成パラメータをメモリから簡単に呼び戻せ
る。なお、単一の入力コマンドに応答して、垂直期間中
に、構成パラメータを呼び戻している。
号装置の制御方法によれば、信号処理技法を含んだエン
コーダ又はデコーダの構成（設定）を実時間で制御し、
種々のインタフェースを介して種々の設定のパラメータ
を蓄積すると共に呼び戻せる（読み出せる）。これらイ
ンタフェースには、局部制御用のフロント・パネル・イ
ンタフェースと、並列及び直列遠隔インタフェース構造
があり、これらインタフェースが、直接制御用のスイッ
チ・パネルとの接続を行い、汎用コンピュータとの接続
を行い、更に、テレビジョン信号編集器又はテレビジョ
ン信号スイチャなどのより特殊化されたコンピュータと
の接続も行う。付随したプログラム及び動作メモリを有
するマイクロプロセッサ・システムは、入力ビデオ信号
から得た垂直同期パルスからタイミングを得る。なお、
この垂直同期パルスは、マイクロプロセッサ・システム
への割り込みとして作用する。データ・バスをマイクロ
プロセッサ・システム及び複数のレジスタ間に結合す
る。これらレジスタを被制御エンコーダ又はデコーダに
結合する。また、アドレス・バスをマイクロプロセッサ
・システム及び適切なアドレス・デコーダ間に結合す
る。このアドレス・デコーダは、ストローブを発生し
て、データ・バス上のデータを適切なラッチ回路にラッ
チするか、又は被制御装置からのデータを適切なレジス
タにラッチして、マイクロプロセッサ・システムに転送
する。この結果がテレビジョン信号装置（エンコーダ／
デコーダ）用制御器となる。この制御器は、フロント・
パネル又は遠隔制御装置からの入力に応答して、ビデオ
信号の垂直期間（垂直インターバル）中に、エンコーダ
又はデコーダに新たなパラメータ情報を供給する。特定
構成に関するパラメータ、即ち、テレビジョン信号装置
（エンコーダ／デコーダ）の各構成回路の設定を制御す
るパラメータ（構成パラメータ）をメモリに蓄積するの
で、この構成パラメータをメモリから簡単に呼び戻せ
る。なお、単一の入力コマンドに応答して、垂直期間中
に、構成パラメータを呼び戻している。
【０００７】本発明の他の目的、利点及び新規な特徴
は、添付図を参照した以下の詳細説明より明らかになろ
う。
は、添付図を参照した以下の詳細説明より明らかになろ
う。
【０００８】
【実施例】図１は、本発明を実施する装置のブロック図
である。テレビジョン信号装置（エンコーダ／デコー
ダ）は、インタフェース・バス１２、アドレス・バス１
４、データ・バス１６及び関連メモリ１８を有するマイ
クロプロセッサ（μＰ）１０を具えている。インタフェ
ース・バス１２をフロント・パネル・インタフェース２
０、及びエンコーダ／デコーダの遠隔制御用である複数
の並列／直列外部インタフェース２２に結合する。デー
タ・バス１６は、複数のレジスタ２４、２６に結合す
る。これらレジスタは、エンコーダ／デコーダの制御可
能な回路及びマイクロプロセッサ１０間でパラメータ・
データのやり取りをする。アドレス・デコーダ２８をア
ドレス・バス１４に結合して、マイクロプロセッサ・プ
ログラムが発生したアドレスに応じて、レジスタ２４、
２６の特定の１個を選択し、マイクロプロセッサ１０が
アクセスする。また、マイクロプロセッサ１０への割り
込みとして、当業者に周知の如く、基準同期発生器又は
入力ビデオ信号から得た垂直同期パルスを入力する。
である。テレビジョン信号装置（エンコーダ／デコー
ダ）は、インタフェース・バス１２、アドレス・バス１
４、データ・バス１６及び関連メモリ１８を有するマイ
クロプロセッサ（μＰ）１０を具えている。インタフェ
ース・バス１２をフロント・パネル・インタフェース２
０、及びエンコーダ／デコーダの遠隔制御用である複数
の並列／直列外部インタフェース２２に結合する。デー
タ・バス１６は、複数のレジスタ２４、２６に結合す
る。これらレジスタは、エンコーダ／デコーダの制御可
能な回路及びマイクロプロセッサ１０間でパラメータ・
データのやり取りをする。アドレス・デコーダ２８をア
ドレス・バス１４に結合して、マイクロプロセッサ・プ
ログラムが発生したアドレスに応じて、レジスタ２４、
２６の特定の１個を選択し、マイクロプロセッサ１０が
アクセスする。また、マイクロプロセッサ１０への割り
込みとして、当業者に周知の如く、基準同期発生器又は
入力ビデオ信号から得た垂直同期パルスを入力する。
【０００９】動作において、フロント・パネル・インタ
フェース２０又は外部インタフェース２２を介してエン
コーダ／デコーダをアクセスするオペレータは、詳細に
後述する如くエンコーダ／デコーダを設定する。マイク
ロプロセッサ１０は、各垂直同期パルス毎に、結果とし
てのパラメータ・データをデータ・バスに出力し、アド
レス・デコーダ２８を介して特定のレジスタ２４をアド
レス指定して、そのレジスタに関連した特定の回路が利
用できるように、データをロードすることによって、オ
ペレータの設定を実現する。エンコーダ／デコーダを設
定すると、オペレータは、単一の蓄積アクセス・ロケー
ション（記憶場所）にパラメータ・データを蓄積する。
マイクロプロセッサ１０は、単一のロケーション・イン
デックスによりレジスタ２６からのパラメータ・データ
を蓄積する。オペレータがその特定構成に再び戻ること
を望む場合、オペレータは、単一のロケーション・イン
デックスを選択し、マイクロプロセッサ１０は、自動的
に総べてのレジスタ２４に蓄積パラメータ・データをロ
ードする。なお、蓄積及び呼び戻し動作の詳細説明に関
しては、米国特許第４２０５３４４号を参照されたい。
フェース２０又は外部インタフェース２２を介してエン
コーダ／デコーダをアクセスするオペレータは、詳細に
後述する如くエンコーダ／デコーダを設定する。マイク
ロプロセッサ１０は、各垂直同期パルス毎に、結果とし
てのパラメータ・データをデータ・バスに出力し、アド
レス・デコーダ２８を介して特定のレジスタ２４をアド
レス指定して、そのレジスタに関連した特定の回路が利
用できるように、データをロードすることによって、オ
ペレータの設定を実現する。エンコーダ／デコーダを設
定すると、オペレータは、単一の蓄積アクセス・ロケー
ション（記憶場所）にパラメータ・データを蓄積する。
マイクロプロセッサ１０は、単一のロケーション・イン
デックスによりレジスタ２６からのパラメータ・データ
を蓄積する。オペレータがその特定構成に再び戻ること
を望む場合、オペレータは、単一のロケーション・イン
デックスを選択し、マイクロプロセッサ１０は、自動的
に総べてのレジスタ２４に蓄積パラメータ・データをロ
ードする。なお、蓄積及び呼び戻し動作の詳細説明に関
しては、米国特許第４２０５３４４号を参照されたい。
【００１０】フロント・パネル・インタフェース用の制
御キーボード３０を図２に示す。このキーボードには、
種々のラベルを付けた機能制御ボタン３２と、選択及び
パラメータ・データを入力するための小さな数の数字キ
ーパッド３４と、種々のラベルを付けた実行制御ボタン
３６とがある。制御キーボード上のこれら種々の制御動
作が、図３〜図７に示されている。エンコーダ／デコー
ダにおいて制御される特定のパラメータには、次のもの
がある。
御キーボード３０を図２に示す。このキーボードには、
種々のラベルを付けた機能制御ボタン３２と、選択及び
パラメータ・データを入力するための小さな数の数字キ
ーパッド３４と、種々のラベルを付けた実行制御ボタン
３６とがある。制御キーボード上のこれら種々の制御動
作が、図３〜図７に示されている。エンコーダ／デコー
ダにおいて制御される特定のパラメータには、次のもの
がある。
【００１１】１）エンコーダ／デコーダのマトリックス
回路へ供給する信号のゲイン（利得）及びオフセット・
レベル。この設定により、種々のコンポーネント・テレ
ビジョン信号標準をエンコード／デコードでき、また、
標準でないレベルを操作者が意識的に補償したり、可変
できる。
回路へ供給する信号のゲイン（利得）及びオフセット・
レベル。この設定により、種々のコンポーネント・テレ
ビジョン信号標準をエンコード／デコードでき、また、
標準でないレベルを操作者が意識的に補償したり、可変
できる。
【００１２】２）クロミナンス・フィルタのレスポン
ス。このレスポンスは、一覧表から選択したディスクリ
ート・レスポンス（予め指定されたレスポンス）である
か、又は連続的に可変できるレスポンスである。この設
定により、帯域幅、リンギング、オーバーシュート、ア
ンダーシュート、エリアシング、及びデコードのクロス
・ルミナンスを改善できる。
ス。このレスポンスは、一覧表から選択したディスクリ
ート・レスポンス（予め指定されたレスポンス）である
か、又は連続的に可変できるレスポンスである。この設
定により、帯域幅、リンギング、オーバーシュート、ア
ンダーシュート、エリアシング、及びデコードのクロス
・ルミナンスを改善できる。
【００１３】３）ルミナンス・フィルタのレスポンス。
このレスポンスは、ルックアップ・テーブルから選択で
きるか、又は連続可変できる。このレスポンスの設定を
テレビジョン信号の垂直、水平及び時間次元上で行うこ
とにより、細かな画像細部を改善するか、ノイズを減ら
して、入力信号を補償したり、アナログ・デジタル信号
変換処理を補償したり、人為的な理由での補償を行う。
また、このルミナンス・フィルタのレスポンスには、レ
ベルに応じてレスポンスが変化する非線形技法を用いて
いる。
このレスポンスは、ルックアップ・テーブルから選択で
きるか、又は連続可変できる。このレスポンスの設定を
テレビジョン信号の垂直、水平及び時間次元上で行うこ
とにより、細かな画像細部を改善するか、ノイズを減ら
して、入力信号を補償したり、アナログ・デジタル信号
変換処理を補償したり、人為的な理由での補償を行う。
また、このルミナンス・フィルタのレスポンスには、レ
ベルに応じてレスポンスが変化する非線形技法を用いて
いる。
【００１４】４）エンコーダ／デコーダにおける入力か
ら出力までにかかる遅延時間。この遅延時間を制御する
と、種々の動作環境を実現でき、また、入力信号を制御
時間だけ遅延させて補助出力を発生できる。
ら出力までにかかる遅延時間。この遅延時間を制御する
と、種々の動作環境を実現でき、また、入力信号を制御
時間だけ遅延させて補助出力を発生できる。
【００１５】５）１次元、２次元又は３次元での非人為
的（アンチ・アーチファクト）処理。この処理により、
クロス・カラー及び／又はクロス・ルミナンスの影響を
除くことができる。また、この処理は、連続的に可変さ
せたり、２以上のオプションから選択したりすることが
できる。
的（アンチ・アーチファクト）処理。この処理により、
クロス・カラー及び／又はクロス・ルミナンスの影響を
除くことができる。また、この処理は、連続的に可変さ
せたり、２以上のオプションから選択したりすることが
できる。
【００１６】６）エンコーダ／デコーダの入力としてテ
レビジョン・テスト信号を選択するか、又はエンコーダ
／デコーダにこのテスト信号を挿入するかの制御。
レビジョン・テスト信号を選択するか、又はエンコーダ
／デコーダにこのテスト信号を挿入するかの制御。
【００１７】７）タイミング遅延、ある外部タイミング
基準に関連したブランキング期間、同期信号期間、バー
スト期間、及びバーストの包絡線の期間の制御。
基準に関連したブランキング期間、同期信号期間、バー
スト期間、及びバーストの包絡線の期間の制御。
【００１８】８）外部タイミング基準の遅延及びタイミ
ング・パラメータの制御。
ング・パラメータの制御。
【００１９】９）種々のインタフェース２０、２２の機
能を独立にイネーブルするか、制限するかの制御。ま
た、優先度を各インタフェースに割り当てて、あるイン
タフェースを他のインタフェースに対して選択的に優先
とする制御。
能を独立にイネーブルするか、制限するかの制御。ま
た、優先度を各インタフェースに割り当てて、あるイン
タフェースを他のインタフェースに対して選択的に優先
とする制御。
【００２０】１０）エンコード／デコードが、バースト
がある場合に通常（カラー）動作するか、バーストがな
い場合にモノクロ（白黒）動作をするかの選択。
がある場合に通常（カラー）動作するか、バーストがな
い場合にモノクロ（白黒）動作をするかの選択。
【００２１】１１）エンコーダ／デコーダにおける故障
位置の確認及びユニット評価のために非標準信号を供給
するか、自己試験制御を行うかの選択。
位置の確認及びユニット評価のために非標準信号を供給
するか、自己試験制御を行うかの選択。
【００２２】１２）エンコーダ／デコーダ状態の表示又
は報告。これには、ユニットの構成及び自己試験の結果
に関する情報が含まれる。
は報告。これには、ユニットの構成及び自己試験の結果
に関する情報が含まれる。
【００２３】１３）種々のインタフェースによるメモリ
制御。この制御により、総べての可能な構成（設定）を
メモリに蓄積したり、蓄積した構成をメモリから呼び戻
す。
制御。この制御により、総べての可能な構成（設定）を
メモリに蓄積したり、蓄積した構成をメモリから呼び戻
す。
【００２４】１４）垂直期間中に、ビデオ信号と同期し
てフレーム単位でのエンコーダ／デコーダの制御。これ
により、ビデオ信号の内容、信号源又は信号の送り先に
応じた技術的理由又は人為的理由により、エンコード処
理又はデコード処理の動作を実時間で選択したり、変更
できる。
てフレーム単位でのエンコーダ／デコーダの制御。これ
により、ビデオ信号の内容、信号源又は信号の送り先に
応じた技術的理由又は人為的理由により、エンコード処
理又はデコード処理の動作を実時間で選択したり、変更
できる。
【００２５】１５）遠隔インタフェース２２を介して外
部メモリへパラメータをアップロードしたり外部メモリ
からパラメータをダウンロードする選択。
部メモリへパラメータをアップロードしたり外部メモリ
からパラメータをダウンロードする選択。
【００２６】図３を参照する。フロント・パネル・イン
タフェース用の制御キーボード３０上の「構成」ボタン
（図２で「構成」のラベルが付いたボタン）が押される
と、構成メニュ（図３で、選択指示用数字と共に示され
た選択肢）が表示され、数字キーパッドの適当な番号を
押して、表示された選択肢からの選択を行う。なお、図
３における「構成」は、本発明の構成パラメータ全体を
示すものではなく、構成パラメータの一部であるフォー
マット、信号選択、ビデオ・モード及びリモートに関す
る設定のみをいう点に留意されたい。そして、このルー
チンは、選択したオプションをアクセスし、付加的なオ
プションも提供して、エンコーダ／デコーダの設定を行
う。「レベル調整」ボタンが押されたとき、図４に示す
如く、レベル調整メニュを表示する。再び数字キーパッ
ドにより適切なオプションを選択し、次のメニュを表示
して、付加的なオプションを与えるか、レベル調整用の
表示を行う。そして、数字キーパッドは、別の機能を用
いて、所望レベルを増加させるか減少させる。なお、現
在のレベルは、エンコーダ／デコーダからレジスタ２６
及びデータ・バス１６を介してマイクロプロセッサ１０
に送られ表示される。
タフェース用の制御キーボード３０上の「構成」ボタン
（図２で「構成」のラベルが付いたボタン）が押される
と、構成メニュ（図３で、選択指示用数字と共に示され
た選択肢）が表示され、数字キーパッドの適当な番号を
押して、表示された選択肢からの選択を行う。なお、図
３における「構成」は、本発明の構成パラメータ全体を
示すものではなく、構成パラメータの一部であるフォー
マット、信号選択、ビデオ・モード及びリモートに関す
る設定のみをいう点に留意されたい。そして、このルー
チンは、選択したオプションをアクセスし、付加的なオ
プションも提供して、エンコーダ／デコーダの設定を行
う。「レベル調整」ボタンが押されたとき、図４に示す
如く、レベル調整メニュを表示する。再び数字キーパッ
ドにより適切なオプションを選択し、次のメニュを表示
して、付加的なオプションを与えるか、レベル調整用の
表示を行う。そして、数字キーパッドは、別の機能を用
いて、所望レベルを増加させるか減少させる。なお、現
在のレベルは、エンコーダ／デコーダからレジスタ２６
及びデータ・バス１６を介してマイクロプロセッサ１０
に送られ表示される。
【００２７】「タイミング」ボタンは、図５に示すよう
に、種々の信号に対するタイミングを調整する。再び、
数字キーパッドにより選択を行う。さらに、数字キーパ
ッドにより、現在の値を増加又は減少させて、「アナロ
グ」値を選択する。「信号処理」ボタンは、図６に示す
信号処理ルーチンを呼び出し、適切なルミナンス、クロ
ミナンス及び／又は遅延処理を選択する。再び、数字キ
ーパッドにより、これらルーチンの所望の各選択を行
う。「構成」、「タイミング」、「レベル調整」及び
「信号処理」ルーチンの動作によりエンコーダ／デコー
ダを設定すると、その結果の設定が、「Ｅ−ＭＥＭ」
（メモリに蓄積する）ルーチン（図７）を用いて、「ス
テータス」ボタンにより表示され、「プリセット」ボタ
ンにより蓄積できる。
に、種々の信号に対するタイミングを調整する。再び、
数字キーパッドにより選択を行う。さらに、数字キーパ
ッドにより、現在の値を増加又は減少させて、「アナロ
グ」値を選択する。「信号処理」ボタンは、図６に示す
信号処理ルーチンを呼び出し、適切なルミナンス、クロ
ミナンス及び／又は遅延処理を選択する。再び、数字キ
ーパッドにより、これらルーチンの所望の各選択を行
う。「構成」、「タイミング」、「レベル調整」及び
「信号処理」ルーチンの動作によりエンコーダ／デコー
ダを設定すると、その結果の設定が、「Ｅ−ＭＥＭ」
（メモリに蓄積する）ルーチン（図７）を用いて、「ス
テータス」ボタンにより表示され、「プリセット」ボタ
ンにより蓄積できる。
【００２８】図７は、Ｅ−ＭＥＭ（特殊効果メモリ）ル
ーチンのメニュを示す。このルーチンは、オペレータ
が、一連の特殊効果に関連したエンコーダ／デコーダの
設定（パラメータ）をメモリの所定のアドレス位置に蓄
積し、そこから読み出すことにより、一連の特殊効果を
再現する。なお、蓄積又は読み出しの際、オペレータ
は、メモリのアドレスを前方（アドレスの減少）又は次
（アドレスの増加）に変化させることにより、所望のア
ドレス位置を選択し、そのアドレス位置にエンコーダ／
デコーダの現在のパラメータを蓄積するか、又は、その
アドレス位置からエンコーダ／デコーダのパラメータを
読み出す。なお、新たな設定は、未使用のアドレス位置
に蓄積し、そのアドレス位置を書き込み禁止にするの
で、これらパラメータを不注意に変更したり消去するこ
とがない。また、既にパラメータが蓄積されたアドレス
位置に新たな蓄積を行なおうとする際には、この蓄積さ
れたパラメータを変更する否かの判断を行う。この際、
パスワードが設けられているので、入力したパスワード
が正しい場合に、新たなパラメータを、禁止されたアド
レス位置に蓄積でき、蓄積後にそのアドレス位置が再び
書き込み禁止になる。
ーチンのメニュを示す。このルーチンは、オペレータ
が、一連の特殊効果に関連したエンコーダ／デコーダの
設定（パラメータ）をメモリの所定のアドレス位置に蓄
積し、そこから読み出すことにより、一連の特殊効果を
再現する。なお、蓄積又は読み出しの際、オペレータ
は、メモリのアドレスを前方（アドレスの減少）又は次
（アドレスの増加）に変化させることにより、所望のア
ドレス位置を選択し、そのアドレス位置にエンコーダ／
デコーダの現在のパラメータを蓄積するか、又は、その
アドレス位置からエンコーダ／デコーダのパラメータを
読み出す。なお、新たな設定は、未使用のアドレス位置
に蓄積し、そのアドレス位置を書き込み禁止にするの
で、これらパラメータを不注意に変更したり消去するこ
とがない。また、既にパラメータが蓄積されたアドレス
位置に新たな蓄積を行なおうとする際には、この蓄積さ
れたパラメータを変更する否かの判断を行う。この際、
パスワードが設けられているので、入力したパスワード
が正しい場合に、新たなパラメータを、禁止されたアド
レス位置に蓄積でき、蓄積後にそのアドレス位置が再び
書き込み禁止になる。
【００２９】
【発明の効果】上述の如く、本発明のテレビジョン信号
装置の制御方法によれば、テレビジョン信号装置の構成
回路の設定を制御するパラメータを夫々対応するレジス
タに蓄積し、蓄積されたパラメータを変更した際には、
この変更したパラメータをメモリに蓄積しておく。そし
て、必要に応じて、メモリに蓄積された変更（された）
パラメータをレジスタに蓄積するので、テレビジョン信
号装置の各構成回路の構成、即ち、設定の制御を、単に
メモリからレジスタに転送するだけで、迅速且つ高速に
行える。この際、メモリからレジスタにパラメータを転
送するには、マイクロプロセッサが、テレビジョン信号
の垂直同期パルスを割り込み信号として受け、メモリに
蓄積された変更パラメータを指定されたレジスタに、テ
レビジョン信号の垂直インターバル期間中に転送する。
テレビジョン信号の垂直インターバル期間中は、このテ
レビジョン信号による表示に現れないので、テレビジョ
ン信号装置からのテレビジョン信号による画像に影響を
与えることなく、レジスタに蓄積されたパラメータを変
更パラメータに置き換えることができる。したがって、
テレビジョン信号装置の設定の制御を、テレビジョン信
号を中断することなく、実質的に実時間で行える。
装置の制御方法によれば、テレビジョン信号装置の構成
回路の設定を制御するパラメータを夫々対応するレジス
タに蓄積し、蓄積されたパラメータを変更した際には、
この変更したパラメータをメモリに蓄積しておく。そし
て、必要に応じて、メモリに蓄積された変更（された）
パラメータをレジスタに蓄積するので、テレビジョン信
号装置の各構成回路の構成、即ち、設定の制御を、単に
メモリからレジスタに転送するだけで、迅速且つ高速に
行える。この際、メモリからレジスタにパラメータを転
送するには、マイクロプロセッサが、テレビジョン信号
の垂直同期パルスを割り込み信号として受け、メモリに
蓄積された変更パラメータを指定されたレジスタに、テ
レビジョン信号の垂直インターバル期間中に転送する。
テレビジョン信号の垂直インターバル期間中は、このテ
レビジョン信号による表示に現れないので、テレビジョ
ン信号装置からのテレビジョン信号による画像に影響を
与えることなく、レジスタに蓄積されたパラメータを変
更パラメータに置き換えることができる。したがって、
テレビジョン信号装置の設定の制御を、テレビジョン信
号を中断することなく、実質的に実時間で行える。
【図１】本発明のテレビジョン信号装置の制御方法を用
いる装置のブロック図である。
いる装置のブロック図である。
【図２】図１のテレビジョン信号装置のフロント・パネ
ル・インタフェースの平面図である。
ル・インタフェースの平面図である。
【図３】本発明のテレビジョン信号装置の制御方法の動
作を説明する流れ図であり、「構成」の場合を示す。
作を説明する流れ図であり、「構成」の場合を示す。
【図４】本発明のテレビジョン信号装置の制御方法の動
作を説明する流れ図であり、「レベル調整」の場合を示
す。
作を説明する流れ図であり、「レベル調整」の場合を示
す。
【図５】本発明のテレビジョン信号装置の制御方法の動
作を説明する流れ図であり、「タイミング」の場合を示
す。
作を説明する流れ図であり、「タイミング」の場合を示
す。
【図６】本発明のテレビジョン信号装置の制御方法の動
作を説明する流れ図であり、「信号処理」の場合を示
す。
作を説明する流れ図であり、「信号処理」の場合を示
す。
【図７】本発明のテレビジョン信号装置の制御方法の動
作を説明する流れ図であり、「Ｅ−ＭＥＭ」の場合を示
す。
作を説明する流れ図であり、「Ｅ−ＭＥＭ」の場合を示
す。
１０ マイクロプロセッサ １２ インタフェース・バス １４ アドレス・バス １６ データ・バス １８ メモリ ２０ フロント・パネル ２２ 外部インタフェース ２４、２６ レジスタ ２８ アドレス・デコーダ
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 ＦＩ Ｈ０４Ｎ 17/02 Ｈ０４Ｎ 7/00 Ｚ (58)調査した分野(Int.Cl.6，ＤＢ名) H04N 5/44,5/14,7/00,9/64,9/67,17 /02
Claims (1)
- 【請求項１】 テレビジョン信号を入力して処理する
か、処理したテレビジョン信号を出力するテレビジョン
信号装置を構成する各構成回路を、該構成回路に対応す
るレジスタに蓄積されたパラメータで制御する方法であ
って、 インタフェース・バス、アドレス・バス及びデータ・バ
スに結合されたマイクロプロセッサをメモリ及び上記レ
ジスタに結合し、 上記インタフェース・バスを介して上記マイクロプロセ
ッサと通信を行なって所望の上記パラメータを変更し、 上記マイクロプロセッサが、上記変更されたパラメータ
を上記メモリに蓄積し、 上記マイクロプロセッサが、上記テレビジョン信号の垂
直同期パルスを割り込み信号として受け、上記アドレス
・バスを介して所望の上記レジスタを指定し、上記メモ
リに蓄積された上記変更されたパラメータを上記指定さ
れたレジスタに上記データ・バスを介して上記テレビジ
ョン信号の垂直インターバル期間中に転送して蓄積し、 上記レジスタに蓄積された上記パラメータにより上記テ
レビジョン信号装置内の対応する上記構成回路を制御し
て、上記テレビジョン信号装置の設定を制御する ことを
特徴とするテレビジョン信号装置の制御方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US471561 | 1990-01-29 | ||
| US07/471,561 US5051827A (en) | 1990-01-29 | 1990-01-29 | Television signal encoder/decoder configuration control |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04213285A JPH04213285A (ja) | 1992-08-04 |
| JP2759896B2 true JP2759896B2 (ja) | 1998-05-28 |
Family
ID=23872084
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3047263A Expired - Lifetime JP2759896B2 (ja) | 1990-01-29 | 1991-01-28 | テレビジョン信号装置の制御方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5051827A (ja) |
| EP (1) | EP0439946B1 (ja) |
| JP (1) | JP2759896B2 (ja) |
| DE (1) | DE69018605T2 (ja) |
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