JPH063908B2 - デ−タ伝送方式 - Google Patents

デ−タ伝送方式

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JPH063908B2
JPH063908B2 JP60043383A JP4338385A JPH063908B2 JP H063908 B2 JPH063908 B2 JP H063908B2 JP 60043383 A JP60043383 A JP 60043383A JP 4338385 A JP4338385 A JP 4338385A JP H063908 B2 JPH063908 B2 JP H063908B2
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JP
Japan
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circuit
controlled
specific
control circuit
vblk
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JP60043383A
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JPS61202542A (ja
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尚雄 茂木
政之 末松
幸祐 藤田
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Sony Corp
Original Assignee
Sony Corp
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/38Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40Transmitting circuits; Receiving circuits
    • H04L25/49Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/44Receiver circuitry for the reception of television signals according to analogue transmission standards

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  • Physics & Mathematics (AREA)
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は内部回路をディジタル的に制御するようにした
テレビ受像機、VTR等の映像機器を制御するのに適用
し得るデータ伝送方式に関するものである。
〔発明の概要〕
本発明は、複数の被制御回路と特定の被制御回路と制御
回路との間にインナーバスが設けられ且つ垂直ブランキ
ング期間にデータの交信を行うようにした映像機器にお
いて、各垂直ブランキング期間毎に特定の被制御回路と
必ず交信を行うことにより、特に早い応答を要求される
特定の被制御回路や常にチェックを要求される特定の被
制御回路に対して優先的に制御が行われるようにしたも
のである。
〔従来の技術〕
ディジタル回路が用いられているテレビ受像機、VT
R、テープレコーダ等の映像機器及び音響機器が普及し
つつあるが、これらのディジタル化された機器の多くは
インナーバスシステムを採用している。インナーバスシ
ステムにおいては、機器内にCPU、インナーバス、R
OM等を設け、上記ROMに各回路の動作設定値を記憶
させて置くようにしている。そして通常の動作時には、
CPUにより上記設定値を読出し、読出されたデータを
インナーバスを通じて所定の回路に供給することによ
り、各回路に所定の動作を行わせるようにしている。こ
れと共にキーボードあるいはリモコン等の外部操作によ
りCPUを介して各回路を制御するようにしている。こ
のようなインナーバスシステムに用いられるインナーバ
スとしては、例えば特開昭57−106262号公報に
開示された通信方式を利用することができる。この方式
のバスラインはデータの伝送路とクロックの伝送路とを
有する2線式バスラインである。
上述したインナーバスシステムが設けられた電子機器
は、製造時及びサービス時における調整の標準化、共通
化及び簡易化等が可能となり、これによって製造コスト
の低減を含む総合的なコストダウンが期待されている。
第4図は上述したインナーバスシステムをテレビ受像機
に適用した場合の従来例を示すもので、本発明を適用し
得るものである。
図において、テレビ受像機には、CPU1、メモリ2、
インナーバスライン3等が設けられている。本例におい
ては被制御回路として、オーディオ処理回路4、ビデオ
制御回路5、ビデオ処理回路6、偏向制御回路7、PL
L回路8及びIF回路9が設けられている。受像機の動
作時には、キーボード11あるいはリモコン用コマンダ
14の指示に応じて、CPU1が各回路4〜9を制御す
る。これによって選局、音量調整、ピクチャー調整等が
行われ、その調整結果が表示部12等で表示される。こ
れと共に各回路4〜9はCPU1によって常に動作状態
を順次にチェックされ、所定の動作に制御されている。
尚13はリモコン信号受信回路、15,16は偏向コイ
ル、17はオーディオ出力アンプ、18はビデオ出力ア
ンプ、19は陰極線管である。
上述したテレビ受像機あるいはその他の映像機器の制御
に際して、CPU1から各被制御回路4〜9に制御信号
を送る場合及び各被制御回路4〜9からCPU1に動作
状態を示す信号を送る場合は、制御内容又は動作状態を
示すデータをクロックと共に送る。この場合、クロック
周波数を高くすると、クロックパルスから発生するノイ
ズによる輻射妨害が画面に現われる。これを避けるため
に、従来は映像信号の垂直ブランキング期間(以下単に
VBLKと言う)のみデータの伝送を行う方法を採用し
ている。前記の2線式バスラインを用いてデータを伝送
する場合は、第5図に示すタイミングでクロックとデー
タとが伝送される。
〔発明が解決しようとする問題点〕
データの伝送を行うVBLKは1.17〜1.33msecの長さで
あり、この期間に例えば100KHzのクロックでデータ
を送るとすると、1回のVBLK中に117ビットのデ
ータ伝送が可能である。従って、1バイトのデータを1
ビットの確認応答ビットと共に伝送する場合は、117
÷9=13バイトのデータの伝送が可能である。
このように1回のVBLK中に伝送できるデータ数は限
られており、従って、CPUと各被制御回路との交信可
能な回数も限られている。さらに待ち時間等を考慮すれ
ば、1回のVBLK中にCPUが必ずしも全ての被制御
回路の動作をチェックしきれない場合が生じる。その場
合、チェックされなかった回路については、次回のVB
LKにおいて交信されることになる。
このため応答時間が長くなることがあり、特にキーボー
ドやリモコンによるチャンネル切替え、画面調整等の指
示に対する応答が遅れることは好ましくない。
〔問題点を解決するための手段〕
本発明においては、各垂直ブランキング期間毎に特定の
被制御回路と常に交信を行う期間を設けている。
〔作用〕
特に早い応答を要求される特定の被制御回路や常にチェ
ックを要求される特定の被制御回路に対して優先的に制
御が行われる。
〔実施例〕
第1図は本発明の実施例を示す。
第1図において、CPU等から成る制御回路1はn個の
被制御回路20〜20と2線式バスライン3を介し
て接続されている。バスライン3はクロック伝送ライン
とデータ伝送ライン3とから成る。
本実施例においては、特定の被制御回路20に対する
制御を各VBLKにおいて毎回必ず行うようにしてい
る。このために第2図に示すように各VBLKには、上
記回路20に対して毎回交信を行うための期間jが設
けられている。上記回路20を除く他の回路20
20に対する交信期間1〜nは、1回のVBLKで行
い切れない場合は、図示のように2回のVBLKにわた
って設けられ、場合によっては3回以上のVBLKにわ
たって設けられる。
また毎回のVBLKで必ず制御される特定の回路として
は、上記回路20一つだけでなく二つ以上あってもよ
い。その場合は毎回のVBLK中に二つ以上の特定の回
路に対する交信期間が設けられる。また特定の回路に対
する交信は毎回のVBLKで行わなくても良く、例えば
一つ置きのVBLK等、所定のVBLKにおいて必ず行
うようにしてもよい。
上記特定の回路20としては、特に早く応答を要求さ
れる回路が選ばれる。第4図のテレビ受像機の場合は、
キーボード11、コマンダ14等による指示に対して優
先的に応答するように成せば最も効果的である。
第4図のテレビ受像機において、特定の被制御回路を複
数個選ぶとすれば、例えば、PLL回路8、IF回路
9、ビデオ制御回路5、ビデオ処理回路5、キーボード
11及び図示せずも管面表示回路等が挙げられる。
第3図は制御回路と被制御回路との交信を行う場合のフ
ローチャートを示す。
先ずVBLKに入ると、各被制御回路に付されたアドレ
スKをK=1に成し、次に制御回路が先ず特定の被制御
回路と所定期間優先的に交信する。この交信が終了する
とアドレスを一つ進め、次にアドレスK+1の回路が特
定の回路であるかを判別する。特定の回路であれば、制
御回路と所定期間優先的に交信し、交信が終了すればア
ドレスをまた一つ進めて同様の動作を繰り返す。K+1
の回路が特定の回路でない場合は、制御回路は非特定回
路と順次に通常の交信を行う。この交信はVBLK中に
行われ、VBLKが終了すると交信が終了する。
〔発明の効果〕
インナーバスラインシステムが設けられたテレビ受像
機、VTR等の映像機器において、特に応答速度の早さ
が要求される回路を他の回路より優先的に制御したり、
チェックすることができる。従って、垂直ブランキング
期間のみに交信を行うようにしても、効率良く交信する
ことができる。
【図面の簡単な説明】
第1図は本発明の実施例を示すブロック図、第2図は第
1図のタイミングチャート、第3図は実施例に関するフ
ローチャート、第4図は本発明を適用し得るインナーバ
スラインシステムが設けられたテレビ受像機のブロック
図、第5図は2線式バスラインにおけるデータ伝送のタ
イミングチャートである。 なお図面に用いた符号において、 1‐‐‐‐‐‐‐‐‐‐‐‐制御回路(又はCPU) 20〜20‐‐被制御回路 20‐‐‐‐‐‐‐‐特定の被制御回路 である。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】各々が映像信号又は音声信号の設定値をデ
    ジタル的に処理する複数の被制御回路と、優先度が高い
    映像信号又は音声信号の設定値をデジタル的に処理する
    特定の被制御回路と、これらの被制御回路をインナーバ
    スを介して制御する制御回路とを備えた映像機器におい
    て、 上記制御回路は、上記映像信号の垂直ブランキング期間
    内に、上記特定の被制御回路との間のデータの交信と、
    上記複数の被制御回路のいずれかとの間のデータの交信
    とを順次行うことを特徴とする映像機器のデータ伝送方
    式。
JP60043383A 1985-03-05 1985-03-05 デ−タ伝送方式 Expired - Lifetime JPH063908B2 (ja)

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JP60043383A JPH063908B2 (ja) 1985-03-05 1985-03-05 デ−タ伝送方式
KR1019860000748A KR950002265B1 (ko) 1985-03-05 1986-02-04 데이터전송시스템
US06/831,875 US4751574A (en) 1985-03-05 1986-02-24 Electronic apparatus control system
CA000502974A CA1282859C (en) 1985-03-05 1986-02-28 Electronic apparatus control system
AT86301509T ATE64666T1 (de) 1985-03-05 1986-03-04 Steuersysteme fuer elektronische einrichtungen.
DE8686301509T DE3679843D1 (de) 1985-03-05 1986-03-04 Steuersysteme fuer elektronische einrichtungen.
EP86301509A EP0194130B1 (en) 1985-03-05 1986-03-04 Electronic apparatus control systems

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JPS61202542A JPS61202542A (ja) 1986-09-08
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KR (1) KR950002265B1 (ja)
AT (1) ATE64666T1 (ja)
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DE (1) DE3679843D1 (ja)

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EP0194130B1 (en) 1991-06-19
CA1282859C (en) 1991-04-09
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