JPS61202542A - デ−タ伝送方式 - Google Patents

デ−タ伝送方式

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JPS61202542A
JPS61202542A JP60043383A JP4338385A JPS61202542A JP S61202542 A JPS61202542 A JP S61202542A JP 60043383 A JP60043383 A JP 60043383A JP 4338385 A JP4338385 A JP 4338385A JP S61202542 A JPS61202542 A JP S61202542A
Authority
JP
Japan
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circuit
controlled
vblk
circuits
period
Prior art date
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JP60043383A
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English (en)
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JPH063908B2 (ja
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Hisao Mogi
茂木 尚雄
Masayuki Suematsu
末松 政之
Yukihiro Fujita
藤田 幸祐
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Sony Corp
Original Assignee
Sony Corp
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Publication date
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Priority to CA000502974A priority patent/CA1282859C/en
Priority to EP86301509A priority patent/EP0194130B1/en
Priority to AT86301509T priority patent/ATE64666T1/de
Priority to DE8686301509T priority patent/DE3679843D1/de
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/38Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40Transmitting circuits; Receiving circuits
    • H04L25/49Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/44Receiver circuitry for the reception of television signals according to analogue transmission standards

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は内部回路をディジタル的に制御するようにした
テレビ受像機、VTR等の映像機器を制御するのに適用
し得るデータ伝送方式に関するものである。
〔発明の概要〕
本発明は、インナーバスシステムが設けられ且つ垂直ブ
ランキング期間にデータの交信を行うようにした映像機
器において、所定の垂直ブランキング期間には特定の被
制御回路と必ず交信を行うことにより、特に早い応答を
要求される被制御回路や常にチェックを要求される被制
御回路に対して優先的に制御が行われるようにしたもの
である。
〔従来の技術〕
ディジタル回路が用いられているテレビ受像機、VTR
、テープレコーダ等の映像機器及び音響機器が背反しつ
つあるが、これらのディジタル化された機器の多くはイ
ンナーバスシステムを採用している。インナーバスシス
テムにおいては、機器内にCPU、インナーバス、RO
M等を設け、上記ROMに各回路の動作設定値を記憶さ
せて置くようにしている。そして通常の動作時には、c
PUにより上記設定値を読出し、読出されたデータをイ
ンナーバスを通じて所定の回路に供給することにより、
各回路に所定の動作を行わせるようにしている。これと
共にキーボードあるいはリモコン等の外部操作によりC
PUを介して各回路を制御するようにしている。このよ
うなインナーバスシステムに用いられるインナーバスと
しては、例えば特開昭57−106262号公報に開示
された通信方式を利用することができる。この方式のパ
スラインはデータの伝送路とクロックの伝送路とを有す
る2線式パスラインである。
上述したインナーハスシステムが設けられた電子機器は
、製造時及びサービス時における調整の標準化1、共通
化及び簡易化等が可能となり、これによって製造コスト
の低減を含む総合的なコストダウンが期待されている。
第4図は上述したインナーバスシステムをテレビ受像機
に適用した場合の従来例を示すもので、本発明を適用し
得るものである。
図において、テレビ受像機には、CPUI、メモリ2、
インナーパスライン3等が設けられている。本例におい
ては被制御回路として、オーディオ処理回路4、ビデオ
制御回路5、ビデオ処理回路6、偏向制御回路7、PL
L回路8及びIF回路9が設けられている。受像機の動
作時には、キーホード11あるいはリモコン用コマンダ
14の指示に応じて、CPUIが各回路4〜9を制御す
る。これによって選局、音量調整、ピクチャー調整等が
行われ、その調整結果が表示部12等で表示される。こ
れと共に各回路4〜9はCPU1によって常に動作状態
を順次にチェックされ、所定の動作に制御されている。
尚13はリモコン信号受信回路、15.16は偏向コイ
ル、17はオーディオ出力アンプ、18はビデオ出力ア
ンプ、19は陰極管である。
上述したテレビ受像機あるいはその他の映像機器の制御
に際して、CPUIから各被制御回路4〜9に制御信号
を送る場合及び各被制御回路4〜9からCPUIに動作
状態を示す信号を送る場合は、制御内容又は動作状態を
示すデータをクロックと共に送る。この場合、クロック
周波数を高くすると、クロックパルスから発生するノイ
ズによる輻射妨害が画面に現われる。これを避けるため
に、従来は映像信号の垂直ブランキング期間(以下単に
VBLKと言う)のみデータの伝送を行う方法を採用し
ている。前記の2線式パスラインを用いてデータを伝送
する場合は、第5図に示すタイミングでクロックとデー
タとが伝送される。
〔発明が解決しようとする問題点〕
データの伝送を行うVBLKは1.17〜1.33m5
ecの長さであり、この期間に例えば100KHzのク
ロックでデータを送るとすると、1回のVBLK中に1
17ビツトのデータ伝送が可能である。
従って、1バイトのデータを1ビツトの確認応答ビット
と共に伝送する場合は、117÷9=13バイトのデー
タの伝送が可能である。
このように1回のVBLK中に伝送できるデータ数は限
られており、従って、CPUと各被制御回路との交信可
能な回数も限られている。さらに待ち時間等を考慮すれ
ば、1回のVBLK中にCPUが必ずしも全ての被制御
回路の動作をチェックしきれない場合が生じる。その場
合、チェックされなかった回路については、次回のVB
LKにおいて交信されることになる。
このため応答時間が長くなることがあり、特にキーボー
ドやリモ゛コンによるチャンネル切替え、画面調整等の
指示に対する応答が遅れることは好ましくない。
c問題点を解決するための手段〕 本発明においては、所定の垂直ブランキング期間内に特
定の被制御回路と常に交信を行う期間を設けている。
〔作用〕
特に早い応答を要求される被制御回路や常にチェックを
要求される被制御回路に対して優先的に制御が行われる
〔実施例〕
第1図は本発明の実施例を示す。
第1図において、CPU等から成る制御回路1はn個の
被制御回路20.〜20、と2線式パスライン3を介し
て接続されている。ハスライン3はクロック伝送ライン
3.とデータ伝送ライン3□とから成る。
本実施例においては、特定の被制御回路20゜に対する
制御を各VBLKにおいて毎回必ず行うようにしている
。このために第2図に示すように各VBLKには、上記
回路20Jに対して毎回交信を行うための期間jが設け
られている。上記回路20.を除く他の回路20.〜2
0.lに対する交信期間1〜nは、1回のVBLKで行
い切れない場合は、図示のように2回のVBLKにわた
って設けられ、場合によっては3回以上のVBLKにわ
たって設けられる。
また毎回のVBLKで必ず制御される特定の回路として
は、上記回路20j一つだけでなく二つ以上あってもよ
い。その場合は毎回のVBLK中に二つ以上の特定の回
路に対する交信期間が設けられる。また特定の回路に対
する交信は毎回のVBLKで行わなくても良く、例えば
一つ置きのVBLK等、所定のVBLKにおいて必ず行
うようにしてもよい。
上記特定の回路20.としては、特に早く応答を要求さ
れる回路が選ばれる。第4図のテレビ受像機の場合は、
キーボード11、コマンダ14等による指示に対して優
先的に応答するように成せば最も効果的である。
第42図のテレビ受像機において、特定の被制御回路を
複数個選ぶとすれば、例えば、PLL回路8、IF回路
9、ビデオ制御回路5、ビデオ処理回路5、キーボード
11及び図示せずも管面表示回路等が挙げられる。
第3図は制御回路と被制御回路との交信を行う場合のフ
ローチャートを示す。
先ずVBLKに入ると、各被制御回路に付されたアドレ
スKをに=1に成し、次に制御回路が先ず特定の被制御
回路と所定期間優先的に交信する。
この交信が終了するとアドレスを一つ進め、次にアドレ
スに+1の回路が特定の回路であるかを判別する。特定
の回路であれば、制御回路と所定期間優先的に交信し、
交信が終了すればアドレスをまた一つ進めて同様の動作
を繰り返す。K+1の回路が特定の回路でない場合は、
制御回路は非特定回路と順次に通常の交信を行う。この
交信はVBLK中に行われ、VBLKが終了すると交信
が終了する。
〔発明の効果〕
インナーパスラインシステムが設けられたテレビ受像機
、VTR等の映像機器において、特に応答速度の早さが
要求される回路を他の回路より優先的に制御したり、チ
ェックすることができる。
従って、垂直ブランキング期間のみに交信を行うように
しても、効率良く交信することができる。
【図面の簡単な説明】
第1図は本発明の実施例を示すブロック図、第2図は第
1図のタイミングチャート、第3図は実施例に関するフ
ローチャート、第4図は本発明を適用し得るインナーパ
スラインシステムが設けられたテレビ受像機のブロック
図、第5図は2線式パスラインにおけるデータ伝送のタ
イミングチャートである。 なお図面に用いた符号において、 1−・−一〜−−−−−−−−−−−制御回路(又はC
PU)20、〜20.−・・被制御回路 20、−−−−−−−−一・・−特定の被制御回路であ
る。

Claims (1)

    【特許請求の範囲】
  1. 制御回路と複数の被制御回路との間で映像信号の垂直ブ
    ランキング期間にインナーバスを通じてデータの交信を
    行うようにした映像機器において、特定の被制御回路と
    常に交信を行う期間を所定の垂直ブランキング期間内に
    設けたことを特徴とするデータ伝送方式。
JP60043383A 1985-03-05 1985-03-05 デ−タ伝送方式 Expired - Lifetime JPH063908B2 (ja)

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JP60043383A JPH063908B2 (ja) 1985-03-05 1985-03-05 デ−タ伝送方式
KR1019860000748A KR950002265B1 (ko) 1985-03-05 1986-02-04 데이터전송시스템
US06/831,875 US4751574A (en) 1985-03-05 1986-02-24 Electronic apparatus control system
CA000502974A CA1282859C (en) 1985-03-05 1986-02-28 Electronic apparatus control system
EP86301509A EP0194130B1 (en) 1985-03-05 1986-03-04 Electronic apparatus control systems
AT86301509T ATE64666T1 (de) 1985-03-05 1986-03-04 Steuersysteme fuer elektronische einrichtungen.
DE8686301509T DE3679843D1 (de) 1985-03-05 1986-03-04 Steuersysteme fuer elektronische einrichtungen.

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JPS61202542A true JPS61202542A (ja) 1986-09-08
JPH063908B2 JPH063908B2 (ja) 1994-01-12

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KR (1) KR950002265B1 (ja)
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CA (1) CA1282859C (ja)
DE (1) DE3679843D1 (ja)

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US4751574A (en) 1988-06-14
EP0194130B1 (en) 1991-06-19
JPH063908B2 (ja) 1994-01-12
EP0194130A1 (en) 1986-09-10
ATE64666T1 (de) 1991-07-15
CA1282859C (en) 1991-04-09
KR950002265B1 (ko) 1995-03-15
DE3679843D1 (de) 1991-07-25

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