JP2679184B2 - ループ形多重化装置 - Google Patents
ループ形多重化装置Info
- Publication number
- JP2679184B2 JP2679184B2 JP30613388A JP30613388A JP2679184B2 JP 2679184 B2 JP2679184 B2 JP 2679184B2 JP 30613388 A JP30613388 A JP 30613388A JP 30613388 A JP30613388 A JP 30613388A JP 2679184 B2 JP2679184 B2 JP 2679184B2
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- JP
- Japan
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- circuit
- time slot
- multiplexed
- multiplexing
- signal
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、１つの多重化装置をノードとし、ループ形
時分割多重伝送路上に複数のノードを配置したときの回
線接続に関し、特に４つのノード内における回線接続に
関するものである。
時分割多重伝送路上に複数のノードを配置したときの回
線接続に関し、特に４つのノード内における回線接続に
関するものである。
従来、この種のループ形多重化装置としては、例えば
第３図に示すものが利用されてきた。同図において、１
はインサート回路（SEL）、２は多重化回路（MUX）、３
は分離回路（DMUX）、４はタイムスロット制御回路（CO
NT）である。
第３図に示すものが利用されてきた。同図において、１
はインサート回路（SEL）、２は多重化回路（MUX）、３
は分離回路（DMUX）、４はタイムスロット制御回路（CO
NT）である。
第３図の装置は、ループ形の時分割多重化された受信
信号ａから、自ノードと回線接続されるタイムスロット
を分離回路３で分離し、一方、多重化回路２で、分離し
たタイムスロットと同一のタイムスロットに回線を多重
化し、インサート回路１にて受信信号ａと組み合わせ、
時分割多重化された送信信号ｂを得る。タイムスロット
制御回路４は上記多重分離、インサートのタイムスロッ
ト制御を行なうものである。
信号ａから、自ノードと回線接続されるタイムスロット
を分離回路３で分離し、一方、多重化回路２で、分離し
たタイムスロットと同一のタイムスロットに回線を多重
化し、インサート回路１にて受信信号ａと組み合わせ、
時分割多重化された送信信号ｂを得る。タイムスロット
制御回路４は上記多重分離、インサートのタイムスロッ
ト制御を行なうものである。
上述した従来のループ形多重化装置は、異なる２つの
ノード間にて任意の回線接続が可能であるが、時分割多
重化された信号のタイムスロット変換機能がないため、
自ノード内の異なる信号源間の双方向回線接続が実現で
きないという欠点があった。
ノード間にて任意の回線接続が可能であるが、時分割多
重化された信号のタイムスロット変換機能がないため、
自ノード内の異なる信号源間の双方向回線接続が実現で
きないという欠点があった。
このような欠点を除去するために本発明は、複数の低
速信号を多重化する第１の多重化回路と、伝送路からの
多重化受信信号に第１の多重化回路の出力である第１の
多重化信号を挿入して伝送路への多重化送信信号を作成
するインサート回路と、多重化受信信号と第１の多重化
信号を多重化する第２の多重化回路と、この第２の多重
化回路の出力をタイムスロット変換するタイムスロット
変換回路と、タイムスロット変換された多重化信号を複
数の低速信号に分離する分離回路と、インサート回路、
第１の多重化回路および分離回路のタイムスロット制御
を行なうタイムスロット制御回路とを設けるようにした
ものである。
速信号を多重化する第１の多重化回路と、伝送路からの
多重化受信信号に第１の多重化回路の出力である第１の
多重化信号を挿入して伝送路への多重化送信信号を作成
するインサート回路と、多重化受信信号と第１の多重化
信号を多重化する第２の多重化回路と、この第２の多重
化回路の出力をタイムスロット変換するタイムスロット
変換回路と、タイムスロット変換された多重化信号を複
数の低速信号に分離する分離回路と、インサート回路、
第１の多重化回路および分離回路のタイムスロット制御
を行なうタイムスロット制御回路とを設けるようにした
ものである。
本発明によるループ形多重化装置においては、タイム
スロット変換が可能となる。
スロット変換が可能となる。
第１図は本発明によるループ形多重化装置の一実施例
を示す系統図であり、第２図は第１図の装置の動作を説
明するためのタイムチャートである。
を示す系統図であり、第２図は第１図の装置の動作を説
明するためのタイムチャートである。
第１図において、１はインサート回路（SEL）、２は
第１の多重化回路（MUX）、３は分離回路（DMUX）、４
はタイムスロット制御回路（COUT）、５は第２の多重化
回路（MUX）、６はタイムスロット変換回路（TSI）であ
る。
第１の多重化回路（MUX）、３は分離回路（DMUX）、４
はタイムスロット制御回路（COUT）、５は第２の多重化
回路（MUX）、６はタイムスロット変換回路（TSI）であ
る。
次に、このように構成された装置の動作について第１
図，第２図を用いて説明する。第１図で、ループ伝送路
からの時分割多重化された受信信号ａ（第２図（ｂ）参
照）は、ノードを通過する回線を実現するためにインサ
ート回路１に入力されるとともに、ノードで時分割多重
化信号を分離するため多重化回路５に入力される。一
方、多重化回路２で多重化された第１の多重化信号ｃ
（第２図（ａ）参照）はループ伝送路へ送信するために
インサート回路１に入力されるとともに、ノード内回線
接続のために多重化回路５に入力される。インサート回
路１は、ノードを通過するバイパス回線と、このノード
から送信し他ノードで受信する回線とをタイムスロット
毎に選択するものであり、伝送路からの多重化受信信号
ａに第１の多重化信号ｃを挿入して伝送路への多重化送
信信号ｂ（第２図（ｆ）参照）を作成する。多重化信号
ａとｃを多重化した第２の多重化信号ｄ（第２図（ｃ）
参照）はタイムスロット変換回路６にてタイムスロット
変換され、多重化信号ｅ（第２図（ｅ）参照）を得る。
このタイムスロット変換回路６にて、第２図（ｃ），
（ｄ）に例示してあるように、a2a3,a5a7とタイム
スロット変換され、さらに分離回路３で分離され、ノー
ド内回線接続が実現される。なお、第２図（ｄ）に示す
信号はタイムスロット変換回路６内部の信号である。
図，第２図を用いて説明する。第１図で、ループ伝送路
からの時分割多重化された受信信号ａ（第２図（ｂ）参
照）は、ノードを通過する回線を実現するためにインサ
ート回路１に入力されるとともに、ノードで時分割多重
化信号を分離するため多重化回路５に入力される。一
方、多重化回路２で多重化された第１の多重化信号ｃ
（第２図（ａ）参照）はループ伝送路へ送信するために
インサート回路１に入力されるとともに、ノード内回線
接続のために多重化回路５に入力される。インサート回
路１は、ノードを通過するバイパス回線と、このノード
から送信し他ノードで受信する回線とをタイムスロット
毎に選択するものであり、伝送路からの多重化受信信号
ａに第１の多重化信号ｃを挿入して伝送路への多重化送
信信号ｂ（第２図（ｆ）参照）を作成する。多重化信号
ａとｃを多重化した第２の多重化信号ｄ（第２図（ｃ）
参照）はタイムスロット変換回路６にてタイムスロット
変換され、多重化信号ｅ（第２図（ｅ）参照）を得る。
このタイムスロット変換回路６にて、第２図（ｃ），
（ｄ）に例示してあるように、a2a3,a5a7とタイム
スロット変換され、さらに分離回路３で分離され、ノー
ド内回線接続が実現される。なお、第２図（ｄ）に示す
信号はタイムスロット変換回路６内部の信号である。
以上説明したように本発明によるループ形多重化装置
は、タイムスロット変換回路を設けたことにより、タイ
ムスロット変換が可能となり、ノード内回線接続を実現
できる効果がある。
は、タイムスロット変換回路を設けたことにより、タイ
ムスロット変換が可能となり、ノード内回線接続を実現
できる効果がある。
この効果は、特に、ノード内の複数の端末からの信号
源を時分割多重化し、ループ形伝送路とは別の同一ノー
ドに接続される伝送路へ送信し、かつその伝送路から時
分割多重化された信号を受信し、上記複数の端末への受
信信号に分離する場合等に大きなものとなる。
源を時分割多重化し、ループ形伝送路とは別の同一ノー
ドに接続される伝送路へ送信し、かつその伝送路から時
分割多重化された信号を受信し、上記複数の端末への受
信信号に分離する場合等に大きなものとなる。
第１図は本発明によるループ形多重化装置の一実施例を
示す系統図、第２図は第１図の装置の動作を説明するた
めのタイムチャート、第３図は従来のループ形多重化装
置を示す系統図である。 １……インサート回路、２……第１の多重化回路、３…
…分離回路、４……タイムスロット制御回路、５……第
２の多重化回路、６……タイムスロット変換回路。
示す系統図、第２図は第１図の装置の動作を説明するた
めのタイムチャート、第３図は従来のループ形多重化装
置を示す系統図である。 １……インサート回路、２……第１の多重化回路、３…
…分離回路、４……タイムスロット制御回路、５……第
２の多重化回路、６……タイムスロット変換回路。
Claims (1)
- 【請求項１】複数の低速信号を多重化する第１の多重化
回路と、伝送路からの多重化受信信号に前記第１の多重
化回路の出力である第１の多重化信号を挿入して伝送路
への多重化送信信号を作成するインサート回路と、前記
多重化受信信号と前記第１の多重化信号を多重化する第
２の多重化回路と、この第２の多重化回路の出力をタイ
ムスロット変換するタイムスロット変換回路と、タイム
スロット変換された多重化信号を複数の低速信号に分離
する分離回路と、前記インサート回路、第１の多重化回
路および分離回路のタイムスロット制御を行なうタイム
スロット制御回路とを備えたことを特徴とするループ形
多重化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30613388A JP2679184B2 (ja) | 1988-12-05 | 1988-12-05 | ループ形多重化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30613388A JP2679184B2 (ja) | 1988-12-05 | 1988-12-05 | ループ形多重化装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02152344A JPH02152344A (ja) | 1990-06-12 |
| JP2679184B2 true JP2679184B2 (ja) | 1997-11-19 |
Family
ID=17953452
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30613388A Expired - Lifetime JP2679184B2 (ja) | 1988-12-05 | 1988-12-05 | ループ形多重化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2679184B2 (ja) |
-
1988
- 1988-12-05 JP JP30613388A patent/JP2679184B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02152344A (ja) | 1990-06-12 |
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