JP2614840B2 - デジタルオーディオ録音再生装置 - Google Patents
デジタルオーディオ録音再生装置Info
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- Control Of Amplification And Gain Control (AREA)
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Description
【０００１】
【産業上の利用分野】本発明は、デジタルオーディオの
録音再生装置に使用するＡＤ・ＤＡ変換回路に関するも
のである。
録音再生装置に使用するＡＤ・ＤＡ変換回路に関するも
のである。
【０００２】
【従来の技術】図１１に従来例の構成をブロック図で示
す。入力端子１１１より入力されたアナログ信号はバッ
ファアンプ１１２，Ｌ.Ｐ.Ｆ１１３，増幅器１１４を経
由してＡＤ変換器１１５に入力されエンコーダ１１６に
よって各種デジタルオーディオフォーマットに変換され
た後、デジタルオーディオ録音再生機１１７に録音され
る。
す。入力端子１１１より入力されたアナログ信号はバッ
ファアンプ１１２，Ｌ.Ｐ.Ｆ１１３，増幅器１１４を経
由してＡＤ変換器１１５に入力されエンコーダ１１６に
よって各種デジタルオーディオフォーマットに変換され
た後、デジタルオーディオ録音再生機１１７に録音され
る。
【０００３】図４の波形図は入力波形を示す図で、波形
はＡＤ変換器に入力される波形であるが、ＡＤ変換器の
アナログ最大入力レベルを越える信号は全てフルスケー
ルデータとなり図５で示す波形データとして録音され
る。この録音されたデータを再生し、図１１に示すデコ
ーダ１１８，ＤＡ変換器１１９，増幅器１２０，Ｌ.Ｐ.
Ｆ１２１，バッファアンプ１２２を経由して出力端子１
２３より出力される。この場合、図５の波形図に示すフ
ルスケール(ＶMax) でクリップした波形が出力される。
はＡＤ変換器に入力される波形であるが、ＡＤ変換器の
アナログ最大入力レベルを越える信号は全てフルスケー
ルデータとなり図５で示す波形データとして録音され
る。この録音されたデータを再生し、図１１に示すデコ
ーダ１１８，ＤＡ変換器１１９，増幅器１２０，Ｌ.Ｐ.
Ｆ１２１，バッファアンプ１２２を経由して出力端子１
２３より出力される。この場合、図５の波形図に示すフ
ルスケール(ＶMax) でクリップした波形が出力される。
【０００４】
【発明が解決しようとする課題】デジタルデータを記録
媒体に記録する場合、記録するビット数はデジタルオー
ディオフォーマットで決められている（例えば１６ビッ
ト）ため、通常ＡＤ変換器はデジタルオーディオフォー
マットの規定のビット数（例えば１６ビット）のものを
使用する。また規定のビット数より大きいビット数をも
つＡＤ変換器（例えば１８ビット）であっても規定のビ
ット数（例えば１６ビット）に変換するため同様であ
る。このＡＤ変換器を使用した場合、平均録音レベル
（例えば−１２ｄＢ）で録音している場合、入力レベル
が急激に大きくなり、ＡＤ変換器の最大入力を越えてし
まい、フルスケールでクリップすることが頻繁に発生す
ることがあった。この様にして録音されたデジタルデー
タをＤＡ変換器で再生・出力すると、フルスケールにク
ランプされたデジタルデータをそのままアナログ信号に
変換するため、フルスケールでクリップした波形の信号
となり、出力の歪が急激に増加し、音質を著しく劣化さ
せるという問題があった。
媒体に記録する場合、記録するビット数はデジタルオー
ディオフォーマットで決められている（例えば１６ビッ
ト）ため、通常ＡＤ変換器はデジタルオーディオフォー
マットの規定のビット数（例えば１６ビット）のものを
使用する。また規定のビット数より大きいビット数をも
つＡＤ変換器（例えば１８ビット）であっても規定のビ
ット数（例えば１６ビット）に変換するため同様であ
る。このＡＤ変換器を使用した場合、平均録音レベル
（例えば−１２ｄＢ）で録音している場合、入力レベル
が急激に大きくなり、ＡＤ変換器の最大入力を越えてし
まい、フルスケールでクリップすることが頻繁に発生す
ることがあった。この様にして録音されたデジタルデー
タをＤＡ変換器で再生・出力すると、フルスケールにク
ランプされたデジタルデータをそのままアナログ信号に
変換するため、フルスケールでクリップした波形の信号
となり、出力の歪が急激に増加し、音質を著しく劣化さ
せるという問題があった。
【０００５】
【課題を解決するための手段】そのため本発明では、ア
ナログ信号をデジタル信号に変換して録音する録音部
と、録音部で録音したデジタル信号をアナログ信号に変
換して再生する再生部を有するデジタルオーディオ録音
再生装置において、規定のビット数より大きいビット数
を有するＡＤ変換器と、ＡＤ変換器から出力されるデジ
タルデータを一時的に保持する録音用データラッチ回路
と、ＡＤ変換器から出力されるデジタルデータの規定ビ
ット数のオーバーフローを検出するオーバーフロー検出
回路と、録音用データラッチ回路の出力信号に一定のオ
フセットデータを加算する録音用加算器と、オーバーフ
ロー検出回路の検出信号で録音用データラッチ回路の出
力信号から録音用加算器の出力信号に切換える録音用信
号切換回路と、録音したデジタル信号を再生し再生信号
を入力する再生用データラッチ回路と、再生信号のフル
スケールデータを検出するフルスケールデータ検出回路
と、再生用データラッチ回路の出力信号に録音部で加算
したオフセットデータ分を減算する再生用加算器と、フ
ルスケールデータ検出回路の検出信号で再生用データラ
ッチ回路の出力信号から再生用加算器の出力信号に切換
える再生用信号切換回路と、信号切換回路の出力信号を
ＤＡ変換する前記ＡＤ変換器と同等かそれ以上のビット
数を有するＤＡ変換器を具備したことを特徴としたもの
である。
ナログ信号をデジタル信号に変換して録音する録音部
と、録音部で録音したデジタル信号をアナログ信号に変
換して再生する再生部を有するデジタルオーディオ録音
再生装置において、規定のビット数より大きいビット数
を有するＡＤ変換器と、ＡＤ変換器から出力されるデジ
タルデータを一時的に保持する録音用データラッチ回路
と、ＡＤ変換器から出力されるデジタルデータの規定ビ
ット数のオーバーフローを検出するオーバーフロー検出
回路と、録音用データラッチ回路の出力信号に一定のオ
フセットデータを加算する録音用加算器と、オーバーフ
ロー検出回路の検出信号で録音用データラッチ回路の出
力信号から録音用加算器の出力信号に切換える録音用信
号切換回路と、録音したデジタル信号を再生し再生信号
を入力する再生用データラッチ回路と、再生信号のフル
スケールデータを検出するフルスケールデータ検出回路
と、再生用データラッチ回路の出力信号に録音部で加算
したオフセットデータ分を減算する再生用加算器と、フ
ルスケールデータ検出回路の検出信号で再生用データラ
ッチ回路の出力信号から再生用加算器の出力信号に切換
える再生用信号切換回路と、信号切換回路の出力信号を
ＤＡ変換する前記ＡＤ変換器と同等かそれ以上のビット
数を有するＤＡ変換器を具備したことを特徴としたもの
である。
【０００６】
【作用】したがって、本発明のデジタルオーディオ録音
再生装置の録音部では、デジタルオーディオフォーマッ
トで決められているオーディオデータのビット数を最大
とするフルスケールデータを検知することができるの
で、ＡＤ変換器で変換後の最大ビット数を越えたデジタ
ルデータ部に対して負のオフセット電圧を加えたデジタ
ルデータに切換えることにより、ＡＤ変換器に入力する
アナログ信号がフルスケールデータを越える信号であっ
ても、その波形の情報をデジタルオーディオ録音再生装
置に録音できるようにした。また、再生部は、再生した
デジタルデータからフルスケールデータを検知し、フル
スケールデータの波形情報によりＡＤ変換時に最大ビッ
ト数を越えたデジタルデータ部に対して行った処理と逆
の処理、即ち正のオフセット電圧を加えたデジタルデー
タに切換えることにより、元の波形を再生するようにし
たものである。
再生装置の録音部では、デジタルオーディオフォーマッ
トで決められているオーディオデータのビット数を最大
とするフルスケールデータを検知することができるの
で、ＡＤ変換器で変換後の最大ビット数を越えたデジタ
ルデータ部に対して負のオフセット電圧を加えたデジタ
ルデータに切換えることにより、ＡＤ変換器に入力する
アナログ信号がフルスケールデータを越える信号であっ
ても、その波形の情報をデジタルオーディオ録音再生装
置に録音できるようにした。また、再生部は、再生した
デジタルデータからフルスケールデータを検知し、フル
スケールデータの波形情報によりＡＤ変換時に最大ビッ
ト数を越えたデジタルデータ部に対して行った処理と逆
の処理、即ち正のオフセット電圧を加えたデジタルデー
タに切換えることにより、元の波形を再生するようにし
たものである。
【０００７】
【実施例】本発明の一実施例を図面により説明する。図
１は本発明を構成するＡＤ変換回路部を示すブロック図
である。ＡＤ変換器１はデジタルオーディオフォーマッ
トのオーディオデータのビット数（例えば１６ビット）
より大きいビット数（例えば１８ビット）を持ち、デー
タラッチ回路２はＡＤ変換器１の出力データを一時的に
保持し、出力データがフルスケールデータ以上となって
いるか判別するオーバーフロー検出回路３及び波形の極
性を示すＭＳＢの出力を保持するＭＳＢ保持回路４に情
報を与える。Ｚの補数表示の場合、ＭＳＢの値は波形が
正の時「０」，負の時「１」である。
１は本発明を構成するＡＤ変換回路部を示すブロック図
である。ＡＤ変換器１はデジタルオーディオフォーマッ
トのオーディオデータのビット数（例えば１６ビット）
より大きいビット数（例えば１８ビット）を持ち、デー
タラッチ回路２はＡＤ変換器１の出力データを一時的に
保持し、出力データがフルスケールデータ以上となって
いるか判別するオーバーフロー検出回路３及び波形の極
性を示すＭＳＢの出力を保持するＭＳＢ保持回路４に情
報を与える。Ｚの補数表示の場合、ＭＳＢの値は波形が
正の時「０」，負の時「１」である。
【０００８】ＡＤ変換器１の実際に動作しているビット
数が規定のビット数（１６ビットのフルスケールデー
タ）より小さい場合、オーバーフロー検出回路３は信号
切換回路５を「オン」，５’を「オフ」としオフセット
データを加算しないデータを出力する。規定のビット数
（１６ビットのフルスケールデータ）より大きい場合は
信号切換回路５を「オフ」，５’を「オン」としＡＤ変
換器１の出力データのうち１６ビット（ＬＳＢ〜）のデ
ータとオフセットデータＤ0 ６を加算器７で加算したデ
ータを出力する。上記により、エンコーダ８に入力する
データは規定のビット（１６ビット）以下であるため、
従来のエンコーダを使用することが可能である。エンコ
ーダ８の出力データはデジタルオーディオ録音再生機９
に録音される。
数が規定のビット数（１６ビットのフルスケールデー
タ）より小さい場合、オーバーフロー検出回路３は信号
切換回路５を「オン」，５’を「オフ」としオフセット
データを加算しないデータを出力する。規定のビット数
（１６ビットのフルスケールデータ）より大きい場合は
信号切換回路５を「オフ」，５’を「オン」としＡＤ変
換器１の出力データのうち１６ビット（ＬＳＢ〜）のデ
ータとオフセットデータＤ0 ６を加算器７で加算したデ
ータを出力する。上記により、エンコーダ８に入力する
データは規定のビット（１６ビット）以下であるため、
従来のエンコーダを使用することが可能である。エンコ
ーダ８の出力データはデジタルオーディオ録音再生機９
に録音される。
【０００９】図２は本発明を構成するＤＡ変換回路のブ
ロック図である。データラッチ回路２１はデジタルオー
ディオ録音再生機２２の信号を復調するデコーダ２３の
データを一時的に保持し、出力データがフルスケールデ
ータとなっているか判別するフルスケールデータ検出回
路２４及び波形の極性を示すＭＳＢの出力を保持するＭ
ＳＢ保持回路２５に情報を与える。フルスケールデータ
検出回路２４がフルスケールデータを検出したとき、信
号切換回路２６を「オフ」，２６’を「オン」とし、波
形の極性に合ったオフセットデータｄ0 ２７と再生した
データとを加算器２８で加算し、ＤＡ変換器２９に入力
する。
ロック図である。データラッチ回路２１はデジタルオー
ディオ録音再生機２２の信号を復調するデコーダ２３の
データを一時的に保持し、出力データがフルスケールデ
ータとなっているか判別するフルスケールデータ検出回
路２４及び波形の極性を示すＭＳＢの出力を保持するＭ
ＳＢ保持回路２５に情報を与える。フルスケールデータ
検出回路２４がフルスケールデータを検出したとき、信
号切換回路２６を「オフ」，２６’を「オン」とし、波
形の極性に合ったオフセットデータｄ0 ２７と再生した
データとを加算器２８で加算し、ＤＡ変換器２９に入力
する。
【００１０】上記の回路構成により、Ｌ.Ｐ.Ｆ３０の出
力には図３で示す波形が再生される。ここで、ＡＤ変換
器１及びＤＡ変換器２９のビット数はデジタルオーディ
オフォーマットで決められたビット数より大きいことが
要求される。（例えば１８ビット又は２０ビット出力の
ＡＤ・ＤＡ変換器等）以上の動作を波形図で説明する。
図４はＡＤ変換器の入力波形図である。図５はＡＤ変換
器が規定のビット数（例えば１６ビット）の場合でフル
スケールでクリップした波形図である。図６はＡＤ変換
器が規定のビット数より大きいビット数（例えば１８ビ
ット）を持つ場合でクリップしていない波形図である。
力には図３で示す波形が再生される。ここで、ＡＤ変換
器１及びＤＡ変換器２９のビット数はデジタルオーディ
オフォーマットで決められたビット数より大きいことが
要求される。（例えば１８ビット又は２０ビット出力の
ＡＤ・ＤＡ変換器等）以上の動作を波形図で説明する。
図４はＡＤ変換器の入力波形図である。図５はＡＤ変換
器が規定のビット数（例えば１６ビット）の場合でフル
スケールでクリップした波形図である。図６はＡＤ変換
器が規定のビット数より大きいビット数（例えば１８ビ
ット）を持つ場合でクリップしていない波形図である。
【００１１】デジタルオーディオ録音再生機９は規定の
ビット数より大きいビットを録音できないため、図６の
データをそのまま録音することができない。図６と等価
の波形とするために、図５の波形のフルスケール部に対
して一定のオフセットデータを加算した波形、図７と規
定のビットを越えた部分の波形、図８のオーバーフロー
データを加算し、図９に示す波形に変換する。デジタル
オーディオ録音再生機に録音する波形データは図９の波
形である。
ビット数より大きいビットを録音できないため、図６の
データをそのまま録音することができない。図６と等価
の波形とするために、図５の波形のフルスケール部に対
して一定のオフセットデータを加算した波形、図７と規
定のビットを越えた部分の波形、図８のオーバーフロー
データを加算し、図９に示す波形に変換する。デジタル
オーディオ録音再生機に録音する波形データは図９の波
形である。
【００１２】図９の波形データを再生すると、データ列
が図１０に示す通り（…Ｄi-1，Ｄi−ｄ0，Ｄi+1−ｄ
0，…Ｄi+n−ｄ0，Ｄi+n+1…）となっている。Ｄi-1，
Ｄi+n+1は必ずフルスケールデータであるからこのデー
タにはさまれたデータ（Ｄi−ｄ0，…Ｄi+n−ｄ0）は必
ずオフセットデータ−ｄ0が加算されている。従って、
（Ｄi−ｄ0，…Ｄi+n−ｄ0）のデータに対してオフセッ
トデータｄ0 を加算すれば図３のように元の波形を再生
することができる。オフセットデータｄ0 を加算後のデ
ータ列は（…Ｄi-1，Ｄi，Ｄi+1，…Ｄi+n，Ｄi+n+1
…）となる。ここでフルスケールデータは幅を持ったデ
ータであっても良い。
が図１０に示す通り（…Ｄi-1，Ｄi−ｄ0，Ｄi+1−ｄ
0，…Ｄi+n−ｄ0，Ｄi+n+1…）となっている。Ｄi-1，
Ｄi+n+1は必ずフルスケールデータであるからこのデー
タにはさまれたデータ（Ｄi−ｄ0，…Ｄi+n−ｄ0）は必
ずオフセットデータ−ｄ0が加算されている。従って、
（Ｄi−ｄ0，…Ｄi+n−ｄ0）のデータに対してオフセッ
トデータｄ0 を加算すれば図３のように元の波形を再生
することができる。オフセットデータｄ0 を加算後のデ
ータ列は（…Ｄi-1，Ｄi，Ｄi+1，…Ｄi+n，Ｄi+n+1
…）となる。ここでフルスケールデータは幅を持ったデ
ータであっても良い。
【００１３】
【発明の効果】本発明のデジタルオーディオ録音再生装
置によれば、ＡＤ変換器で変換されるデジタルデータが
規定ビット数を越、えるような、大きなレベルのアナロ
グ信号が録音部に入力されてもその波形情報を録音する
ことができ、再生部で再生したアナログ信号は、録音時
のアナログ信号に対してレベルの変化や歪の増加を伴う
ことなく出力することができる。
置によれば、ＡＤ変換器で変換されるデジタルデータが
規定ビット数を越、えるような、大きなレベルのアナロ
グ信号が録音部に入力されてもその波形情報を録音する
ことができ、再生部で再生したアナログ信号は、録音時
のアナログ信号に対してレベルの変化や歪の増加を伴う
ことなく出力することができる。
【図１】本発明の一実施例を示すブロック図。
【図２】本発明の一実施例を示すブロック図。
【図３】本発明を説明するための波形図。
【図４】本発明を説明するための波形図。
【図５】本発明を説明するための波形図。
【図６】本発明を説明するための波形図。
【図７】本発明を説明するための波形図。
【図８】本発明を説明するための波形図。
【図９】本発明を説明するための波形図。
【図１０】本発明を説明するための波形図。
【図１１】従来例を示すブロック図。
１，１１５ ＡＤ変換器 ２，２１ データラッチ回路 ３， オーバーフロー検出
回路 ４，２５ ＭＳＢ保持回路 ５，５’，２６，２６’ 信号切換回路 ６， オフセットデータｄ
0 ７，２８ 加算器 ８，１１６ エンコーダ ９，２２，１１７ デジタルオーディオ
録音再生機 １０，３０，１１３，１２１ Ｌ.Ｐ.Ｆ １１，３１ 増幅器 ２３，１１８ デコーダ ２４ フルスケールデータ
検出回路 ２７ オフセットデータＤ
ｏ ２９，１１９ ＤＡ変換器 １１１ 入力端子 １１２，１１４，１２０，１２２ バッファアンプ １２３ 出力端子
回路 ４，２５ ＭＳＢ保持回路 ５，５’，２６，２６’ 信号切換回路 ６， オフセットデータｄ
0 ７，２８ 加算器 ８，１１６ エンコーダ ９，２２，１１７ デジタルオーディオ
録音再生機 １０，３０，１１３，１２１ Ｌ.Ｐ.Ｆ １１，３１ 増幅器 ２３，１１８ デコーダ ２４ フルスケールデータ
検出回路 ２７ オフセットデータＤ
ｏ ２９，１１９ ＤＡ変換器 １１１ 入力端子 １１２，１１４，１２０，１２２ バッファアンプ １２３ 出力端子
Claims (1)
- 【請求項１】 アナログ信号をデジタル信号に変換して
録音する録音部と、録音部で録音したデジタル信号をア
ナログ信号に変換して再生する再生部を有するデジタル
オーディオ録音再生装置において、規定のビット数より
大きいビット数を有するＡＤ変換器と、該ＡＤ変換器か
ら出力されるデジタルデータを一時的に保持して出力す
る録音用データラッチ回路と、前記ＡＤ変換器から出力
されるデジタルデータの規定ビット数のオーバーフロー
を検出するオーバーフロー検出回路と、前記録音用デー
タラッチ回路の出力信号に一定のオフセットデータを加
算する録音用加算器と、前記オーバーフロー検出回路の
検出信号で前記録音用データラッチ回路の出力信号から
前記録音用加算器の出力信号に切換える録音用信号切換
回路と、録音した前記デジタル信号を再生し再生信号を
入力する再生用データラッチ回路と、前記再生信号のフ
ルスケールデータを検出するフルスケールデータ検出回
路と、前記再生用データラッチ回路の出力信号に前記録
音部で加算したオフセットデータ分を減算する再生用加
算器と、前記フルスケールデータ検出回路の検出信号で
前記再生用データラッチ回路の出力信号から前記再生用
加算器の出力信号に切換える再生用信号切換回路と、該
信号切換回路の出力信号をＤＡ変換する前記ＡＤ変換器
と同等かそれ以上のビット数を有するＤＡ変換器を具備
したことを特徴とするデジタルオーディオ録音再生装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5205654A JP2614840B2 (ja) | 1993-07-28 | 1993-07-28 | デジタルオーディオ録音再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5205654A JP2614840B2 (ja) | 1993-07-28 | 1993-07-28 | デジタルオーディオ録音再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0744999A JPH0744999A (ja) | 1995-02-14 |
| JP2614840B2 true JP2614840B2 (ja) | 1997-05-28 |
Family
ID=16510477
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5205654A Expired - Fee Related JP2614840B2 (ja) | 1993-07-28 | 1993-07-28 | デジタルオーディオ録音再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2614840B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4432530B2 (ja) | 2004-02-23 | 2010-03-17 | パナソニック株式会社 | デジタル信号処理アンプ |
| WO2012057157A1 (ja) | 2010-10-29 | 2012-05-03 | ライオン株式会社 | 歯ブラシ |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS624570A (ja) * | 1985-07-01 | 1987-01-10 | Mazda Motor Corp | 研削制御装置 |
-
1993
- 1993-07-28 JP JP5205654A patent/JP2614840B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0744999A (ja) | 1995-02-14 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19961217 |
|
| S531 | Written request for registration of change of domicile |
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| S111 | Request for change of ownership or part of ownership |
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| R360 | Written notification for declining of transfer of rights |
Free format text: JAPANESE INTERMEDIATE CODE: R360 |
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Free format text: JAPANESE INTERMEDIATE CODE: R370 |
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