JP2523056B2 - 制御回路 - Google Patents
制御回路Info
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- JP2523056B2 JP2523056B2 JP2287481A JP28748190A JP2523056B2 JP 2523056 B2 JP2523056 B2 JP 2523056B2 JP 2287481 A JP2287481 A JP 2287481A JP 28748190 A JP28748190 A JP 28748190A JP 2523056 B2 JP2523056 B2 JP 2523056B2
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Description
【発明の詳細な説明】 （イ）産業上の利用分野 本発明は、主制御と副制御により被制御回路を制御す
る制御回路に関するもので、特に主制御と副制御とのト
ータルの制御量を制限することが出来る制御回路に関す
る。
る制御回路に関するもので、特に主制御と副制御とのト
ータルの制御量を制限することが出来る制御回路に関す
る。
（ロ）従来の技術 主制御と副制御の２つで被制御回路を制御するものと
してテレビジョン受像機の輝度レベルの調整がある。第
２図は、そのような制御回路を示すもので視聴者が好み
により手動で輝度信号レベルを調整する主制御と、ABL
（自動輝度制限）回路により、自動的に輝度信号のレベ
ルを調整する副制御との場合である。第２図で、ABL回
路が働かないような通常動作時には、入力端子（１）か
らの映像信号が輝度調整回路（２）で好みのレベルに調
整された後、映像増幅トランジスタ（３）で増幅され、
更にRGB出力回路（４）で３つの色差信号と各々混合さ
れる。その結果、R,G,Bの原色信号がブラウン管（５）
のカソード電極に印加される。この時、ダイオード
（６）を図示の方向に流れるアノード電流IAは、所定値
以下の小さい値である。すると、トラジスタ（７）のエ
ミッタ電圧VEは、高い値となっており、トランジスタ
（７）はオフしている。
してテレビジョン受像機の輝度レベルの調整がある。第
２図は、そのような制御回路を示すもので視聴者が好み
により手動で輝度信号レベルを調整する主制御と、ABL
（自動輝度制限）回路により、自動的に輝度信号のレベ
ルを調整する副制御との場合である。第２図で、ABL回
路が働かないような通常動作時には、入力端子（１）か
らの映像信号が輝度調整回路（２）で好みのレベルに調
整された後、映像増幅トランジスタ（３）で増幅され、
更にRGB出力回路（４）で３つの色差信号と各々混合さ
れる。その結果、R,G,Bの原色信号がブラウン管（５）
のカソード電極に印加される。この時、ダイオード
（６）を図示の方向に流れるアノード電流IAは、所定値
以下の小さい値である。すると、トラジスタ（７）のエ
ミッタ電圧VEは、高い値となっており、トランジスタ
（７）はオフしている。
この状態から何らかの理由により、輝度が異常に上が
り過ぎたとすると、前記アノード電流IAが増加し、ある
所定値を超えたとする。すると、前記電圧VEが低下し、
トランジスタ（７）がオンし始める。すると、映像増幅
トランジスタ（３）のベース電圧が低下し、RGB出力回
路（４）を介してブラウン管（５）内のカソード電極電
圧を低下させる。
り過ぎたとすると、前記アノード電流IAが増加し、ある
所定値を超えたとする。すると、前記電圧VEが低下し、
トランジスタ（７）がオンし始める。すると、映像増幅
トランジスタ（３）のベース電圧が低下し、RGB出力回
路（４）を介してブラウン管（５）内のカソード電極電
圧を低下させる。
従って、第２図の回路では、手動と自動の２つの制御
系で輝度レベルを制御している。
系で輝度レベルを制御している。
（ハ）発明が解決しようとする課題 しかしながら、第２図の回路では手動と自動の２つの
制御が無関係に独立して行なわれる為、トータルの制御
量が設定されていなかった。その為、過大な制御が行な
われる場合があり、画質上好ましくなかった。
制御が無関係に独立して行なわれる為、トータルの制御
量が設定されていなかった。その為、過大な制御が行な
われる場合があり、画質上好ましくなかった。
（ニ）課題を解決するための手段 本発明は、上述の点に鑑み成されたもので、エミッタ
が共通接続された第１及び第２のトランジスタから成
り、該第１及び第２のトランジスタのベース間に主制御
信号を印加し、前記第１のトランジスタのコレクタから
第１の制御信号を発生する第１の差動増幅器と、前記第
２のトランジスタのコレクタ電流と前記第１のトランジ
スタのコレクタ電流との差を検出する検出手段と、該検
出手段の出力電流を動作電流とし、副制御信号に応じて
前記動作電流を分流し、分流したものを第２の制御信号
として発生する第２の差動増幅器と、前記第１及び第２
の制御信号が加算されて供給される被制御回路と、から
成ることを特徴とする。
が共通接続された第１及び第２のトランジスタから成
り、該第１及び第２のトランジスタのベース間に主制御
信号を印加し、前記第１のトランジスタのコレクタから
第１の制御信号を発生する第１の差動増幅器と、前記第
２のトランジスタのコレクタ電流と前記第１のトランジ
スタのコレクタ電流との差を検出する検出手段と、該検
出手段の出力電流を動作電流とし、副制御信号に応じて
前記動作電流を分流し、分流したものを第２の制御信号
として発生する第２の差動増幅器と、前記第１及び第２
の制御信号が加算されて供給される被制御回路と、から
成ることを特徴とする。
（ホ）作用 本発明に依れば、主制御を行なう第１の差動増幅器の
２つの出力信号の差を検出し、その検出出力を副制御を
行なう第２の差動増幅器の動作電流源としている。その
為、前記第１の差動増幅器の２つの出力信号の差の値を
設定することで、主制御及び副制御による最大の制御量
が設定できる。
２つの出力信号の差を検出し、その検出出力を副制御を
行なう第２の差動増幅器の動作電流源としている。その
為、前記第１の差動増幅器の２つの出力信号の差の値を
設定することで、主制御及び副制御による最大の制御量
が設定できる。
（ヘ）実施例 第１図は、本発明の一実施例を示す回路図で、（８）
はエミッタが共通接続された第１及び第２のトランジス
タ（９）及び（10）から成る第１差動増幅器、（11）は
エミッタが共通接続された第３及び第４のトランジスタ
（12）及び（13）から成る第２差動増幅器、（14）は第
１の制御信号が印加される第１の制御端子、（15）は第
１乃至第３電流ミラー回路（16）乃至（18）から成る減
算回路、（19）は前記減算回路（15）の出力電流を反転
する第４電流ミラー回路、（20）は前記第４電流ミラー
回路（19）の出力電流を第２の制御端子（21）からの第
２の制御信号に応じて分流する第３差動増幅器、及び
（22）は被制御回路である。
はエミッタが共通接続された第１及び第２のトランジス
タ（９）及び（10）から成る第１差動増幅器、（11）は
エミッタが共通接続された第３及び第４のトランジスタ
（12）及び（13）から成る第２差動増幅器、（14）は第
１の制御信号が印加される第１の制御端子、（15）は第
１乃至第３電流ミラー回路（16）乃至（18）から成る減
算回路、（19）は前記減算回路（15）の出力電流を反転
する第４電流ミラー回路、（20）は前記第４電流ミラー
回路（19）の出力電流を第２の制御端子（21）からの第
２の制御信号に応じて分流する第３差動増幅器、及び
（22）は被制御回路である。
第１図において、第１の制御信号VCTL1が主制御信号
であり、第２の制御信号VCTL2が副制御信号である。主
制御の第１の制御信号VCTL1は、一旦ある直流電圧に設
定されると、その状態を継続し、この状態で副制御の第
２の制御信号VCTL2が加わるとする。第１の制御信号V
CTL1に応じて第１トランジスタ（９）のコレクタには電
流ICTL1が、第２トランジスタ（10）のコレクタには電
流I1が流れる。同様に第３トランジスタ（12）のコレク
タには電流I1が、第４トランジスタ（13）のコレクタに
は電流ICTL1が流れる。すると、減算回路（15）内のト
ランジスタ（23）のコレクタには電流I1が、トラジスタ
（24）のコレクタには電流ICTL1が流れるので、出力端
Ａに流れる電流ΔＩは、 ΔＩ＝I1−ICTL1 ……（１） となる。ここで、第１の制御信号VCTL1は、基準電源（2
5）の基準電圧Vrefより高く設定し、電流I1の方が電流I
CTL1より大であれば前記電流ΔＩは、正の値となる。第
１及び第２定電流源（26）及び（27）の電流値をI0とす
ると、前記電流I1は、 I1＝I0−ICTL1 ……（２） と表わされ、第（１）式の電流ΔＩは、 ΔＩ＝I0−2ICTL1 ……（３） となる。第４電流ミラー回路（19）の入出力間の電流ミ
ラー比をn:1とすると、第３差動増幅器（20）を構成す
るトランジスタ（28）及び（29）の共通エミッタに流れ
る電流はΔI/nとなる。第２の制御端子（21）からの第
２の制御信号VCTL2に応じてトランジスタ（28）のコレ
クタに流れる電流をICTL2とすると、電流ICTL2は０から
ΔI/nまでの変化範囲を有することになる。ここで、前
記ミラー比ｎを２とすると電流ICTL2は、 となる。つまり、第２の制御信号VCTL2によって第３差
動増幅器（20）は、最大で第（４）式の値の電流を制御
出来る。その為、被制御回路（22）に流れる電流（I
CTL1＋ICTL2）は、 となる。第（５）式から明らかなように被制御回路（2
2）に流れる電流は、主制御と副制御によるトータルで
最大I0/2となり、トータルの制御量を制限することが出
来る。即ち、第１差動増幅器（８）のバランス状態を限
界とした制御が可能である。
であり、第２の制御信号VCTL2が副制御信号である。主
制御の第１の制御信号VCTL1は、一旦ある直流電圧に設
定されると、その状態を継続し、この状態で副制御の第
２の制御信号VCTL2が加わるとする。第１の制御信号V
CTL1に応じて第１トランジスタ（９）のコレクタには電
流ICTL1が、第２トランジスタ（10）のコレクタには電
流I1が流れる。同様に第３トランジスタ（12）のコレク
タには電流I1が、第４トランジスタ（13）のコレクタに
は電流ICTL1が流れる。すると、減算回路（15）内のト
ランジスタ（23）のコレクタには電流I1が、トラジスタ
（24）のコレクタには電流ICTL1が流れるので、出力端
Ａに流れる電流ΔＩは、 ΔＩ＝I1−ICTL1 ……（１） となる。ここで、第１の制御信号VCTL1は、基準電源（2
5）の基準電圧Vrefより高く設定し、電流I1の方が電流I
CTL1より大であれば前記電流ΔＩは、正の値となる。第
１及び第２定電流源（26）及び（27）の電流値をI0とす
ると、前記電流I1は、 I1＝I0−ICTL1 ……（２） と表わされ、第（１）式の電流ΔＩは、 ΔＩ＝I0−2ICTL1 ……（３） となる。第４電流ミラー回路（19）の入出力間の電流ミ
ラー比をn:1とすると、第３差動増幅器（20）を構成す
るトランジスタ（28）及び（29）の共通エミッタに流れ
る電流はΔI/nとなる。第２の制御端子（21）からの第
２の制御信号VCTL2に応じてトランジスタ（28）のコレ
クタに流れる電流をICTL2とすると、電流ICTL2は０から
ΔI/nまでの変化範囲を有することになる。ここで、前
記ミラー比ｎを２とすると電流ICTL2は、 となる。つまり、第２の制御信号VCTL2によって第３差
動増幅器（20）は、最大で第（４）式の値の電流を制御
出来る。その為、被制御回路（22）に流れる電流（I
CTL1＋ICTL2）は、 となる。第（５）式から明らかなように被制御回路（2
2）に流れる電流は、主制御と副制御によるトータルで
最大I0/2となり、トータルの制御量を制限することが出
来る。即ち、第１差動増幅器（８）のバランス状態を限
界とした制御が可能である。
第１図の第１の制御信号VCTL1を手動の輝度調整信
号、第２の制御信号VCTL2をABL回路からの制御信号と
し、被制御経路（22）を輝度調整の被制御回路で抵抗負
荷とすると、輝度調整の特性は、第３図の如くなる。第
３図で、ビーム電流の値が小さく前記信号VCTL2が大き
な値であり、トランジスタ（28）がオフ、トランジスタ
（29）がオンであるとすると、電流ICTL2は０であるの
で、電流ICTL1のみによって定まる輝度レベルで一定の
値となっている。この状態からビーム電流の値が増加
し、前記信号VCTL2が低下すると、前記電流ICTL2が流れ
始め、輝度レベルが徐々に低下する。更にビーム電流が
増加するが、電流ICTL2は所定値以上増加せずトータル
の電流はI0/2で制限され、輝度レベルも一定値で制限さ
れる。
号、第２の制御信号VCTL2をABL回路からの制御信号と
し、被制御経路（22）を輝度調整の被制御回路で抵抗負
荷とすると、輝度調整の特性は、第３図の如くなる。第
３図で、ビーム電流の値が小さく前記信号VCTL2が大き
な値であり、トランジスタ（28）がオフ、トランジスタ
（29）がオンであるとすると、電流ICTL2は０であるの
で、電流ICTL1のみによって定まる輝度レベルで一定の
値となっている。この状態からビーム電流の値が増加
し、前記信号VCTL2が低下すると、前記電流ICTL2が流れ
始め、輝度レベルが徐々に低下する。更にビーム電流が
増加するが、電流ICTL2は所定値以上増加せずトータル
の電流はI0/2で制限され、輝度レベルも一定値で制限さ
れる。
上述の例では電流の最大値がI0/2であったが、これよ
り大きくすることも小さくすることも第４電流ミラー回
路（19）のミラー比を変えることで可能である。例え
ば、ミラー比を3:1にするならば第１図の電流ICTL2の最
大値が低下することになり、第３図での制限値（I0/2）
より高いレベルで制限される。逆にミラー比を1:1にす
るならば、前記電流ICTL2の最大値が増加し、第３図の
制限値より低いレベルでの制限が可能となる。
り大きくすることも小さくすることも第４電流ミラー回
路（19）のミラー比を変えることで可能である。例え
ば、ミラー比を3:1にするならば第１図の電流ICTL2の最
大値が低下することになり、第３図での制限値（I0/2）
より高いレベルで制限される。逆にミラー比を1:1にす
るならば、前記電流ICTL2の最大値が増加し、第３図の
制限値より低いレベルでの制限が可能となる。
第３図の制限値を変える方法には減算回路（15）によ
るものでも良い。例えば、トランジスタ（23）及び（2
4）をマルチコレクタ型の構成にして、一部のコレクタ
出力を利用しても良い。
るものでも良い。例えば、トランジスタ（23）及び（2
4）をマルチコレクタ型の構成にして、一部のコレクタ
出力を利用しても良い。
（ト）発明の効果 以上述べた如く、本発明は依れば主制御側の設定によ
り、主制御と副制御によるトータルの制御量を制限する
ことが出来る。又、本発明に依ればトータルの制御量の
値を電流ミラー回路のミラー比を変えるだけで簡単に変
更することが出来る。
り、主制御と副制御によるトータルの制御量を制限する
ことが出来る。又、本発明に依ればトータルの制御量の
値を電流ミラー回路のミラー比を変えるだけで簡単に変
更することが出来る。
第１図は、本発明の一実施例を示す回路図、第２図は、
従来のテレビジョン受像機を示す回路図、及び第３図は
第１図の説明に供する為の特性図である。 （８）……第１差動増幅器、（15）……減算回路、（1
9）……第４電流ミラー回路、（20）……第３差動増幅
器、（22）……被制御回路。
従来のテレビジョン受像機を示す回路図、及び第３図は
第１図の説明に供する為の特性図である。 （８）……第１差動増幅器、（15）……減算回路、（1
9）……第４電流ミラー回路、（20）……第３差動増幅
器、（22）……被制御回路。
Claims (4)
- 【請求項１】エミッタが共通接続された第１及び第２の
トランジスタから成り、該第１及び第２のトランジスタ
のベース間に主制御信号を印加し、前記第１のトランジ
スタのコレクタから第１の制御信号を発生する第１の差
動増幅器と、 前記第２のトランジスタのコレクタ電流と前記第１のト
ランジスタのコレクタ電流との差を検出する検出手段
と、 該検出手段の出力電流を動作電流とし、副制御信号に応
じて前記動作電流を分流し、分流したものを第２の制御
信号として発生する第２の差動増幅器と、 前記第１及び第２の制御信号が加算されて供給される被
制御回路と、 から成ることを特徴とする制御回路。 - 【請求項２】前記検出手段と前記第２の差動増幅器との
間に電流ミラー回路が接続されていることを特徴とする
請求項第１項記載の制御回路。 - 【請求項３】前記電流ミラー回路のミラー比はn:1（ｎ
は正の整数）であることを特徴とする請求項第２項記載
の制御回路。 - 【請求項４】前記第１の制御信号は、テレビジョン受像
機における輝度調整信号であり、前記第２の制御信号は
テレビジョン受像機における自動輝度制限信号であるこ
とを特徴とする請求項第１項記載の制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2287481A JP2523056B2 (ja) | 1990-10-24 | 1990-10-24 | 制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2287481A JP2523056B2 (ja) | 1990-10-24 | 1990-10-24 | 制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04160886A JPH04160886A (ja) | 1992-06-04 |
| JP2523056B2 true JP2523056B2 (ja) | 1996-08-07 |
Family
ID=17717900
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2287481A Expired - Fee Related JP2523056B2 (ja) | 1990-10-24 | 1990-10-24 | 制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2523056B2 (ja) |
-
1990
- 1990-10-24 JP JP2287481A patent/JP2523056B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04160886A (ja) | 1992-06-04 |
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Legal Events
| Date | Code | Title | Description |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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