JP2516921B2 - 画像情報読み取り・格納装置 - Google Patents
画像情報読み取り・格納装置Info
- Publication number
- JP2516921B2 JP2516921B2 JP61155336A JP15533686A JP2516921B2 JP 2516921 B2 JP2516921 B2 JP 2516921B2 JP 61155336 A JP61155336 A JP 61155336A JP 15533686 A JP15533686 A JP 15533686A JP 2516921 B2 JP2516921 B2 JP 2516921B2
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- Japan
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- color
- image
- output
- data
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- Facsimile Scanning Arrangements (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は、フルカラー複写機等において原稿を読み取
り、メモリ内へそのデータの格納を行うために用いる画
像情報読み取り・格納装置に関するものである。従来の
技術 従来よりカラー画像、例えばカラー原稿等の読み取り
にはダイクロイックミラーを用いて、原稿からの反射光
を赤（以下Ｒと記す）、緑（以下Ｇと記す）、青（以下
Ｂと記す）等の光の三原色に分離し、これを３個のCCD
等のイメージセンサにそれぞれ照射して、それぞれの色
濃度を得るごとく構成していた。その一例を第５図に示
す。16はダイクロイックミラーおよびレンズで、原稿か
らの反射光をR,G,B等の三原色に分離する。17,18,19は
それぞれR,G,B分離光に対応するCCD等のイメージセン
サ、20,21,22はそれぞれ対応するイメージセンサの出力
バッファアンプ、23、24、25はそれぞれ対応するバッフ
ァアンプの出力をディジタルデータに変換するアナログ
−ディジタル変換器（以下A/D変換器という）、26,27,2
8はそれぞれ対応するA/D変換器の出力をクロックΦに同
期して記憶するラインメモリである。29は前記イメージ
センサのスタート信号およびクロック信号を与える制御
クロック回路、30はスタート信号によりリセットされ、
クロック信号の立ち上がりで＋１カウントされるライト
アドレスカウンタである。
り、メモリ内へそのデータの格納を行うために用いる画
像情報読み取り・格納装置に関するものである。従来の
技術 従来よりカラー画像、例えばカラー原稿等の読み取り
にはダイクロイックミラーを用いて、原稿からの反射光
を赤（以下Ｒと記す）、緑（以下Ｇと記す）、青（以下
Ｂと記す）等の光の三原色に分離し、これを３個のCCD
等のイメージセンサにそれぞれ照射して、それぞれの色
濃度を得るごとく構成していた。その一例を第５図に示
す。16はダイクロイックミラーおよびレンズで、原稿か
らの反射光をR,G,B等の三原色に分離する。17,18,19は
それぞれR,G,B分離光に対応するCCD等のイメージセン
サ、20,21,22はそれぞれ対応するイメージセンサの出力
バッファアンプ、23、24、25はそれぞれ対応するバッフ
ァアンプの出力をディジタルデータに変換するアナログ
−ディジタル変換器（以下A/D変換器という）、26,27,2
8はそれぞれ対応するA/D変換器の出力をクロックΦに同
期して記憶するラインメモリである。29は前記イメージ
センサのスタート信号およびクロック信号を与える制御
クロック回路、30はスタート信号によりリセットされ、
クロック信号の立ち上がりで＋１カウントされるライト
アドレスカウンタである。
以下、その動作についてＲの分離光が入光した時より
Ｒのカラーデータが出力されるまでを説明する。カラー
原稿からのＲの分離光が入射されているＲの分離光受光
用イメージセンサ17は、制御クロック回路29からスター
ト信号が入力されると、クロック信号Φに従って順次デ
ータを送出する。次にこの送出されたデータをバッファ
アンプ20で一定のレベルまで増幅した後、A/D変換器23
によりイメージセンサ17の出力データをディジタルデー
タに変換し、そのディジタルデータをラインメモリ26に
書き込みＲカラーデータとする。ラインメモリ26はCPU
等の外部装置によりR/W（リードライト）ラインを“L"
レベルにされており、書き込みモードになっているの
で、ライトアドレスカウンタ30は、前記クロック信号Φ
の立ち上がりで＋１ずつ加算されるから、前記イメージ
センサからの出力データは順次ディジタル化されたデー
タとなってラインメモリ26に書き込まれて行く。イメー
ジセンサよりのデータがすべて書き込まれ、制御クロッ
ク回路29より次のスタート信号が出されるとCPU等外部
装置は、R/W信号を“H"とし、ラインメモリ26を読み出
しモードにする。ここでCPU等外部装置はラインメモリ2
6にリードアドレスを与え、イメージセンサ17のデータ
の読み出しを行う。このようにして、カラー原稿等のＲ
カラーデータを読み出すことができる。同様にしてG,B
のデータも読み出すことができ、カラー原稿のカラーデ
ータ読み出しができることになる。
Ｒのカラーデータが出力されるまでを説明する。カラー
原稿からのＲの分離光が入射されているＲの分離光受光
用イメージセンサ17は、制御クロック回路29からスター
ト信号が入力されると、クロック信号Φに従って順次デ
ータを送出する。次にこの送出されたデータをバッファ
アンプ20で一定のレベルまで増幅した後、A/D変換器23
によりイメージセンサ17の出力データをディジタルデー
タに変換し、そのディジタルデータをラインメモリ26に
書き込みＲカラーデータとする。ラインメモリ26はCPU
等の外部装置によりR/W（リードライト）ラインを“L"
レベルにされており、書き込みモードになっているの
で、ライトアドレスカウンタ30は、前記クロック信号Φ
の立ち上がりで＋１ずつ加算されるから、前記イメージ
センサからの出力データは順次ディジタル化されたデー
タとなってラインメモリ26に書き込まれて行く。イメー
ジセンサよりのデータがすべて書き込まれ、制御クロッ
ク回路29より次のスタート信号が出されるとCPU等外部
装置は、R/W信号を“H"とし、ラインメモリ26を読み出
しモードにする。ここでCPU等外部装置はラインメモリ2
6にリードアドレスを与え、イメージセンサ17のデータ
の読み出しを行う。このようにして、カラー原稿等のＲ
カラーデータを読み出すことができる。同様にしてG,B
のデータも読み出すことができ、カラー原稿のカラーデ
ータ読み出しができることになる。
発明が解決しようとする問題点 しかしながらこのような構成では、R,G,B等三原色分
離のためのダイクロイックミラーは高価であること、ま
たイメージセンサ以後の回路が３組必要となることを考
えると全体として非常に高価なものになってしまう。こ
のため近年R,G,B等三原色を１個で同時に読み取ること
のできるカラーイメージセンサが発表されている。これ
は、イメージセンサ受光部にR,G,B各フィルターを順次
オンチップで形成したもので、その構造を第６図、また
その動作タイムチャートを第７図に示す。
離のためのダイクロイックミラーは高価であること、ま
たイメージセンサ以後の回路が３組必要となることを考
えると全体として非常に高価なものになってしまう。こ
のため近年R,G,B等三原色を１個で同時に読み取ること
のできるカラーイメージセンサが発表されている。これ
は、イメージセンサ受光部にR,G,B各フィルターを順次
オンチップで形成したもので、その構造を第６図、また
その動作タイムチャートを第７図に示す。
しかしながら、第７図でわかるように、R,G,Bのカラ
ーデータは入力されるクロック信号Φに従ってR1,G1,B
1,R2,……,Rn,Gn,Bnの順に直列に出力されるために、色
分離回路が複雑になるという欠点を持っていた。
ーデータは入力されるクロック信号Φに従ってR1,G1,B
1,R2,……,Rn,Gn,Bnの順に直列に出力されるために、色
分離回路が複雑になるという欠点を持っていた。
問題点を解決するための手段 本発明は上記問題点を解決するために、読み込んだ画
像信号を複数の原色信号に変換する画像信号変換手段
と、画像読み取りを開始する走査開始信号及びクロック
信号を出力する制御クロック手段と、前記制御クロック
手段からクロック信号を受信して原色信号を構成する構
成信号の各々が格納されるべき登録領域を示す第一のア
ドレスを出力する分周手段と、前記制御クロック手段か
ら受信したクロック信号と前記分周手段から受信した第
一のアドレスに基いて前記原色信号を構成する構成信号
の前記登録領域内における登録順位を示す第二のアドレ
スを出力するバイナリカウンタと、前記画像信号変換手
段が出力した前記原色信号を前記分周手段及び前記バイ
ナリカウンタが出力した第一及び第二のアドレスに応じ
てその構成信号毎にそれぞれ互いに異なる登録領域に格
納する画像信号格納手段とを備えたことを特徴とする構
成とした。
像信号を複数の原色信号に変換する画像信号変換手段
と、画像読み取りを開始する走査開始信号及びクロック
信号を出力する制御クロック手段と、前記制御クロック
手段からクロック信号を受信して原色信号を構成する構
成信号の各々が格納されるべき登録領域を示す第一のア
ドレスを出力する分周手段と、前記制御クロック手段か
ら受信したクロック信号と前記分周手段から受信した第
一のアドレスに基いて前記原色信号を構成する構成信号
の前記登録領域内における登録順位を示す第二のアドレ
スを出力するバイナリカウンタと、前記画像信号変換手
段が出力した前記原色信号を前記分周手段及び前記バイ
ナリカウンタが出力した第一及び第二のアドレスに応じ
てその構成信号毎にそれぞれ互いに異なる登録領域に格
納する画像信号格納手段とを備えたことを特徴とする構
成とした。
作用 本発明は上記した構成により、カラーイメージセンサ
から順序よく、且つ直列に出力される三原色のカラーデ
ータは、メモリ内にそれぞれの原色毎に整列されて格納
される。
から順序よく、且つ直列に出力される三原色のカラーデ
ータは、メモリ内にそれぞれの原色毎に整列されて格納
される。
実施例 第１図は本発明の画像情報読み取り・格納装置の一実
施例を示すブロック図である。第１図において、１はカ
ラー原稿等の被写体よりの反射光を集光し、結像するた
めの光学レンズ、２は結像した像に対応するカラーデー
タを出力するカラーイメージセンサ、３はカラーデータ
を一定のレベルまで増幅するバッファアンプ、４は増幅
されたカラーデータを対応するディジタル値に変換する
A/D変換器、５はカラーデータに対応するディジタル値
を書き込み、また外部装置によってアクセスされカラー
データの読み出しが行われるラインメモリ部であり、R/
W信号により、読み出しモード、書き込みモードの切換
えが行われる。６はカラーイメージセンサ２にスタート
信号（走査開始信号）およびクロック信号Φを与える制
御クロック回路である。７はスタート信号でリセットさ
れ、クロック信号２Φを入力する1/3分周器であり、そ
の内部フリップフロップの出力は下位がC0、上位がC1と
なって、ラインメモリ部５にカラーデータ書き込みを行
う際の上位アドレス２ビットとなる。また８はスタート
信号でリセットされ、前記C1信号によりカウントアップ
するｎビットバイナリカウンタで、ラインメモリ部５に
カラーデータの書き込みを行う際の下位アドレスにな
る。
施例を示すブロック図である。第１図において、１はカ
ラー原稿等の被写体よりの反射光を集光し、結像するた
めの光学レンズ、２は結像した像に対応するカラーデー
タを出力するカラーイメージセンサ、３はカラーデータ
を一定のレベルまで増幅するバッファアンプ、４は増幅
されたカラーデータを対応するディジタル値に変換する
A/D変換器、５はカラーデータに対応するディジタル値
を書き込み、また外部装置によってアクセスされカラー
データの読み出しが行われるラインメモリ部であり、R/
W信号により、読み出しモード、書き込みモードの切換
えが行われる。６はカラーイメージセンサ２にスタート
信号（走査開始信号）およびクロック信号Φを与える制
御クロック回路である。７はスタート信号でリセットさ
れ、クロック信号２Φを入力する1/3分周器であり、そ
の内部フリップフロップの出力は下位がC0、上位がC1と
なって、ラインメモリ部５にカラーデータ書き込みを行
う際の上位アドレス２ビットとなる。また８はスタート
信号でリセットされ、前記C1信号によりカウントアップ
するｎビットバイナリカウンタで、ラインメモリ部５に
カラーデータの書き込みを行う際の下位アドレスにな
る。
以下、その作用について説明する。
カラー原稿等の対象物に対応したカラーデータはカラ
ーイメージセンサ２より第７図に示すように制御クロッ
ク回路６からスタート信号が出力された時点からクロッ
ク信号Φに同期して、R1,G1,B1,R2,G2,B2,……,Rn−1,G
n−1,Bn−1,Rn,Gn,Bnの順に三原色のデータが出力され
る。この出力信号（OS）をバッファアンプ３で一定のレ
ベルに増幅した後、A/D変換器４により、ディジタル値
に変換する。一方、制御クロック回路６よりのクロック
信号２Φを第２図に示すような1/3分周器７に入力する
と、第３図に示すようなC0およびC1信号出力を得る。こ
のC1信号はまたｎビットカウンタ８に入力され、その出
力はW0よりWnまでのｎビット出力となる。このW0〜Wnを
下位アドレス、C0およびC1をその上位２ビットの書き込
みアドレス、前記A/D変換器４によりディジタル値化さ
れたカラーデータを入力データとして、ラインメモリ部
５に対し書き込みを行う。ラインメモリ部５へ入力され
るCPU等外部装置からのR/W信号を“L"とするとラインメ
モリ部５は書き込みモードとなり、カラーイメージセン
サ２より連続して出力されるカラーデータはディジタル
値化されて第４図のごとくラインメモリ部６に収納され
る。このようにして、R,G,Bの順に連続してカラーイメ
ージセンサ２より出力されるカラーデータが、ラインメ
モリ上にR,G,B毎に整列されて収納される。
ーイメージセンサ２より第７図に示すように制御クロッ
ク回路６からスタート信号が出力された時点からクロッ
ク信号Φに同期して、R1,G1,B1,R2,G2,B2,……,Rn−1,G
n−1,Bn−1,Rn,Gn,Bnの順に三原色のデータが出力され
る。この出力信号（OS）をバッファアンプ３で一定のレ
ベルに増幅した後、A/D変換器４により、ディジタル値
に変換する。一方、制御クロック回路６よりのクロック
信号２Φを第２図に示すような1/3分周器７に入力する
と、第３図に示すようなC0およびC1信号出力を得る。こ
のC1信号はまたｎビットカウンタ８に入力され、その出
力はW0よりWnまでのｎビット出力となる。このW0〜Wnを
下位アドレス、C0およびC1をその上位２ビットの書き込
みアドレス、前記A/D変換器４によりディジタル値化さ
れたカラーデータを入力データとして、ラインメモリ部
５に対し書き込みを行う。ラインメモリ部５へ入力され
るCPU等外部装置からのR/W信号を“L"とするとラインメ
モリ部５は書き込みモードとなり、カラーイメージセン
サ２より連続して出力されるカラーデータはディジタル
値化されて第４図のごとくラインメモリ部６に収納され
る。このようにして、R,G,Bの順に連続してカラーイメ
ージセンサ２より出力されるカラーデータが、ラインメ
モリ上にR,G,B毎に整列されて収納される。
次に、読み出し時にはラインメモリ部５へ入力される
外部装置からのR/W信号を“H"にすると、ラインメモリ
は読み出しモードとなり、CPU等の外部装置によって読
み出しアドレスを与えられ、自由にR,G,Bカラーデータ
を読み出せることとなる。
外部装置からのR/W信号を“H"にすると、ラインメモリ
は読み出しモードとなり、CPU等の外部装置によって読
み出しアドレスを与えられ、自由にR,G,Bカラーデータ
を読み出せることとなる。
発明の効果 以上述べてきたように、本発明によれば極めて簡単な
回路で画像情報の読み取りおよびメモリへの格納が行
え、メモリ内には画像の三原色情報がそれぞれの原色毎
に整列された状態で格納されるため、読み出し装置によ
る読み出し動作が行いやすく、従ってその読み出し回路
の構成を簡単にすることが可能となり、実用的に極めて
有用である。
回路で画像情報の読み取りおよびメモリへの格納が行
え、メモリ内には画像の三原色情報がそれぞれの原色毎
に整列された状態で格納されるため、読み出し装置によ
る読み出し動作が行いやすく、従ってその読み出し回路
の構成を簡単にすることが可能となり、実用的に極めて
有用である。
第１図は本発明の一実施例における画像情報読み取り・
格納装置の構成を示すブロック図、第２図は1/3分周器
の一例を示す回路図、第３図は同実施例の画像情報読み
取り・格納装置による画像情報記録動作を説明するため
のタイムチャート、第４図は画像情報が書き込まれたメ
モリのメモリマップ図、第５図は従来の画像情報読み取
り・格納装置の構成を示すブロック図、第６図はカラー
イメージセンサの構造図、第７図はカラーイメージセン
サからの画像情報出力タイミングを示すタイミングチャ
ートである。 １……光学レンズ ２……カラーイメージセンサ ３……バッファアンプ ４……アナログ−ディジタル変換器 ５……ラインメモリ部 ６……制御クロック回路 ７……1/3分周器 ８……ｎビットバイナリカウンタ
格納装置の構成を示すブロック図、第２図は1/3分周器
の一例を示す回路図、第３図は同実施例の画像情報読み
取り・格納装置による画像情報記録動作を説明するため
のタイムチャート、第４図は画像情報が書き込まれたメ
モリのメモリマップ図、第５図は従来の画像情報読み取
り・格納装置の構成を示すブロック図、第６図はカラー
イメージセンサの構造図、第７図はカラーイメージセン
サからの画像情報出力タイミングを示すタイミングチャ
ートである。 １……光学レンズ ２……カラーイメージセンサ ３……バッファアンプ ４……アナログ−ディジタル変換器 ５……ラインメモリ部 ６……制御クロック回路 ７……1/3分周器 ８……ｎビットバイナリカウンタ
Claims (1)
- 【請求項１】読み込んだ画像信号を複数の原色信号に変
換する画像信号変換手段と、 画像読み取りを開始する走査開始信号及びクロック信号
を出力する制御クロック手段と、 前記制御クロック手段からクロック信号を受信して原色
信号を構成する構成信号の各々が格納されるべき登録領
域を示す第一のアドレスを出力する分周手段と、 前記制御クロック手段から受信したクロック信号と前記
分周手段から受信した第一のアドレスに基いて前記原色
信号を構成する構成信号の前記登録領域内における登録
順位を示す第二のアドレスを出力するバイナリカウンタ
と、 前記画像信号変換手段が出力した前記原色信号を前記分
周手段及び前記バイナリカウンタが出力した第一及び第
二のアドレスに応じてその構成信号毎にそれぞれ互いに
異なる登録領域に格納する画像信号格納手段とを備えた
ことを特徴とする画像情報読み取り・格納装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61155336A JP2516921B2 (ja) | 1986-07-02 | 1986-07-02 | 画像情報読み取り・格納装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61155336A JP2516921B2 (ja) | 1986-07-02 | 1986-07-02 | 画像情報読み取り・格納装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6310964A JPS6310964A (ja) | 1988-01-18 |
| JP2516921B2 true JP2516921B2 (ja) | 1996-07-24 |
Family
ID=15603662
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61155336A Expired - Lifetime JP2516921B2 (ja) | 1986-07-02 | 1986-07-02 | 画像情報読み取り・格納装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2516921B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5986361A (ja) * | 1982-11-09 | 1984-05-18 | Toshiba Corp | カラ−密着センサ |
| JPS59156065A (ja) * | 1983-02-25 | 1984-09-05 | Canon Inc | カラ−画像情報記憶方法 |
-
1986
- 1986-07-02 JP JP61155336A patent/JP2516921B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6310964A (ja) | 1988-01-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |