JP2020123870A - 入力回路 - Google Patents
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Abstract
Description
更に、本実施形態の入力回路は、閾値が電流源105の電流値とNMOSトランジスタ103の電流駆動力によって決まるため、電源電圧の影響を受けることは無い。即ち、本実施形態の入力回路は、閾値の電源電圧依存性が無い、という特徴を有する。
NMOSトランジスタ311は、ゲートがNMOSトランジスタ312のゲートと接続され、ドレインがカレントミラー106の出力端子に接続され、ソースが第二の電源端子に接続されている。NMOSトランジスタ312は、ドレインがスイッチ313を介してNMOSトランジスタ311のドレインに接続されている。
NMOSトランジスタ103は、このように構成することで、制御信号がLレベルで電流駆動力が小さくなり、制御信号がHレベルで電流駆動力が大きくなるように制御される。
PMOSトランジスタ731とPMOSトランジスタ732は、カレントミラーを構成する。PMOSトランジスタ731は、ドレインがNMOSトランジスタ102のドレインとPMOSトランジスタ101のドレインに接続されている。PMOSトランジスタ732は、ソースがカレントミラー106の入力に接続され、ドレインがデプレショントランジスタ105のドレインに接続されている。
スイッチ107は、このように構成することで、制御端子の電圧がLレベルのときにオンし、Hレベルのときにオフするように制御される。
NMOSトランジスタ321とNMOSトランジスタ322は、互いのゲートが接続され、且つ直列に接続されている。スイッチ323は、トランジスタ322と並列に接続されている。
NMOSトランジスタ103は、このように構成することで、制御信号がLレベルで電流駆動力が小さくなり、制御信号がHレベルで電流駆動力が大きくなるように制御される。
基本的な動作は、上述の入力回路と同様であり、詳細な説明は省略する。
105 電流源
106 カレントミラー
110 入力端子
111 出力端子
221 インバータ
Claims (2)
- 入力端子に入力された信号に応じた出力信号を出力端子から出力する入力回路であって、
ゲートが前記入力端子に接続され、ソースが第二電源端子に接続された第一入力トランジスタと、
ゲートが前記入力端子に接続され、ソースが前記第二電源端子に接続され、ドレイン電圧に基づく電圧が前記出力端子から出力される第二入力トランジスタと、
ドレインが前記第一入力トランジスタのドレインに接続され、ソースが第一電源端子に接続され、前記出力信号に基づく信号よってオンオフが制御されるトランジスタと、
一端が前記第二電源端子に接続された電流源と、
一端が前記電流源の他端に接続され、制御端子が前記第一入力トランジスタのドレインに接続された第一スイッチと、
入力端子が前記第一スイッチの他端に接続され、出力端子が前記第二入力トランジスタのドレインに接続され、制御端子が前記電流源の他端に接続されたカレントミラーと、を備え、
前記第二入力トランジスタの電流駆動力は、前記出力信号によって切替えられ、
前記入力回路の閾値は、前記第二入力トランジスタと前記電流源の電流駆動力に基づくことを特徴とする入力回路。 - 前記第一電源端子と前記第一入力トランジスタ及び前記第二入力トランジスタとの間に第二スイッチを備え、
前記第二スイッチは、前記入力信号によって前記第一入力トランジスタ及び前記第二入力トランジスタがオンしているときにオフする
ことを特徴とする請求項1に記載の入力回路。
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