JP2018517328A - 信号増幅回路 - Google Patents
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- 230000003321 amplification Effects 0.000 title claims abstract description 20
- 238000003199 nucleic acid amplification method Methods 0.000 title claims abstract description 20
- 239000003990 capacitor Substances 0.000 claims abstract description 212
- 230000001133 acceleration Effects 0.000 claims description 5
- 239000004065 semiconductor Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 31
- JPKJQBJPBRLVTM-OSLIGDBKSA-N (2s)-2-amino-n-[(2s,3r)-3-hydroxy-1-[[(2s)-1-[[(2s)-1-[[(2s)-1-[[(2r)-1-(1h-indol-3-yl)-3-oxopropan-2-yl]amino]-1-oxo-3-phenylpropan-2-yl]amino]-1-oxo-3-phenylpropan-2-yl]amino]-1-oxo-3-phenylpropan-2-yl]amino]-1-oxobutan-2-yl]-6-iminohexanamide Chemical compound C([C@H](NC(=O)[C@@H](NC(=O)[C@@H](N)CCCC=N)[C@H](O)C)C(=O)N[C@@H](CC=1C=CC=CC=1)C(=O)N[C@@H](CC=1C=CC=CC=1)C(=O)N[C@H](CC=1C2=CC=CC=C2NC=1)C=O)C1=CC=CC=C1 JPKJQBJPBRLVTM-OSLIGDBKSA-N 0.000 description 5
- 102100031277 Calcineurin B homologous protein 1 Human genes 0.000 description 5
- 102100031272 Calcineurin B homologous protein 2 Human genes 0.000 description 5
- 102100031077 Calcineurin B homologous protein 3 Human genes 0.000 description 5
- 241001510512 Chlamydia phage 2 Species 0.000 description 5
- 241000839426 Chlamydia virus Chp1 Species 0.000 description 5
- 101000777252 Homo sapiens Calcineurin B homologous protein 1 Proteins 0.000 description 5
- 101000777239 Homo sapiens Calcineurin B homologous protein 2 Proteins 0.000 description 5
- 101000777270 Homo sapiens Calcineurin B homologous protein 3 Proteins 0.000 description 5
- 101000943802 Homo sapiens Cysteine and histidine-rich domain-containing protein 1 Proteins 0.000 description 5
- 230000001276 controlling effect Effects 0.000 description 5
- 238000001514 detection method Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 101100263704 Arabidopsis thaliana VIN3 gene Proteins 0.000 description 4
- 101100102627 Oscarella pearsei VIN1 gene Proteins 0.000 description 4
- 230000007423 decrease Effects 0.000 description 4
- 230000010354 integration Effects 0.000 description 4
- 230000000875 corresponding effect Effects 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 3
- 230000000737 periodic effect Effects 0.000 description 3
- 238000005070 sampling Methods 0.000 description 3
- 230000002596 correlated effect Effects 0.000 description 2
- 238000013461 design Methods 0.000 description 2
- 238000012545 processing Methods 0.000 description 2
- 230000000630 rising effect Effects 0.000 description 2
- 230000005236 sound signal Effects 0.000 description 2
- 230000001629 suppression Effects 0.000 description 2
- 101100112673 Rattus norvegicus Ccnd2 gene Proteins 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 238000012937 correction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
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- H—ELECTRICITY
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- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/45—Differential amplifiers
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- H03F2203/00—Indexing scheme relating to amplifiers with only discharge tubes or only semiconductor devices as amplifying elements covered by H03F3/00
- H03F2203/45—Indexing scheme relating to differential amplifiers
- H03F2203/45514—Indexing scheme relating to differential amplifiers the FBC comprising one or more switched capacitors, and being coupled between the LC and the IC
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- H03—ELECTRONIC CIRCUITRY
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- H03F2203/45—Indexing scheme relating to differential amplifiers
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Abstract
Description
第1入力端、第2入力端、第1スイッチ、第2スイッチ、第1可変抵抗器、第2可変抵抗器、第1キャパシタ、第2キャパシタ、第1出力端及び第2出力端を備え、第1入力端が第1スイッチと第1可変抵抗器を介して第1出力端に接続され、第2入力端が第2スイッチと第2可変抵抗器を介して第2出力端に接続され、第1キャパシタと第2キャパシタが、互いに逆の極性でそれぞれ第1出力端と第2出力端との間に接続されているローパスフィルタ回路と、
第3入力端、第4入力端、第1演算増幅器、第2演算増幅器、第3スイッチ、第4スイッチ、第5スイッチ、第6スイッチ、第7スイッチ、第8スイッチ、第9スイッチ、第10スイッチ、第11スイッチ、第12スイッチ、第13スイッチ、第14スイッチ、第3出力端と第4出力端を備え、第3入力端が第3スイッチを介して第1演算増幅器の正入力端に接続され、第3入力端が第4スイッチを介して第1演算増幅器の負入力端に接続され、第1演算増幅器の正出力端が第5スイッチを介して第3出力端に接続され、第1演算増幅器の負出力端が第6スイッチを介して第3出力端に接続され、第1演算増幅器の正入力端が第7スイッチを介して第1演算増幅器の負出力端に接続され、第1演算増幅器の負入力端が第8スイッチを介して第1演算増幅器の正出力端に接続され、第4入力端が、第9スイッチを介して第2演算増幅器の正入力端に接続され、また第10スイッチを介して第2演算増幅器の負入力端に接続され、第2演算増幅器の正出力端が第11スイッチを介して第4出力端に接続され、第2演算増幅器の負出力端が第12スイッチを介して第4出力端に接続され、第2演算増幅器の正入力端が第13スイッチを介して第2演算増幅器の負出力端に接続され、第2演算増幅器の負入力端が第14スイッチを介して第2演算増幅器の正出力端に接続されているバッファ回路と、
第5入力端、第6入力端、第3演算増幅器、第1スイッチトキャパシタモジュール、第2スイッチトキャパシタモジュール、第3スイッチトキャパシタモジュール、第4スイッチトキャパシタモジュール、第1キャパシタモジュール、第2キャパシタモジュール、第1チョッパ変調器、第2チョッパ変調器、第3チョッパ変調器、第5出力端及び第6出力端を備え、各スイッチトキャパシタモジュールが、キャパシタと少なくとも4つのスイッチを有してスイッチトキャパシタ構造を形成し、各キャパシタモジュールが、並列に接続される可変キャパシタと少なくとも1つのスイッチを有し、各チョッパ変調器が、少なくとも4つのスイッチを有してチョッパ変調構造を形成し、第5入力端が、第1スイッチトキャパシタモジュールと第1チョッパ変調器を順次介して第3演算増幅器の正入力端に接続され、第6入力端が、第2スイッチトキャパシタモジュールと第1チョッパ変調器を順次介して第3演算増幅器の負入力端に接続され、第3演算増幅器の正入力端が、第2チョッパ変調器と第1キャパシタモジュールを順次介して第5出力端に接続され、第3演算増幅器の負入力端が、第2チョッパ変調器と第2キャパシタモジュールを順次介して第6出力端に接続され、第3演算増幅器の正入力端が、第3スイッチトキャパシタモジュールを介して第5出力端に接続され、第3演算増幅器の負入力端が、第4スイッチトキャパシタモジュールを介して第6出力端に接続され、第3演算増幅器の正出力端が、第3チョッパ変調器を介して第6出力端に接続され、第3演算増幅器の負出力端が、第3チョッパ変調器を介して第5出力端に接続されているスイッチトキャパシタ積分回路と、
第1入力端と第2入力端から増幅前の電圧信号が入力され、第1出力端が第3入力端に接続され、第2出力端が第4入力端に接続され、第3出力端が第5入力端に接続され、第4出力端が第6入力端に接続され、第5出力端と第6出力端から増幅後の電圧信号を出力するように構成され、増幅前の電圧信号のON/OFFを制御するための信号スイッチと、を備える。
状態1と状態2:VP−VN=−(Voffp−Voffn)
状態3:VP−VN=Voffn×(2×Cff/Cf+1)−Voffp×(2×Cff/Cf+1)
状態4:VP−VN=(2×Cff/Cf−1)×(Voffn−Voffp)、そしてCff=1/2×Cfになると、出力がゼロになる。
状態5:VP−VN=Ci/Cf×(Voffp−Voffn)
状態6:VP−VN=(Ci/Cf−2)×(Voffp−Voffn)
状態7:VP−VN=2×(Voffn−Voffp)
状態8:VP−VN=0
状態8の後に、状態5から状態8までのステップを繰り返す。積分周期を選択する場合、入力信号がなければ、必ず出力がゼロになるようにして、増幅器の入力オフセット電圧と低周波の1/fノイズを除去する。
Claims (10)
- 第1入力端、第2入力端、第1スイッチ、第2スイッチ、第1可変抵抗器、第2可変抵抗器、第1キャパシタ、第2キャパシタ、第1出力端及び第2出力端を備え、前記第1入力端が前記第1スイッチと前記第1可変抵抗器を介して前記第1出力端に接続され、前記第2入力端が前記第2スイッチと前記第2可変抵抗器を介して前記第2出力端に接続され、前記第1キャパシタと前記第2キャパシタが互いに逆の極性でそれぞれ前記第1出力端と前記第2出力端との間に接続されているローパスフィルタ回路と、
第3入力端、第4入力端、第1演算増幅器、第2演算増幅器、第3スイッチ、第4スイッチ、第5スイッチ、第6スイッチ、第7スイッチ、第8スイッチ、第9スイッチ、第10スイッチ、第11スイッチ、第12スイッチ、第13スイッチ、第14スイッチ、第3出力端及び第4出力端を備え、前記第3入力端が、前記第3スイッチを介して前記第1演算増幅器の正入力端に接続され、前記第3入力端が、前記第4スイッチを介して前記第1演算増幅器の負入力端に接続され、前記第1演算増幅器の正出力端が前記第5スイッチを介して前記第3出力端に接続され、前記第1演算増幅器の負出力端が前記第6スイッチを介して前記第3出力端に接続され、前記第1演算増幅器の正入力端が前記第7スイッチを介して前記第1演算増幅器の負出力端に接続され、前記第1演算増幅器の負入力端が前記第8スイッチを介して前記第1演算増幅器の正出力端に接続され、前記第4入力端が、前記第9スイッチを介して前記第2演算増幅器の正入力端に接続され、また前記第10スイッチを介して前記第2演算増幅器の負入力端に接続され、前記第2演算増幅器の正出力端が前記第11スイッチを介して前記第4出力端に接続され、前記第2演算増幅器の負出力端が前記第12スイッチを介して前記第4出力端に接続され、前記第2演算増幅器の正入力端が前記第13スイッチを介して前記第2演算増幅器の負出力端に接続され、前記第2演算増幅器の負入力端が前記第14スイッチを介して前記第2演算増幅器の正出力端に接続されているバッファ回路と、
第5入力端、第6入力端、第3演算増幅器、第1スイッチトキャパシタモジュール、第2スイッチトキャパシタモジュール、第3スイッチトキャパシタモジュール、第4スイッチトキャパシタモジュール、第1キャパシタモジュール、第2キャパシタモジュール、第1チョッパ変調器、第2チョッパ変調器、第3チョッパ変調器、第5出力端及び第6出力端を備え、各前記スイッチトキャパシタモジュールが、キャパシタと少なくとも4つのスイッチを有してスイッチトキャパシタ構造を形成し、各前記キャパシタモジュールが、並列に接続される可変キャパシタと少なくとも1つのスイッチを有し、各前記チョッパ変調器が、少なくとも4つのスイッチを有してチョッパ変調構造を形成し、前記第5入力端が、前記第1スイッチトキャパシタモジュールと前記第1チョッパ変調器を順次介して前記第3演算増幅器の正入力端に接続され、前記第6入力端が、前記第2スイッチトキャパシタモジュールと前記第1チョッパ変調器を順次介して前記第3演算増幅器の負入力端に接続され、前記第3演算増幅器の正入力端が、前記第2チョッパ変調器と前記第1キャパシタモジュールを順次介して前記第5出力端に接続され、前記第3演算増幅器の負入力端が、前記第2チョッパ変調器と前記第2キャパシタモジュールを順次介して前記第6出力端に接続され、前記第3演算増幅器の正入力端が、前記第3スイッチトキャパシタモジュールを介して前記第5出力端に接続され、前記第3演算増幅器の負入力端が、前記第4スイッチトキャパシタモジュールを介して前記第6出力端に接続され、前記第3演算増幅器の正出力端が、前記第3チョッパ変調器を介して前記第6出力端に接続され、前記第3演算増幅器の負出力端が、前記第3チョッパ変調器を介して前記第5出力端に接続されているスイッチトキャパシタ積分回路と、
前記第1入力端と前記第2入力端から増幅前の電圧信号が入力され、前記第1出力端が前記第3入力端に接続され、前記第2出力端が前記第4入力端に接続され、前記第3出力端が前記第5入力端に接続され、前記第4出力端が前記第6入力端に接続され、前記第5出力端と前記第6出力端から増幅後の電圧信号を出力するように構成され、増幅前の電圧信号のON/OFFを制御するための信号スイッチと、
を備えることを特徴とする信号増幅回路。 - 各スイッチトキャパシタモジュールは、キャパシタと、第1制御スイッチ、第2制御スイッチ、第3制御スイッチ及び第4制御スイッチとを有し、前記キャパシタの第1極板が、前記第1制御スイッチを介して前記スイッチトキャパシタモジュールの入力端に接続され、また前記第2制御スイッチを介してグランドに接続され、前記キャパシタの第2極板が、前記第3制御スイッチを介して前記スイッチトキャパシタモジュールの出力端に接続され、また前記第4制御スイッチを介してグランドに接続されている
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記第1スイッチトキャパシタモジュール及び前記第2スイッチトキャパシタモジュールにおけるキャパシタは、可変キャパシタである
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記信号増幅回路は、さらに第1接続スイッチ、第2接続スイッチ、第3接続スイッチ及び第4接続スイッチを備え、前記第1スイッチトキャパシタモジュールにおけるキャパシタの両端が、それぞれ前記第1接続スイッチと前記第2接続スイッチを介して前記第3スイッチトキャパシタモジュールにおけるキャパシタの両端に並列に接続され、前記第2スイッチトキャパシタモジュールにおけるキャパシタの両端が、それぞれ前記第3接続スイッチと前記第4接続スイッチを介して前記第4スイッチトキャパシタモジュールにおけるキャパシタの両端に並列に接続されている
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記可変キャパシタは、複数のキャパシタと複数のスイッチを有し、各キャパシタと各スイッチが直列に接続されてキャパシタ分岐を形成し、全てのキャパシタ分岐が並列接続されている
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記キャパシタモジュールの可変キャパシタにおけるスイッチは前記キャパシタモジュールの入力端の近くに設けられ、前記第1スイッチトキャパシタモジュールの可変キャパシタにおけるスイッチは前記第1スイッチトキャパシタモジュールの出力端の近くに設けられ、前記第2スイッチトキャパシタモジュールの可変キャパシタにおけるスイッチは前記第2スイッチトキャパシタモジュールの出力端の近くに設けられている
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記チョッパ変調器は、第1チョッパスイッチ、第2チョッパスイッチ、第3チョッパスイッチ及び第4チョッパスイッチを有し、前記チョッパ変調器の第1入力端が、前記第1チョッパスイッチを介して前記チョッパ変調器の第1出力端に接続され、また前記第2チョッパスイッチを介して前記チョッパ変調器の第2出力端に接続され、前記チョッパ変調器の第2入力端が、前記第3チョッパスイッチを介して前記チョッパ変調器の第2出力端に接続され、また前記第4チョッパスイッチを介して前記チョッパ変調器の第1出力端に接続されている
ことを特徴とする請求項1に記載の信号増幅回路。 - 信号スイッチを介してグランドに接続されるとともに、前記ローパスフィルタ回路の第1入力端と第2入力端に接続され、自身の抵抗変化を利用して増幅前の電圧信号として差動出力電圧を出力するセンサを有する
ことを特徴とする請求項1に記載の信号増幅回路。 - 前記センサは、バリスタ素子を利用するホイートストンブリッジ回路から構成される加速度センサである
ことを特徴とする請求項8に記載の信号増幅回路。 - 全ての前記スイッチは、いずれも半導体装置のスイッチであり、複数組みのスイッチ信号により制御されるように構成されている
ことを特徴とする請求項1に記載の信号増幅回路。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201510171099.6A CN106160671B (zh) | 2015-04-10 | 2015-04-10 | 信号放大电路 |
CN201510171099.6 | 2015-04-10 | ||
PCT/CN2016/072813 WO2016161839A1 (zh) | 2015-04-10 | 2016-01-29 | 信号放大电路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018517328A true JP2018517328A (ja) | 2018-06-28 |
JP6476315B2 JP6476315B2 (ja) | 2019-02-27 |
Family
ID=57071647
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017553082A Active JP6476315B2 (ja) | 2015-04-10 | 2016-01-29 | 信号増幅回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US10079577B2 (ja) |
JP (1) | JP6476315B2 (ja) |
CN (1) | CN106160671B (ja) |
WO (1) | WO2016161839A1 (ja) |
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US10079577B2 (en) | 2018-09-18 |
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WO2016161839A1 (zh) | 2016-10-13 |
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JP6476315B2 (ja) | 2019-02-27 |
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Date | Code | Title | Description |
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A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20181214 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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