JP2017513344A5 - - Google Patents
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- 239000004020 conductor Substances 0.000 claims 1
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Claims (15)
- 基板上の第1の領域内の複数の微細加工超音波トランスデューサセルと、前記基板上の第2の領域内の複数の相互接続部と、を含むデバイスを製造する方法であって、前記方法は、
前記基板上に誘電層スタックを形成するステップであって、前記誘電層スタックが、前記第1の領域内の前記微細加工超音波トランスデューサセルの各膜を画定する、ステップと、
前記第2の領域内の前記誘電層スタックを部分的にエッチング除去することによって前記第2の領域内の前記誘電層スタックの厚さを低減するステップと、
前記誘電層スタックの低減された厚さ部分に複数のトレンチをエッチングするステップであって、前記トレンチのそれぞれが前記第2の領域内の導電性コンタクトを露出させる、ステップと、
前記トレンチを導電性材料で少なくとも裏張りするステップと、
を含む、方法。 - 前記第2の領域内の前記誘電層スタックの厚さを低減する前記ステップが、前記誘電層スタック上にレジスト層を堆積させるステップと、リソグラフィマスクを介して前記レジスト層を現像するステップと、前記第2の領域から前記レジストを除去するステップと、を含む、請求項1に記載の方法。
- 前記第2の領域内の前記誘電層スタックの厚さを低減する前記ステップが、前記誘電層スタック上にハードマスクを堆積させるステップと、前記第2の領域を露出させるために前記ハードマスクをパターニングするステップと、を含む、請求項1に記載の方法。
- 前記基板上に誘電層スタックを形成する前記ステップが、前記第2の領域内の前記スタック内にエッチストップ層を形成するステップを更に含み、
前記第2の領域内の前記誘電層スタックを部分的にエッチング除去する前記ステップが、前記エッチストップ層上で前記エッチングステップを終了するステップを含む、
請求項1乃至3の何れか一項に記載の方法。 - 前記エッチストップ層を除去するステップを更に含む、請求項4に記載の方法。
- 前記基板上の前記第1の領域内に複数の第1の電極を形成するステップと、
前記第1の電極それぞれの上に犠牲材料層部分を形成するステップと、
前記犠牲材料層部分上に前記誘電層スタックの第1の誘電層を形成するステップと、
前記犠牲材料層部分それぞれの上の前記第1の誘電層上に各第2の電極を形成するステップと、
得られた構造を前記誘電層スタックの少なくとも1つの更なる誘電層によって被覆するステップと、
前記第1の誘電層及び前記少なくとも1つの更なる誘電層に複数の開口を形成するステップであって、各開口が前記犠牲材料部分の1つへのアクセスを提供する、ステップと、
前記開口を介して前記犠牲材料部分を除去するステップと、
前記第1の誘電層上に前記誘電層スタックの少なくとも第2の更なる誘電層を形成するステップであって、前記第2の更なる誘電層が前記開口を封止する、ステップと、
を更に含む、請求項1乃至5の何れか一項に記載の方法。 - 前記複数の第1の電極を形成する前記ステップが、前記基板上に第1の金属層を堆積させるステップと、前記第1の金属層をパターニングするステップと、を含み、前記パターニングするステップが、前記第2の領域内に前記導電性コンタクトを形成するステップを更に含む、請求項6に記載の方法。
- 前記第2の電極を形成する前記ステップが、前記第1の誘電層上に第2の金属層を堆積させるステップと、前記第2の金属層をパターニングするステップと、を含み、前記パターニングするステップが、前記第2の領域内に前記導電性コンタクトを形成するステップを更に含む、請求項6に記載の方法。
- 前記基板が平坦化スタック及び不動態化スタックの少なくとも1つを担持し、前記導電性コンタクトが前記平坦化スタック及び/又は前記不動態化スタックの下に配置される、請求項1乃至8の何れか一項に記載の方法。
- 基板上の第1の領域内の複数の微細加工超音波トランスデューサセルと、前記基板上の各導電性コンタクトへの接続を設けるための、前記基板上の第2の領域内の複数の相互接続部と、を含むデバイスであって、
前記第1の領域内の前記微細加工超音波トランスデューサセルの各膜を画定する、前記基板上の誘電層スタックを更に含み、
前記スタックが前記第2の領域において凹設される階段状の外形を前記誘電層スタックが有するように、前記複数の相互接続部が前記第2の領域内の前記誘電層スタック内に延び、前記誘電層スタックの一部が前記第2の領域から除去される、
デバイス。 - 前記スタックが前記第2の領域において少なくとも2ミクロン凹設されている、請求項10に記載のデバイス。
- 前記膜がそれぞれ、少なくとも100ミクロンの直径及び/又は少なくとも3ミクロンの厚さを有する、請求項10又は11に記載のデバイス。
- 前記第2の領域が前記デバイスの周辺領域である、請求項10乃至12の何れか一項に記載のデバイス。
- 各微細加工超音波トランスデューサセルが、空洞部によって第2の電極から分離される第1の電極を含み、前記第2の電極が前記誘電層スタックの第1の誘電層によって前記空洞部から分離されるように各第2の電極が前記膜に埋設されており、前記膜が、前記第2の電極上の前記誘電層スタックの少なくとも1つの更なる誘電層を更に含み、前記少なくとも1つの更なる誘電層が前記第1の誘電層よりも厚い、請求項10乃至13の何れか一項に記載のデバイス。
- 請求項10乃至14の何れか一項に記載のデバイスを含む、装置。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
EP14161057.6 | 2014-03-21 | ||
EP14161057 | 2014-03-21 | ||
PCT/EP2015/054801 WO2015139979A1 (en) | 2014-03-21 | 2015-03-09 | Cmut device and manufacturing method |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2017513344A JP2017513344A (ja) | 2017-05-25 |
JP2017513344A5 true JP2017513344A5 (ja) | 2017-09-21 |
JP6422991B2 JP6422991B2 (ja) | 2018-11-14 |
Family
ID=50391021
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016557627A Active JP6422991B2 (ja) | 2014-03-21 | 2015-03-09 | Cmutデバイス及び製造方法 |
Country Status (5)
Country | Link |
---|---|
US (1) | US9889472B2 (ja) |
EP (1) | EP3119533B1 (ja) |
JP (1) | JP6422991B2 (ja) |
CN (1) | CN106132568B (ja) |
WO (1) | WO2015139979A1 (ja) |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP3370621B1 (en) | 2015-11-02 | 2019-01-09 | Koninklijke Philips N.V. | Ultrasound transducer array, probe and system |
CN106744642A (zh) * | 2017-01-06 | 2017-05-31 | 中北大学 | 收发平衡的宽频带混合式超声换能器面阵探头及制备方法 |
CN106865483A (zh) * | 2017-01-06 | 2017-06-20 | 中北大学 | 医用微电容超声换能器面阵探头及其制备方法 |
US11329098B2 (en) * | 2018-11-08 | 2022-05-10 | Vanguard International Semiconductor Singapore Pte. Ltd. | Piezoelectric micromachined ultrasonic transducers and methods for fabricating thereof |
US11050012B2 (en) * | 2019-04-01 | 2021-06-29 | Taiwan Semiconductor Manufacturing Co., Ltd. | Method to protect electrodes from oxidation in a MEMS device |
CN110174453B (zh) * | 2019-05-08 | 2021-08-03 | 中国科学院微电子研究所 | 一种微电极结构及其制作方法及包括该器件的电子设备 |
CN114302774B (zh) * | 2019-08-30 | 2023-05-23 | 维蒙股份公司 | Cmut换能器 |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5591678A (en) | 1993-01-19 | 1997-01-07 | He Holdings, Inc. | Process of manufacturing a microelectric device using a removable support substrate and etch-stop |
US6165896A (en) | 1998-06-25 | 2000-12-26 | Siemens Aktiengesellschaft | Self-aligned formation and method for semiconductors |
EP1668406B1 (en) * | 2003-09-22 | 2011-03-23 | TPO Hong Kong Holding Limited | Method of manufacturing liquid crystal display device |
WO2005077012A2 (en) * | 2004-02-06 | 2005-08-25 | Georgia Tech Research Corporation | Cmut devices and fabrication methods |
WO2005114820A2 (en) * | 2004-05-14 | 2005-12-01 | The University Of Georgia Research Foundation, Inc. | Implantable ultrasonic transducer systems and methods |
CN101006361A (zh) | 2004-08-18 | 2007-07-25 | 皇家飞利浦电子股份有限公司 | 二维超声换能器阵列 |
US8309428B2 (en) | 2004-09-15 | 2012-11-13 | Sonetics Ultrasound, Inc. | Capacitive micromachined ultrasonic transducer |
JP4891182B2 (ja) * | 2007-08-28 | 2012-03-07 | オリンパスメディカルシステムズ株式会社 | 超音波トランスデューサ、超音波診断装置及び超音波顕微鏡 |
US8047995B2 (en) * | 2007-08-28 | 2011-11-01 | Olympus Medical Systems Corp. | Ultrasonic transducer, method of manufacturing ultrasonic transducer, ultrasonic diagnostic apparatus, and ultrasonic microscope |
US7843022B2 (en) | 2007-10-18 | 2010-11-30 | The Board Of Trustees Of The Leland Stanford Junior University | High-temperature electrostatic transducers and fabrication method |
US7898081B2 (en) * | 2008-07-03 | 2011-03-01 | United Microelectronics Corp. | MEMS device and method of making the same |
JP5317826B2 (ja) * | 2009-05-19 | 2013-10-16 | キヤノン株式会社 | 容量型機械電気変換素子の製造方法 |
JP5875243B2 (ja) * | 2011-04-06 | 2016-03-02 | キヤノン株式会社 | 電気機械変換装置及びその作製方法 |
JP2013219303A (ja) * | 2012-04-12 | 2013-10-24 | Hitachi Ltd | 半導体装置およびその製造方法 |
JP6262496B2 (ja) * | 2013-11-08 | 2018-01-17 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
US9067779B1 (en) * | 2014-07-14 | 2015-06-30 | Butterfly Network, Inc. | Microfabricated ultrasonic transducers and related apparatus and methods |
-
2015
- 2015-03-09 US US15/126,089 patent/US9889472B2/en active Active
- 2015-03-09 WO PCT/EP2015/054801 patent/WO2015139979A1/en active Application Filing
- 2015-03-09 JP JP2016557627A patent/JP6422991B2/ja active Active
- 2015-03-09 CN CN201580015010.5A patent/CN106132568B/zh active Active
- 2015-03-09 EP EP15708226.4A patent/EP3119533B1/en active Active
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