JP2017191598A - Ic設計のカスタムレイアウトを容易にする方法、非一時的なコンピュータ読取可能な記憶媒体、およびマルチゲート素子のカスタムレイアウトを容易にする方法 - Google Patents
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Abstract
【解決手段】特異な色パターンを、ネットに対応する、IC設計図のレイアウト内の一組の形状に割当てることができる。次に、IC設計図のレイアウトを、IC設計ツールのグラフィカルユーザインターフェイス(GUI)に表示することができる。いくつかの実施形態は、マルチゲート素子の拡散領域を、この拡散領域が一組のフィントラックに対して位置合わせされるように、素子コンタクトの場所に対して移動させることができ、各マルチゲート素子の各フィンはフィントラック上に位置する。
【選択図】図5B
Description
関連技術
プロセス技術およびIC設計ソフトウェアツールの向上によって素子サイズは数十年にわたって縮小し続けてきた。しかしながら、プロセス技術が20ナノメートル(nm)というプロセスノードに近づきこのプロセスノードを超えると、それに伴って素子サイズの縮小はますます困難になってゆく。具体的には、このようなプロセスノードで性能もパワーも最適化することは、不可能でなくても非常に困難になった。
本明細書に記載のいくつかの実施形態は、FinFET素子等のマルチゲート素子を含むIC設計レイアウトを作成し操作するためのIC設計ツールを提供する。具体的には、いくつかの実施形態は、マルチゲート素子のカスタムレイアウトを容易にするグラフィカルユーザインターフェイス(GUI)の特徴を提供する。
以下の説明は、当業者が本発明を実現し使用できるようにするために示され、特定のアプリケーションおよびその必要条件という文脈の中で提供される。開示されている実施形態のさまざまな変形は、当業者には直ちに明らかになるであろう。本明細書で定義されている一般的な原則は、本発明の精神および範囲から逸脱することなく他の実施形態およびアプリケーションに適用し得る。よって、本発明は、示されている実施形態に限定されるのではなく、本明細書に開示されている原則および特徴に従う最大範囲と一致することを意図している。
IC設計ソフトウェアツールを用いてIC設計図を作成することができる。IC設計図が完成すると、製造、パッケージング、および組立てを経て、ICチップを製造することができる。IC設計および製造プロセスは全体として複数のエンティティを含み得る。たとえば、ある企業がIC設計フローで使用されるソフトウェアツールを作成し、別の企業が上記IC設計フローを利用してこのソフトウェアツールを使用することによりIC設計図を作成し、また別の企業が上記IC設計フローを利用して作成されたIC設計図に基づいてICチップを製造する場合がある。IC設計フローに含まれる工程のうちのいずれか1つが改善されると、結果としてIC設計および製造プロセス全体が改善されることになる。たとえば、IC設計フローで使用される改善されたソフトウェアツールは、IC設計および製造プロセス全体を改善する。IC設計フローは複数の工程を含み得る。各工程は、1つ以上のIC設計ソフトウェアツールの使用を必要とする場合がある。IC設計工程および関連するソフトウェアツールのいくつかの例を以下で説明する。これらの例は、専ら説明を目的としているのであって、実施形態を開示されている形態に限定することを意図しているのではない。
IC設計レイアウト内の回路素子は、ルーティンググリッドに沿ってルーティングされるワイヤを用いて互いに電気的に接続することができる。図2Aは、本明細書に記載のいくつかの実施形態に従うルーティンググリッドを示す。一般的に、金属トラック202が等間隔の一組の横線と縦線に配置されている。隣合う2本の金属トラック間の距離は金属ピッチと呼ばれる。図2Aでは縦方向の金属ピッチと横方向の金属ピッチは等しいが、一般的には等しいピッチである必要はない。1つの回路素子の出力端子P1と別の回路素子の入力端子P2との間に電気的な接続が必要なときは、図2Aに示されるように金属ワイヤを横方向の金属トラックと縦方向の金属トラックに沿ってルーティングすればよい。
図3A〜図3Eは、本明細書に記載のいくつかの実施形態に従い、如何にしてIC設計レイアウトツールのGUIを用いてマルチゲート素子を配置できるかを示す。図3A〜図3Eは、専ら説明を目的としているのであって、本明細書に記載の実施形態を開示されている形態に限定することを意図しているのではない。
マルチゲート素子(たとえばFinFET素子)が配置されたら、レイアウト技術者はこれらの素子を電気的に接続することができる。図4A〜図4Gは、本明細書に記載のいくつかの実施形態に従う、容易にかつ迅速にマルチゲート素子を接続するために使用できるGUIを示す。具体的には、図4A〜図4Gは、如何にして2入力マルチプレクサのためのFinFETを容易にかつ迅速に接続できるかを示す。図4A〜図4Gは、専ら説明を目的としているのであって、本明細書に記載の実施形態を開示されている形態に限定することを意図しているのではない。
図5Aは、本明細書に記載のいくつかの実施形態に従う、マルチゲート素子を配置するためのプロセスを示す。このプロセスは、マルチゲート素子をIC設計レイアウト内に配置するための配置場所を受けること(オペレーション502)から始まる。次に、このプロセスは、マルチゲート素子の素子コンタクト(たとえばゲートコンタクト、ソースコンタクト、またはドレインコンタクト)が一組の配線トラックに対して位置合わせされるように、このマルチゲート素子をIC設計レイアウト内に配置することを含み得るものであり、IC設計レイアウト内の回路素子間の電気的接続は、配線トラックに沿ってルーティングされる(オペレーション504)。このプロセスは次に、マルチゲート素子の拡散領域を、拡散領域が一組のフィントラックに対して位置合わせされるように、素子コンタクトの位置に対して移動させることを含み得るものであり、各マルチゲート素子の各フィンはフィントラック上に位置する(オペレーション506)。
Claims (20)
- IC設計図のカスタムレイアウトを容易にするための方法であって、前記方法は、
IC設計図における一組のネットに含まれる各ネットごとに、前記ネットに対応する、前記IC設計図のレイアウト内の一組の形状に、特異な色パターンを割当てるステップを含み、前記一組の形状に含まれる各形状は、前記IC設計図に基づいて製造可能なICチップ内の物理的構造に対応し、
前記IC設計図のレイアウトを、IC設計ツールのグラフィカルユーザインターフェイス(GUI)に表示するステップを含み、前記IC設計図のレイアウト内の各形状は、前記形状に割当てられた前記色パターンを用いて、前記IC設計ツールのGUIに表示される、方法。 - 一組のGUIオブジェクトを、前記IC設計図のレイアウト内に、前記IC設計図のレイアウト内の形状を切断するために表示するステップをさらに含み、前記一組のGUIオブジェクトに含まれる各GUIオブジェクトは、少なくとも1つの形状を切断することが可能な、前記IC設計図のレイアウト内の場所に対応し、2つのネット間のショートは、2つの特異な色パターンを用いて着色された、前記IC設計図のレイアウト内の隣合う2つの形状に対応し、
ユーザによって選択された各GUIオブジェクトごとに、前記選択されたGUIオブジェクトに対応する場所において少なくとも1つの形状を切断するステップをさらに含む、請求項1に記載の方法。 - 一組のGUIオブジェクトを、前記IC設計図のレイアウト内に、電気的コンタクトを形成するために表示するステップをさらに含み、前記一組のGUIオブジェクトに含まれる各GUIオブジェクトは、前記IC設計図のレイアウト内のある形状に対応し、
ユーザによって選択された各GUIオブジェクトに対応する各形状に、電気的コンタクトを形成するステップをさらに含む、請求項1に記載の方法。 - ユーザが対応するGUIオブジェクトを選択することによって形成した電気的コンタクト間に、ルータを用いて電気的接続を形成するステップをさらに含む、請求項3に記載の方法。
- 各色パターンは、色とパターンとの組合わせである、請求項1に記載の方法。
- コンピュータによって実行されたときに集積回路(IC)設計図のカスタムレイアウトを容易にするための方法を前記コンピュータに実行させる命令が格納された非一時的なコンピュータ読取可能な記憶媒体であって、前記方法は、
IC設計図における一組のネットに含まれる各ネットごとに、前記ネットに対応する、前記IC設計図のレイアウト内の一組の形状に、特異な色パターンを割当てるステップを含み、前記一組の形状に含まれる各形状は、前記IC設計図に基づいて製造可能なICチップ内の物理的構造に対応し、
前記IC設計図のレイアウトを、IC設計ツールのグラフィカルユーザインターフェイス(GUI)に表示するステップを含み、前記IC設計図のレイアウト内の各形状は、前記形状に割当てられた前記色パターンを用いて、前記IC設計ツールのGUIに表示される、非一時的なコンピュータ読取可能な記憶媒体。 - 一組のGUIオブジェクトを、前記IC設計図のレイアウト内に、前記IC設計図のレイアウト内の形状を切断するために表示するステップをさらに含み、前記一組のGUIオブジェクトに含まれる各GUIオブジェクトは、少なくとも1つの形状を切断することが可能な、前記IC設計図のレイアウト内の場所に対応し、2つのネット間のショートは、2つの特異な色パターンを用いて着色された、前記IC設計図のレイアウト内の隣合う2つの形状に対応し、
ユーザによって選択された各GUIオブジェクトごとに、前記選択されたGUIオブジェクトに対応する場所において少なくとも1つの形状を切断するステップをさらに含む、請求項6に記載の非一時的なコンピュータ読取可能な記憶媒体。 - 一組のGUIオブジェクトを、前記IC設計図のレイアウト内に、電気的コンタクトを形成するために表示するステップをさらに含み、前記一組のGUIオブジェクトに含まれる各GUIオブジェクトは、前記IC設計図のレイアウト内のある形状に対応し、
ユーザによって選択された各GUIオブジェクトに対応する各形状に、電気的コンタクトを形成するステップをさらに含む、請求項6に記載の非一時的なコンピュータ読取可能な記憶媒体。 - ユーザが対応するGUIオブジェクトを選択することによって形成した電気的コンタクト間に、ルータを用いて電気的接続を形成するステップをさらに含む、請求項8に記載の非一時的なコンピュータ読取可能な記憶媒体。
- 各色パターンは、色とパターンとの組合わせである、請求項6に記載の非一時的なコンピュータ読取可能な記憶媒体。
- マルチゲート素子のカスタムレイアウトを容易にするための方法であって、前記方法は、
マルチゲート素子を、IC設計レイアウト内に、前記マルチゲート素子の素子コンタクトが、一組の配線トラックに対して位置合わせされるように配置するステップを含み、前記IC設計レイアウト内の回路素子間の電気的接続は、配線トラックに沿ってルーティングされ、
前記マルチゲート素子の拡散領域を、前記拡散領域が一組のフィントラックに対して位置合わせされるように、前記素子コンタクトの場所に対して移動させるステップを含み、各マルチゲート素子の各フィンはフィントラック上に位置する、方法。 - 前記一組の配線トラックに含まれる隣合う配線トラックの間隔は第1の距離であり、前記一組のフィントラックに含まれる隣合うフィントラックの間隔は第2の距離である、請求項11に記載の方法。
- 前記マルチゲート素子はフィン電界効果トランジスタ(FinFET)であり、前記第2の距離は前記第1の距離と異なる、請求項12に記載の方法。
- 前記IC設計レイアウト内の形状を1つ以上の色パターンで着色するステップをさらに含み、互いに電気的に接続される予定の形状は、同一の色パターンを用いて着色される、請求項11に記載の方法。
- 1つ以上のマルチゲート素子内の1つ以上の形状との電気的コンタクトを形成するために、グラフィカルユーザインターフェイス(GUI)オブジェクトを前記IC設計レイアウト内に表示するステップをさらに含む、請求項11に記載の方法。
- ユーザによって選択された各GUIオブジェクトに電気的コンタクトを形成するステップをさらに含む、請求項15に記載の方法。
- 前記IC設計レイアウト内の電気的コンタクト間に、ルータを用いて電気的接続を形成するステップをさらに含む、請求項16に記載の方法。
- 前記マルチゲート素子内のポリシリコン形状を切断するために、グラフィカルユーザインターフェイス(GUI)オブジェクトを前記IC設計レイアウト内に表示するステップをさらに含む、請求項11に記載の方法。
- GUIオブジェクトの場所で、前記マルチゲート素子内のポリシリコン形状を、前記GUIオブジェクトの選択を受けたことに応じて切断するステップをさらに含む、請求項18に記載の方法。
- 前記マルチゲート素子はパラメータ化されたセルによって表わされ、前記パラメータ化されたセルは、ソース、ドレイン、およびゲート接続場所に関するパラメータと、素子寸法に関するパラメータとを含み、各パラメータの値は、前記第1の距離の倍数として特定される、請求項11に記載の方法。
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