JP2015084399A - アレイ型積層セラミック電子部品及びその実装基板 - Google Patents
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Abstract
Description
110 セラミック本体
111a、111b 第1及び第2誘電体層
112、113 カバー層
121、122、123、124 第1から第4内部電極
131、132、133、134 第1から第4外部電極
210 印刷回路基板
221、222、223、224 第1から第4電極パッド
Claims (21)
- 複数の第1誘電体層及び複数の第2誘電体層が厚さ方向に積層されて形成され、厚さ方向に相対する第1及び第2主面、幅方向に相対する第1及び第2側面、及び長さ方向に相対する第1及び第2端面を有するセラミック本体と、
前記複数の第1誘電体層上に形成され、一つの第1誘電体層を介して対向するように配置される第1及び第2内部電極と、
前記複数の第2誘電体層上に形成され、一つの第2誘電体層を介して対向するように配置される第3及び第4内部電極と、
前記セラミック本体の第1端面に形成され、前記第1内部電極と連結される第1外部電極と、
前記セラミック本体の第1側面に形成され、前記第2内部電極と連結される第2外部電極と、
前記セラミック本体の第2端面に形成され、前記第3内部電極と連結される第3外部電極と、
前記セラミック本体の第2側面に形成され、前記第4内部電極と連結される第4外部電極と、を含む、アレイ型積層セラミック電子部品。 - 第1誘電体層、第1及び第2内部電極は第1キャパシタ部を形成し、前記第2誘電体層、第3及び第4内部電極は第2キャパシタ部を形成する、請求項1に記載のアレイ型積層セラミック電子部品。
- 前記第2誘電体層は、前記第1誘電体層の厚さ方向の下部に配置される、請求項1または2に記載のアレイ型積層セラミック電子部品。
- 前記第1内部電極は前記第1端面に引出される第1リード部を含み、前記第2内部電極は前記第1側面に引出される第2リード部を含み、前記第3内部電極は前記第2端面に引出される第3リード部を含み、前記第4内部電極は前記第2側面に引出される第4リード部を含む、請求項1から3のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1誘電体層の積層数及び前記第2誘電体層の積層数が異なる、請求項1から4のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1誘電体層及び前記第2誘電体層は異なる材料を含む、請求項1から5のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1誘電体層及び前記第2誘電体層の厚さは異なる、請求項1から6のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 複数の第1誘電体層、第1及び第2内部電極を含む第1キャパシタ部と前記第1キャパシタ部の厚さ方向の下部に配置され、複数の第2誘電体層、第3及び第4内部電極を含む第2キャパシタ部とが結合された六面体状の複合体と、
前記複合体の第1端面に形成され、前記第1内部電極と連結される第1信号電極と、
前記複合体の第1側面に形成され、前記第2内部電極と連結される第1接地電極と、
前記複合体の第2端面に形成され、前記第3内部電極と連結される第2信号電極と、
前記複合体の第4端面に形成され、前記第4内部電極と連結される第2接地電極と、を含む、アレイ型積層セラミック電子部品。 - 前記第1キャパシタ部の最下端の内部電極は第2内部電極であり、前記第2キャパシタ部の最上端の内部電極は第4内部電極である、請求項8に記載のアレイ型積層セラミック電子部品。
- 前記第1キャパシタ部の最下端の内部電極は第2内部電極、前記第2キャパシタ部の最上端の内部電極は第4内部電極であり、前記第1キャパシタ部の最下端の内部電極と前記第2キャパシタ部の最上端の内部電極は一誘電体層を介して対向する、請求項8または9に記載のアレイ型積層セラミック電子部品。
- 前記第1キャパシタ部及び前記第2キャパシタ部は相互独立的に動作する、請求項8から10のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1キャパシタ部及び前記第2キャパシタ部は異なる容量を有する、請求項8から11のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1キャパシタ部の電流方向及び前記第2キャパシタ部の電流方向は反対である、請求項8から12のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1及び第2内部電極は一つの第1誘電体層を介して対向するように複数の第1誘電体層上に形成され、前記第3及び第4内部電極は一つの第2誘電体層を介して対向するように複数の第2誘電体層上に形成される、請求項8から13のいずれか一項に記載のアレイ型積層セラミック電子部品。
- 前記第1内部電極は前記第1端面に引出される第1リード部を含み、前記第2内部電極は前記第1側面に引出される第2リード部を含み、前記第3内部電極は前記第2端面に引出される第3リード部を含み、前記第4内部電極は第2側面に引出される第4リード部を含む、請求項8から14のいずれか一項に記載のアレイ型積層セラミック電子部品。
- バッテリーからの供給を受ける第1電源を安定化させて電力管理部に供給する第1キャパシタ部と前記第1キャパシタ部の下部に配置され、前記電力管理部で変換された第2電源の供給を受けて安定化させ、駆動電源を供給する第2キャパシタ部とが結合された六面体状の複合体と、
前記複合体の第1端面に形成され、前記バッテリーと連結されて前記第1電源を前記第1キャパシタ部に伝達する第1信号電極と、
前記複合体の第2端面に形成され、前記電力管理部と連結されて前記第2電源を前記第2キャパシタ部に伝達する第2信号電極と、
前記複合体の第1側面に形成され、第1キャパシタ部を接地するための第1接地電極と、
前記複合体の第2側面に形成され、第2キャパシタ部を接地するための第2接地電極と、を含む、アレイ型積層セラミック電子部品。 - 前記第1キャパシタ部は複数の第1誘電体層、第1及び第2内部電極を含み、前記第2キャパシタ部は複数の第2誘電体層、第3及び第4内部電極を含む、請求項16に記載のアレイ型積層セラミック電子部品。
- 前記第1内部電極は前記第1信号電極と連結され、前記第2内部電極は前記第1接地電極と連結され、前記第3内部電極は前記第2信号電極と連結され、前記第4内部電極は前記第2接地電極と連結される、請求項17に記載のアレイ型積層セラミック電子部品。
- 前記第1キャパシタ部の最下端の内部電極は第2内部電極であり、前記第2キャパシタ部の最上端の内部電極は第4内部電極である、請求項16から18のいずれか一項に記載のアレイ型積層セラミック電子部品。
- バッテリーからの供給を受ける電圧を変換する電力管理部で変換された第1電源の供給を受けて安定化させ、駆動電源を供給する第1キャパシタ部と前記電力管理部で変換された第2電源の供給を受けて安定化させ、駆動電源を供給する第2キャパシタ部とが結合された六面体状の複合体と、
前記複合体の第1端面に形成され、前記電力管理部と連結されて前記第1電源を前記第1キャパシタ部に伝達する第1信号電極と、
前記複合体の第2端面に形成され、前記電力管理部と連結されて前記第2電源を前記第2キャパシタ部に伝達する第2信号電極と、
前記複合体の第1側面に形成され、第1キャパシタ部を接地するための第1接地電極と、
前記複合体の第2側面に形成され、第2キャパシタ部を接地するための第2接地電極と、を含む、アレイ型積層セラミック電子部品。 - 上部に3つ以上の電極パッドを有する印刷回路基板と、
前記印刷回路基板上に設置される請求項1から20のいずれか一項に記載のアレイ型積層セラミック電子部品と、
前記電極パッドと前記アレイ型積層セラミック電子部品を連結するはんだと、を含む、アレイ型積層セラミック電子部品の実装基板。
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