JP2015053587A - 電流電圧変換回路と共に用いるバラツキ補償回路 - Google Patents
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Abstract
Description
Vc=(I/C)T (1)
2)スイッチSWset_compをOFFした後、 SWinをOFFし、VinをVin_btにセットする。この時、キャパシタCAは基準電圧Vramp_btと基準電圧Vin_btのオフセット電圧を保持する。そして、ランプ波形を立ち上げる。
3) キャパシタCAでオフセット補償されたVinをPWM変換した信号が出力される。
4)以上のシーケンスをTtgt=TPWM_δを与えるようなノードPの電圧Vpに収束するまで繰り返す。
Tfb = TPWM_δ-Ttgt (2)
と定義する。TPWM_δ、Ttgtはそれぞれランプ関数の傾きkramp(単位はs/V)を用いてTPWM_δ = krampVXn、Ttgt = krampVtgtと表現できる。VtgtはTtgtを与えるときの目標電圧である。この関係性から式(2)はVXn、Vtgtを用いて
Tfb = kramp(VXn-Vtgt) (3)
と表現できる。ノードPの離散時間(n + 1)での電圧は前の離散時間ステップにおける電圧VPnに電流Ipを容量CpのキャパシタでTfb秒間積分した
VPn+1 = VPn + (Ip/Cp)Tfb (Ttgt<TPWM_δ) (4)
VPn+1 = VPn - (Iq/Cp)Tfb (Ttgt>TPWM_δ) (5)
で表される。さらにVXnは関数f(Vp)を用いて
VXn = (f(VPn)/Cx)Tδ (6)
と表される。式(4)、(5)に式(3)を代入すると
VPn+1 = VPn + (Ip/Cp)kramp(VXn-Vtgt)(Ttgt < TPWM_δ) (7)
VPn+1 = VPn - (Iq/Cp)kramp(VXn-Vtgt)(Ttgt > TPWM_δ) (8)
さらに式 (7)、(8)に式(6)を代入すると
VPn+1=(IpTδ/CpCx)krampf(VPn)+VPn-(IpVtgt /Cp)kramp (Ttgt < TPWM_δ) (9)
VPn+1=-(IpTδ/CpCx)krampf(VPn)+VPn+(IpVtgt/Cp)kramp (Ttgt > TPWM_δ) (10)
となりVPnのみの関数として記述できる。
Vfix = Vfix + (Ip/Cp)kramp[(f(Vfix)/ Cx)Tδ-Vtgt]
0 = (f(Vfix)/ Cb)Tδ-Vtgt
Vtgt = (f(Vfix)/ Cb)Tδ (11)
を満たす。PWM時間幅Ttgt= krampVtgtの関係を用いると式(11)は
Vtgt = (f(Vfix)/ Cb)Tδ
Ttgt /kramp = (f(Vfix)/ Cb)Tδ
Ttgt = (f(Vfix)/ Cb)Tδkramp (12)
と書ける。式 (12)よりVPnがVfixに収束した状態で、時間幅TδのPWM信号がSWδに入力されるとTtgtが得られる。このことから、Vfixが安定固定点となるように設計できればノードPの初期電位V0によらず電流源のゲインを補償できる。式(12)にはCxも含まれることから、電流源のみならず容量のバラツキも補償される。
Claims (5)
- 電源と、電源からの電流値を制御する制御素子と、前記制御素子により制御された電流値を入力パルス変調信号によりオンオフするためのスイッチ素子と、オンオフされた電流を電荷として保持して電圧に変換して出力するキャパシタCxとを備える電流電圧変換回路と共に用いて、該電流電圧変換回路の回路素子或いは電気的特性に基づくバラツキの影響を補償するためのバラツキ補償回路において、
前記キャパシタCxに保持された電圧を第1の入力端子にフィードバックして、第2の入力端子に入力された時間電圧波形と対比することによりPWM信号に変換するコンパレータと、
前記コンパレータから出力したPWM信号と外部から与えられる目標時間幅Ttgtを比較し、その差分PWM信号を出力するパルス差分計算回路と、
前記パルス差分信号の大きさを電圧値Vpに変換する回路と、
前記変換された電圧値Vpに基づき、前記電流電圧変換回路の前記制御素子を制御して、前記コンパレータにより生成されたPWM信号のパルス幅が前記目標時間幅Ttgtに一致するように制御することで、前記電源からの電流値をバラツキの影響をキャンセルした値に制御することから成るバラツキ補償回路。 - 前記コンパレータは、前記二つの入力端子におけるそれぞれの電圧の差であるオフセット電圧を保持するキャパシタCAを備えた請求項1に記載のバラツキ補償回路。
- 前記電流電圧変換回路の前記スイッチ素子がオンになるとき以外は、前記コンパレータの前記第1の入力端子は基準電位Vin0に固定される請求項1に記載のバラツキ補償回路。
- 前記パルス差分信号を電圧値Vpに変換する回路は、差分PWM信号で制御される電流源と、その電流源からの電流値を積分するキャパシタCpを備え、該キャパシタCpの充電電圧に差分PWM信号を電圧変換したものを加算あるいは減算していくことにより、電圧値Vpとして出力する請求項1に記載のバラツキ補償回路。
- 前記電流電圧変換回路の前記制御素子を、MOSトランジスタにより構成した請求項1に記載のバラツキ補償回路。
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Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02181284A (ja) * | 1988-02-18 | 1990-07-16 | Hitachi Ltd | ニューラルネットワーク |
JP2006135377A (ja) * | 2004-11-02 | 2006-05-25 | Toshiba Corp | 半導体装置 |
JP2007066258A (ja) * | 2005-09-02 | 2007-03-15 | Canon Inc | 演算装置 |
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Non-Patent Citations (1)
Title |
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上ノ原 誠二他4名: "NC2012-112 電圧・電流サンプリング方式によるしきい値結合CMOSカオス回路の設計", 電子情報通信学会技術研究報告, vol. 第112巻第390号, JPN6017039420, 17 January 2013 (2013-01-17), JP, pages 105 - 110, ISSN: 0003662645 * |
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