JP2014522204A - 回路装置および信号を送信するための方法 - Google Patents

Abstract

本発明は、回路装置（Ｓ，Ｅ）、および論理レベルに基づくシングルエンド信号と、特にコモンモードベースの差動信号、を用いる対応する方法であって、シリアル化された信号が、正確で安定した方法で継続的に送信される方法に関する。

Description

本発明は、請求項１のプリアンブルに記載の回路装置、ならびに請求項１２のプリアンブルに記載の対応する方法に関する。

ビット伝送層または物理層（ｐｈｙｓｉｃａｌ ｌａｙｅｒ：ＰＨＹ）は、ＯＳＩ（Ｏｐｅｎ Ｓｙｓｔｅｍｓ Ｉｎｔｅｒｃｏｎｎｅｃｔｉｏｎ）参照モデルとも呼ばれるＯＳＩ階層モデルの最下位層であり、コンピュータネットワークにおける通信プロトコルの設計基準としても役に立つ、国際標準化機構（Ｉｎｔｅｒｎａｔｉｏｎａｌ Ｓｔａｎｄａｒｄｓ Ｏｒｇａｎｉｓａｔｉｏｎ：ＩＳＯ）の階層モデルを示す。

物理層（ＰＨＹ）は、結合、順方向誤り訂正（Ｆｏｒｗａｒｄ Ｅｒｒｏｒ Ｃｏｒｒｅｃｔｉｏｎ：ＦＥＣ）、電力制御、拡散（符号分割多元接続）（Ｃｏｄｅ Ｄｉｖｉｓｉｏｎ Ｍｕｌｔｉｐｌｅ Ａｃｃｅｓｓ：ＣＤＭＡ）等に関与し、およびデータもアプリケーションも識別せず、０と１のみを識別する。ＰＨＹは、その上のセキュリティ層（データリンク層）（Ｄａｔａ Ｌｉｎｋ Ｌａｙｅｒ：ＤＬＬ）が、特に、媒体アクセス制御（Ｍｅｄｉａ Ａｃｃｅｓｓ Ｃｏｎｔｒｏｌ：ＭＡＣ）層と呼ばれる部分層を利用可能な論理チャネル（ＵＭＴＳ（Ｕｎｉｖｅｒｓａｌ Ｍｏｂｉｌｅ Ｔｅｌｅｃｏｍｍｕｎｉｃａｔｉｏｎｓ Ｓｙｓｔｅｍ）用のトランスポートチャネル）を形成する。

原理的に、Ｄ−ＰＨＹは、モバイル装置内のコンポーネント間の通信リンクのためのフレキシブルで、低コストで、高速のシリアルインタフェースを実現できる。

図４Ａに示すように、最新の携帯電話において、データソース、例えば、アプリケーションプロセッサは、関連するデータシンク上、例えば、関連するディスプレイ上での表示のために、イメージデータをＤ−ＰＨＹ信号として、ＭＩＰＩ−ＤＳＩ（Ｍｏｂｉｌｅ Ｉｎｄｕｓｔｒｙ Ｐｒｏｃｅｓｓｏｒ Ｉｎｔｅｒｆａｃｅ−Ｄｉｓｐｌａｙ Ｓｅｒｉａｌ Ｉｎｔｅｒｆａｃｅ）に供給する。また、アプリケーションプロセッサ等のデータシンクは、関連するデータソースから、例えば、関連するカメラから、ＭＩＰＩ−ＣＳＩ（Ｃａｍｅｒａ Ｓｅｒｉａｌ Ｉｎｔｅｒｆａｃｅ）を介して、Ｄ−ＰＨＹフォーマットでイメージデータを受信することができる。

Ｄ−ＰＨＹプロトコルに基づくＤＳＩまたはＤＳＩ−２またはＣＳＩまたはＣＳＩ−２またはＣＳＩ−３は、４つ以下の差動データラインと、差動クロックラインとを備え、これらは、銅ケーブルを用いて、該アプリケーションプロセッサを該ディスプレイおよび／または該カメラに接続する。差動データライン当たりのデータ転送速度は、最高で１．５Ｇｂｐｓ（ギガビット／秒）である。

１〜４つの差動データ信号および差動クロックラインを介した、この従来のＤ−ＰＨＹ−ＤＳＩ信号またはＤ−ＰＨＹ−ＣＳＩ信号の送信および受信は、マスター側のモジュール（データソース、例えば、カメラおよび／またはアプリケーションプロセッサ）と、スレーブ側のモジュール（データシンク、例えば、アプリケーションプロセッサおよび／またはディスプレイユニット）との間の（データレーンＣＨ０＋，ＣＨ０−およびＣＨ１＋，ＣＨ１−と呼ばれる）２つのデータチャネルおよび（クロックレーンＣＬＫ＋，ＣＬＫ−と呼ばれる）クロックラインを手段として、図４ＢのＤ−ＰＨＹインタフェース構造に例として図示されている。

この状況において、図４Ａを見て分かるように、各関連するディプレイのための、または、各関連するカメラのためのデータ伝送には、最高１０の銅線（例えば、２つのデータラインの４倍と、２つのクロックラインの１倍）を要する。

ラインの数の望ましい低減を考えると、シリアル化された信号伝送を考慮すべきである。しかし、そのようなシリアル化は、エラーを起こしやすく、不安定なことが多い。

上述した欠点および不十分な点を発端として、ならびに概略が説明された従来技術を考慮して、本発明の目的は、効率的なシリアル化信号伝送を、エラーのない安定した方法で、常に実行できるように、上述したタイプの回路装置および上述したタイプの方法をさらに発展させることである。

この目的は、請求項１の特徴を有する回路装置と、請求項１２の特徴を有する方法によって達成される。本発明の有利な実施形態および適切なさらなる発展は、それぞれの従属項において特徴付けられている。

したがって、回路装置および方法が提案され、それを用いて、
論理レベルに基づく信号に対応するシングルエンド高速（Ｈｉｇｈ Ｓｐｅｅｄ：ＨＳ）データと、
特に、コモンモード信号に基づく信号に対応する差動低電力（Ｌｏｗ Ｐｏｗｅｒ：ＬＰ）データと、
がシリアル化されて、共通信号ストリームを形成する。

シリアル化された共通信号ストリームを伴うこの種の伝送路を用いて、ＨＳ／ＬＰデータは、少なくとも１つのマルチプレクサを本質的に備える少なくとも１つの送信ビルディングブロック（＝送信装置）によって一括化されて、シリアル化された共通データストリームとして、受信ビルディングブロック（＝受信装置）へ送信される。

少なくとも１つのデマルチプレクサを本質的に備えるこの受信装置は、該シリアルデータを細分化して、それを元の形態でＨＳ／ＬＰデータとして再び出力する。該送信装置に印加されたクロック（Ｃｌｏｃｋ：ＣＬＫ）は、該マルチプレクサのクロック基準として機能し、および該共通シリアル信号ストリームに埋め込まれる。該受信装置は、このクロックを再生して、それをＣＬＫとして再出力する。

全てのデータ入力部がＨＳデータを処理する状況に基づく、データビルディングのための通常のアプローチは、該データが多重化されて、シリアルデータストリームとして送出されることである。

しかし、ＭＩＰＩ−Ｄ−ＰＨＹ規格においては、いわゆるＬＰ送信モードへのリターンは、ＨＳデータのシグナリングに用いられる電圧レベルの範囲外の電圧振幅によって伝えられることが既に合意されている。

これらのＬＰ信号レベルは、既に説明したように、単純に一括化されたシリアルデータストリームのデータスペースで符号化することができない追加的な情報を示す。

本発明によれば、特に、ＬＰデータだけを含み、ＨＳレーンと並列に該マルチプレクサに入力される少なくとも１つの追加的な、特に仮想レーンを挿入することが提案されている。これは、このために設けられた該マルチプレクサの入力部のＨＳデータのための符号化スペースを拡大することなく、ＬＰ状態を伝えることを可能にする。

このレーン、具体的には、テレグラムレーンと呼ぶこともできる仮想レーンは、他のシステム関連情報を運ぶのにも用いることができ、例えば、該レーンは、該シリアルデータリンクが間もなく切断されるという情報を送信するのに用いることができるであろう。

本発明は、典型的には、シングルエンド論理レベルベースのデータ信号およびクロック信号と、特に、コモンモードベースの差動データ信号およびクロック信号の両方の、具体的には、Ｄ−ＰＨＹデータ信号またはＤ−ＰＨＹクロック信号、例えば、１〜４ビット幅のＭＩＰＩ−Ｄ−ＰＨＹデータ信号およびＭＩＰＩ−Ｄ−ＰＨＹクロック信号の、少なくとも１つのデータソース、具体的には、例えば、少なくとも高解像度カメラおよび／または画像ソースとして機能するカメラおよび／または少なくとも１つのアプリケーションプロセッサと、少なくとも１つのデータシンク、具体的には、少なくとも１つのアプリケーションプロセッサおよび／または少なくとも１つの高解像度ディスプレイユニットまたは例えば、画像シンクとして機能するディスプレイユニット、例えば、少なくとも１つのディスプレイまたは少なくとも１つのモニタとの間での、少なくとも１つのシリアルおよび／または一括の、具体的には、ＣＳＩプロトコルベースのおよび／またはＣＳＩ−２プロトコルベースのおよび／またはＣＳＩ−３プロトコルベースのおよび／またはＤＳＩプロトコルベースのおよび／またはＤＳＩ−２プロトコルベースの送信中に適用することができる。

前述したように、本発明に関する教示を有利な方法で具体化し、さらに発展させる様々な可能性がある。このため、一方において、請求項１に従属する請求項について、および請求項１２について説明し、他方においては、本発明の追加的な実施形態、特徴および効果が、以下でより詳細に、とりわけ、図１Ａ〜図３によって図示されている例示的な実施形態によって説明されている。

本発明の方法に従って作動する、本発明に従って構成された回路装置の第１の部分、すなわち、送信装置の実施形態を示す、概念的略図である。 図１Ａにおける送信装置のフレーマの実施形態の詳細を示す、概念的略図である。 図１Ａの送信装置のマルチプレクサの実施形態の概念的略図である。 本発明の方法に従って作動する、本発明に従って構成された回路装置の第２の部分、すなわち、送信装置の実施形を示す、概念的略図である。 図２Ａの受信装置のデフレーマの実施形態の詳細を示す、概念的略図である。 ＨＳデータ伝送およびＬＰデータ伝送の場合のそれぞれの電圧レベルの実施形態の概略図である。 従来技術による装置の実施例の概念的略図である。 図４Ａに示す装置がそれをベースにしている、２つのデータチャネルとクロックラインとを備えるインタフェース構造の実施例の概念的略図である。

図１Ａ〜図４Ｂにおいて、類似のまたは同様の実施形態、要素または機能には、同一の参照数字が付けられている。
（発明を具体化するための最良の方法）

原理的には、
本発明による送信装置Ｓに関する図１Ａに示す実施形態によって、および
本発明による受信装置Ｅに関する図２Ａに示す実施形態によって、
ケーブルベースのリンクを実現するおよび作動させるための、本発明による回路装置Ａ（図１Ａ、図２Ａを参照）が得られ（本発明に関しては、互いに無関係に、送信装置Ｓと受信装置Ｅを実現すること、作動させることが可能である）、
そのリンクは、光学的に、具体的には、少なくとも１つの光学媒体に基づいて、例えば、光導波路ＯＭ（図１Ａ、図２Ａの詳細図を参照）に基づいて、例えば、少なくとも１つのガラス繊維に基づいて、および／または少なくとも１つのプラスチック繊維に基づいて多重化され、およびシリアル化され、および／または
そのリンクは、電気的にまたはガルバニックに、具体的には、少なくとも１つの電気的またはガルバニックなリンクに基づいて、例えば、少なくとも１つの銅線に基づいて、および／または例えば、少なくともプリント回路基板上に配列された少なくとも１つの電気的ラインに基づいて多重化されていない
ことが可能である。

図１Ａは、ＤＳＩデータ伝送インタフェースＩＳまたはＣＳＩデータ伝送インタフェースＩＳへの接続のための送信装置Ｓの原理的構造の実施形態を示す。

アプリケーションプロセッサＡＰ内で、または、カメラＫＡ内で生成された画像データは、Ｄ−ＰＨＹ補正クロック信号ＣＬＫ＋，ＣＬＫ−とともに、最高で４ビット幅のデータ伝送インタフェースＩＳにおいて、４つ他のデータラインまたはデータチャネルＣＨ０＋，ＣＨ０−，ＣＨ１＋，ＣＨ１−，ＣＨ２＋，ＣＨ２−，ＣＨ３＋，ＣＨ３−上でＤ−ＰＨＹ信号として利用可能になっている。

送信装置Ｓは、これらの信号を集積インタフェースロジックＬＳにおいて受け取り、そのブロックは、それらの信号が、Ｄ−ＰＨＹ信号の正しい解釈のための、および高周波データストリーム（いわゆるＨＳデータ）と低周波データストリーム（いわゆる低速（Ｌｏｗ Ｓｐｅｅｄ：ＬＳ）データ）を区別するための少なくとも１つの状態機械を有することを証明できる。

送信装置Ｓにおける次のフレーマＦＲ（図１Ｂの詳細図も参照）は、入力信号の直流（Ｄｉｒｅｃｔ Ｃｕｒｒｅｎｔ：ＤＣ）平衡を確保し、および受信側（図２Ａを参照）で認識可能なフレームを生成し、そのことは、受信装置Ｅ（図２Ａを参照）が、補正出力データラインまたは出力チャネルＣＨ０＋，ＣＨ０−，ＣＨ１＋，ＣＨ１−，ＣＨ２＋，ＣＨ２−，ＣＨ３＋，ＣＨ３−に、受信したデータを再割当てすることを可能にする。

詳細には、論理レベルベースのシングルエンドデータ信号ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３と、差動データ信号ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−の両方を、図１ＢによるフレーマＦＲに印加することができる。５ｂ／６ｂ符号化ブロックとして構成されたその符号器ＫＯを用いて、図１Ｂによる該フレーマは、それらの差動データ信号ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−を、シングルエンド論理レベルベースのデータ信号ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３から成るストリームに埋め込む。

フレーマＦＲに隣接するマルチプレクサＭＵ、具体的には、ＨＳ Ｍｕｘは、位相ロックループとして、具体的には、ＣＭＵとして構成されたクロック発振器ＰＳを用いて、高周波シリアルまたは一括送信信号を生成し、その信号は、出力ドライバＡＴを用いて、送信装置Ｓの出力ＡＳにおいて利用可能になっている。フレーマＦＲとマルチプレクサＭＵは、一緒にシリアライザＳＥを構成している。

クロック発振器ＰＳを用いて、クロックポートＣＬＫ＋，ＣＬＫ−を介して、およびインタフェースロジックＬＳのクロックモジュールＣＳを介して供給されたＤ−ＰＨＹクロック信号は、シリアライザＳＥのための、具体的には、そのマルチプレクサＭＵのための（クロック）基準として用いられ、および該シリアルデータストリームに、すなわち、シリアル化された出力信号に埋め込まれる。これにより、受信装置Ｅ（図２Ａを参照）に伝達される共通信号ストリームＳＩが生成される。

さらに図１Ａを見て分かるように、出力ドライバＡＴは、少なくとも１つの直接接続されたレーザＬＡを駆動するための、具体的には、少なくとも１つの面発光レーザ（Ｖｅｒｔｉｃａｌ Ｃａｖｉｔｙ Ｓｕｒｆａｃｅ Ｅｍｉｔｔｉｎｇ Ｌａｓｅｒｄｉｏｄｅ：ＶＣＳＥＬ）を駆動するための一体型レーザドライバとして実装されている。

図２Ａは、ＤＳＩデータ伝送インタフェースＩＥまたはＣＳＩデータ伝送インタフェースＩＥへの接続のための受信装置Ｅの原理的構造の実施形態を示す。

送信装置Ｓ（図１Ａを参照）によって送出されたシリアルまたは一括データは、受信装置Ｅの入力増幅器ＥＶを介して受け取られ、集積クロックまたはデータリカバリＣＤへ供給される。

この集積クロックまたはデータリカバリＣＤは、共通信号ストリームＳＩから元のＤ−ＰＨＹクロックを再生し、その後、該クロックは、インタフェースロジックＬＥのクロックモジュールＣＥを介して、再び、ＤＳＩまたはＣＳＩが直接、利用できるようにされる。残りのシリアルデータストリームは、デマルチプレクサＤＭによって細分化および並列化されて、原理的には、図１ＢによるフレーマＦＲの鏡像であるデフレーマＤＦ（図２Ｂも参照）へ引き渡される。デマルチプレクサＤＭとデフレーマＤＦは、一緒にデシリアライザＤＳを構成する。

詳細には、図２ＢのデフレーマＦＲは、６ｂ／５ｂ復号器ブロックとして構成されたその復号器ＤＫを用いて、差動データ信号は、ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−と、シングルエンド論理レベルベースのデータ信号ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３を分けて、再並列化されたデータ信号を、それぞれの適用可能なデータラインＣＨ０＋，ＣＨ０−，ＣＨ１＋，ＣＨ１−，ＣＨ２＋，ＣＨ２−，ＣＨ３＋，ＣＨ３−に再割り当てすることができる。

受信装置Ｅ内に図示されているインタフェースロジックブロックＬＥは、それぞれ、Ｄ−ＰＨＹ論理信号の正しい解釈のための、および高周波データストリームと低周波データストリームを区別するための少なくとも１つの状態機械を備えていてもよい。

図２Ａの説明図を見ても分かるように、入力増幅器ＥＶは、集積トランスインピーダンス増幅器として実装され、該増幅器は、フォトダイオードＦＤを受信装置Ｅに直接接続することを可能にしている。

このようにして、本発明によれば、回路装置Ｓ，Ｅ（図１Ａ、図２Ａを参照）に関しては、送信装置Ｓ（図１Ａを参照）と受信装置Ｅ（図２Ａを参照）との間で、ケーブルベースの多重化リンクを光学的に、すなわち、例えば、ガラス繊維の形態でおよび／またはプラスチック繊維の形態で構成された光導波路ＯＭを用いて実現し、および作動させることが可能である。

全てのデータ入力部ＥＳが、シングルエンド論理レベルベースの信号に対応するＨＳデータを処理する状況に基づいて、データ一括化のための通常のアプローチは、図１ＡによるマルチプレクサＭＵによって該データを多重化して、それをシリアル信号ストリームＳＩとして送出することである。

しかし、ＭＩＰＩ−Ｄ−ＰＨＹ規格においては、特に、コモンモードベースの差動信号に対応するＬＰ送信モードへのリターンは、図３に示すように、ＨＳデータのシグナリングに用いられる電圧レベルの範囲外の電圧振幅によって伝えられることが既に合意されている。

これらのＬＰ信号レベルは、既に説明したように、単純に一括化されたシリアル信号ストリームＳＩのデータスペースで符号化することができない追加的な情報を示す。

このため、特に、ＬＰデータだけを含み、ＨＳレーンと並列に該マルチプレクサＭＵに入力される、図１Ｃによる追加的な仮想レーンが導入されている。

このために、少なくとも１つのフィルタＦＩが、マルチプレクサＭＵのＨＳ／ＬＰデータ入力部に設けられ、該フィルタは、該データに固有の電圧レベルにより、ＬＰデータとＨＳデータを識別することができる。このフィルタＦＩは、このようにして得られたＬＰデータを、追加的な入力、いわば、仮想ＨＳデータレーンとして、さらなるまたは追加的なマルチプレクサＭＵＺへ供給する。

このレーンは、テレグラムレーンと呼ぶことができる。該仮想テレグラムレーンの例示的な構造は、以下のようになると思われる。

該仮想テレグラムレーンの１６のビットは、
受信側Ｅで同期を実施するのに用いられる、最初の４ビット長の同期／スタートシーケンスと、
その後の、ＬＰデータごとの３ビットと、
に分けられている。

したがって、図示の実施形態においては、４つのレーン入力ＣＨ０＋，ＣＨ０−，ＣＨ１＋，ＣＨ１−，ＣＨ２＋，ＣＨ２−，ＣＨ３＋，ＣＨ３−が処理される。

さらなるまたは追加的なマルチプレクサＭＵＺの上流でのＬＰデータのシリアライゼーションにより、これらのＬＰデータは、並列に送信されるＨＳデータと同じデータ転送速度では送信されない。実施例として、ここで処理されるこのＭＩＰＩ−Ｄ−ＰＨＹシステムにおいては、いずれにしても、ＬＰデータのデータ転送速度は、ＨＳデータのデータ転送速度よりもかなり遅い。

図２ＡによるデマルチプレクサＤＭは、図１ＣによるマルチプレクサＭＵの鏡像として構成することができる。

Ｅ 受信装置
Ｓ 送信装置
ＡＥ 受信装置Ｅの出力部
ＡＰ アプリケーションプロセッサ
ＡＳ 送信装置Ｓの出力部
ＡＴ 出力ドライバ、具体的には、レーザドライバ
ＣＤ クロックおよびデータリカバリユニット
ＣＥ 受信インタフェースロジックＬＥのクロックモジュール
ＣＨ０± 第１のデータラインまたは第１のチャネル
ＣＨ１± 第２のデータラインまたは第２のチャネル
ＣＨ２± 第３のデータラインまたは第３のチャネル
ＣＨ３± 第４のデータラインまたは第４のチャネル
ＣＬＫ± クロックラインまたはクロックチャネル
ＣＳ 送信インタフェースロジックＬＳのクロックモジュール
ＤＤ０± 第１のデータラインまたは第１のチャネルＣＨ０±上の差動信号、具体的には、コモンモードベースのデータ信号
ＤＤ１± 第２のデータラインまたは第２のチャネルＣＨ１±上の差動信号、具体的には、コモンモードベースのデータ信号
ＤＤ２± 第３のデータラインまたは第３のチャネルＣＨ２±上の差動信号、具体的には、コモンモードベースのデータ信号
ＤＤ３± 第４のデータラインまたは第４のチャネルＣＨ３±上の差動信号、具体的には、コモンモードベースのデータ信号
ＤＦ デフレーマ
ＤＫ デフレーマＤＦの復号器、具体的には、６ｂ／５ｂ復号器ブロック
ＤＭ デマルチプレクサ
ＤＳ デシリアライゼーション要素またはデシリアライザ
ＤＵ ディスプレイユニット
ＥＥ 受信装置Ｅの入力部
ＥＳ 送信装置Ｓの入力部
ＥＶ 入力増幅器、具体的には、トランスインピーダンス増幅器
ＦＤ フォトダイオード
ＦＩ フィルタ、具体的には、データフィルタ、例えば、ＬＰデータフィルタ
ＦＲ フレーマ
ＨＳ 高速
ＨＳＤ０ 第１のデータラインまたは第１のチャネルＣＨ０±上のシングルエンド論理レベルベースのデータ信号
ＨＳＤ１ 第２のデータラインまたは第２のチャネルＣＨ１±上のシングルエンド論理レベルベースのデータ信号
ＨＳＤ２ 第３のデータラインまたは第３のチャネルＣＨ２±上のシングルエンド論理レベルベースのデータ信号
ＨＳＤ３ 第４のデータラインまたは第４のチャネルＣＨ３±上のシングルエンド論理レベルベースのデータ信号
ＩＥ データシンク関連のＣＳＩおよび／またはＣＳＩ−２および／またはＣＳＩ−３および／またはＤＳＩおよび／またはＤＳＩ−２インタフェース
ＩＳ データソース関連のＣＳＩおよび／またはＣＳＩ−２および／またはＣＳＩ−３および／またはＤＳＩおよび／またはＤＳＩ−２インタフェース
ＫＡ カメラ
ＫＯ フレーマＦＲの符号器、具体的には、５ｂ／６ｂ符号器ブロック
ＬＡ レーザ
ＬＥ 受信インタフェースロジック
ＬＰ 低電力
ＬＳ 送信インタフェースロジック
ＭＵ マルチプレクサ
ＭＵＺ マルチプレクサＭＵにおけるさらなるまたは追加的なマルチプレクサ
ＯＭ 光学媒体、具体的には、光導波路、例えば、ガラス繊維および／またはプラスチック繊維
ＰＳ クロック発振器、具体的には、位相ロックループ、例えば、クロックマルチプライヤユニット
ＳＥ シリアライゼーション要素またはシリアライザ
ＳＩ 共通信号ストリーム
ＴＬ クロックライン

Claims (15)

1. シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）と、
   特に、コモンモードベースの、差動データ信号およびクロック信号（ＬＰ）との両方を、
   少なくとも１つのシリアル化された共通信号ストリーム（ＳＩ）の形態で、少なくとも１つのデータソースに割り当て可能な少なくとも１つの送信装置（Ｓ）と、少なくとも１つのデータシンクに割り当て可能な少なくとも１つの受信装置（Ｅ）との間で伝送するための回路装置（Ｓ，Ｅ）であって、前記差動データ信号およびクロック信号（ＬＰ）のデータ転送速度は、前記シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）のデータ転送速度とは異なる回路装置。
2. 前記差動データ信号およびクロック信号（ＬＰ）のデータ転送速度は、前記シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）のデータ転送速度よりも遅いことを特徴とする請求項１に記載の回路装置。
3. 送信装置（Ｓ）は、
   前記データ信号およびクロック信号（ＨＳ；ＬＰ）のための少なくとも１つの入力部（ＥＳ）と、
   入力部（ＥＳ）の下流の、前記データ信号およびクロック信号（ＨＳ；ＬＰ）を受け取るための少なくとも１つの送信インタフェースロジック（ＬＳ）と、
   送信インタフェースロジック（ＬＳ）の下流の、共通信号ストリーム（ＳＩ）を生成するための少なくとも１つのシリアライザ（ＳＥ）と、
   シリアライザ（ＳＥ）の上流で、送信インタフェースロジック（ＬＳ）の少なくとも１つのクロックモジュール（ＣＳ）の下流に設けられた、少なくとも１つの基準クロックを生成するための少なくとも１つのクロック発振器（ＰＳ）、特に、位相ロックループ、例えば、クロックマルチプライヤユニットと、
   シリアライザ（ＳＥ）の下流の少なくとも１つの出力ドライバ（ＡＴ）と、
   出力ドライバ（ＡＴ）の下流の、共通信号ストリーム（ＳＩ）を受信装置（Ｅ）へ送信するための少なくとも１つの出力部（ＡＳ）と、
   を備えることを特徴とする請求項１または２に記載の回路装置。
4. 前記クロック発振器（ＰＳ）は、少なくとも位相ロックループとして、具体的には、少なくとも１つのクロックマルチプライヤユニットとして構成されることを特徴とする請求項３に記載の回路装置。
5. 前記シリアライザ（ＳＥ）は、
   前記送信インタフェースロジック（ＬＳ）の下流の、前記共通信号ストリーム（ＳＩ）のための、前記受信装置（Ｅ）で認識可能な少なくとも１つのフレームを生成するための少なくとも１つのフレーマ（ＦＲ）と、
   前記フレーマ（ＦＲ）の下流の、前記共通信号ストリーム（ＳＩ）を生成するための少なくとも１つのマルチプレクサ（ＭＵ）と、
   を備えることを特徴とする請求項３または４に記載の回路装置。
6. 前記シングルエンド論理レベルベースのデータ信号（ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３）と前記差動データ信号（ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−）との両方を、前記フレーマ（ＦＲ）に印加することができること、および、前記フレーマは、少なくとも１つの符号器（ＫＯ）を用いて、具体的には、少なくとも１つの５ｂ／６ｂ符号器ブロックを用いて、前記差動データ信号（ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−）を、前記シングルエンド論理レベルベースのデータ信号（ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３）のストリームに埋め込むことを特徴とする請求項４に記載の回路装置。
7. 前記マルチプレクサ（ＭＵ）は、
   前記差動データ信号および／またはクロック信号（ＬＰ）と、前記シングルエンド論理レベルベースのデータ信号および／またはクロック信号（ＨＳ）を識別するための少なくとも１つのフィルタ（ＦＩ）と、
   前記フィルタ（ＦＩ）から来る前記差動データ信号および／またはクロック信号（ＬＰ）を追加的に印加することのできる少なくとも１つの追加的なマルチプレクサ（ＭＵＺ）と、
   を備えることを特徴とする請求項５または６に記載の回路装置。
8. 前記受信装置（Ｅ）は、
   前記送信装置（Ｓ）によって送信された前記共通信号ストリーム（ＳＩ）のための少なくとも１つの入力部（ＥＥ）と、
   前記共通信号ストリーム（ＳＩ）を受け取るための少なくとも１つの入力増幅器（ＥＶ）と、
   前記データ信号およびクロック信号（ＨＳ，ＬＰ）を前記共通信号ストリーム（ＳＩ）から復元するための少なくとも１つのクロックおよびデータリカバリユニット（ＣＤ）と、
   前記クロックおよびデータリカバリユニット（ＣＤ）の下流の、少なくとも１つの受信インタフェースロジック（ＬＥ）の少なくとも１つのクロックモジュール（ＣＥ）と、
   前記クロックおよびデータリカバリユニット（ＣＤ）の下流の、前記データおよび／またはクロック信号（ＨＳ，ＬＰ）を再並列化するための、および前記再並列化されたデータおよび／またはクロック信号（ＨＳ，ＬＰ）を受信インタフェースロジック（ＬＥ）に割り当てるための少なくとも１つのデシリアライザ（ＤＳ）と、
   前記受信インタフェースロジック（ＬＥ）の下流の、前記データ信号およびクロック信号（ＨＳ，ＬＰ）のための少なくとも１つの出力部（ＡＥ）と、
   を備えることを特徴とする請求項１〜７の少なくとも一項に記載の回路装置。
9. 前記デシリアライザ（ＤＳ）は、
   前記クロックおよびデータリカバリユニット（ＣＤ）の下流の、前記データおよび／またはクロック信号（ＨＳ，ＬＰ）を再並列化するための少なくとも１つのデマルチプレクサ（ＤＭ）と、
   前記デマルチプレクサ（ＤＭ）の下流の、前記再並列化されたデータおよび／またはクロック信号（ＨＳ，ＬＰ）を、前記受信インタフェースロジック（ＬＥ）に割り当てるための少なくとも１つのデフレーマ（ＤＦ）と、
   を備えることを特徴とする請求項８に記載の回路装置。
10. 前記デフレーマ（ＤＦ）は、前記差動データ信号（ＤＤ０＋，ＤＤ０−，ＤＤ１＋，ＤＤ１−，ＤＤ２＋，ＤＤ２−，ＤＤ３＋，ＤＤ３−）を、少なくとも１つの復号器（ＤＫ）を用いて、具体的には、少なくとも１つの６ｂ／５ｂ復号器ブロックを用いて、前記シングルエンド論理レベルベースのデータ信号（ＨＳＤ０，ＨＳＤ１，ＨＳＤ２，ＨＳＤ３）と分けて、前記再並列化されたデータ信号を、それぞれのデータライン（ＣＨ０＋，ＣＨ０−，ＣＨ１＋，ＣＨ１−，ＣＨ２＋，ＣＨ２−，ＣＨ３＋，ＣＨ３−）に割り当てることを特徴とする請求項９に記載の回路装置。
11. 共通信号ストリーム（ＳＩ）は、
    少なくとも１つの光学媒体（ＯＭ）を介して、具体的には、少なくとも１つの光導波路を介して、例えば、少なくとも１つのガラス繊維および／または少なくとも１つのプラスチック繊維を介して、および／または
    少なくとも１つの電気的またはガルバニックを介して、具体的には、１ビット幅のリンク（ＧＡ）を介して、特に、少なくとも１つの銅線を介しておよび／または例えば、少なくとも１つのプリント回路基板上に配置された少なくとも１つの電気的ラインを介して、
    送信装置（Ｓ）と受信装置（Ｅ）との間で転送可能であることを特徴とする請求項１〜１０の少なくとも一項に記載の回路装置。
12. シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）と、
    特に、コモンモードベースの、差動データ信号およびクロック信号（ＬＰ）との両方を、
    少なくとも１つのシリアル化された共通信号ストリーム（ＳＩ）の形態で、少なくとも１つのデータソースに割り当て可能な少なくとも１つの送信装置（Ｓ）と、少なくとも１つのデータシンクに割り当て可能な少なくとも１つの受信装置（Ｅ）との間で伝送するための方法であって、前記差動データ信号およびクロック信号（ＬＰ）のデータ転送速度が、前記シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）のデータ転送速度と異なる方法。
13. 前記差動データ信号およびクロック信号（ＬＰ）のデータ転送速度は、前記シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）のデータ転送速度よりも遅いことを特徴とする請求項１２に記載の方法。
14. 前記送信装置（Ｓ）と前記受信装置（Ｅ）との間の共通信号ストリーム（ＳＩ）は、
    少なくとも１つの光学媒体（ＯＭ）を介して、具体的には、少なくとも１つの光導波路を介して、例えば、少なくとも１つのガラス繊維および／または少なくとも１つのプラスチック繊維を介して、および／または
    少なくとも１つの電気的またはガルバニックを介して、具体的には、１ビット幅のリンク（ＧＡ）を介して、特に、例えば、少なくとも１つの銅線を介しておよび／または例えば、少なくとも１つのプリント回路基板上に配置された少なくとも１つの電気的ラインを介して、
    転送されることを特徴とする請求項１２または１３に記載の方法。
15. シングルエンド論理レベルベースのデータ信号およびクロック信号（ＨＳ）と、特に、コモンモードベースの差動データ信号およびクロック信号（ＬＰ）の両方の、具体的には、Ｄ−ＰＨＹデータ信号およびＤ−ＰＨＹクロック信号、例えば、４ビット幅以下のＭＩＰＩ−Ｄ−ＰＨＹデータ信号およびＭＩＰＩ−Ｄ−ＰＨＹクロック信号の、少なくとも１つのデータソース、具体的には、例えば、画像ソースとして機能する、例えば、少なくとも１つの高解像度カメラ（ＫＡ）および／または少なくとも１つのアプリケーションプロセッサ（ＡＰ）と、少なくとも１つのデータシンク、具体的には、少なくとも１つのアプリケーションプロセッサ（ＡＰ）および／または少なくとも１つの例えば、高解像度ディスプレイユニット（ＤＵ）および／または例えば、画像シンクとして機能するディスプレイユニット、例えば、少なくとも１つのディスプレイまたは少なくとも１つのモニタとの間での、シリアルおよび／または一括の、具体的には、ＣＳＩプロトコルベースのおよび／またはＣＳＩ−２プロトコルベースのおよび／またはＣＳＩ−３プロトコルベースのおよび／またはＤＳＩプロトコルベースのおよび／またはＤＳＩ−２プロトコルベースの送信中の、請求項１〜１１の少なくとも一項に記載の少なくとも１つの回路装置（Ｓ，Ｅ）の、および／または請求項１２〜１４の少なくとも一項に記載の方法の使用。

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