JP2014513889A - 低密度パリティ検査符号を使用するシステムにおける信号マッピング/デマッピング装置及び方法 - Google Patents
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Abstract
Description
図1を参照すると、LDPC符号化器110は、長さがKldpcである情報語(information word)ベクトル(vector)
また、上記LDPC符号語ベクトルに含まれたLDPC符号語ビットそれぞれの誤り訂正能力は、上記LDPC符号語ビットの各々に該当する変数ノード(variable node)の次数(degree)に対応するように決定される。
また、本発明は、LDPC符号を使用するシステムにおけるLDPC符号語とQAM変調シンボル間のマッピング/デマッピング装置及び方法を提案する。
本発明の上記及び他の態様、特徴、及び利点は、添付の図面と共に述べる以下の詳細な説明から、一層明らかになるはずである。
図面中、同一の図面参照符号は、同一の構成要素、特性、及び構造を意味することが分かるはずである。
下記の説明において、具体的な構成及び構成要素のような特定の詳細は、本発明の実施形態の全般的な理解を助けるために提供されるにすぎない。したがって、本発明の範囲及び趣旨を逸脱することなく、以下に説明される本発明の様々な変形及び変更が可能であることは、当該技術分野における通常の知識を持つ者には明らかである。なお、公知の機能または構成に関する具体的な説明は、明瞭性と簡潔性のために省略する。
本発明の別の実施形態によれば、LDPC符号語(codeword)とQAM(Quadrature Amplitude Modulation)変調シンボル(symbol)間のマッピング/デマッピング装置及び方法を提案する。
図2を参照すると、信号送信装置は、LDPC符号化器210と、前処理器220と、インタリーバ(interleaver)230と、逆多重化器(de-multiplexer:DEMUX)240と、シンボルマッピング器(symbol mapping unit)250と、を含む。
図6ではインタリーバ230は、Nc個の列と、Nldpc/Nc個の行で具現されると仮定する。
まず、Nldpc=16200と仮定する場合、16−QAM変調方式及び64−QAM変調方式に従う行の個数Nrと列の個数Ncは、下記<表1>のように具現される。
図7を参照すると、逆多重化器240の動作は、Vi(i=0,1,・・・,Nldpc-1)とbj(j=0,1,・・・,Nsubstreams−1)との関係で示すことができ、NldpcがNsubstreamsの倍数の場合には、同一の規則を適用して拡張することができる。
図8で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb2に、ビットv1をビットb4に、ビットv2をビットb5に、ビットv3をビットb0に、ビットv4をビットb7に、ビットv5をビットb1に、ビットv6をビットb3に、ビットv7をビットb6にマッピングする。
図9で、Nsubstreams=12と仮定すると、逆多重化器240は、入力ビットv0乃至v11を出力ビットb0乃至b11にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb6に、ビットv4をビットb2に、ビットv5をビットb3に、ビットv6をビットb8に、ビットv7をビットb9に、ビットv8をビットb7に、ビットv9をビットb5に、ビットv10をビットb10に、ビットv11をビットb11にマッピングする。
図10で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb2に、ビットv1をビットb4に、ビットv2をビットb5に、ビットv3をビットb1に、ビットv4をビットb6に、ビットv5をビットb0に、ビットv6をビットb7に、ビットv7をビットb3にマッピングする。
図11で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。すなわち、逆多重化器240は、ビットv0をビットb2に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb3に、ビットv4をビットb6に、ビットv5をビットb4に、ビットv6をビットb7に、ビットv7をビットb5にマッピングする。
図12で、Nsubstreams=12と仮定すると、逆多重化器240は、入力ビットv0乃至v11を出力ビットb0乃至b11にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb4に、ビットv1をビットb2に、ビットv2をビットb0に、ビットv3をビットb5に、ビットv4をビットb6に、ビットv5をビットb1に、ビットv6をビットb3に、ビットv7をビットb7に、ビットv8をビットb8に、ビットv9をビットb9に、ビットv10をビットb10に、ビットv11をビットb11にマッピングする。
図13で、Nsubstreams=12と仮定すると、逆多重化器240は、入力ビットv0乃至v11を出力ビットb0乃至b11にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb6に、ビットv4をビットb2に、ビットv5をビットb3に、ビットv6をビットb5に、ビットv7をビットb8に、ビットv8をビットb7に、ビットv9をビットb10に、ビットv10をビットb9に、ビットv11をビットb11にマッピングする。
図14で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb2に、ビットv1をビットb0に、ビットv2をビットb4に、ビットv3をビットb1に、ビットv4をビットb6に、ビットv5をビットb5に、ビットv6をビットb7に、ビットv7をビットb3にマッピングする。
図15で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb2に、ビットv4をビットb5に、ビットv5をビットb3に、ビットv6をビットb6に、ビットv7をビットb7にマッピングする。
図16で、Nsubstreams=8と仮定すると、逆多重化器240は、入力ビットv0乃至v7を出力ビットb0乃至b7にマッピングする。
すなわち、逆多重化器240は、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb5に、ビットv3をビットb1に、ビットv4をビットb2に、ビットv5をビットb3に、ビットv6をビットb6に、ビットv7をビットb7にマッピングする。
図17を参照すると、信号受信装置は、ビットメトリック計算機1710と、多重化器1720と、デインタリーバ1730と、後処理器1740と、LDPC復号器1750と、を含む。
図18を参照すると、逆多重化器240は、逆多重化ユニット1811と選択信号生成ユニット1813を含む。
逆多重化ユニット1811は、インタリーバ230から出力されたベクトルVを選択信号生成ユニット1813から出力した選択信号を使用してNsubstreams個のサブストリームを生成する。選択信号生成ユニット1813は、ベクトルVが含むビットの各々がどのサブストリームに割り当てられるかを決定する。選択信号生成ユニット1813は、保存ユニット、一例ではメモリに保存された値を読み取るか、予め設定されている規則を有する信号を生成して選択信号を出力する。この時、選択信号生成ユニット1813から出力する選択信号は、システムで使われる誤り訂正符号(error correction code)の種類と符号語長さ、符号率、変調方式などによって決定され、システムの誤り訂正能力に影響を及ぼす重要な要因である。
図19を参照すると、多重化器1720は、多重化ユニット1911と選択信号生成ユニット1913を含む。
多重化ユニット1911は、Nsubstreams個のサブストリームを選択信号生成ユニット1913から出力される選択信号を使用してインタリービングされた符号語の推定値を出力する。選択信号生成ユニット1913は、インタリービングされた符号語の推定値のうち、それぞれのビット値をどのサブストリームで獲得するかを決定する。選択信号生成ユニット1913は、メモリに保存された値を読み取るか、予め設定されている規則を有する信号を生成して選択信号を出力し、信号送信装置が含む逆多重化器、すなわち、図2の逆多重化器240の逆多重化動作に対応する多重化動作を遂行するように設計される。
220 前処理器
230 インタリーバ
240,440 逆多重化器
250 シンボルマッピング器
1710 ビットメトリック計算機
1720 多重化器
1730 デインタリーバ
1740 後処理器
1750 LDPC復号器
1811 逆多重化ユニット
1813 選択信号生成ユニット
1911 多重化ユニット
1913 選択信号生成ユニット
Claims (12)
- 低密度パリティ検査(LDPC)符号を使用するシステムの信号送信装置における信号マッピング方法であって、
LDPC符号語ビットを列方向で保存するステップと、
前記保存されたLDPC符号語ビットを行方向で出力するステップと、
前記出力されたビットを逆多重化方式を使用して逆多重化することによりサブストリームを生成するステップと、
前記サブストリームのそれぞれに含まれたビットを信号コンステレーション内にシンボルでマッピングするステップと、を含み、
前記逆多重化方式は、前記信号送信装置で使用される変調方式と、前記LDPC符号語の長さと、前記サブストリームの個数とに対応するように決定されることを特徴とする信号送信装置の信号マッピング方法。 - 前記サブストリームを生成するステップは、
前記変調方式が64−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが12(Nsubstreams=12)であり、前記出力されたビットであるv0乃至v11を前記12個のサブストリームであるb0乃至b11に割り当てる場合、ビットv0をビットb4に、ビットv1をビットb2に、ビットv2をビットb0に、ビットv3をビットb5に、ビットv4をビットb6に、ビットv5をビットb1に、ビットv6をビットb3に、ビットv7をビットb7に、ビットv8をビットb8に、ビットv9をビットb9に、ビットv10をビットb10に、ビットv11をビットb11に割り当てるステップを含むことを特徴とする請求項1に記載の信号送信装置の信号マッピング方法。 - 前記サブストリームを生成するステップは、
前記変調方式が64−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが12(Nsubstreams=12)であり、前記出力されたビットであるv0乃至v11を前記12個のサブストリームであるb0乃至b11に割り当てる場合、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb6に、ビットv4をビットb2に、ビットv5をビットb3に、ビットv6をビットb5に、ビットv7をビットb8に、ビットv8をビットb7に、ビットv9をビットb10に、ビットv10をビットb9に、ビットv11をビットb11に割り当てるステップを含むことを特徴とする請求項1に記載の信号送信装置の信号マッピング方法。 - 前記サブストリームを生成するステップは、
前記変調方式が256−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが8(Nsubstreams=8)であり、前記出力されたビットであるv0乃至v7を前記8個のサブストリームであるb0乃至b7に割り当てる場合、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb1に、ビットv3をビットb2に、ビットv4をビットb5に、ビットv5をビットb3に、ビットv6をビットb6に、ビットv7をビットb7に割り当てるステップを含むことを特徴とする請求項1に記載の信号送信装置の信号マッピング方法。 - 前記サブストリームを生成するステップは、
前記変調方式が256−QAM)変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが8(Nsubstreams=8)であり、前記出力されたビットであるv0乃至v7を前記8個のサブストリームであるb0乃至b7に割り当てる場合、ビットv0をビットb4に、ビットv1をビットb0に、ビットv2をビットb5に、ビットv3をビットb1に、ビットv4をビットb2に、ビットv5をビットb3に、ビットv6をビットb6に、ビットv7をビットb7に割り当てるステップを含むことを特徴とする請求項1に記載の信号送信装置の信号マッピング方法。 - 低密度パリティ検査(LDPC)符号を使用するシステムにおける請求項1乃至5のいずれか一項に記載の方法を実行する信号送信装置。
- 低密度パリティ検査(LDPC)符号を使用するシステムの信号受信装置における信号デマッピング方法であって、
サブストリームを多重化方式を使用して多重化するステップと、
前記多重化されたビットをデインタリービングするステップと、
前記デインタリービングされたビットをLDPC復号してLDPC符号語ビットを生成するステップと、を含み、
前記多重化方式は、信号送信装置で使用される逆多重化方式に対応するように決定され、前記逆多重化方式は、前記信号送信装置で使用される変調方式と、LDPC符号語の長さと、前記サブストリームの個数とに対応するように決定されることを特徴とする信号受信装置の信号デマッピング方法。 - 前記多重化するステップは、
前記変調方式が64−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが12(Nsubstreams=12)であり、前記12個のサブストリームであるb0乃至b11を前記多重化されたビットであるv0乃至v11に割り当てる場合、ビットb0をビットv2に、ビットb1をビットv5に、ビットb2をビットv1に、ビットb3をビットv6に、ビットb4をビットv0に、ビットb5をビットv3に、ビットb6をビットv4に、ビットb7をビットv7に、ビットb8をビットv8に、ビットb9をビットv9に、ビットb10をビットv10に、ビットb11をビットv11に割り当てるステップを含むことを特徴とする請求項7に記載の信号受信装置の信号デマッピング方法。 - 前記多重化するステップは、
前記変調方式が64−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200で(Nldpc=16200で)、前記サブストリームの個数であるNsubstreamsが12(Nsubstreams=12)であり、前記12個のサブストリームであるb0乃至b11を前記多重化されたビットであるv0乃至v11に割り当てる場合、ビットb0をビットv1に、ビットb1をビットv2に、ビットb2をビットv4に、ビットb3をビットv5に、ビットb4をビットv0に、ビットb5をビットv6に、ビットb6をビットv3に、ビットb7をビットv8に、ビットb8をビットv7に、ビットb9をビットv10に、ビットb10をビットv9に、ビットb11をビットv11に割り当てるステップを含むことを特徴とする請求項7に記載の信号受信装置の信号デマッピング方法。 - 前記多重化するステップは、
前記変調方式が256−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200(Nldpc=16200)であり、前記サブストリームの個数であるNsubstreamsが8(Nsubstreams=8)であり、前記8個のサブストリームであるb0乃至b7を前記多重化されたビットであるv0乃至v7に割り当てる場合、ビットb0をビットv1に、ビットb1をビットv2に、ビットb2をビットv3に、ビットb3をビットv5に、ビットb4をビットv0に、ビットb5をビットv4に、ビットb6をビットv6に、ビットb7をビットv7に割り当てるステップを含むことを特徴とする請求項7に記載の信号受信装置の信号デマッピング方法。 - 前記多重化するステップは、
前記変調方式が256−QAM変調方式であり、前記LDPC符号語の長さであるNldpcが16200で(Nldpc=16200であり、前記サブストリームの個数であるNsubstreamsが8(Nsubstreams=8)であり、前記8個のサブストリームであるb0乃至b7を前記多重化されたビットであるv0乃至v7に割り当てる場合、ビットb0をビットv1に、ビットb1をビットv3に、ビットb2をビットv4に、ビットb3をビットv5に、ビットb4をビットv0に、ビットb5をビットv2に、ビットb6をビットv6に、ビットb7をビットv7に割り当てるステップを含むことを特徴とする請求項7に記載の信号受信装置の信号デマッピング方法。 - 低密度パリティ検査(LDPC)符号を使用するシステムにおける請求項7乃至11のいずれか一項に記載の方法を実行する信号受信装置。
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Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10425110B2 (en) * | 2014-02-19 | 2019-09-24 | Samsung Electronics Co., Ltd. | Transmitting apparatus and interleaving method thereof |
CN111200443B (zh) * | 2014-03-19 | 2023-09-12 | 三星电子株式会社 | 发送设备及其交织方法 |
KR101775704B1 (ko) | 2014-05-21 | 2017-09-19 | 삼성전자주식회사 | 송신 장치 및 그의 인터리빙 방법 |
US20160204804A1 (en) * | 2015-01-13 | 2016-07-14 | Sony Corporation | Data processing apparatus and method |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2009064134A2 (en) * | 2007-11-14 | 2009-05-22 | Lg Electronics Inc. | Method and system for transmitting and receiving signals |
WO2009109830A1 (en) * | 2008-03-03 | 2009-09-11 | Rai Radiotelevisione Italiana S.P.A. | Bit permutation patterns for ldpc coded modulation and qam constellations |
JP2009225416A (ja) * | 2008-07-07 | 2009-10-01 | Sony Corp | データ処理装置、及びデータ処理方法 |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8208499B2 (en) * | 2003-06-13 | 2012-06-26 | Dtvg Licensing, Inc. | Framing structure for digital broadcasting and interactive services |
KR100809619B1 (ko) * | 2003-08-26 | 2008-03-05 | 삼성전자주식회사 | 이동 통신 시스템에서 블록 저밀도 패러티 검사 부호부호화/복호 장치 및 방법 |
KR100922956B1 (ko) * | 2003-10-14 | 2009-10-22 | 삼성전자주식회사 | 저밀도 패리티 검사 코드의 부호화 방법 |
KR100918763B1 (ko) * | 2003-11-14 | 2009-09-24 | 삼성전자주식회사 | 병렬 연접 저밀도 패리티 검사 부호를 사용하는 채널 부호화/복호 장치 및 방법 |
US7395494B2 (en) * | 2003-12-22 | 2008-07-01 | Electronics And Telecommunications Research Institute | Apparatus for encoding and decoding of low-density parity-check codes, and method thereof |
WO2006011744A2 (en) * | 2004-07-27 | 2006-02-02 | Lg Electronics Inc. | Method of encoding and decoding using low density parity check code |
CN101009534A (zh) * | 2007-02-01 | 2007-08-01 | 中兴通讯股份有限公司 | 一种多输入多输出系统的发射方法及系统 |
KR20090063184A (ko) * | 2007-12-12 | 2009-06-17 | 엘지전자 주식회사 | 신호 송수신 방법 및 신호 송수신 장치 |
KR101502623B1 (ko) * | 2008-02-11 | 2015-03-16 | 삼성전자주식회사 | 저밀도 패리티 검사 부호를 사용하는 통신 시스템에서 채널부호/복호 방법 및 장치 |
PL2099135T3 (pl) * | 2008-03-03 | 2018-07-31 | Samsung Electronics Co., Ltd. | Urządzenie i sposób kodowania i dekodowania kanałowego w systemie komunikacyjnym wykorzystującym kody sprawdzania parzystości o niskiej gęstości |
EP2178214A1 (en) * | 2008-10-16 | 2010-04-21 | Thomson Licensing | Method and apparatus for algebraic erasure decoding |
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Patent Citations (3)
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WO2009064134A2 (en) * | 2007-11-14 | 2009-05-22 | Lg Electronics Inc. | Method and system for transmitting and receiving signals |
WO2009109830A1 (en) * | 2008-03-03 | 2009-09-11 | Rai Radiotelevisione Italiana S.P.A. | Bit permutation patterns for ldpc coded modulation and qam constellations |
JP2009225416A (ja) * | 2008-07-07 | 2009-10-01 | Sony Corp | データ処理装置、及びデータ処理方法 |
Non-Patent Citations (2)
Title |
---|
JPN6015047545; Final draft ETSI EN 302 755 V1.2.1 , 201010, pp.1-4,34-81,177 * |
JPN6015047548; Yan Li et al.: 'Bit-reliability mapping in LDPC-coded modulation systems' Communications Letters, IEEE Vol.9, No.1, 200501, pp.1-3 * |
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