JP2014082281A - 基板、半導体装置、基板の製造方法 - Google Patents
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- 239000000758 substrate Substances 0.000 title claims abstract description 129
- 239000004065 semiconductor Substances 0.000 title claims description 33
- 238000004519 manufacturing process Methods 0.000 title claims description 9
- 239000002184 metal Substances 0.000 claims abstract description 39
- 229910052751 metal Inorganic materials 0.000 claims abstract description 39
- 239000000463 material Substances 0.000 claims abstract description 26
- 229920005989 resin Polymers 0.000 description 26
- 239000011347 resin Substances 0.000 description 26
- 238000000034 method Methods 0.000 description 13
- 229910000679 solder Inorganic materials 0.000 description 8
- 235000012431 wafers Nutrition 0.000 description 8
- 238000003825 pressing Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 5
- 238000010438 heat treatment Methods 0.000 description 5
- 239000012212 insulator Substances 0.000 description 4
- 238000005304 joining Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- 239000012298 atmosphere Substances 0.000 description 2
- 238000005520 cutting process Methods 0.000 description 2
- 238000002844 melting Methods 0.000 description 2
- 230000008018 melting Effects 0.000 description 2
- BDAGIHXWWSANSR-UHFFFAOYSA-N methanoic acid Natural products OC=O BDAGIHXWWSANSR-UHFFFAOYSA-N 0.000 description 2
- 238000007747 plating Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- OSWFIVFLDKOXQC-UHFFFAOYSA-N 4-(3-methoxyphenyl)aniline Chemical compound COC1=CC=CC(C=2C=CC(N)=CC=2)=C1 OSWFIVFLDKOXQC-UHFFFAOYSA-N 0.000 description 1
- 229910004166 TaN Inorganic materials 0.000 description 1
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 239000012141 concentrate Substances 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
- 238000007772 electroless plating Methods 0.000 description 1
- 230000004907 flux Effects 0.000 description 1
- 235000019253 formic acid Nutrition 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000003475 lamination Methods 0.000 description 1
- 239000000155 melt Substances 0.000 description 1
- 239000007769 metal material Substances 0.000 description 1
- 230000005012 migration Effects 0.000 description 1
- 238000013508 migration Methods 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 239000012299 nitrogen atmosphere Substances 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229920001296 polysiloxane Polymers 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 238000004528 spin coating Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
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- H01L2224/05138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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Abstract
【課題】基板同士の接合時の加重を大きくしてもバンプ潰れによるブリッジ等の接続不良を防止しつつ、高精度なアライメントができる基板を提供する。
【解決手段】所定の厚さを有する基材10と、該基材の厚さ方向の一方の面に設けられる接続部20を有する基板であって、前記接続部は、所定の深さを有する凹部300と、凹部を囲むように立設した壁部240と、凹部の底面に配置される電極220と、電極と接触して配置される金属部250と、を備えることを特徴とする基板。
【選択図】図3
【解決手段】所定の厚さを有する基材10と、該基材の厚さ方向の一方の面に設けられる接続部20を有する基板であって、前記接続部は、所定の深さを有する凹部300と、凹部を囲むように立設した壁部240と、凹部の底面に配置される電極220と、電極と接触して配置される金属部250と、を備えることを特徴とする基板。
【選択図】図3
Description
本発明は、基板、それを用いた半導体装置および基板の製造方法に関する。
システムの小型化、高機能化のために、より小型で高性能な半導体装置が要請され、微小なバンプが多数形成されたウェハ同士を接合することが検討されている。
微小なバンプが多数形成されたウェハの電極同士を電気的に接続するためには、基材であるウェハに荷重をかける必要があるが、必要な荷重は電極の数とともに増加する。例えば、8インチ(20.32cm)のウェハ全面に径が10μm程度の電極が形成された場合、電極の数は数億個になり、接合に必要な荷重は数トンになる。このような荷重が特定の電極に集中して作用してしまうと、電極やウェハにダメージを及ぼすことがある。
一方、ウェハ(もしくは半導体チップ)同士の接合には、バンプに半田を用いた接合が行われている。小型で高性能な半導体装置の要請によりバンプの小型化が要求される中で、バンプに半田を用いると、バンプが潰れることや、半田成分がマイグレーションを起こすことによりブリッジ等の接続不良が多発してしまう。
特許文献1には、一方の基板の表面に電極を形成し、形成した電極を覆うように樹脂膜を形成した後、電極部が露出するように、形成された樹脂膜の一部に開口部を形成し、開口部に金属ボール(バンプ)を供給した後、他方の基板を積層し、押圧しつつ加熱処理を行う方法が提案されている。
また、特許文献2には、半田バンプを溶融させない状態で基板同士を接合し、接合後に半田を溶融させる方法が提案されている。
また、特許文献2には、半田バンプを溶融させない状態で基板同士を接合し、接合後に半田を溶融させる方法が提案されている。
バンプの小型化が進むに従って、基板同士の接合時に、基板同士を高精度にアライメント(位置合わせ)する要求が高まってきている。また、ウェハなどの大面積で基板同士の接合を実現するために、基板の反り等を抑えるために接合時の加重を大きくしなければならない。
特許文献1の記載の方法では、基板同士の接合時に、基板同士を押圧しつつ加熱処理をする際に金属ボールが潰れても、電極を囲むように樹脂膜が形成されているので、ブリッジ等の接続不良を防止することができる。しかしながら、金属ボールが潰れてしまうので、基板同士を接合するためには、樹脂膜が変形するまで基板同士を押圧する必要がある。樹脂膜が変形するまで基板同士を押圧してしまうと、セルフアライメントによる力は小さいため、基板同士は、セルフアライメントによるアライメントができない。すなわち、基板同士は、高精度なアライメントをすることができない。
また、特許文献2の記載の方法では、半田を溶解させずに基板同士を接合するので、基板同士のセルフアライメントできない。よって、基板同士は、高精度なアライメントをすることができない。
また、特許文献2の記載の方法では、半田を溶解させずに基板同士を接合するので、基板同士のセルフアライメントできない。よって、基板同士は、高精度なアライメントをすることができない。
本発明は、上記事情を鑑みてなされたものであって、基板同士の接合時に、基板同士を押圧しつつ加熱処理してもバンプ潰れによるブリッジ等の接続不良を防止しつつ、高精度なアライメントができる基板を提供することを目的とする。
本発明は、所定の厚さを有する基材と、該基材の厚さ方向の一方の面に設けられる接続部を有する基板であって、前記接続部は、所定の深さを有する凹部と、前記凹部の底面に配置される電極部と、前記凹部の外部に配置され、前記凹部を囲むように立設した壁部と、前記電極部と接触して配置される金属部と、を備えることを特徴とする基板である。
また、本発明は、複数の基板を積層して、電気的に接続した半導体装置であって、前記複数の基板のうち、少なくとも1つは、前記基板であることを特徴とする半導体装置である。
また、本発明は、所定の厚さを有する基材と、該基材の厚さ方向の一方の面に設けられる接続部を有する基板の製造方法であって、所定の深さを有する凹部を形成する工程と、前記凹部の底面に電極部を形成する工程と、前記凹部の外部であって、前記凹部を囲むように壁部を立設する工程と、前記電極部と接触するように金属部を配置する工程と、を有する基板の製造方法である。
本発明の基板によれば、基板同士の接合時に、基板同士を押圧しつつ加熱処理してもバンプ潰れによるブリッジ等の接続不良を防止し、なおかつ、基板同士の高精度なアライメントができる。
また、本発明の半導体装置によれば、バンプの接続不良がなく、高精度なアライメントがされた状態でバンプが接合された半導体装置を提供することができる。
また、本発明の半導体装置によれば、バンプの接続不良がなく、高精度なアライメントがされた状態でバンプが接合された半導体装置を提供することができる。
以下、図面を参照し、本発明の実施形態を説明する。
(第1の実施形態)
本発明における第1の実施形態について、図1から図4を参照して説明する。
図1は、本実施形態の基板1を示す平面図である。基板1は、板状またはシート状の基材10と、基材10の面上に形成された接続部20を複数備えている。
本発明における第1の実施形態について、図1から図4を参照して説明する。
図1は、本実施形態の基板1を示す平面図である。基板1は、板状またはシート状の基材10と、基材10の面上に形成された接続部20を複数備えている。
基材10は、絶縁体あるいは半導体で所定の厚さを有する板状またはシート状に形成されている。基材10を構成する絶縁体および半導体としては、例えばシリコン、樹脂、セラミクス、ガラス等が挙げられる。本実施形態では、基材10として、シリコンウェハを用いている。
また、図示を省略しているが、基材10には、接続部20と電気的に接続された配線が形成されている。配線の態様は、印刷やエッチング等により基材10の厚さ方向の一方または両方の面に形成されてもよいし、ビア等のように、基材を貫通するように形成されてもよいし、さらには、積層技術を用いた立体配線であってもよく、これらが適宜組み合わされてもよい。
また、図示を省略しているが、基材10には、接続部20と電気的に接続された配線が形成されている。配線の態様は、印刷やエッチング等により基材10の厚さ方向の一方または両方の面に形成されてもよいし、ビア等のように、基材を貫通するように形成されてもよいし、さらには、積層技術を用いた立体配線であってもよく、これらが適宜組み合わされてもよい。
基材10の一方の面は、他の基板と接合される面10Aとされている。接合面10Aには、矩形の単位領域11が複数設けられており、各単位領域11に、接続部20が同一レイアウトで形成され、同一態様の配線が形成されている。
図2は、単位領域11を拡大して示す概略図である。接続部20は、基材10上に二次元配列されている。隣接する単位領域との境界12は、個片化の際の切離線、いわゆるスクライブラインとなるが、概念上の線であり、必ずしも基材10上に線状に形成される必要はない。
図3は、接続部20を模式的に示す図であり、基板1の厚み方向の断面図である。なお、図3(a)は電極220と、金属部250を省略して示した接続部20の基板1の厚み方向の断面図であり、図3(b)は、電極220と、金属部250を省略せずに示した接続部20の基板1の厚み方向の断面図である。接続部20は、電極220と、樹脂部(壁部)240と、金属部250と、凹部300と、を備える。
電極220は、基板10の厚さ方向の一方の面に形成された凹部300の底面に形成され、Cu、Ni、Ta、TaN、Ti、TiNのいずれかまたはその合金、または多層構造で形成される。電極220は、基材10の内部に設けられた図示しない配線層と金属部250との電気的な接続がされる。なお、本実施形態では、電極220の表面形状は、円形でも良いし、多角形等でも良い。
樹脂部240は、金属部250を他の基板等と接続する際にブリッジ等により接続不良を防止するものである。樹脂部240は、樹脂材料等の絶縁体で形成されており、電極220を囲むように立設されている。なお、樹脂材料は、フラックス成分を含むものを用いても良い。また、樹脂部240で囲む領域である開口部270は、後述する金属層290等が形成される。
金属部250は、電極220と接触するように、電極220の上部に配置され、電極220を介して配線と電気的な接続がされる。なお、金属部250は、例えば、半田等の金属材料を溶融させたバンプ等で形成される。
図4は、本実施形態における基板1の製造方法を示す図である。
図4(a)に示すように、基板1は、基材10の厚さ方向の一方の面にエッチング等により所定の深さを有する凹部300が形成される。
次に、図4(b)に示すように、基板1は、凹部300の底面に電極220が形成される。ここで、電極220は、スパッタ法またはめっき法によって形成されるが、好ましくは無電解めっき法を用いて形成される。
次に、図4(c)に示すように、基板1は、電極220を形成した面の一面に樹脂が塗布され、樹脂層280が形成される。ここで、樹脂は、スピンコート等により塗布される。
次に、図4(d)に示すように、基板1は、電極220が露出するように樹脂膜280の一部をエッチング等で除去される。この工程により、電極220を囲むように立設する樹脂部(壁部)240が形成される。
次に、図4(e)に示すように、基板1は、基材10の電極220を形成した面の一面に金属が供給され、金属層290が形成される。ここで、金属は、半田等の材料であり、印刷法、スパッタ法、めっき法等により供給される。
次に、図4(f)に示すように、基板1は、バイト260を用いて塗布された金属層290のうち、樹脂部240の高さよりも高い位置にある余分な金属を除去される。なお、本実施形態では、バイト260を用いた例で説明したが、CMP(Chemical Mechanical Polishing)やスキージを用いて余分な金属を除去しても良い。
次に、基板1は、供給された金属層290が溶融する温度以上で加熱されることにより、金属層290は溶融し、図4(g)に示すような楕円体の金属部250が形成される。
ここで、基材10は、絶縁体または半導体で形成されているため、金属層290に対する濡れ性が低い。そのため、凹部300の側壁から金属部250に対して力5が働く。同様に、基材10の表面から金属部250に対して力6が働く。これらの力5と力6により、基板同士の接合時に押圧しつつ加熱しても、金属部250は、潰れにくくなる。そのため、樹脂部240が変形するまで基板同士を押圧しなくても、基板同士は電気的な接続をすることができるので、基板同士はセルフアライメントによる高精度なアライメントができる。また、基板接合時に、基板を加熱処理することにより金属部250が溶融しても、樹脂部240によってブリッジ等による接続不良を防止することができる。
なお、本実施形態において、電極220の表面形状が円形の場合に電極220の直径の長さを直径とする球の体積は、開口部270の体積よりも小さくしても良い。この場合、基板同士の接合時に、基板同士を押圧する圧力を増加させても、ブリッジ等による接続不良を防止する効果が高まる。また、電極220の表面形状が多角形の場合に電極220の対角線の長さを直径とする球の体積は、開口部270の体積よりも小さくしても良い。
また、本実施形態において、凹部300の底面に電極220を形成したが、図5に示すように、凹部300の内部をすべて電極220で満たしても良い。この場合、図4(f)に示す力5は、金属部250に対して働かないが、力6は働く。この力6により、基板同士の接合時に押圧しつつ加熱しても、金属部250は、潰れにくくなるのは同様である。そのため、樹脂部240が変形するまで基板同士を押圧しなくても、基板同士は電気的な接続をすることができるので、基板同士はセルフアライメントによる高精度なアライメントができる。
(第2の実施形態)
次に、第2の実施形態の基板について図6および図7を用いて説明する。
なお、第2の実施形態の基板は、第1の実施形態の基板と接続部のみが異なる。よって、接続部以外の部分については説明を省略する。
次に、第2の実施形態の基板について図6および図7を用いて説明する。
なお、第2の実施形態の基板は、第1の実施形態の基板と接続部のみが異なる。よって、接続部以外の部分については説明を省略する。
図6は、本実施形態の接続部40−1、40−2、40−3を示す図であり、基板の断面図である。
本実施形態の基板は、接続部40−1、40−2、40−3の大きさが異なり、接続部40−1、接続部40−2、接続部40−3の順で大きくなっている。
本実施形態の基板は、接続部40−1、40−2、40−3の大きさが異なり、接続部40−1、接続部40−2、接続部40−3の順で大きくなっている。
接続部40−1、40−2、40−3は、開口部270−1、270−2、270−3の体積をそれぞれ異ならせることにより形成される。ここで、開口部270−1、270−2,270−3の体積を異ならせるためには、開口部270−1、270−2、270−3の高さ(樹脂部240−1、240−240−3の高さと等しい)は、すべて同じにし、開口面積を異ならせる。ここで、開口面積とは、開口部270−1、270−2、270−3の基板1の厚みに対して垂直方向の断面積である。
電極220−1、220−2、220−3は、第1の実施形態と同様に、例えば、表面形状が円形となるように形成されるが、多角形等でも良い。
なお、電極220−1における表面の面積と開口部270−1の開口面積の比と、電極220−2における表面の面積と開口部270−2の開口面積の比と、電極220−3における表面の面積と開口部270−3の開口面積の比と、は等しいことが好ましいが、これに限定されない。
図7は、本実施形態における基板1を他の基板と接合される面10Aから見た図である。
接続部40−1は、単位領域11の中心部分に近い領域に配置されている。接続部40−3は、単位領域11の最外周に配置されている。接続部40−2は、接続部40−1と接続部40−3の間に配置されている。すなわち、単位領域11の中心部分から境界12に近くなるにつれて、接続部を大きくするようにしている。
接続部40−1は、単位領域11の中心部分に近い領域に配置されている。接続部40−3は、単位領域11の最外周に配置されている。接続部40−2は、接続部40−1と接続部40−3の間に配置されている。すなわち、単位領域11の中心部分から境界12に近くなるにつれて、接続部を大きくするようにしている。
このように、境界12に近くなるにつれて接続部を大きくしているため、基板同士の接合時に、基板同士は、より広範囲でセルフアライメント効果を発揮することができる。その結果、より高精度なアライメントをすることができるとともに、基板同士の接合時の加重を大きくしてもバンプ潰れによる接続不良を防止することができる
なお、本実施形態では、接続部40−1、40−2、40−3の大きさは、すべて異なる例について説明したが、少なくとも1つの接続部の大きさが異なれば良く、例えば、図8に示すように、単位領域11の最外周に配置される接続部のみ、他の接続部よりも大きくしても良い。
なお、本実施形態では、接続部40−1、40−2、40−3の大きさは、すべて異なる例について説明したが、少なくとも1つの接続部の大きさが異なれば良く、例えば、図8に示すように、単位領域11の最外周に配置される接続部のみ、他の接続部よりも大きくしても良い。
(第3の実施形態)
次に、第1の実施形態または第2の実施形態の基板1を複数備える半導体装置について説明する。なお、本実施形態では、第1の実施形態の基板1を複数備える半導体を用いて説明する。
次に、第1の実施形態または第2の実施形態の基板1を複数備える半導体装置について説明する。なお、本実施形態では、第1の実施形態の基板1を複数備える半導体を用いて説明する。
図9は、本実施形態の半導体装置2を示す図である。
半導体装置2は、2つの基板を積層し、それぞれの基板を接続部を介して、電気的に接続したものである。本実施形態では、第1の実施形態の基板を2つ用いた例で説明するが、第2の実施形態の基板を2つ用いても良いし、一方の基板に第1の実施形態の基板を用いて、他方の基板に第2の実施形態の基板を用いても良い。また、一方の基板に第1の実施形態の基板または第2の実施形態の基板を用いて、他方の基板に本発明以外の基板を用いても良い。すなわち、少なくとも一方の基板に、第1の実施形態の基板または第2の実施形態の基板を用いれば良い。
半導体装置2は、2つの基板を積層し、それぞれの基板を接続部を介して、電気的に接続したものである。本実施形態では、第1の実施形態の基板を2つ用いた例で説明するが、第2の実施形態の基板を2つ用いても良いし、一方の基板に第1の実施形態の基板を用いて、他方の基板に第2の実施形態の基板を用いても良い。また、一方の基板に第1の実施形態の基板または第2の実施形態の基板を用いて、他方の基板に本発明以外の基板を用いても良い。すなわち、少なくとも一方の基板に、第1の実施形態の基板または第2の実施形態の基板を用いれば良い。
図10は、本実施形態の半導体装置2の製造方法を示す図である。
まず、図10(a)に示すように、金属部250同士が近づくように、基板1同士をアライメント(位置合わせ)しながら、基板1同士を近づける。
まず、図10(a)に示すように、金属部250同士が近づくように、基板1同士をアライメント(位置合わせ)しながら、基板1同士を近づける。
次に、基板1は、押圧されつつ、金属部250が溶融する温度に加熱され、図10(b)に示すように金属部250同士が接続される。このとき、金属部250は、第1の実施形態で述べたように、基板同士を押圧しても潰れにくいため、樹脂部240が変形するまで押圧しなくても金属部250同士が接続される。よって。基板同士は、セルフアライメントによる力が働き、基板同士を高精度にアライメントすることができる。また、樹脂層240により、基板同士の接合時の加重を大きくしてもバンプ潰れによる接続不良を防止することができる。
次に、基板に対する加熱と加圧を終了し、図10(c)に示す半導体装置2が完成する。なお、図10(a)〜図9(c)に示す工程は、真空中や窒素雰囲気中や蟻酸雰囲気中などの所定の雰囲気中で行われる。
本実施形態の半導体装置は、第1の実施形態または第2の実施形態の基板を複数備え、お互いに接合した半導体装置であるため、セルフアライメント効果により高精度なアライメントができ、なおかつ、バンプ潰れによる接続不良を防止することができる。
1・・・基板、2・・・半導体装置、10・・・基材、11・・・単位領域、12・・・境界線、20、40・・・接続部、220・・・電極、240・・・樹脂部(壁部)、250・・・金属部、280・・・樹脂層、290・・・金属層
Claims (6)
- 基材と、該基材の厚さ方向の一方の面に設けられる接続部を有する半導体基板であって、
前記接続部は、
凹部と、
前記凹部の底面に配置される電極部と、
前記凹部の外部に配置され、前記凹部を囲むように立設した非導電性の壁部と、
前記電極部と接触して配置される金属部と、
を備えることを特徴とする半導体基板。 - 前記電極の直径の長さを直径とする球の体積は、前記壁部が囲む体積よりも小さいことを特徴とする請求項1に記載の半導体基板。
- 前記接続部を複数有し、
複数の前記接続部は、大きさがそれぞれ異なることを特徴とする請求項1に記載の半導体基板。 - 請求項1に記載の基板は、所定の単位領域毎に分けられ、
前記所定の単位領域の最外周に配置した前記接続部は、他の接続部よりも大きいことを特徴とする請求項3に記載の半導体基板。 - 複数の半導体基板を積層して、電気的に接続した半導体装置であって、
前記複数の半導体基板のうち、少なくとも1つは、請求項1に記載の半導体基板である
ことを特徴とする半導体装置。 - 基材と、該基材の厚さ方向の一方の面に設けられる接続部を有する半導体基板の製造方法であって、
凹部を形成する工程と、
前記凹部の底面に電極部を形成する工程と、
前記凹部の外部であって、前記凹部を囲むように壁部を立設する工程と、
前記電極部と接触するように金属部を配置する工程と、
を有する半導体基板の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012228294A JP2014082281A (ja) | 2012-10-15 | 2012-10-15 | 基板、半導体装置、基板の製造方法 |
US14/035,516 US20140103522A1 (en) | 2012-10-15 | 2013-09-24 | Semiconductor substrate, semiconductor device, and method of manfacturing semiconductor substrate |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012228294A JP2014082281A (ja) | 2012-10-15 | 2012-10-15 | 基板、半導体装置、基板の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2014082281A true JP2014082281A (ja) | 2014-05-08 |
Family
ID=50474655
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012228294A Pending JP2014082281A (ja) | 2012-10-15 | 2012-10-15 | 基板、半導体装置、基板の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20140103522A1 (ja) |
JP (1) | JP2014082281A (ja) |
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Publication number | Publication date |
---|---|
US20140103522A1 (en) | 2014-04-17 |
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