JP2012222200A - 電子装置 - Google Patents
電子装置 Download PDFInfo
- Publication number
- JP2012222200A JP2012222200A JP2011087591A JP2011087591A JP2012222200A JP 2012222200 A JP2012222200 A JP 2012222200A JP 2011087591 A JP2011087591 A JP 2011087591A JP 2011087591 A JP2011087591 A JP 2011087591A JP 2012222200 A JP2012222200 A JP 2012222200A
- Authority
- JP
- Japan
- Prior art keywords
- wiring board
- electronic device
- metal
- metal core
- core
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/19015—Structure including thin film passive components
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/191—Disposition
- H01L2924/19101—Disposition of discrete passive components
- H01L2924/19107—Disposition of discrete passive components off-chip wires
Landscapes
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
Abstract
【解決手段】電子装置において、メタルコア配線基板2の相対する両面に電子部品9,11が実装される。電子装置は、電子部品の発熱を放熱するためのヒートシンク14と、メタルコア配線基板2を外部と接続する配線用リード5とを有する。メタルコア配線基板2及び電子部品が封止樹脂1により封止されている。ヒートシンク14は、メタルコア配線基板のコアメタル3の一部であり、一体的に形成されている。
【選択図】図1
Description
かかる構成により、電子部品を配線基板に実装し樹脂封止した電子装置において、小型化が可能となる。
図1は、本発明の一実施形態による電子装置の構成を示す外観斜視図である。図2は、本発明の一実施形態による電子装置の構成を示す断面図であり、図1のX−X’断面図である。図3は、本発明の一実施形態による電子装置の構成を示す断面図であり、図1のY−Y’断面図である。なお、図1〜図3において、同一符号は同一部分を示している。
半導体チップ9およびチップ部品11などの電子部品が実装されたメタルコア配線基板2と、このメタルコア配線基板2と接続されたヒートシンク14の一部は、封止樹脂1により封止され、外部環境から保護されている。ヒートシンク14の一部は、封止樹脂1の外部に露出している。
図4は、本発明の一実施形態による電子装置の変形例の構成を示す断面図であり、図1のX−X’断面図である。なお、図4において、図2と同一符号は同一部分を示している。
図5〜図8は、本発明の一実施形態による電子装置の製造プロセスの説明図である。なお、図5〜図8において、図1〜図3と同一符号は同一部分を示している。
図5は、本実施形態による電子装置に用いるメタルコア配線基板2の上面図である。
2…メタルコア配線基板
3…コアメタル
4…座繰り部
5…配線用リード
6…金属ワイヤ
7…IVH
8…基板内層間ビア
9…半導体チップ
10,12…導電性接合剤
11…チップ部品
13,18…貫通ホール
14…ヒートシンク
15…メタルコア配線基板の電子部品実装面
16…ボンディングパッド
17…フランジ部
20…ダイシング位置
Claims (5)
- 相対する両面に電子部品を実装されたメタルコア配線基板と、
前記電子部品の発熱を放熱するためのヒートシンクと、
前記メタルコア配線基板を外部と接続する配線用リードとを有し、
前記メタルコア配線基板及び前記電子部品が封止樹脂により封止された電子装置であって、
前記ヒートシンクは、前記メタルコア配線基板のコアメタルの一部であり、一体的に形成されていることを特徴とする電子装置。 - 請求項1記載の電子装置において、
前記配線リードは、前記ヒートシンクは、前記メタルコア配線基板のコアメタルの一部であり、前記コアメタルから切り離されて形成されていることを特徴とする電子装置。 - 請求項1記載の電子装置において、
前記メタルコア配線基板の電子部品を実装する面に設けられた電子部品搭載用の座繰り部を備え、
前記座繰り部では、前記コアメタルが露出しており、
当該露出したコアメタルの部分に電子部品が接合剤により直接実装されることを特徴とする電子装置。 - 請求項1記載の電子装置において、
前記メタルコア配線基板の層間配線を形成する貫通ホールを備え、
該貫通ホールには、前記封止樹脂が充填されることを特徴とする電子装置。 - 請求項1記載の電子装置において、
前記ヒートシンクに形成された貫通ホールを備え、
該貫通ホールには、前記樹脂封止に用いる樹脂が充填されていることを特徴とする電子装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011087591A JP5401498B2 (ja) | 2011-04-11 | 2011-04-11 | 電子装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011087591A JP5401498B2 (ja) | 2011-04-11 | 2011-04-11 | 電子装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2012222200A true JP2012222200A (ja) | 2012-11-12 |
JP5401498B2 JP5401498B2 (ja) | 2014-01-29 |
Family
ID=47273379
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2011087591A Active JP5401498B2 (ja) | 2011-04-11 | 2011-04-11 | 電子装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5401498B2 (ja) |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01286344A (ja) * | 1988-05-12 | 1989-11-17 | Ibiden Co Ltd | 電子部品搭載用基板 |
JPH04139863A (ja) * | 1990-10-01 | 1992-05-13 | Matsushita Electric Ind Co Ltd | 半導体素子の放熱兼用シールドケース |
JPH05175407A (ja) * | 1991-12-25 | 1993-07-13 | Sumitomo Bakelite Co Ltd | 半導体搭載基板 |
JP2004281722A (ja) * | 2003-03-17 | 2004-10-07 | Hitachi Ltd | 電子回路装置及びその製造方法 |
JP2006005281A (ja) * | 2004-06-21 | 2006-01-05 | Nippon Inter Electronics Corp | リードフレーム及びその製造方法並びに樹脂封止型半導体装置 |
-
2011
- 2011-04-11 JP JP2011087591A patent/JP5401498B2/ja active Active
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01286344A (ja) * | 1988-05-12 | 1989-11-17 | Ibiden Co Ltd | 電子部品搭載用基板 |
JPH04139863A (ja) * | 1990-10-01 | 1992-05-13 | Matsushita Electric Ind Co Ltd | 半導体素子の放熱兼用シールドケース |
JPH05175407A (ja) * | 1991-12-25 | 1993-07-13 | Sumitomo Bakelite Co Ltd | 半導体搭載基板 |
JP2004281722A (ja) * | 2003-03-17 | 2004-10-07 | Hitachi Ltd | 電子回路装置及びその製造方法 |
JP2006005281A (ja) * | 2004-06-21 | 2006-01-05 | Nippon Inter Electronics Corp | リードフレーム及びその製造方法並びに樹脂封止型半導体装置 |
Also Published As
Publication number | Publication date |
---|---|
JP5401498B2 (ja) | 2014-01-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10204848B2 (en) | Semiconductor chip package having heat dissipating structure | |
KR102151047B1 (ko) | 전력 오버레이 구조 및 그 제조 방법 | |
JP4438489B2 (ja) | 半導体装置 | |
TWI613774B (zh) | 功率覆蓋結構及其製造方法 | |
JP5975180B2 (ja) | 半導体モジュール | |
JP6021504B2 (ja) | プリント配線板、プリント回路板及びプリント回路板の製造方法 | |
US20140029201A1 (en) | Power package module and manufacturing method thereof | |
TW201546914A (zh) | 基板及其製造方法 | |
WO1997020347A1 (en) | Semiconductor device, process for producing the same, and packaged substrate | |
JP2007158279A (ja) | 半導体装置及びそれを用いた電子制御装置 | |
JP2019071412A (ja) | チップパッケージ | |
US8598701B2 (en) | Semiconductor device | |
JP2013123011A (ja) | 電子装置 | |
WO2004112129A1 (ja) | 電子装置 | |
JP6697944B2 (ja) | 電力用半導体装置 | |
JP5169800B2 (ja) | 電子装置 | |
JP6048238B2 (ja) | 電子装置 | |
KR101754031B1 (ko) | 양면 기판 노출형 반도체 패키지 | |
JP5358515B2 (ja) | 半導体装置及びそれを用いた電子制御装置 | |
JP5401498B2 (ja) | 電子装置 | |
JP2012253118A (ja) | 半導体装置 | |
JP2011003818A (ja) | モールドパッケージ | |
JP4861200B2 (ja) | パワーモジュール | |
JP2010103231A (ja) | 電子装置 | |
JP2013065887A (ja) | 電子装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20130220 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20130718 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20130730 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20130919 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20131015 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20131028 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 5401498 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |