JP2012195910A - 検波回路 - Google Patents
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Abstract
【解決手段】検波回路は,アノードに交流信号が入力されると共に定電圧が供給される第1のダイオードと,アノードに前記定電圧が供給される第2のダイオードと,第1のダイオードに流れる第1の電流と,第2のダイオードに流れる第2の電流との差電流を生成する差電流生成回路とを有する。
【選択図】図5
Description
アノードに前記定電圧が供給される第2のダイオードと,
前記第1のダイオードに流れる第1の電流と,前記第2のダイオードに流れる第2の電流との差電流を生成する差電流生成回路とを有する。
図3は,第1の実施の形態における電力検波回路である。図3の電力検波回路は,交流信号である高周波信号が入力端子RFINの入力容量CIを介して供給される第1のダイオードD1を有する入力回路20と,第2のダイオードD2を有する基準回路22とを有する。入力容量CIは,入力端子RFINに印加される高周波信号のDC成分をカットし,AC成分のみを第1のダイオードD1のアノードに印加する。すなわち,ノードn1には高周波信号のAC成分が印加されることになる。第1のダイオードD1は,ノードn1に印加されるAC成分を整流するダイオードであり,第2のダイオードD2は,ダイオードの閾値電圧の変動を補償する補償用ダイオードである。両ダイオードD1,D2は,PN接合などを有する一方向性素子である。
まず,図3の電力検波回路の通常動作である電力検波の動作を説明する。図4は,図3の電力検波回路の通常動作を説明する図である。図4の横軸は時間t,縦軸は電圧Vであり,入力回路20内のノードn1の印加電圧VB+RFINとダイオードD1の閾値電圧Vthとの関係が示されている。図中入力端子RFINに印加される高周波信号のAC成分がRFINで示されている。
次に,ダイオードD1,D2の相対ばらつきや,カレントミラー回路の電流コピー誤差によって誤差電流またはオフセット電流が生じた場合の動作について説明する。このような誤差電流が発生すると,出力回路26に入力される差電流IACに誤差電流が混入し,入力高周波信号の電力に対応した正確な電流IACを出力できなくなる。したがって,このような誤差電流をゼロにするキャリブレーション機能が必要になる。
前述の通り,ダイオードの相対的なばらつきやカレントミラー誤差によって生じる誤差電流を低減させるために,本実施の形態の電力検波回路は,キャリブレーション回路を有する。図5のキャリブレーション回路は,定電流Iを出力抵抗ROに供給する電流源と,基準電位を発生する定電流I’及び抵抗RO’と,その差電圧の大小を比較する比較器28と,比較器の結果によってスイッチング制御を行いカレントミラー回路CM1のカレントミラー比を調整するキャリブレーション制御部16とを有する。
図8は,第1の実施の形態における電力検波回路の変形例1を示す図である。この変形例1では,カレントミラー回路CM2のカレントミラー比を調整する。そのために,カレントミラー回路CM2のNMOSトランジスタN21に並列に,調整用トランジスタN22,N23を設け,それらのゲートのスイッチSW0,SW1をキャリブレーション回路14内の制御回路の制御コードS16によりオン,オフ制御する。これにより,トランジスタN21側の基準電流の大きさが調節される。キャリブレーション方法は,前述と同じである。なお,調整用トランジスタN22,N23は,図5と同様に2の累乗のチャネル幅に設定されていることが望ましい。また,調整用トランジスタは,図5と同様に3個であってもよい。さらに,調整用トランジスタは,トランジスタN20に並列に設けても良い。
V1 = I・t/C3 (1)
つまり,電圧V1は既知の電流I,時間(クロックCLKの4周期)t,容量値C3により一定値に定まる。この電位V1を予めインバータ30の閾値と同じ電位になるように設定しておく。
図15は,第2の実施の形態における電力検波回路の図である。この電力検波回路は,第1の実施の形態と同様に,入力回路20と基準回路22とを設け,両ダイオードD1,D2に生成される電流の差IACを,差電流生成回路24でノードn3に生成し,その差電流IACを出力抵抗ROに流して,その電圧を出力端子OUTから出力する。
アノードに交流信号が入力されると共に定電圧が供給される第1のダイオードと,
アノードに前記定電圧が供給される第2のダイオードと,
前記第1のダイオードに流れる第1の電流と,前記第2のダイオードに流れる第2の電流との差電流を生成する差電流生成回路とを有する検波回路。
付記1において,
前記差電流生成回路は,
前記第1のダイオードのカソード側に設けられ前記第1の電流と第1のカレントミラー比の電流値を有する第3の電流を生成する第1のカレントミラー回路と,
前記第2のダイオードのカソード側に設けられ前記第2の電流と第2のカレントミラー比の電流値を有する第4の電流を生成する第2のカレントミラー回路と,
前記第3の電流と第3のカレントミラー比の電流値を有する第5の電流,または,前記第4の電流と前記第3のカレントミラー比の電流値を有する第6の電流を生成する第3のカレントミラー回路と,
前記第5の電流の経路と前記第4の電流の経路とが接続される接続ノードまたは前記第6の電流の経路と前記第3の電流の経路とが接続される接続ノードとを有し,
前記接続ノードに前記差電流が生成される検波回路。
付記2において,
さらに,前記交流信号の入力を停止した状態で,前記差電流が減少する様に,前記第1,第2,第3のカレントミラー比のうち少なくとも一つを可変設定するキャリブレーション回路を有する検波回路。
付記1または2において,
前記定電圧が第1の抵抗を介して前記第1のダイオードのアノードに印加され,第2の抵抗を介して前記第2のダイオードのアノードに印加され,
さらに,前記高周波信号の入力を停止した状態で,前記差電流が減少する様に,前記第2の抵抗の抵抗値を可変設定するキャリブレーション回路を有する検波回路。
付記3または4において,
前記キャリブレーション回路は,前記差電流の符号を検出する比較器と,前記比較器の比較結果に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。
付記5において,
前記キャリブレーション回路は,キャリブレーション用電流が第1のスイッチを介して供給されるキャリブレーション容量と,前記接続ノードと前記キャリブレーション容量との間に設けられた第2のスイッチと,前記接続ノードの電圧を入力するインバータと,前記第1のスイッチがオンされて前記キャリブレーション容量が前記インバータの閾値電圧まで充電された後に前記第1のスイッチがオフされ前記第2のスイッチがオンされて前記差電流が前記キャリブレーション容量に供給された時の前記インバータの出力に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。
付記3において,
前記第1,第2,第3のカレントミラー回路は,ゲートが共通に接続された1対のトランジスタをそれぞれ有し,前記1対のトランジスタのチャネル幅比を可変設定することで前記第1,第2,第3のカレントミラー比の可変設定が行われる検波回路。
付記2において,
前記第1のダイオードのカソードと前記第1のカレントミラー回路との間に設けられた第1の平滑化回路と,
前記第2のダイオードのカソードと前記第2のカレントミラー回路との間に設けられた第2の平滑化回路とを有する検波回路。
付記8において,
前記第1の平滑化回路は,前記第1のダイオードのカソードに接続された第1の平滑化キャパシタと,前記第1のダイオードのカソードと前記第1のカレントミラー回路との間に設けられた第3の抵抗とを有し,
前記第2の平滑化回路は,前記第2のダイオードのカソードに接続された第2の平滑化キャパシタと,前記第2のダイオードのカソードと前記第2のカレントミラー回路との間に設けられた第4の抵抗とを有する検波回路。
付記1乃至9のいずれか一つにおいて
前記差電流の大きさを出力する出力回路を有する検波回路。
付記5において,
前記差電流の大きさを出力する出力回路を有し,
前記出力回路は,前記接続ノードとグランドとの間に設けられた出力抵抗と,前記出力抵抗の電圧を出力する出力端子とを有し,
前記キャリブレーション回路は,前記出力ノードに供給される第1の電流源と,前記第1の電流源と出力抵抗の第1の直列回路に並列に設けられた第2の電流源と基準抵抗の第2の直列回路と,前記出力抵抗と基準抵抗の電圧を比較する比較器と,前記比較器の比較結果に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。
付記10または11において,
前記出力回路は,前記接続ノードとグランドとの間に設けられた出力抵抗と,前記出力抵抗の電圧を出力する出力端子とを有する検波回路。
入力信号に対応する電圧に,バイアス電圧に基づく第1の電圧を加えた電圧を整流する第1の整流回路と,
前記第1の整流回路により整流される電流を検出する第1の電流検出回路と,
前記バイアス電圧に基づく第2の電圧を整流する第2の整流回路と,
前記第2の整流回路により整流される電流を検出する第2の電流検出回路と,
前記第1の電流検出回路で検出される電流と前記第2の電流検出回路で検出される電流との差分を検出する電流差分検出回路と
を有する検波回路。
付記13において
前記第1の電流検出回路,前記第2の電流検出回路及び前記電流差分検出回路は,各々カレントミラー回路を有し,
前記各々のカレントミラー回路の少なくとも何れか一つは,ミラー比が調整可能である検波回路。
付記13または14において
さらに,前記第1の整流回路と前記バイアス電圧を発生する電源との間に接続される第1の抵抗と,
前記第2の整流回路と前記電源との間に接続される第2の抵抗とを有し,
前記第2の抵抗は可変抵抗である検波回路。
付記14において
さらに,前記差分に応じて制御信号を出力する制御回路を有し,
前記制御回路は,前記入力信号が無信号時に,前記差分が減少するように,前記カレントミラー回路の前記ミラー比を調整する検波回路。
付記15において
さらに,前記差分に応じて制御信号を出力する制御回路を有し,
前記制御回路は,前記入力信号が無信号時に,前記差分が減少するように,前記第2の抵抗の抵抗値を調整する検波回路。
付記13乃至17のいずれか一つにおいて
さらに,前記差分を電圧に変換する電流電圧変換回路を有する検波回路。
付記18において
前記制御回路は,前記電流電圧変換回路と前記電源との間に接続される第1の定電流源と,
前記電源に一方の端子が接続される第2の定電流源と,
前記電流電圧変換回路と前記第1の定電流源の接続ノードの電圧及び前記第2の定電流源の他方の端子の電圧を比較する比較器とを有し,
前記制御回路は,前記比較器の出力結果に応じて前記制御信号を出力する検波回路。
RFIN:入力端子 VB:DC電圧,定電圧,バイアス電圧,電源電圧
R1,C1:平滑化回路 R2,C2:平滑化回路
24:差電流生成回路 CM1,CM2,CM3:カレントミラー回路
26:出力回路 14:キャリブレーション回路
Claims (10)
- アノードに交流信号が入力されると共に定電圧が供給される第1のダイオードと,
アノードに前記定電圧が供給される第2のダイオードと,
前記第1のダイオードに流れる第1の電流と,前記第2のダイオードに流れる第2の電流との差電流を生成する差電流生成回路とを有する検波回路。 - 請求項1において,
前記差電流生成回路は,
前記第1のダイオードのカソード側に設けられ前記第1の電流と第1のカレントミラー比の電流値を有する第3の電流を生成する第1のカレントミラー回路と,
前記第2のダイオードのカソード側に設けられ前記第2の電流と第2のカレントミラー比の電流値を有する第4の電流を生成する第2のカレントミラー回路と,
前記第3の電流と第3のカレントミラー比の電流値を有する第5の電流,または,前記第4の電流と前記第3のカレントミラー比の電流値を有する第6の電流を生成する第3のカレントミラー回路と,
前記第5の電流の経路と前記第4の電流の経路とが接続される接続ノードまたは前記第6の電流の経路と前記第3の電流の経路とが接続される接続ノードとを有し,
前記接続ノードに前記差電流が生成される検波回路。 - 請求項2において,
さらに,前記交流信号の入力を停止した状態で,前記差電流が減少する様に,前記第1,第2,第3のカレントミラー比のうち少なくとも一つを可変設定するキャリブレーション回路を有する検波回路。 - 請求項1または2において,
前記定電圧が第1の抵抗を介して前記第1のダイオードのアノードに印加され,第2の抵抗を介して前記第2のダイオードのアノードに印加され,
さらに,前記高周波信号の入力を停止した状態で,前記差電流が減少する様に,前記第2の抵抗の抵抗値を可変設定するキャリブレーション回路を有する検波回路。 - 請求項3または4において,
前記キャリブレーション回路は,前記差電流の符号を検出する比較器と,前記比較器の比較結果に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。 - 請求項5において,
前記キャリブレーション回路は,キャリブレーション用電流が第1のスイッチを介して供給されるキャリブレーション容量と,前記接続ノードと前記キャリブレーション容量との間に設けられた第2のスイッチと,前記接続ノードの電圧を入力するインバータと,前記第1のスイッチがオンされて前記キャリブレーション容量が前記インバータの閾値電圧まで充電された後に前記第1のスイッチがオフされ前記第2のスイッチがオンされて前記差電流が前記キャリブレーション容量に供給された時の前記インバータの出力に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。 - 請求項2において,
前記第1のダイオードのカソードと前記第1のカレントミラー回路との間に設けられた第1の平滑化回路と,
前記第2のダイオードのカソードと前記第2のカレントミラー回路との間に設けられた第2の平滑化回路とを有する検波回路。 - 請求項7において,
前記第1の平滑化回路は,前記第1のダイオードのカソードに接続された第1の平滑化キャパシタと,前記第1のダイオードのカソードと前記第1のカレントミラー回路との間に設けられた第3の抵抗とを有し,
前記第2の平滑化回路は,前記第2のダイオードのカソードに接続された第2の平滑化キャパシタと,前記第2のダイオードのカソードと前記第2のカレントミラー回路との間に設けられた第4の抵抗とを有する検波回路。 - 請求項1乃至8のいずれか一つにおいて
さらに,前記差電流の大きさを出力する出力回路を有する検波回路。 - 請求項5において,
前記差電流の大きさを出力する出力回路を有し,
前記出力回路は,前記接続ノードとグランドとの間に設けられた出力抵抗と,前記出力抵抗の電圧を出力する出力端子とを有し,
前記キャリブレーション回路は,前記出力ノードに供給される第1の電流源と,前記第1の電流源と出力抵抗の第1の直列回路に並列に設けられた第2の電流源と基準抵抗の第2の直列回路と,前記出力抵抗と基準抵抗の電圧を比較する比較器と,前記比較器の比較結果に応じて,前記可変設定をするキャリブレーション制御回路とを有する検波回路。
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