JP2010258902A - アナログ増幅回路を用いた出力回路 - Google Patents
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Abstract
【解決手段】出力回路が、アナログ増幅回路と、第1〜第n出力ノードと、出力パッドと、第1〜第n静電保護抵抗とを具備している。アナログ増幅回路は、入力電圧を受け取る差動増幅段と、第1〜第n出力系統とを備えている。第1〜第n出力系統のうちの第i出力系統は(iは、1以上n以下の任意の整数)、第1〜第n出力ノードのうちの第i出力ノードにドレインが接続され、ゲートが差動増幅段の第1出力に接続されたPMOSトランジスタと、第i出力ノードにドレインが接続され、ゲートが差動増幅段の第2出力に接続されたNMOSトランジスタとを備えている。第1〜第n静電保護抵抗は、それぞれ、第1〜第n出力ノードと出力パッドの間に接続されている。
【選択図】図4
Description
Industries Association of Japan)で決められた静電保護基準を満足することができない。
図4は、本発明の第1の実施形態における出力回路の構成の例を示す回路図である。図4の出力回路は、アナログ増幅回路1と、出力パッド2と、静電保護抵抗RESD1、RESD2と、帰還抵抗R1、R2とを備えている。
Vout=Vin
となる。本実施形態の出力回路では、帰還経路に帰還抵抗R1、R2が設けられている。仮に、MOSトランジスタの素子バラツキのために出力ノードNOUT1、NOUT2間に電位差が生じた場合、帰還抵抗R1、R2の間に電流が流れる。ここで帰還抵抗R1、R2の抵抗値が同一で、静電保護抵抗RESD1、RESD2の抵抗値が同一であれば、出力ノードNOUT1、NOUT2の間に電圧が生じても、差動増幅段3の反転入力端子に接続されている帰還抵抗R1、R2の共通接続点と出力パッド2に接続されている静電保護抵抗RESD1、RESD2の共通接続点は同じ電位になる。すなわち、入力電圧と出力パッド2に出力される電圧は等しくなる。これは、オフセット電圧が発生しないことを意味する。
図6は、第2の実施形態における出力回路の構成を示す回路図である。図6の回路構成は、図4の回路構成を一般化したもので、n個の出力系統を有している。図4の回路構成は、図6において、n=2の例である。
図7を参照して、第3の実施形態における出力回路の構成を説明する。第3の実施形態の出力回路では、帰還点が、第1の実施形態(図4参照)から変更される。詳細には、図4において帰還抵抗R1、R2を削除し、その代わりに、差動増幅段3の反転入力端子と出力パッド2の間に接続された第3の静電保護抵抗RESD3が設けられる。これ以外の構成は、第1の実施形態(図4)と全く同一である。なお、図6の出力回路に対しても、帰還抵抗R1〜Rnを削除して第3の静電保護抵抗RESD3の一端を差動増幅段3の反転入力端子に接続し、第3の静電保護抵抗RESD3の他端を出力パッド2に接続する構成も可能であることに留意されたい。
2:出力パッド
3:差動増幅段
4:出力段
101:アナログ増幅回路
102:出力パッド
103:差動増幅段
104:出力段
105:内部回路
106:出力端子パッド
107:インバータ
Claims (4)
- 入力電圧を受け取る差動増幅段と第1〜第n出力系統とを備えるアナログ増幅回路と(nは2以上の自然数)、
第1〜第n出力ノードと、
出力パッドと、
第1〜第n静電保護抵抗
とを具備し、
前記第1〜第n出力系統のうちの第i出力系統は(iは、1以上n以下の任意の整数)、
前記第1〜第n出力ノードのうちの前記第i出力ノードにドレインが接続され、ゲートが前記差動増幅段の第1出力に接続されたPMOSトランジスタと、
前記第i出力ノードにドレインが接続され、ゲートが前記差動増幅段の第2出力に接続されたNMOSトランジスタ
とを備え、
前記第1〜第n静電保護抵抗が、それぞれ、前記第1〜第n出力ノードと前記出力パッドの間に接続された
出力回路。 - 請求項1に記載の出力回路であって、
更に、第1〜第n帰還抵抗を具備し、
前記差動増幅段は、
前記入力電圧が入力される正転入力端子と、
反転入力端子
とを有しており、
前記第1〜第n帰還抵抗が、それぞれ、前記第1〜第n出力ノードと前記反転入力端子との間に接続された
出力回路。 - 請求項1又は2に記載の出力回路であって、
更に、
第1〜第nP側位相補償容量と、
第1〜第nN側位相補償容量
とを具備し、
前記第1〜第nP側位相補償容量の一端は、それぞれ、前記第1〜第n出力ノードに接続され、
前記第1〜第nN側位相補償容量の一端は、それぞれ、前記第1〜第n出力ノードに接続され、
前記第iP側位相補償容量と前記第iN型位相補償容量の他端は共通に接続された上で前記差動増幅段に接続された
出力回路。 - 請求項1に記載の出力回路であって、
更に、第(n+1)静電保護抵抗を具備し、
前記差動増幅段は、
前記入力電圧が入力される正転入力端子と、
反転入力端子
とを有しており、
前記第(n+1)静電保護抵抗は、前記出力パッドと前記反転入力端子の間に接続された
出力回路。
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