JP2010107732A - 液晶表示装置 - Google Patents
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Abstract
【解決手段】 基板上にマトリクス状に配置された液晶画素PXと、列毎に設けられ、各列のそれぞれの液晶画素と接続して当該液晶画素に映像信号に対応する2値信号を供給する信号線Sと、行毎に設けられ、各行のそれぞれの液晶画素と接続し、行単位に液晶画素を選択して映像信号に対応する2値信号を書き込み・保持させる複数の制御信号を供給する制御線Gとを有し、液晶画素は、映像信号に対応する2値信号を取り込むスイッチ素子Wと、取り込んだ2値信号を保持するスタティックメモリ10と、保持された2値信号の極性を制御する極性制御部13と、極性が制御された2値信号から液晶に印加する電圧を生成する印加電圧生成部14と、印加された電圧に対応して透過率を変更する液晶CLCとを備えた液晶表示装置である。
【選択図】 図2
Description
図12に示す回路では、第1トランジスタ15のドレイン電極はスタティック・メモリの記憶状態をセットするための入力に、第2トランジスタ18のドレイン電極はリセットするための入力に、第1トランジスタのソース電極はデータ線に各々接続され、ゲート線と平行方向に一列に配置された複数の画素回路に含まれる第1トランジスタのゲート電極は複数のゲート線のいずれか1本のゲート線に接続され、前記一列に配置された複数の画素回路に対して隣接して一列に配列された複数の画素回路に含まれる第2トランジスタのゲート電極が一本のゲート線に接続された構成となっている。
また、VLCa、VLCbの駆動回路をアレイ内に画素と同じプロセスで集積する場合には駆動回路の回路規模が大きくなるため、広いレイアウトスペースを必要とし、額縁が大きくなってしまい商品価値を損なうことにつながる。
また、電源立ち上げ時、立ち下げ時、突発的な電源断に対し、この回路では画素の保持電流が抜けにくいため残像を発生させ易いという問題点も指摘されている。
以下、本発明の一実施形態に係る液晶表示装置について添付図面を参照して説明する。
表示パネル1は、ガラス板等の光透過性絶縁基板であるアレイ基板2上にマトリクス状に配列されるm×n個の液晶画素PX、液晶画素の行毎に接続されているとともにそれぞれ独立して4本ずつ設けられた第1走査制御線群G1、・・・、第m走査制御線群Gmを備えている。そして、それぞれの走査制御線群Gには、各液晶画素PXの動作を制御する制御線Gate,GateB、PolA,PolBが設けられている。
なお、走査制御線駆動回路5、信号線駆動回路6、及びコントローラ3は、アレイ基板2上に形成されても良く、基板2の外に外部ICとして設けられても良い。
なお、それぞれの液晶画素PXの構成は同一であるため、以下の説明では、液晶画素を特定する添え字を省略する。
なお、図2には、液晶画素PXの動作説明のために、残像対策スイッチ15との接続を併せて図示している。
またコモン線COMは、インバータと残像対策SWを介して信号線Sと接続している。
そして、残像対策SWは、リセット線を介して供給されるリセット信号Rsetによって断続動作を行う。
図3は、画素電位の書き換え動作を説明する図である。この動作は、信号線Sの1ビット情報である「H」レベル(=「VLCH」)、「L」レベル(=「VLCL」)を液晶層に印加する動作である。この動作時にはコントローラ3によって、制御線Gateは「H」、制御線GateBは制御線Gateとは逆の「L」、制御線PolAは「L」、制御線PolBは「H」の電位となり、残像対策SWは「OFF」の状態となっている。
制御線Gateの電位が「H」となったとき、スイッチング素子Wは導通し、第1のインバータ回路11の入力端子には「H」が印加される。その結果、ノードa2は「VLCL」の電位となる。しかし、クロックドインバータ回路12は制御線Gateの電位が「H」、制御線GateBの電位が「L」であることから「OFF」状態となっている。従って、ノードa3には、図に示す矢印の経路により、信号線Sの電位「H」が印加される。
上述と同様の経路で、信号線Sの電位「L」が伝播し、ノードa4の電位は、ノードa3の電位である「L」となる。その結果、第2のインバータ回路14では、TFT33が「ON」状態となり、画素電極PEには電位「VLCH」が印加される。
画素電位書き換え動作時の信号線Sの電位が「H」の場合について説明する。このときは上述のように、ノードa1、a3の電位は「H」であり、ノードa2の電位は「VLCL」である。
即ち、SRAM回路10の出力であるノードa2の電位は「VLCL」、ノードa3の電位は「VLCH」を保持する。
なお、 画素電位書き換え動作時の信号線Sの電位が「L」の場合には、ノードa2の電位は「VLCH」、ノードa3の電位は「VLCL」を保持する。しかし、この場合であっても、制御線PolAと制御線PolBの極性を交互に切り替えることで、液晶に印加される電圧を交流化することができる。
液晶表示装置の電源投入時/電源立ち下げ時/突発電源断時では、全ての液晶画素PXに対して、コントローラ3が、強制的に制御線Gateを「H」、制御線GateBを「L」、制御線PolAを「L」、制御線PolBを「H」の電位とし、リセット信号Rsetを「ON」とする。
ここで、突発電源断時とは、例えば、携帯電話、デジタルカメラ、デジタルレコーダなどで電源断スイッチ操作を行わずに、直接電池、あるいは電源パックを取り外すような場合を想定している。
液晶画素PXでは、液晶に印加する電圧を交流化することが必要である。これは、同じ極性の直流電圧を継続して液晶に印加した場合は、イオン化の影響により表示不良が発生するからである。
図6では、コモン線COMの電圧をフレーム毎に反転する。そして、フレーム毎に制御線PolA、PolBの「H」,「L」電位を交互に入れ替える。
そこで、制御線Gateの電位を「L」→「H」→「L」とパルス状に変化させる。このとき、第1フレームでは、制御線PolAは「L」、制御線PolBは「H」の状態となり、即ち、図3に示す書き換え状態となっているため、制御線Gateの電位が「H」のタイミングで、信号線Sの電位に対応して画素電位を書き換えることができる。
図7では、縦方向に順次走査制御線群G1〜Gmを選択している。このため、選択ラインの制御線Gateのパルス位置は、右の方向にシフトしている。
この液晶表示装置はSRAM回路10を備えている。従って、フレーム毎に画素電位を書き換えて更新する必要はなく、制御線PolA,PolBの電位を切り替えることで上述の交流化動作を実現できる。
ここで、PolAが立ち下がった後、所定時間後にPolBが立ち上がる(あるいは、PolBが立ち下がった後、所定時間後にPolAが立ち上がる)のは、両信号が同時に「H」となることによる動作の競合を回避するためである。
第2の実施の形態では、液晶画素PXの構成が第1の実施の形態と異なっている。従って、第1の実施の形態と同一の部位には同一の符号を付して、その詳細の説明は省略する。
第2の実施の形態の液晶画素PXでは、スイッチング素子W1がNチャンネルトランジスタとPチャンネルトランジスタとを用いたトランスファーゲートで構成されている。
図3に示すスイッチング素子Wは、Nチャンネルトランジスタのみで構成されていた。従って、信号線Sから電圧「H」が入力されたときは、閾値電圧だけ減少した電圧(H−Vth)がノードa1に印加される。これに対して、スイッチング素子W1では、Pチャンネルトランジスタが閾値電圧の低下を補うため、電圧「H」をノードa1に印加することができる。
この結果、第1の実施の形態の液晶画素PXで設けられていた第2のインバータ回路14が不要となり、極性反転スイッチ13’の出力を直接画素電極PEに供給することができる。
第3の実施の形態では、液晶画素PXの構成が第1の実施の形態と異なっている。従って、第1の実施の形態と同一の部位には同一の符号を付して、その詳細の説明は省略する。
第3の実施の形態の液晶画素PXでは、第1の実施の形態の液晶画素PXを構成していた第2のインバータ回路14が設けられていない。
上述のように、第2のインバータ回路14は、閾値電圧の影響を回避するために設けられていたため、第2のインバータ回路14を設けない場合は、前段において、閾値電圧Vthの影響を補償することが必要となる。
あるいは、出力電圧がVth低下したときはそれに対応して、コモン線COMの電圧をVthだけシフトして調整することで、閾値電圧の影響を回避しても良い。
第4の実施の形態では、液晶画素PXを用いて面積変調によるデジタル階調表示を行う。第1の実施の形態と同一の部位には同一の符号を付して、その詳細の説明は省略する
これは、画素電極PEを所定数毎にブロック化すると共に、ブロック内の各々の画素電極の寸法を変え、各ブロック内で表示すべき画素を選択することにより、各ブロックの表示画素面積をデジタル的に変化するものである。
これは、4ビット16階調表示の場合を示している。P0に対応した画素電極PEの面積を1とすると、P1は2倍、P2は4倍、P3は8倍となっている。
入力される4ビットの画像データは、各ビットに対応して設けられたSRAM回路10によって書込み電圧に変換されて、P0〜P3の画素電極PEに供給される。
本発明の実施の形態の液晶画素PXには、第1のインバータ回路11とクロックドインバータ回路12からなるSRAM回路10、極性反転スイッチ13、液晶を駆動する第2のインバータ回路14が設けられ、さらにデータ線の終端にはデータ線電位をCOM電位の反転信号と短絡する残像対策スイッチ15を設けている。
そして、画素への書込み・保持などの駆動動作は、制御信号Gate,GateB,PolA,PolBによって行う。
このような構成によって、各実施の形態の液晶表示装置は、種々の効果を奏することができる。
Claims (7)
- 基板上にマトリクス状に配置された液晶画素と、
列毎に設けられ、各列のそれぞれの液晶画素と接続して当該液晶画素に映像信号に対応する2値信号を供給する信号線と、
行毎に設けられ、各行のそれぞれの液晶画素と接続し、行単位に液晶画素を選択して前記映像信号に対応する2値信号を書き込み・保持させる複数の制御信号を供給する制御線とを有し、
前記液晶画素は、
前記映像信号に対応する2値信号を取り込むスイッチ素子と、
前記取り込んだ2値信号を保持するスタティックメモリと、
保持された2値信号の極性を制御する極性制御部と、
極性が制御された2値信号から液晶に印加する電圧を生成する印加電圧生成部と、
印加された電圧に対応して透過率を変更する液晶と
を備えたことを特徴とする液晶表示装置。 - 前記制御線は、第1のゲート信号と、当該第1のゲート信号と極性の異なる第2のゲート信号を供給し、
前記スイッチ素子は、前記第1のゲート信号に対応して、前記信号線から前記スタティックメモリへの前記2値信号の供給を断続し、
前記スタティックメモリは、
前記取り込んだ2値信号を反転する第1のインバータと、
前記反転した2値信号を入力するクロックドインバータと、
前記第1のインバータの入力部と、前記クロックドインバータの出力部とを接続する接続線とを有し、
前記クロックドインバータは、前記第1及び第2のゲート信号によって駆動されること
を特徴とする請求項1に記載の液晶表示装置。 - 前記制御線は、第1の極性制御信号と、当該第1の極性制御信号と極性の異なる第2の極性制御信号を更に供給し、
前記極性制御部は、前記第1及び第2の極性制御信号に対応して、前記第1のインバータの出力信号と、前記クロックドインバータの出力信号とのいずれかの出力信号を選択し、選択した出力信号の極性を反転すること
を特徴とする請求項2に記載の液晶表示装置。 - 前記制御線は、第1の極性制御信号と、当該第1の極性制御信号と極性の異なる第2の極性制御信号を供給し、
前記第1及び第2の極性制御信号の極性をフレーム毎に交互に切り替えて、前記液晶に印加する電圧を交流化するコントローラを備えたことを特徴とする請求項1に記載の液晶表示装置。 - 前記液晶画素に供給するコモン電圧を反転するインバータと、反転したコモン電圧の前記信号線への供給を断続する残像対策スイッチとを更に備えたことを特徴とする請求項1に記載の液晶表示装置。
- 前記液晶表示装置の立ち上げ、立ち下げ、突発電源断の際、前記残像対策スイッチを制御して前記信号線に前記反転したコモン電圧を供給し、前記スイッチ素子、スタティックメモリ、極性制御部、印加電圧生成部を駆動して前記液晶にコモン電圧を印加するコントローラを更に備えたことを特徴とする請求項5に記載の液晶表示装置。
- 基板上にマトリクス状に配置された液晶画素と、
列毎に設けられ、各列のそれぞれの液晶画素と接続して当該液晶画素に映像信号に対応する2値信号を供給する信号線と、
行毎に設けられ、各行のそれぞれの液晶画素と接続し、行単位に液晶画素を選択して前記映像信号に対応する2値信号を書き込み・保持させる複数の制御信号を供給する制御線とを有し、
前記液晶画素は、
前記映像信号に対応する2値信号を取り込むスイッチ素子と、
前記取り込んだ2値信号を保持するスタティックメモリと、
保持された2値信号の極性を制御して液晶に印加する電圧を生成する極性制御部と、
印加された電圧に対応して透過率を変更する液晶と
を備え、
前記スイッチ素子および極性制御部はトランジスタで構成されるとともに、当該トランジスタの閾値電圧の影響を回避するようになされていることを特徴とする液晶表示装置。
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