JP2010021639A - フィルタ - Google Patents
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Abstract
【解決手段】誘電体基板と、前記誘電体基板の第1の側を覆って連続的に形成された電極層22と、前記誘電体基板の第2の側に、前記電極層とともに前記誘電体基板を挟持するように設けられた設けられたディスク状の電極パターンと、前記電極層22のうち、前記ディスク状の電極パターンとともに前記誘電体基板を挟持する円形領域に、前記円形領域の中心に対して非対称に形成され前記誘電体基板を露出する開口部よりなるグランドスロット22Bと、前記電極層22に、前記円形領域に到達するように形成され、第1の方向に延在する入力側カットアウト部と、前記第1の方向に直交する第2の方向に延在する出力側カットアウト部と、前記入力側カットアウト部に形成された入力側導体パターンと、前記出力側カットアウト部に形成された出力側導体パターンと、を含む。
【選択図】図2B
Description
図2A〜図2Cは、第1の実施形態による超伝導デュアルモード共振器20の構成を示す、それぞれ平面図、底面図、および図2B中、線A−A’に沿った断面図である。
kslot=(f2 2−f1 2)/(f2 2+f1 2) (f2>f1)
により求めている。
図5は、前記デュアルモード共振器20を使った第2の実施形態による超伝導フィルタ30を示す。
図7は、第3の実施形態による超伝導フィルタ40を示す。
図11A〜図11Cは、第4の実施形態による共振器50の構成を示す、それぞれ平面図、底面図、および図11B中、線B−B’に沿った断面図である。
kdd=(f2 2−f1 2)/(f2 2+f1 2) (f2>f1)
により求めている。
図14は、第5の実施形態による超伝導フィルタ60を示す。
図19A〜図19Cは、第6の実施形態による共振器70を示す、それぞれ平面図、底面図、および図19B中、線D−D’に沿った断面図である。
図21は、第7の実施形態による超伝導フィルタ80を示す。
図23は、前記第1〜第7の実施形態のいずれかによる超伝導フィルタを使ったGHz帯域の送受信機90の概略的構成を示す。
(付記1)
誘電体基板と、
前記誘電体基板の第1の側を覆って連続的に形成された電極層と、
前記誘電体基板の第2の側に、前記電極層とともに前記誘電体基板を挟持するように設けられたディスク状の電極パターンと、
前記電極層のうち、前記ディスク状の電極パターンとともに前記誘電体基板を挟持する円形の領域に、前記円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する開口部よりなるグランドスロットと、
前記誘電体基板の前記第1の側において前記電極層に、前記円形の領域に到達するように形成され、第1の方向に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記電極層に、前記円形の領域に到達するように形成され、前記第1の方向に直交する第2の方向に延在する出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成された入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成された出力側導体パターンと、
を含むフィルタ。
(付記2)
前記入力側導体パターンは、前記入力側カットアウト部の形状に整合した形状を有し、前記出力側導体パターンは、前記出力側カットアウト部の形状に整合した形状を有する付記1記載のフィルタ。
(付記3)
前記入力側カットアウト部と前記入力側導体パターンは、第1のコプレーナ型フィーダラインを形成し、前記出力側カットアウト部と前記出力側導体パターンは、第2のコプレーナ型フィーダラインを形成する、付記2記載のフィルタ。
(付記4)
前記グランドスロットは、円形の開口部である付記1〜3のうち、いずれか一項記載のフィルタ。
(付記5)
前記誘電体基板の前記第1の側に、前記グランドスロットに対向して磁性体または誘電体よりなる調整ロッドをさらに備えた付記1〜4のうち、いずれか一項記載のフィルタ。
(付記6)
前記調整ロッドは、前記グランドスロットに対して近接・離間自在に保持される付記5記載のフィルタ。
(付記7)
前記電極層、前記電極パターン、前記入力側導体パターンおよび前記出力側導体パターンは、超伝導体よりなる付記1〜6のうち、いずれか一項記載のフィルタ。
(付記8)
第1の領域および第2の領域を含む誘電体基板と、
前記誘電体基板の第1の側において、前記第1の領域に形成された第1の電極パターンと、
前記誘電体基板の前記第1の側において、前記第2の領域に形成された第2の電極パターンと、
前記誘電体基板の前記第1の側に、前記第1の電極パターンと前記第2の電極パターンとを接続して延在する接続電極パターンと、
前記誘電体基板の前記第1の側とは反対の第2の側に、前記第1の領域において前記第1の電極パターンとともに前記誘電体基板を挟持するように設けられたディスク状の第3の電極パターンと、
前記誘電体基板の第2の側に、前記第2の領域において前記第2の電極パターンともに前記誘電体基板を挟持するように設けられたディスク状の第4の電極パターンと、
前記誘電体基板の前記第1の側において前記第1の電極パターンに、前第1の領域にまで到達するように形成され、前記接続電極パターンの延在する方向に直交する方向に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記第2の電極パターンに、前記第2の領域にまで到達するように、前記入力側カットアウト部に対して平行に形成される出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成され前記第1の電極層とともに第1の信号伝送路を形成する入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成され前記第1の電極層とともに第2の信号伝送路を形成する出力側導体パターンと、
前記第1の電極パターンのうち、前記ディスク状の第3の電極パターンとともに前記誘電体基板を挟持する第1の円形の領域に、前記第1の円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する第1の開口部よりなる第1のグランドスロットと、
前記第1の電極パターンのうち、前記ディスク状の第4の電極パターンとともに前記誘電体基板を挟持する第2の円形の領域に、前記第2の円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する第2の開口部よりなる第2のグランドスロットと、
を含むフィルタ。
(付記9)
前記入力側カットアウト部と前記入力側導体パターンは、第1のコプレーナ型フィーダラインを形成し、前記出力側カットアウト部と前記出力側導体パターンは、第2のコプレーナ型フィーダラインを形成する、付記8記載のフィルタ。
(付記10)
さらに前記接続電極パターンに形成され前記誘電体基板を露出する第3の開口部よりなる第3のグランドスロットを含む付記8または9記載のフィルタ。
(付記11)
前記第1〜第3のグランドスロットの各々には、各々磁性体または誘電体よりなる第1〜第3の調整ロッドが、それぞれ近接・離間自在に設けられている付記10記載のフィルタ。
(付記12)
前記第1〜第4の電極パターン、前記接続電極パターン、前記入力側導体パターンおよび前記出力側導体パターンは、超伝導体よりなる付記8〜11のうち、いずれか一項記載のフィルタ。
(付記13)
第1の領域および第2の領域を含む誘電体基板と、
前記誘電体基板の第1の側において、前記第1の領域に形成された第1の電極パターンと、
前記誘電体基板の前記第1の側において、前記第2の領域に形成された第2の電極パターンと、
前記誘電体基板の前記第1の側に、前記第1の電極パターンと前記第2の電極パターンとを接続して延在する接続電極パターンと、
前記誘電体基板の前記第1の側とは反対の第2の側に、前記第1の領域において前記第1の電極パターンとともに前記誘電体基板を挟持するように設けられたディスク状の第3の電極パターンと、
前記誘電体基板の第2の側に、前記第2の領域において前記第2の電極パターンともに前記誘電体基板を挟持するように設けられたディスク状の第4の電極パターンと、
前記誘電体基板の前記第1の側において前記第1の電極パターンに、前第1の領域にまで到達するように形成され、前記接続電極パターンの延在する方向に平行に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記第2の電極パターンに、前記第2の領域にまで到達するように、前記入力側カットアウト部に対して平行に形成される出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成され前記第1の電極層とともに第1の信号伝送路を形成する入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成され前記第1の電極層とともに第2の信号伝送路を形成する出力側導体パターンと、
を含むフィルタ。
(付記14)
前記入力側カットアウト部と前記入力側導体パターンは、第1のコプレーナ型フィーダラインを形成し、前記出力側カットアウト部と前記出力側導体パターンは、第2のコプレーナ型フィーダラインを形成する、付記13記載のフィルタ。
(付記15)
前記接続電極パターンのうち、前記第3の電極パターンの中心と前記第4の電極パターンの中心を結ぶ仮想的な線分の中央に対応して、前記グランドスロットに対向して近接・離間自在に、磁性体または誘電体よりなる調整ロッドをさらに備えた付記13または14記載のフィルタ。
(付記16)
前記第1〜第4の電極パターン、前記接続電極パターン、前記入力側導体パターンおよび前記出力側導体パターンは、超伝導体よりなる付記13〜15のうち、いずれか一項記載のフィルタ。
11 誘電体基板
12 電極層
13A〜13D ディスク状電極パターン
14A〜14E フィーダライン
15 誘電体板
15A 開口部
20 超伝導共振器
21 誘電体基板
22 電極層
22a,52a,52b,72a,72b 円形領域
22B グランドスロット
22a,22c 入力側フィーダライン
22b,22d 出力側フィーダライン
23 ディスク状電極パターン
30,40,60,80 超伝導フィルタ
31,41,61,81 パッケージ容器
31B,41B,61B,81A,81B,81C 開口部
31L,41L,61L,81L 蓋
32,42,62 誘電体板
32A,32B,42A,42B,62A,62B、82A,82B ロッド
50,70 超伝導共振器
51A,51B,71A,71B 共振器領域
51C,71C 中間領域
51a,51b カットアウト
52A,52B 電極パターン
52C 接続電極
52c,52e,72c,72d 入力側フィーダライン
52d,52f,72d,72f 出力側フィーダライン
41C,61C,81D,81E,81F ロッド
72AG,72BG グランドスロット
90 送受信機
91 信号処理部
92A 変調器
92B 復調器
93A アップコンバータ
93B ダウンコンバータ
94A 電力増幅器
94B 低雑音増幅器
95A 超伝導フィルタ
95B フィルタ
96 アンテナ
97 クライオスタット
Claims (8)
- 誘電体基板と、
前記誘電体基板の第1の側を覆って連続的に形成された電極層と、
前記誘電体基板の第2の側に、前記電極層とともに前記誘電体基板を挟持するように設けられたディスク状の電極パターンと、
前記電極層のうち、前記ディスク状の電極パターンとともに前記誘電体基板を挟持する円形の領域に、前記円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する開口部よりなるグランドスロットと、
前記誘電体基板の前記第1の側において前記電極層に、前記円形の領域に到達するように形成され、第1の方向に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記電極層に、前記円形の領域に到達するように形成され、前記第1の方向に直交する第2の方向に延在する出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成された入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成された出力側導体パターンと、
を含むフィルタ。 - 前記入力側カットアウト部と前記入力側導体パターンは、第1のコプレーナ型フィーダラインを形成し、前記出力側カットアウト部と前記出力側導体パターンは、第2のコプレーナ型フィーダラインを形成する、請求項1記載のフィルタ。
- 前記グランドスロットは、円形の開口部である請求項1または2記載のフィルタ。
- 前記誘電体基板の前記第1の側に、前記グランドスロットに対向して磁性体または誘電体よりなる調整ロッドをさらに備えた請求項1〜3のうち、いずれか一項記載のフィルタ。
- 前記調整ロッドは、前記グランドスロットに対して近接・離間自在に保持される請求項3記載のフィルタ。
- 前記電極層、前記電極パターン、前記入力側導体パターンおよび前記出力側導体パターンは、超伝導体よりなる請求項1〜5のうち、いずれか一項記載のフィルタ。
- 第1の領域および第2の領域を含む誘電体基板と、
前記誘電体基板の第1の側において、前記第1の領域に形成された第1の電極パターンと、
前記誘電体基板の前記第1の側において、前記第2の領域に形成された第2の電極パターンと、
前記誘電体基板の前記第1の側に、前記第1の電極パターンと前記第2の電極パターンとを接続して延在する接続電極パターンと、
前記誘電体基板の前記第1の側とは反対の第2の側に、前記第1の領域において前記第1の電極パターンとともに前記誘電体基板を挟持するように設けられたディスク状の第3の電極パターンと、
前記誘電体基板の第2の側に、前記第2の領域において前記第2の電極パターンともに前記誘電体基板を挟持するように設けられたディスク状の第4の電極パターンと、
前記誘電体基板の前記第1の側において前記第1の電極パターンに、前第1の領域にまで到達するように形成され、前記接続電極パターンの延在する方向に直交する方向に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記第2の電極パターンに、前記第2の領域にまで到達するように、前記入力側カットアウト部に対して平行に形成される出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成され前記第1の電極層とともに第1の信号伝送路を形成する入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成され前記第1の電極層とともに第2の信号伝送路を形成する出力側導体パターンと、
前記第1の電極パターンのうち、前記ディスク状の第3の電極パターンとともに前記誘電体基板を挟持する第1の円形の領域に、前記第1の円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する第1の開口部よりなる第1のグランドスロットと、
前記第1の電極パターンのうち、前記ディスク状の第4の電極パターンとともに前記誘電体基板を挟持する第2の円形の領域に、前記第2の円形の領域の中心に対して非対称に形成され前記誘電体基板を露出する第2の開口部よりなる第2のグランドスロットと、
を含むフィルタ。 - 第1の領域および第2の領域を含む誘電体基板と、
前記誘電体基板の第1の側において、前記第1の領域に形成された第1の電極パターンと、
前記誘電体基板の前記第1の側において、前記第2の領域に形成された第2の電極パターンと、
前記誘電体基板の前記第1の側に、前記第1の電極パターンと前記第2の電極パターンとを接続して延在する接続電極パターンと、
前記誘電体基板の前記第1の側とは反対の第2の側に、前記第1の領域において前記第1の電極パターンとともに前記誘電体基板を挟持するように設けられたディスク状の第3の電極パターンと、
前記誘電体基板の第2の側に、前記第2の領域において前記第2の電極パターンともに前記誘電体基板を挟持するように設けられたディスク状の第4の電極パターンと、
前記誘電体基板の前記第1の側において前記第1の電極パターンに、前第1の領域にまで到達するように形成され、前記接続電極パターンの延在する方向に平行に延在する入力側カットアウト部と、
前記誘電体基板の前記第1の側において前記第2の電極パターンに、前記第2の領域にまで到達するように、前記入力側カットアウト部に対して平行に形成される出力側カットアウト部と、
前記誘電体基板の前記第1の側において、前記入力側カットアウト部に形成され前記第1の電極層とともに第1の信号伝送路を形成する入力側導体パターンと、
前記誘電体基板の前記第1の側において、前記出力側カットアウト部に形成され前記第1の電極層とともに第2の信号伝送路を形成する出力側導体パターンと、
を含むフィルタ。
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