JP2007535006A - システムメモリへのgpuのレンダリング - Google Patents
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Abstract
【選択図】図2
Description
Claims (21)
- データのレンダリングに応じてレンダリング済み画像の画像データを作成するように構成されているレンダリングユニットと、
データバスを介してコンピュータシステムのシステムメモリ装置に接続されるように構成されているデータバスインターフェイスと
を備えるグラフィックス処理サブシステムであって、
前記グラフィックス処理サブシステムに関連付けられているグラフィックスメモリへの第1のデータの書き込み操作に応じて、前記グラフィックス処理サブシステムが、前記第1のデータの前記書き込み操作を完了させるのに必要な第2のデータを取り出し、前記システムメモリ内の前記第1のデータの宛先を前記第2のデータから決定し、前記第1のデータの前記書き込み操作を前記システムメモリ内の前記第1のデータの前記宛先に向け直すように構成されている
グラフィックス処理サブシステム。 - 前記システムメモリ内の前記第1のデータの前記宛先が、前記グラフィックス処理サブシステムに関連付けられている前記グラフィックスメモリとして指定される前記システムメモリの一部内にある、請求項1に記載のグラフィックス処理サブシステム。
- 前記データバスの第1の仮想チャネルから前記データバスインターフェイスを介して前記第1のデータの前記書き込み操作を受信し、前記データバスの第2の仮想チャネルを使用して、前記データバスインターフェイスを介してシステムメモリから前記第2のデータを取り出すようにさらに構成されている、請求項1に記載のグラフィックス処理サブシステム。
- 前記グラフィックス処理サブシステムに接続されているローカルメモリから前記第2のデータを取り出すようにさらに構成されている、請求項1に記載のグラフィックス処理サブシステム。
- 前記第2のデータが、アドレス変換情報を含み、前記グラフィックス処理サブシステムが、前記グラフィックスメモリに関連付けられている仮想アドレスをシステムメモリ内の対応する宛先に変換するように構成されている、請求項1に記載のグラフィックス処理サブシステム。
- 前記第2のデータが、コンテキスト状態情報を含み、前記グラフィックス処理サブシステムが、前記第1のデータに応じてコンテキスト切替を行うように構成されている、請求項1に記載のグラフィックス処理サブシステム。
- 画像のある位置に対応する仮想メモリアドレスを、システムメモリ内の画像データのタイル構成内のメモリアドレスに変換するように構成されているタイルアドレス変換ユニット
をさらに備える、請求項1に記載のグラフィックス処理サブシステム。 - 前記タイルアドレス変換ユニットが、画像の連続部分に対応するある範囲の仮想メモリアドレスに応じて、前記データバス上で前記データバスインターフェイスを介して複数のシステムメモリアクセスを開始するようにさらに構成されている、請求項7に記載のグラフィックス処理サブシステム。
- 前記複数のシステムメモリアクセスが、システムメモリの非連続部分に対するものである、請求項8に記載のグラフィックス処理サブシステム。
- 前記データバスインターフェイスが、前記システムメモリに関連付けられているメモリコントローラが前記第1のデータパケットタイプとの互換性があることを示す指示に応じて、第1のデータパケットタイプのデータパケットを使用して、前記データバスを介して第3のデータを前記システムメモリに伝え、前記メモリコントローラが前記第1のデータパケットタイプと互換性がないことを示す指示に応じて、第2のデータパケットタイプの複数のデータパケットを使用して、前記データバスを介して前記第3のデータを前記システムメモリに伝えるように構成されている、請求項1に記載のグラフィックス処理サブシステム。
- 前記第1のデータパケットタイプが拡張バイトイネーブルデータを含む、請求項10に記載のグラフィックス処理サブシステム。
- レンダリング済み画像に対応する表示信号を表示装置に伝えるように構成されている表示装置コントローラをさらに含む、請求項1に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記グラフィックス処理サブシステムに接続されているローカルメモリから前記レンダリング済み画像に対応する画像データを取り出すように構成されている、請求項12に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記システムメモリから前記レンダリング済み画像に対応する画像データを取り出すように構成されている、請求項12に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記システムメモリ内の画像データのタイル構成から前記レンダリング済み画像の第1の行に対応する第1の画像データを取り出し、前記第1の画像データを前記表示装置に伝えるように構成されている、請求項14に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記レンダリング済み画像の前記第1の行を含む前記レンダリング済み画像の1組のタイルに対応する1組の画像データを前記システムメモリから取り出すように構成されている、請求項15に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、画像データの前記第1の行を含まない、前記1組の画像データの一部分を破棄するように構成されている、請求項16に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記1組のタイルに含まれ、前記レンダリング済み画像の少なくとも1つの追加行に対応する第2の画像データを格納するように構成されている画像データキャッシュを含み、
前記表示装置コントローラが、前記第1の画像データを取り出した後、前記画像データキャッシュから前記第2の画像データを取り出し、前記第2の画像データを前記表示装置に伝えるように構成されている
請求項16に記載のグラフィックス処理サブシステム。 - システムメモリ内の画像データのタイル構成からレンダリング済み画像の第1の行に対応する第1の画像データを取り出し、前記第1の画像データを表示装置に伝えるように構成されている表示装置コントローラを備える、グラフィックス処理サブシステム。
- 前記表示装置コントローラが、画像データの前記第1の行を含まない、前記1組の画像データの一部分を破棄するように構成されている、請求項19に記載のグラフィックス処理サブシステム。
- 前記表示装置コントローラが、前記1組のタイルに含まれ、前記レンダリング済み画像の少なくとも1つの追加行に対応する第2の画像データを格納するように構成されている画像データキャッシュを含み、
前記表示装置コントローラが、前記第1の画像データを取り出した後、前記画像データキャッシュから前記第2の画像データを取り出し、前記第2の画像データを前記表示装置に伝えるように構成されている、請求項19に記載のグラフィックス処理サブシステム。
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---|---|
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---|---|---|---|
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Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010140480A (ja) * | 2008-12-12 | 2010-06-24 | Nvidia Corp | Cpuトラフィックを特殊とマークすることによるデッドロックの回避 |
JP2012238158A (ja) * | 2011-05-11 | 2012-12-06 | Canon Inc | データ転送装置及びデータ転送方法 |
JP2013534680A (ja) * | 2010-07-15 | 2013-09-05 | アドバンスト・マイクロ・ディバイシズ・インコーポレイテッド | Pciエクスプレス適合デバイスの資源にアクセスするためのシステム及び方法 |
JP2015176569A (ja) * | 2014-03-18 | 2015-10-05 | 日本電気株式会社 | 情報処理装置、描画方法、及びプログラム |
Families Citing this family (42)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8497865B2 (en) | 2006-12-31 | 2013-07-30 | Lucid Information Technology, Ltd. | Parallel graphics system employing multiple graphics processing pipelines with multiple graphics processing units (GPUS) and supporting an object division mode of parallel graphics processing using programmable pixel or vertex processing resources provided with the GPUS |
EP1687732A4 (en) | 2003-11-19 | 2008-11-19 | Lucid Information Technology Ltd | METHOD AND SYSTEM FOR A MULTIPLEXED 3D GRAPHIC PIPELINE VIA A PC BUS |
US8085273B2 (en) | 2003-11-19 | 2011-12-27 | Lucid Information Technology, Ltd | Multi-mode parallel graphics rendering system employing real-time automatic scene profiling and mode control |
US20090027383A1 (en) | 2003-11-19 | 2009-01-29 | Lucid Information Technology, Ltd. | Computing system parallelizing the operation of multiple graphics processing pipelines (GPPLs) and supporting depth-less based image recomposition |
US7961194B2 (en) | 2003-11-19 | 2011-06-14 | Lucid Information Technology, Ltd. | Method of controlling in real time the switching of modes of parallel operation of a multi-mode parallel graphics processing subsystem embodied within a host computing system |
US20080079737A1 (en) | 2003-11-19 | 2008-04-03 | Reuven Bakalash | Multi-mode parallel graphics rendering and display system supporting real-time detection of mode control commands (MCCS) programmed within pre-profiled scenes of the graphics-based application |
JP4244028B2 (ja) * | 2004-09-22 | 2009-03-25 | 株式会社ソニー・コンピュータエンタテインメント | グラフィックプロセッサ、制御用プロセッサおよび情報処理装置 |
EP1681656A1 (en) * | 2005-01-18 | 2006-07-19 | Oculus Info Inc. | System and method for processing map data |
EP1846834A2 (en) | 2005-01-25 | 2007-10-24 | Lucid Information Technology, Ltd. | Graphics processing and display system employing multiple graphics cores on a silicon chip of monolithic construction |
US20080143731A1 (en) * | 2005-05-24 | 2008-06-19 | Jeffrey Cheng | Video rendering across a high speed peripheral interconnect bus |
US7730336B2 (en) * | 2006-05-30 | 2010-06-01 | Ati Technologies Ulc | Device having multiple graphics subsystems and reduced power consumption mode, software and methods |
US7444583B2 (en) * | 2005-05-27 | 2008-10-28 | Microsoft Corporation | Standard graphics specification and data binding |
US7619628B2 (en) * | 2005-06-24 | 2009-11-17 | Microsoft Corporation | Caching digital image data |
US7554550B2 (en) * | 2005-06-24 | 2009-06-30 | Microsoft Corporation | Non-destructive processing of digital image data |
US7535433B2 (en) * | 2006-05-18 | 2009-05-19 | Nvidia Corporation | Dynamic multiple display configuration |
US8555099B2 (en) * | 2006-05-30 | 2013-10-08 | Ati Technologies Ulc | Device having multiple graphics subsystems and reduced power consumption mode, software and methods |
US7986327B1 (en) * | 2006-10-23 | 2011-07-26 | Nvidia Corporation | Systems for efficient retrieval from tiled memory surface to linear memory display |
US7805587B1 (en) | 2006-11-01 | 2010-09-28 | Nvidia Corporation | Memory addressing controlled by PTE fields |
TWI328198B (en) * | 2006-12-11 | 2010-08-01 | Via Tech Inc | Gpu context switching system |
TWI372352B (en) | 2008-01-04 | 2012-09-11 | Asustek Comp Inc | Method for assisting in calculation of data using display card |
US8245011B2 (en) * | 2008-02-08 | 2012-08-14 | Texas Instruments Incorporated | Method and system for geometry-based virtual memory management in a tiled virtual memory |
US8849190B2 (en) | 2009-04-21 | 2014-09-30 | Andrew Llc | Radio communication systems with integrated location-based measurements for diagnostics and performance optimization |
US9793982B2 (en) | 2009-04-21 | 2017-10-17 | Commscope Technologies Llc | System for automatic configuration of a mobile communication system |
US9189242B2 (en) * | 2009-09-24 | 2015-11-17 | Nvidia Corporation | Credit-based streaming multiprocessor warp scheduling |
US8669990B2 (en) | 2009-12-31 | 2014-03-11 | Intel Corporation | Sharing resources between a CPU and GPU |
US8537169B1 (en) | 2010-03-01 | 2013-09-17 | Nvidia Corporation | GPU virtual memory model for OpenGL |
CN101976183B (zh) * | 2010-09-27 | 2012-02-22 | 广东威创视讯科技股份有限公司 | 一种多窗口图像同时更新时图像更新的方法及装置 |
US8683135B2 (en) * | 2010-10-31 | 2014-03-25 | Apple Inc. | Prefetch instruction that ignores a cache hit |
CN102096897B (zh) * | 2011-03-17 | 2012-05-02 | 长沙景嘉微电子有限公司 | 基于分块渲染的gpu中块存储策略的实现 |
CN102270095A (zh) * | 2011-06-30 | 2011-12-07 | 威盛电子股份有限公司 | 多重显示器控制方法及其系统 |
US8830246B2 (en) * | 2011-11-30 | 2014-09-09 | Qualcomm Incorporated | Switching between direct rendering and binning in graphics processing |
US9305324B2 (en) * | 2012-12-21 | 2016-04-05 | Nvidia Corporation | System, method, and computer program product for tiled deferred shading |
US9495721B2 (en) * | 2012-12-21 | 2016-11-15 | Nvidia Corporation | Efficient super-sampling with per-pixel shader threads |
EP2775695B1 (en) * | 2013-03-07 | 2016-08-17 | ABB Schweiz AG | Mobile device with context specific transformation of data items to data images |
EP3014456A4 (en) * | 2013-06-24 | 2017-01-18 | Intel Corporation | Page management approach to fully utilize hardware caches for tiled rendering |
US8719374B1 (en) | 2013-09-19 | 2014-05-06 | Farelogix, Inc. | Accessing large data stores over a communications network |
GB2521151B (en) | 2013-12-10 | 2021-06-02 | Advanced Risc Mach Ltd | Configurable thread ordering for a data processing apparatus |
GB2521155B (en) * | 2013-12-10 | 2021-06-02 | Advanced Risc Mach Ltd | Configuring thread scheduling on a multi-threaded data processing apparatus |
CN105427236A (zh) * | 2015-12-18 | 2016-03-23 | 魅族科技(中国)有限公司 | 一种图像渲染方法及装置 |
CN105678680A (zh) * | 2015-12-30 | 2016-06-15 | 魅族科技(中国)有限公司 | 一种图像处理的方法和装置 |
US10282808B2 (en) * | 2016-05-27 | 2019-05-07 | Intel Corporation | Hierarchical lossless compression and null data support |
US10417733B2 (en) * | 2017-05-24 | 2019-09-17 | Samsung Electronics Co., Ltd. | System and method for machine learning with NVMe-of ethernet SSD chassis with embedded GPU in SSD form factor |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09212654A (ja) * | 1996-02-06 | 1997-08-15 | Sony Computer Entertainment:Kk | 描画装置及び描画方法 |
US6665788B1 (en) * | 2001-07-13 | 2003-12-16 | Advanced Micro Devices, Inc. | Reducing latency for a relocation cache lookup and address mapping in a distributed memory system |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6104417A (en) * | 1996-09-13 | 2000-08-15 | Silicon Graphics, Inc. | Unified memory computer architecture with dynamic graphics memory allocation |
US5907330A (en) * | 1996-12-18 | 1999-05-25 | Intel Corporation | Reducing power consumption and bus bandwidth requirements in cellular phones and PDAS by using a compressed display cache |
US6195734B1 (en) * | 1997-07-02 | 2001-02-27 | Micron Technology, Inc. | System for implementing a graphic address remapping table as a virtual register file in system memory |
US6075546A (en) * | 1997-11-10 | 2000-06-13 | Silicon Grahphics, Inc. | Packetized command interface to graphics processor |
US6275243B1 (en) * | 1998-04-08 | 2001-08-14 | Nvidia Corporation | Method and apparatus for accelerating the transfer of graphical images |
US7130958B2 (en) * | 2003-12-02 | 2006-10-31 | Super Talent Electronics, Inc. | Serial interface to flash-memory chip using PCI-express-like packets and packed data for partial-page writes |
WO2002015470A2 (en) * | 2000-08-17 | 2002-02-21 | Advanced Micro Devices, Inc. | System and method for separate virtual channels for posted requests in a multiprocessor system |
US20020083254A1 (en) * | 2000-12-22 | 2002-06-27 | Hummel Mark D. | System and method of implementing interrupts in a computer processing system having a communication fabric comprising a plurality of point-to-point links |
US6847370B2 (en) * | 2001-02-20 | 2005-01-25 | 3D Labs, Inc., Ltd. | Planar byte memory organization with linear access |
US7009618B1 (en) * | 2001-07-13 | 2006-03-07 | Advanced Micro Devices, Inc. | Integrated I/O Remapping mechanism |
US7376695B2 (en) * | 2002-03-14 | 2008-05-20 | Citrix Systems, Inc. | Method and system for generating a graphical display for a remote terminal session |
-
2004
- 2004-04-27 US US10/833,694 patent/US20050237329A1/en not_active Abandoned
-
2005
- 2005-04-26 DE DE602005018623T patent/DE602005018623D1/de active Active
- 2005-04-26 EP EP05739859A patent/EP1741089B1/en active Active
- 2005-04-26 WO PCT/US2005/014368 patent/WO2005104740A2/en not_active Application Discontinuation
- 2005-04-26 CA CA002564601A patent/CA2564601A1/en not_active Abandoned
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09212654A (ja) * | 1996-02-06 | 1997-08-15 | Sony Computer Entertainment:Kk | 描画装置及び描画方法 |
US6665788B1 (en) * | 2001-07-13 | 2003-12-16 | Advanced Micro Devices, Inc. | Reducing latency for a relocation cache lookup and address mapping in a distributed memory system |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010140480A (ja) * | 2008-12-12 | 2010-06-24 | Nvidia Corp | Cpuトラフィックを特殊とマークすることによるデッドロックの回避 |
US8392667B2 (en) | 2008-12-12 | 2013-03-05 | Nvidia Corporation | Deadlock avoidance by marking CPU traffic as special |
JP2013534680A (ja) * | 2010-07-15 | 2013-09-05 | アドバンスト・マイクロ・ディバイシズ・インコーポレイテッド | Pciエクスプレス適合デバイスの資源にアクセスするためのシステム及び方法 |
JP2012238158A (ja) * | 2011-05-11 | 2012-12-06 | Canon Inc | データ転送装置及びデータ転送方法 |
JP2015176569A (ja) * | 2014-03-18 | 2015-10-05 | 日本電気株式会社 | 情報処理装置、描画方法、及びプログラム |
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